JPS63112034U - - Google Patents
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- Publication number
- JPS63112034U JPS63112034U JP19707587U JP19707587U JPS63112034U JP S63112034 U JPS63112034 U JP S63112034U JP 19707587 U JP19707587 U JP 19707587U JP 19707587 U JP19707587 U JP 19707587U JP S63112034 U JPS63112034 U JP S63112034U
- Authority
- JP
- Japan
- Prior art keywords
- address
- bits
- character
- stored
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000000872 buffer Substances 0.000 claims description 10
- 238000000034 method Methods 0.000 claims description 2
- 239000011159 matrix material Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Dot-Matrix Printers And Others (AREA)
Description
第1図はワイヤドツトプリンタの平面図、第2
図は印字ヘツドの斜視図、第3図は従来の印字制
御回路のブロツク図、第4図はドツトによる印字
過程を示す図、第5図のイは従来のCGのメモリ
マツプ、ロは本考案によるCGのメモリマツプ、
第6図は本考案による印字制御回路の実施例を示
すブロツク図、第7図は印字タイミングとイメー
ジバツフアへの読み込みのタイミングを示すタイ
ムチヤートである。 図において、5は印字ヘツド、W1…W9は印
字ワイヤ、19はラインバツフア、20,20′
はCG、21は印字ヘツド駆動回路、23はテー
ブル、24,25はイメージバツフア、26はマ
ルチプレクサである。
図は印字ヘツドの斜視図、第3図は従来の印字制
御回路のブロツク図、第4図はドツトによる印字
過程を示す図、第5図のイは従来のCGのメモリ
マツプ、ロは本考案によるCGのメモリマツプ、
第6図は本考案による印字制御回路の実施例を示
すブロツク図、第7図は印字タイミングとイメー
ジバツフアへの読み込みのタイミングを示すタイ
ムチヤートである。 図において、5は印字ヘツド、W1…W9は印
字ワイヤ、19はラインバツフア、20,20′
はCG、21は印字ヘツド駆動回路、23はテー
ブル、24,25はイメージバツフア、26はマ
ルチプレクサである。
Claims (1)
- 【実用新案登録請求の範囲】 マトリクス状に配列されたドツトの組合せによ
り文字等を構成すると共に、ラインバツフアに蓄
えられた1行分の文字コードを1桁分ずつ読み出
してキヤラクタジエネレータの対応するアドレス
の文字パターン情報を読み出し印字ヘツドを駆動
して印字するシリアル式のドツトプリンタにおい
て、 該キヤラクタジエネレータを、1アドレスに付
きNビツト情報格納可能なメモリで構成するとと
もに、上記印字ヘツドの1印字タイミングで駆動
されるドツド数Mは上記Nより大きく、1印字タ
イミングで必要とされるMビツトのうちNビツト
を所定のアドレスに格納し、且つ残りの(M―N
)ビツトを当該所定のアドレスとは異なる他のア
ドレスに格納し、該印字タイミングの次の印字タ
イミングで必要とされるMビツトのうちのNビツ
トは上記所定のアドレスの次のアドレスに格納す
るとともに、その残りの(M―N)ビツトを上記
他のアドレスにおいて既に格納されているビツト
位置の次のビツト位置へ格納するようにして1文
字分の文字パターン情報を記憶する構成としたこ
と、 印字ヘツドの駆動部と前記構成のキヤラクタジ
エネレータとの間に文字パターン情報を一時スト
アしておくイメージバツフアを複数備えると共に
、各イメージバツフアに1桁分ずつ、該1桁の文
字コードに対応するアドレスのNビツトと該アド
レスに開連する他のアドレスのNビツト中の該ア
ドレスに関連するビツト位置の(M―N)ビツト
を組み合わせる処理を行ないつつ順次文字パター
ン情報を書込む構成としたこと、 あるイメージバツフアに文字パターン情報の書
込みが行なわれている際に、既に文字パターン情
報の書込みが終了している他のイメージバツフア
を読み出して印字ヘツド駆動部へ出力し、且つイ
メージバツフアへの文字パターン情報の書込みを
、現在印字動作中の印字桁よりも先の印字桁の情
報について行なう構成としたこと、 を特徴とするドツトプリンタの印字制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19707587U JPS63112034U (ja) | 1987-12-25 | 1987-12-25 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19707587U JPS63112034U (ja) | 1987-12-25 | 1987-12-25 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63112034U true JPS63112034U (ja) | 1988-07-19 |
Family
ID=31156474
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19707587U Pending JPS63112034U (ja) | 1987-12-25 | 1987-12-25 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63112034U (ja) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55108084A (en) * | 1979-02-14 | 1980-08-19 | Tokyo Electric Co Ltd | Memory method for character pattern in dot printer |
JPS55124842A (en) * | 1979-03-19 | 1980-09-26 | Toshiba Corp | Printer |
-
1987
- 1987-12-25 JP JP19707587U patent/JPS63112034U/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55108084A (en) * | 1979-02-14 | 1980-08-19 | Tokyo Electric Co Ltd | Memory method for character pattern in dot printer |
JPS55124842A (en) * | 1979-03-19 | 1980-09-26 | Toshiba Corp | Printer |
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