JPS6241196U - - Google Patents

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JPS6241196U
JPS6241196U JP12492686U JP12492686U JPS6241196U JP S6241196 U JPS6241196 U JP S6241196U JP 12492686 U JP12492686 U JP 12492686U JP 12492686 U JP12492686 U JP 12492686U JP S6241196 U JPS6241196 U JP S6241196U
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JP
Japan
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attack
circuit
accumulator
envelope
output signal
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JP12492686U
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Description

【図面の簡単な説明】
第１図、第２図はそれぞれ本考案の実施例の構
成を示す概略説明図、第３図は第２図の要部であ
るエンベロープ発生回路の実施例説明図、第４図
、第５図は本考案の原理説明図、第６図は第３図
の実施例の詳細な回路例、第７図ａ〜ｇは第６図
の動作を示すタイムチヤート、第８図は第６図の
要部の詳細回路例であり、図中、１はキースイツ
チ、２はキーアサイナ、３はトーン発生回路、４
はエンベロープ発生回路、５は音響装置、６はセ
レクトスイツチ、７はリズムパターン発生器、８
は音源、１１は累算器、１３はアタツクデイケイ
係数メモリ、１４はエンベロープ波形テーブル、
１５，１６はＯＲ回路、１７はエンベロープ制御
回路、１９はタイミングクロツク発生回路、２０
はアドレスカウンタ、２１はチヤンネルデコーダ
、２２はＥＸ―ＯＲ回路、２３はＤ／Ａ変換器、
２４はアナログマルチプレクサ、２５はサンプル
ホールド回路、２６はゲートを示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. タイミングパルスを発生するタイミング発生回
    路、該タイミング発生回路で駆動されるアドレス
    カウンタ、該アドレスカウンタのアドレスパルス
    によつて、アタツク、デイケイ時間に関連する係
    数が読み出されるアタツクデイケイ係数記憶回路
    、前記タイミング発生回路のタイミングパルスと
    前記アドレスカウンタのアドレスパルスとに応じ
    前記係数を累算し、累算出力信号とアタツク、デ
    イケイの各終了信号を出力する累算器、外部から
    のアタツク信号と累算器からのアタツク、デイケ
    イの各終了信号とにより累算器の前記累算出力信
    号を制御するエンベロープ制御回路、該エンベロ
    ープ制御回路からの制御信号により累算器へ入力
    する係数を一時停止する累算停止手段、対数曲線
    をもつエンベロープ波形を記憶しておき前記累算
    出力信号により読み出すエンベロープ波形記憶回
    路、および該エンベロープ波形記憶回路の出力信
    号を前記累算器からのアタツク終了信号により反
    転させる手段を具えたことを特徴とする電子楽器
    。
JP12492686U 1986-08-14 1986-08-14 Pending JPS6241196U (ja)

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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS50131513A (ja) * 1974-04-04 1975-10-17
JPS5144919A (ja) * 1974-08-13 1976-04-16 Shii Jii Kon Ltd
JPS5246494A (en) * 1975-10-09 1977-04-13 Nobutaka Kato Cutting machine
JPS5381227A (en) * 1976-12-27 1978-07-18 Kawai Musical Instr Mfg Co Electronic musical instrument
JPS5383610A (en) * 1976-12-29 1978-07-24 Nippon Gakki Seizo Kk Wave generator for electronic musical instruments
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