JPS62250737A - 速度変換方式 - Google Patents
速度変換方式Info
- Publication number
- JPS62250737A JPS62250737A JP61095469A JP9546986A JPS62250737A JP S62250737 A JPS62250737 A JP S62250737A JP 61095469 A JP61095469 A JP 61095469A JP 9546986 A JP9546986 A JP 9546986A JP S62250737 A JPS62250737 A JP S62250737A
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- JP
- Japan
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- terminal
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- circuit
- signal
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- Granted
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 23
- 238000000034 method Methods 0.000 claims description 6
- 210000004899 c-terminal region Anatomy 0.000 abstract description 2
- 230000005540 biological transmission Effects 0.000 description 20
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 7
- 238000010586 diagram Methods 0.000 description 4
- 238000000926 separation method Methods 0.000 description 2
- 101100417882 Arabidopsis thaliana RRA2 gene Proteins 0.000 description 1
- 101100478296 Arabidopsis thaliana SR45A gene Proteins 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 101150058668 tra2 gene Proteins 0.000 description 1
Landscapes
- Time-Division Multiplex Systems (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデジタルデータ通信に関する。特に、ＣＣＩＴ
Ｔ（国際電信電話諮問委員会）勧告■４６１およびＩ４
６３に準拠した速度変換手段に関する。
Ｔ（国際電信電話諮問委員会）勧告■４６１およびＩ４
６３に準拠した速度変換手段に関する。
本発明は、多数の信号をフレームに多重化し、速度変換
して送信し、受信側では、この多重化された信号を分離
して出力する速度変換方式において、 ＣＣＩＴＴ勧告Ｉ４６１および同Ｉ４６３に規定するス
テータスビットにかかわる信号を切替えて、所定の入力
端子と出力端子とで授受させることにより、 同一のハードウェアを共通に使用することができるよう
にしたものである。
して送信し、受信側では、この多重化された信号を分離
して出力する速度変換方式において、 ＣＣＩＴＴ勧告Ｉ４６１および同Ｉ４６３に規定するス
テータスビットにかかわる信号を切替えて、所定の入力
端子と出力端子とで授受させることにより、 同一のハードウェアを共通に使用することができるよう
にしたものである。
Ｃ（ＩＩＴＴ勧告ｌ６４１およびＩ４６３は各々既存の
Ｘシリーズ端末およびＶシリーズ端末をｌ５ＤＮ（統合
サービスデジタル！ｉｌ）に収容するために新しく制定
された勧告であるが、この両勧告を同一ハードウェアで
実現する速度変換回路は開発されていない。
Ｘシリーズ端末およびＶシリーズ端末をｌ５ＤＮ（統合
サービスデジタル！ｉｌ）に収容するために新しく制定
された勧告であるが、この両勧告を同一ハードウェアで
実現する速度変換回路は開発されていない。
ＣＣＩＴＴ勧告！４６１ではステータスビットにＣ線の
状態をサンプリングして送信し、受信側ではステータス
ビットの値を１線上に出力する仕様になっており、勧告
１４６３ではステータスビットにＥＲ線およびＲＳ線の
状態をサンプリングしたものを多重して送信し、受信側
ではステータスビットの値をＤＲ線およびＣＤ線上に分
離して出力する仕様になっている。以上のことを除けば
、勧告Ｉ４６１および勧告Ｉ４６３準拠の速度変換回路
は基本的に同一回路で構成できる。したがって、勧告■
４６１およびＩ４６３専用の速度変換回路をそれぞれ別
個に用意することは経済的に問題がある。
状態をサンプリングして送信し、受信側ではステータス
ビットの値を１線上に出力する仕様になっており、勧告
１４６３ではステータスビットにＥＲ線およびＲＳ線の
状態をサンプリングしたものを多重して送信し、受信側
ではステータスビットの値をＤＲ線およびＣＤ線上に分
離して出力する仕様になっている。以上のことを除けば
、勧告Ｉ４６１および勧告Ｉ４６３準拠の速度変換回路
は基本的に同一回路で構成できる。したがって、勧告■
４６１およびＩ４６３専用の速度変換回路をそれぞれ別
個に用意することは経済的に問題がある。
本発明はこのような欠点を除去するもので、勧告Ｉ４６
１およびＩ４６３の再任様を同一ハードウェア構成で満
足する速度変換方式を提供することを目的とする。
１およびＩ４６３の再任様を同一ハードウェア構成で満
足する速度変換方式を提供することを目的とする。
本発明は、ステータス信号を生成する生成回路と、この
ステータス信号を他の信号に多重化する多重化手段とを
含む送信装置と、上記多重化手段を経由して到来する信
号から上記ステータス信号を分離する分離化手段と、こ
のステータス信号を一時保持する保持手段とを含む受信
装置とを備えた速度変換方式において、国際電信電話諮
問委員会勧告Ｉ４６１に規定するＣ線からＩ線へステー
タス信号を送出する第一動作モードと、開会勧告■４６
３に規定するＥＲ線およびＲＳ線からＤＲ線およびＣＤ
線へステータス信号を送出する第二動作モードのいずれ
か一方の動作モードを指示する信号の入力手段を備え、
上記送信装置は、上記Ｃ線またはＥＲ線の一方が接続さ
れた第一端子と、上記ＲＳ線が接続された第二端子と、
第一モードが設定されたときに、上記第一端子から入力
する信号に基づいて上記生成回路を有効にし、また第二
モードが設定されたときに、上記第一端子および上記第
二端子から入力する信号に基づいて上記生成回路を有効
にする第一切替回路とを備え、上記受信装置は、上記■
線または上記ＤＲ線のいずれか一方が接続された第三端
子と、上記ＣＤ線が接続され第四端子と、第一モードが
設定されたときに、上記保持回路からの出力に基づいて
上記第一端子からの出力を有効にし、第二モードが設定
されたときに、上記保持回路からの出力に基づいて上記
第一端子および上記第二端子からの出力を有効にする第
二切替手段とを備えたことを特徴とする。
ステータス信号を他の信号に多重化する多重化手段とを
含む送信装置と、上記多重化手段を経由して到来する信
号から上記ステータス信号を分離する分離化手段と、こ
のステータス信号を一時保持する保持手段とを含む受信
装置とを備えた速度変換方式において、国際電信電話諮
問委員会勧告Ｉ４６１に規定するＣ線からＩ線へステー
タス信号を送出する第一動作モードと、開会勧告■４６
３に規定するＥＲ線およびＲＳ線からＤＲ線およびＣＤ
線へステータス信号を送出する第二動作モードのいずれ
か一方の動作モードを指示する信号の入力手段を備え、
上記送信装置は、上記Ｃ線またはＥＲ線の一方が接続さ
れた第一端子と、上記ＲＳ線が接続された第二端子と、
第一モードが設定されたときに、上記第一端子から入力
する信号に基づいて上記生成回路を有効にし、また第二
モードが設定されたときに、上記第一端子および上記第
二端子から入力する信号に基づいて上記生成回路を有効
にする第一切替回路とを備え、上記受信装置は、上記■
線または上記ＤＲ線のいずれか一方が接続された第三端
子と、上記ＣＤ線が接続され第四端子と、第一モードが
設定されたときに、上記保持回路からの出力に基づいて
上記第一端子からの出力を有効にし、第二モードが設定
されたときに、上記保持回路からの出力に基づいて上記
第一端子および上記第二端子からの出力を有効にする第
二切替手段とを備えたことを特徴とする。
データ信号とともに送出されるステータス信号は、ＣＣ
ＩＴＴ勧告１４６１テは、送信側のＣ線から受信側のＩ
線に送出され、また、勧告１４６３では、送信側のＥＲ
線およびＲＳ線は受信側のＤＲ線およびＣＤ線に送出さ
れる。送信側および受信側に設けた切替手段に送信の動
作モードを設定すると、接続切替えが実行され、所望の
送信側端子から所望の受信側端子間の信号送出がなされ
る。
ＩＴＴ勧告１４６１テは、送信側のＣ線から受信側のＩ
線に送出され、また、勧告１４６３では、送信側のＥＲ
線およびＲＳ線は受信側のＤＲ線およびＣＤ線に送出さ
れる。送信側および受信側に設けた切替手段に送信の動
作モードを設定すると、接続切替えが実行され、所望の
送信側端子から所望の受信側端子間の信号送出がなされ
る。
以下、本発明の実施例方式を図面に基づいて説明する。
第１図は本発明の一実施例方式の構成を示すブロック構
成図である。
成図である。
まず、この実施例方式の構成を第１図に基づいて説明す
る。この実施例方式は、送信系第一段速度変換回路１と
、送信系第二段速度変換回路２と、受信系第一段速度変
換回路３と、受信系第一段速度変換回路４とを備える。
る。この実施例方式は、送信系第一段速度変換回路１と
、送信系第二段速度変換回路２と、受信系第一段速度変
換回路３と、受信系第一段速度変換回路４とを備える。
ここで、送信系第一段速度変換回路１は、送信データビ
ア）制御回路１１と、送信用モード切替回路１５および
送信ステータスビット生成回路１６とを有する送信ステ
ータスビット制御回路１２と、送信データ多重回路２１
とを備え、また受信系第一段速度変換回路４は、受信デ
ータビット制御回路１３と、受信ステータスビット保持
回路１７、Ｉ／ＤＲ信号生成回路１９およびＣＤ信号生
成回路２０とを有する受信ステータスビット制御回路１
４と、受信データ分離回路２２とを備える。
ア）制御回路１１と、送信用モード切替回路１５および
送信ステータスビット生成回路１６とを有する送信ステ
ータスビット制御回路１２と、送信データ多重回路２１
とを備え、また受信系第一段速度変換回路４は、受信デ
ータビット制御回路１３と、受信ステータスビット保持
回路１７、Ｉ／ＤＲ信号生成回路１９およびＣＤ信号生
成回路２０とを有する受信ステータスビット制御回路１
４と、受信データ分離回路２２とを備える。
次に、この実施例方式の動作を第１図に基づいて説明す
る。勧告１４６１モードにおけるＣ端子およびＩ端子は
それぞれ勧告Ｉ４６３モードにおけるＥＲ端子およびＤ
Ｒ端子と共用になっており、１４６１モードではＣ端子
の信号は送信ステータスビット生成回路１６のＳｌ、Ｓ
３およびＳ４端子に入力され、それぞれ受信側の受信ス
テータスビット保持回路１７のＳｌ、Ｓ３およびＳ４端
子に出力され受信ステータスビット保持回路１７の８１
、Ｓ３およびＳ４端子の出力はすべてＩ／ＤＲ信号生成
回路１９に入力されてＩ端子に出力される。一方、Ｉ４
６３モードではＥＲ端子の信号は送信ステータスビット
生成回路１６のＳｌおよびＳ３端子に入力され、またＲ
Ｓ端子の信号はＳ４端子に入力され、それぞれ受信側の
受信ステータスビット保持回路１７の５ｉＳ３およびＳ
４端子に出力され、受信ステータスビット保持回路１７
のＳｌおよびＳ３端子の出力はＩ／ＤＲ信号生成回路１
９に入力されてＤＲ端子に出力され、Ｓ４端子の出力は
ＣＤ信号生成回路２０に入力されてＣＤ端子に出力され
る。
る。勧告１４６１モードにおけるＣ端子およびＩ端子は
それぞれ勧告Ｉ４６３モードにおけるＥＲ端子およびＤ
Ｒ端子と共用になっており、１４６１モードではＣ端子
の信号は送信ステータスビット生成回路１６のＳｌ、Ｓ
３およびＳ４端子に入力され、それぞれ受信側の受信ス
テータスビット保持回路１７のＳｌ、Ｓ３およびＳ４端
子に出力され受信ステータスビット保持回路１７の８１
、Ｓ３およびＳ４端子の出力はすべてＩ／ＤＲ信号生成
回路１９に入力されてＩ端子に出力される。一方、Ｉ４
６３モードではＥＲ端子の信号は送信ステータスビット
生成回路１６のＳｌおよびＳ３端子に入力され、またＲ
Ｓ端子の信号はＳ４端子に入力され、それぞれ受信側の
受信ステータスビット保持回路１７の５ｉＳ３およびＳ
４端子に出力され、受信ステータスビット保持回路１７
のＳｌおよびＳ３端子の出力はＩ／ＤＲ信号生成回路１
９に入力されてＤＲ端子に出力され、Ｓ４端子の出力は
ＣＤ信号生成回路２０に入力されてＣＤ端子に出力され
る。
なお、どちらのモードでも送信ステータスビット（Ｓ）
は、１．０、データビット（Ｄ） 、Ｘビット（Ｘ）お
よびＥビット（Ｅ）と多重され送信系第二段速度変換回
路２を介して相手装置に送信され、また受信系第二速度
変換回路３を介して受信した相手装置からのデータはデ
ータビットＣＤ）、ステータスビット（Ｓ） 、Ｘビッ
ト（Ｘ）およびＥビット（Ｅ）に分離される。
は、１．０、データビット（Ｄ） 、Ｘビット（Ｘ）お
よびＥビット（Ｅ）と多重され送信系第二段速度変換回
路２を介して相手装置に送信され、また受信系第二速度
変換回路３を介して受信した相手装置からのデータはデ
ータビットＣＤ）、ステータスビット（Ｓ） 、Ｘビッ
ト（Ｘ）およびＥビット（Ｅ）に分離される。
〔発明の効果〕
本発明は、以上説明したように、モード切替え信号によ
りステータスビット生成回路の動作モードを連動して切
替えることができるので、ＣＣＩＴＴ勧告■４６１およ
びＩ４６３に準拠した速度変換方式の双方とも同一のハ
ードウェアで実現できる効果がある。
りステータスビット生成回路の動作モードを連動して切
替えることができるので、ＣＣＩＴＴ勧告■４６１およ
びＩ４６３に準拠した速度変換方式の双方とも同一のハ
ードウェアで実現できる効果がある。
第１図は本発明実施例方式の構成を示すプロ・ンク構成
図。 第２図はＣＣＩＴＴ勧告Ｉ４６１で定められた速度変換
方式の概略図。 第３図はＣＣＩＴＴ勧告Ｉ４６３で定められた速度変換
方式の概略図。 １・・・送信系第一段速度変換回路（ＴＲＡＩ）、２・
・・送信系第二段速度変換回路（ＴＲＡ２） 、３・・
・受信系第二段速度変換回路（ＲＲＡ２） 、４・・・
受信系第一段速度変換回路（ＲＲＡＩ） 、５・・・送
信データ線（Ｔ／ＴＤ） 、６・・・Ｃ線（１４６１）
／ＥＲ線（１４６３） （Ｃ／ＥＲ） 、？・・・ＲＳ
線（１４６３）（ＲＳ）、８・・・受信データ線（Ｒ／
ＲＤ）、９・・引線（１４６１） ／ＤＲ線（Ｉ４６３
）（１／Ｄ Ｒ） 、１０・・・ＣＤ線（１４６３）
（ＣＤ）、１１・・・送信データビット制御回路（Ｔ
ＤＣＯＮＴ） 、１２・・・送信ステータスビット制御
回路（ＴＳＣＯＮＴ） 、１３・・・受信データビット
制御回路（ＲＤＣＯＮＴ） 、１４・・・受信ステータ
スビット制御回路（ＲＳＣＯＮＴ） 、１５・・・送信
用モード切替回路（ＴＳＥＬ） 、１６・・・送信ステ
ータスビット生成回路（ＴＳＧＥＮ）、１７・・・受信
ステータスビット保持回路（ＲＳＬＡＴ） 、１８・・
・受信用モード切替回路（ＲＳＥＬ）、１９・・・Ｉ／
ＤＲ信号生成回路（１／ＤＲＧＥＮ）、２０・・・ＣＤ
信号生成回路（ＣＤ ＧＥＮ） 、２１・・・送信デ
ータ多重回路（ＭＵＸ）、２２・・・受信データ分離回
路（ＤＭＸ）。
図。 第２図はＣＣＩＴＴ勧告Ｉ４６１で定められた速度変換
方式の概略図。 第３図はＣＣＩＴＴ勧告Ｉ４６３で定められた速度変換
方式の概略図。 １・・・送信系第一段速度変換回路（ＴＲＡＩ）、２・
・・送信系第二段速度変換回路（ＴＲＡ２） 、３・・
・受信系第二段速度変換回路（ＲＲＡ２） 、４・・・
受信系第一段速度変換回路（ＲＲＡＩ） 、５・・・送
信データ線（Ｔ／ＴＤ） 、６・・・Ｃ線（１４６１）
／ＥＲ線（１４６３） （Ｃ／ＥＲ） 、？・・・ＲＳ
線（１４６３）（ＲＳ）、８・・・受信データ線（Ｒ／
ＲＤ）、９・・引線（１４６１） ／ＤＲ線（Ｉ４６３
）（１／Ｄ Ｒ） 、１０・・・ＣＤ線（１４６３）
（ＣＤ）、１１・・・送信データビット制御回路（Ｔ
ＤＣＯＮＴ） 、１２・・・送信ステータスビット制御
回路（ＴＳＣＯＮＴ） 、１３・・・受信データビット
制御回路（ＲＤＣＯＮＴ） 、１４・・・受信ステータ
スビット制御回路（ＲＳＣＯＮＴ） 、１５・・・送信
用モード切替回路（ＴＳＥＬ） 、１６・・・送信ステ
ータスビット生成回路（ＴＳＧＥＮ）、１７・・・受信
ステータスビット保持回路（ＲＳＬＡＴ） 、１８・・
・受信用モード切替回路（ＲＳＥＬ）、１９・・・Ｉ／
ＤＲ信号生成回路（１／ＤＲＧＥＮ）、２０・・・ＣＤ
信号生成回路（ＣＤ ＧＥＮ） 、２１・・・送信デ
ータ多重回路（ＭＵＸ）、２２・・・受信データ分離回
路（ＤＭＸ）。
Claims (1)
- （１）ステータス信号を生成する生成回路（１６）と、
このステータス信号を他の信号に多重化する多重化手段
（２１）とを含む送信装置と、 上記多重化手段を経由して到来する信号から上記ステー
タス信号を分離する分離化手段（２２）と、このステー
タス信号を一時保持する保持手段（１７）とを含む受信
装置と を備えた速度変換方式において、 国際電信電話諮問委員会勧告Ｉ４６１に規定するＣ線か
らＩ線へステータス信号を送出する第一動作モードと、
同会勧告Ｉ４６３に規定するＥＲ線およびＲＳ線からＤ
Ｒ線およびＣＤ線へステータス信号を送出する第二動作
モードのいずれか一方の動作モードを指示する信号の入
力手段 を備え、 上記送信装置は、 上記Ｃ線またはＥＲ線の一方が接続された第一端子（６
）と、 上記ＲＳ線が接続された第二端子（７）と、第一モード
が設定されたときに、上記第一端子から入力する信号に
基づいて上記生成回路を有効にし、また第二モードが設
定されたときに、上記第一端子および上記第二端子から
入力する信号に基づいて上記生成回路を有効にする第一
切替回路（１５）と を備え、 上記受信装置は、 上記Ｉ線または上記ＤＲ線のいずれか一方が接続された
第三端子（９）と、 上記ＣＤ線が接続され第四端子（１０）と、第一モード
が設定されたときに、上記保持回路からの出力に基づい
て上記第一端子からの出力を有効にし、第二モードが設
定されたときに、上記保持回路からの出力に基づいて上
記第一端子および上記第二端子からの出力を有効にする
第二切替手段（１８）と を備えたことを特徴とする速度変換方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61095469A JPH0646723B2 (ja) | 1986-04-23 | 1986-04-23 | 速度変換方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61095469A JPH0646723B2 (ja) | 1986-04-23 | 1986-04-23 | 速度変換方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62250737A true JPS62250737A (ja) | 1987-10-31 |
| JPH0646723B2 JPH0646723B2 (ja) | 1994-06-15 |
Family
ID=14138507
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61095469A Expired - Lifetime JPH0646723B2 (ja) | 1986-04-23 | 1986-04-23 | 速度変換方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0646723B2 (ja) |
-
1986
- 1986-04-23 JP JP61095469A patent/JPH0646723B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0646723B2 (ja) | 1994-06-15 |
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