JPS62209656A - デ−タ転送制御方式 - Google Patents
デ−タ転送制御方式Info
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- JPS62209656A JPS62209656A JP5280586A JP5280586A JPS62209656A JP S62209656 A JPS62209656 A JP S62209656A JP 5280586 A JP5280586 A JP 5280586A JP 5280586 A JP5280586 A JP 5280586A JP S62209656 A JPS62209656 A JP S62209656A
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- buffer memory
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- 238000001514 detection method Methods 0.000 claims description 9
- 230000004044 response Effects 0.000 abstract 1
- 238000000034 method Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 6
- 230000005540 biological transmission Effects 0.000 description 3
- 230000004913 activation Effects 0.000 description 2
- 101150029237 Il11 gene Proteins 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
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- Engineering & Computer Science (AREA)
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- General Physics & Mathematics (AREA)
- Information Transfer Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
回線等からのデータを受信して処理するシステムにおい
て、受信データをパブ７丁に受信したのち、これを処理
装置へ転送する方法が広く用いられるが、本発明は、処
理装置−から転送データ量を任意に設定して、処坤能力
ｋＣ応じたデータ量の転送制御を可能とした。
て、受信データをパブ７丁に受信したのち、これを処理
装置へ転送する方法が広く用いられるが、本発明は、処
理装置−から転送データ量を任意に設定して、処坤能力
ｋＣ応じたデータ量の転送制御を可能とした。
本発明はデータ転送を制御するデータ転送制御方式の改
良に関する。
良に関する。
転送データを処理する処理装置側では、処理能力に応じ
たデータ転送を行いうる対策の実現が望まれている。
たデータ転送を行いうる対策の実現が望まれている。
従来例を図によって説明する。第３図は従来例を説明す
るブロック図である０ 制御装置ｌからデータ２を処理装置３へ送出して処９す
るシステムにおいて、通常、両者の中間にバッファメモ
リ（記憶部）４を設け、これ釦デ籍 一タ２を一旦婿納したのち、これを処理装置３へ転送す
る方法が採られている。その転送は転送制御部５が行う
。
るブロック図である０ 制御装置ｌからデータ２を処理装置３へ送出して処９す
るシステムにおいて、通常、両者の中間にバッファメモ
リ（記憶部）４を設け、これ釦デ籍 一タ２を一旦婿納したのち、これを処理装置３へ転送す
る方法が採られている。その転送は転送制御部５が行う
。
送信されるデータ２は、電文などの場合忙は複数のブロ
ックデータＤ１〜Ｄｎで構成される。このときの、デー
タ転送は、プロプク毎忙行われ、電文の最後には、終結
情報６が付加されるものとする。一方転送制御１１１ｇ
５において、パ９７アメモリ４としては、所定容量数（
例えばプロ雫り数が「３」）のメモリを用意しておく。
ックデータＤ１〜Ｄｎで構成される。このときの、デー
タ転送は、プロプク毎忙行われ、電文の最後には、終結
情報６が付加されるものとする。一方転送制御１１１ｇ
５において、パ９７アメモリ４としては、所定容量数（
例えばプロ雫り数が「３」）のメモリを用意しておく。
そして、このバッファメモリ４内に３個のブロックデー
タ社例えばり、〜Ｄ、）が格納され、満杯となったとき
忙。
タ社例えばり、〜Ｄ、）が格納され、満杯となったとき
忙。
鍍ブロダクデータＤ、〜Ｄｓを一括して処理装置３へ送
出する。なおこのとき転送制御部５は、後続のデータ有
りを示す継続情報７を、処理ｔＡＩｔ３へ送出する。
出する。なおこのとき転送制御部５は、後続のデータ有
りを示す継続情報７を、処理ｔＡＩｔ３へ送出する。
処理装置３側で受信されたデータ（Ｄ＋−Ｄａ）は、記
ｔｉ部８へ格納され、処理装置３は、継続情！７によっ
て、後続データ有りと判断し、終結情報６を受信した時
点で、電文受信終了を判別する。
ｔｉ部８へ格納され、処理装置３は、継続情！７によっ
て、後続データ有りと判断し、終結情報６を受信した時
点で、電文受信終了を判別する。
このように従来は、容量が固定されたバッファメモリ４
を用いで、データを転送制御する方法が採られていた。
を用いで、データを転送制御する方法が採られていた。
以上で明らかなように従来は、固定された容量のバッフ
ァメモリ４を用いているので、転送されるデータ量が一
定となる。；ｔ；１ｌｃｌｉため、処理装置！１３側の
処理能力に応じた可変量のデータ転送を行い得ないとい
う問題点があった。
ァメモリ４を用いているので、転送されるデータ量が一
定となる。；ｔ；１ｌｃｌｉため、処理装置！１３側の
処理能力に応じた可変量のデータ転送を行い得ないとい
う問題点があった。
第１図は本発明の原卯プロ噌り図である。本発明は、
制御装置１、バー１７アメモリ４を有する転送制御１部
５及び処理装置３が結ばれ、制御装置ｌｌから。
５及び処理装置３が結ばれ、制御装置ｌｌから。
複数個のデータからなるデータ２が、転送制御部５を経
て処理装置３へ転送されるシステムにおいて、 転送されるデータ量を指定する容量情報１２を発する手
段を有する処理装ａ３と、 容を情報１２が設定される数値設定部９及びバッファメ
モリ４内の受信データ数が数値設定部９に設定されたと
きバッファメモリ４内のデータ及び継続情報７を送出す
るデータ検出部１０を有する転送制御部５ とを備えている。
て処理装置３へ転送されるシステムにおいて、 転送されるデータ量を指定する容量情報１２を発する手
段を有する処理装ａ３と、 容を情報１２が設定される数値設定部９及びバッファメ
モリ４内の受信データ数が数値設定部９に設定されたと
きバッファメモリ４内のデータ及び継続情報７を送出す
るデータ検出部１０を有する転送制御部５ とを備えている。
処理装Ｗｔ３から発せられた容量情報１２で指定された
数置を数値設定部９に設定した転送制御部５が、制御値
ｆｉｌｌからのデータ２を受信した際、データ検出部１
０は、バッファメモリ４内の受信データ数が、数値設定
部９に設定された数値と等しくなったとき、バッフアメ
そり４内の受信データ及び継続情報７を処理装置３へ送
出する。
数置を数値設定部９に設定した転送制御部５が、制御値
ｆｉｌｌからのデータ２を受信した際、データ検出部１
０は、バッファメモリ４内の受信データ数が、数値設定
部９に設定された数値と等しくなったとき、バッフアメ
そり４内の受信データ及び継続情報７を処理装置３へ送
出する。
以下、本発明を図面によって説明する。第２図は本発明
の一実施例を説明するブロック図である。
の一実施例を説明するブロック図である。
制御装置１から処理装置３へ転送されるデータ２は、従
来例と同様に、複数のブロックデータＤ１〜Ｄｎで構成
される電文であり、電文の後尾には、終結情報６が付加
される。またそのデータ転送は、電文が分割されるもの
とする。一方、バッファメモリ（記憶部）４を有する転
送制御部５）Ｃは、レジスタ９、データ検出部１０及び
送信部１１が設けられている。
来例と同様に、複数のブロックデータＤ１〜Ｄｎで構成
される電文であり、電文の後尾には、終結情報６が付加
される。またそのデータ転送は、電文が分割されるもの
とする。一方、バッファメモリ（記憶部）４を有する転
送制御部５）Ｃは、レジスタ９、データ検出部１０及び
送信部１１が設けられている。
データ転送開始に先立ち処理装置１３は、処理能力に応
じた容量情報１２（例えば数値「３」）を転送制御部５
へ送出する。この容量情報１２によりレジスタ（数値設
定部）９には、数値「３」が設定される。なおこの数値
３は、バッファメモリ４の容ｉＮ以下の値である口 制御値［１から、データ２が、プロリフ単位（Ｄｔ〜Ｄ
ｎ）で転送制御ｇ（１５へ送出される。転送制御１部５
において、データ受信部１３で受信されたデータは、バ
ー１７アメモリ４Ｖｃ順次格納されていく。データ検出
部１０は、バ・ソファメモリ４を常時監視し、データの
プロ・・り数が、レジスタ９に設定された数値「３」に
達したとぎ、例えばブロックデータＤ、、 Ｄ、及びＤ
３を受信したときに、起動信号１４を発する。これを受
けたデータ送信部１５は、バッファメモリ４内のデータ
２即ちブロックデータＤ、−Ｄ、を処理装（ｉ１３へ送
出する。
じた容量情報１２（例えば数値「３」）を転送制御部５
へ送出する。この容量情報１２によりレジスタ（数値設
定部）９には、数値「３」が設定される。なおこの数値
３は、バッファメモリ４の容ｉＮ以下の値である口 制御値［１から、データ２が、プロリフ単位（Ｄｔ〜Ｄ
ｎ）で転送制御ｇ（１５へ送出される。転送制御１部５
において、データ受信部１３で受信されたデータは、バ
ー１７アメモリ４Ｖｃ順次格納されていく。データ検出
部１０は、バ・ソファメモリ４を常時監視し、データの
プロ・・り数が、レジスタ９に設定された数値「３」に
達したとぎ、例えばブロックデータＤ、、 Ｄ、及びＤ
３を受信したときに、起動信号１４を発する。これを受
けたデータ送信部１５は、バッファメモリ４内のデータ
２即ちブロックデータＤ、−Ｄ、を処理装（ｉ１３へ送
出する。
一方、起動信号１４により起動された送信部１１からは
、継続情報７が送出される。
、継続情報７が送出される。
処理装置３は、受信したデータ２（即ちブロックデータ
Ｄ８〜Ｄ、）を、記憶部８に格納し、また継続情報７に
より、引続いて同一電文のデータが送信されてくること
を知る。ブロックデータＤ４以降のデータについても同
様に、ブロック数「３」Ｋ達すると、転送制御部５から
処理装置３へのデータ転送が行われる。このように本発
明では、処理装置３がレジスタ９に設定した数値で定ま
るデータ量の転送制御が行われる。換言すれば、データ
転送量な任意に可変とすることができる。
Ｄ８〜Ｄ、）を、記憶部８に格納し、また継続情報７に
より、引続いて同一電文のデータが送信されてくること
を知る。ブロックデータＤ４以降のデータについても同
様に、ブロック数「３」Ｋ達すると、転送制御部５から
処理装置３へのデータ転送が行われる。このように本発
明では、処理装置３がレジスタ９に設定した数値で定ま
るデータ量の転送制御が行われる。換言すれば、データ
転送量な任意に可変とすることができる。
データ転送が引続いて行われ、受信の最後に、＆１ｌＵ
Ｉｌ１１部５のバッファメモリ４には、受信された終結
情報６が格納される。終結検出部１６がこれを検出する
と、起動信号１７を発信してデータ送信部１５を起動す
る。これによりバッファメモリ４内のデータ２、例えば
ブロックデータＤｎ及び終結情報６が、処理装置３へ送
°出される。
Ｉｌ１１部５のバッファメモリ４には、受信された終結
情報６が格納される。終結検出部１６がこれを検出する
と、起動信号１７を発信してデータ送信部１５を起動す
る。これによりバッファメモリ４内のデータ２、例えば
ブロックデータＤｎ及び終結情報６が、処理装置３へ送
°出される。
処理装置３が終結情報６を受信すると、データ２の全電
文の転送制御が終了する。なお終結検出部１６は、バッ
ファメモリ内忙受信されたデータプロブク数とは関係な
く、終結情報６を検出すると、直ちに作動する。
文の転送制御が終了する。なお終結検出部１６は、バッ
ファメモリ内忙受信されたデータプロブク数とは関係な
く、終結情報６を検出すると、直ちに作動する。
本発明は転送されたデータを処理する処理装置の処理効
率を向上する効果をもたらす利点を有する。
率を向上する効果をもたらす利点を有する。
＄を目は本発明の原理ブローク図
Ｍ：＃Ｊは本発明の一実施例を説明するブロック図月３
図は従来例を説明するブロック図 図において、 １は制御装置、２はデータ、３は処理装置、４はバッフ
ァメモリ％５は転送制御部、６は終結情報、７は継続情
報、８は記憶部、９は数値設定部（レジスタ）、１０は
データ検出部、１１は送信部、１２は容量情報、１３は
データ受信部、１４゜１７は起動信号、１５はデータ送
信部、１６は終結検出部を示す。
図は従来例を説明するブロック図 図において、 １は制御装置、２はデータ、３は処理装置、４はバッフ
ァメモリ％５は転送制御部、６は終結情報、７は継続情
報、８は記憶部、９は数値設定部（レジスタ）、１０は
データ検出部、１１は送信部、１２は容量情報、１３は
データ受信部、１４゜１７は起動信号、１５はデータ送
信部、１６は終結検出部を示す。
Claims (1)
- 【特許請求の範囲】 制御装置（１）、バッファメモリ（４）を有する転送制
御部（５）及び処理装置（３）が結ばれ、制御装置（１
）から、複数個のデータからなるデータ（２）が転送制
御部（５）を経て処理装置（３）へ転送されるシステム
において、転送されるデータ量を指定する容量情報（１
２）を発する手段を有する処理装置（３）と、 容量情報（１２）が設定される数値設定部（９）及びバ
ッファメモリ（４）内の受信データ数が数値設定部（９
）に設定されたときバッファメモリ（４）内のデータ及
び継続情報（７）を送出するデータ検出部（１０）を有
する転送制御部（５）とを備え、 処理装置（３）から発せられた容量情報（１２）で指定
された数値を数値設定部（９）に設定した転送制御部（
５）が、制御装置（１）からのデータ（２）を受信した
際データ検出部（１０）は、バッファメモリ（４）内の
受信データ数が、数値設定部（９）に設定された数値と
等しくなったとき、バッファメモリ（４）内の受信デー
タ及び継続情報（７）を処理装置（３）へ送出すること
を特徴とするデータ転送制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5280586A JPS62209656A (ja) | 1986-03-11 | 1986-03-11 | デ−タ転送制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5280586A JPS62209656A (ja) | 1986-03-11 | 1986-03-11 | デ−タ転送制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62209656A true JPS62209656A (ja) | 1987-09-14 |
Family
ID=12925056
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5280586A Pending JPS62209656A (ja) | 1986-03-11 | 1986-03-11 | デ−タ転送制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62209656A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01159768A (ja) * | 1987-12-16 | 1989-06-22 | Hitachi Ltd | 図形データ表示方法及び装置 |
| EP0573583A4 (en) * | 1991-02-26 | 1995-07-26 | Digi Int Inc | DATA INPUT METHOD FOR A BUFFED VART. |
| US6671752B1 (en) | 2000-08-28 | 2003-12-30 | International Business Machines Corporation | Method and apparatus for bus optimization in a PLB system |
-
1986
- 1986-03-11 JP JP5280586A patent/JPS62209656A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01159768A (ja) * | 1987-12-16 | 1989-06-22 | Hitachi Ltd | 図形データ表示方法及び装置 |
| EP0573583A4 (en) * | 1991-02-26 | 1995-07-26 | Digi Int Inc | DATA INPUT METHOD FOR A BUFFED VART. |
| US6671752B1 (en) | 2000-08-28 | 2003-12-30 | International Business Machines Corporation | Method and apparatus for bus optimization in a PLB system |
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