JPS62207014A - 自動音質制御回路 - Google Patents
自動音質制御回路Info
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- JPS62207014A JPS62207014A JP61050158A JP5015886A JPS62207014A JP S62207014 A JPS62207014 A JP S62207014A JP 61050158 A JP61050158 A JP 61050158A JP 5015886 A JP5015886 A JP 5015886A JP S62207014 A JPS62207014 A JP S62207014A
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Landscapes
- Noise Elimination (AREA)
- Filters That Use Time-Delay Elements (AREA)
- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、デジタル信号処理プロセッサを用いた自動音
質制御回路に関する。
質制御回路に関する。
ＦＭ放送をステレオで受信時に、電界強度が弱くなると
高域ノイズを発生する。またモノラルの場合でもアンテ
ナ入力で２０ｄＢμ以下になるとＳ／Ｎが４０ｄＢ以下
となり、相当に耳ざゎりなノイズを出力する。この場合
、電界低下時に７ＫＨｚ以上の高域のレベルを低下させ
ると聴感上のＳ／Ｎを改善できる。これが自動音質制御
（ＡＴＣ： Ａｕむｏ Ｔｏｎｅ Ｃｏｎｔｒｏｌ
）の原理である。
高域ノイズを発生する。またモノラルの場合でもアンテ
ナ入力で２０ｄＢμ以下になるとＳ／Ｎが４０ｄＢ以下
となり、相当に耳ざゎりなノイズを出力する。この場合
、電界低下時に７ＫＨｚ以上の高域のレベルを低下させ
ると聴感上のＳ／Ｎを改善できる。これが自動音質制御
（ＡＴＣ： Ａｕむｏ Ｔｏｎｅ Ｃｏｎｔｒｏｌ
）の原理である。
第６図はＦＭ受信機の概略ブロック図である。
受信電界は中間周波段ＩＦのシグナルレベルで検知し、
これをＡＴＣ回路に与える。ＡＴＣ回路は一種のローパ
スフィルタで、そのカットオフ周波数がシグナルレベル
で変化する。第７図（ａｌが従来のアナログ回路による
ＡＴＣ回路の構成例で、Ｒ＝５にΩとして容量Ｃをシグ
ナルレベルに応じて変化させると１０ＫＨｚの減衰量は
次の様に変化表 １ 同図（ｂ）はこのＡＴＣ回路によるハイカット率で、シ
グナルレベルが低下する弱電界時はどハイカット率は上
昇する。このＡＴＣ回路の伝達関数は同図（Ｃ）の入出
力ｅ１．ｓｏを用いるとｅｏ １ ：’ ｅ、 １＋ｊωＣＲ であり、これをＺ変換すると Ｅ（（ｚ） ＝ １．−ＣＲ／ｆ、４ 。
これをＡＴＣ回路に与える。ＡＴＣ回路は一種のローパ
スフィルタで、そのカットオフ周波数がシグナルレベル
で変化する。第７図（ａｌが従来のアナログ回路による
ＡＴＣ回路の構成例で、Ｒ＝５にΩとして容量Ｃをシグ
ナルレベルに応じて変化させると１０ＫＨｚの減衰量は
次の様に変化表 １ 同図（ｂ）はこのＡＴＣ回路によるハイカット率で、シ
グナルレベルが低下する弱電界時はどハイカット率は上
昇する。このＡＴＣ回路の伝達関数は同図（Ｃ）の入出
力ｅ１．ｓｏを用いるとｅｏ １ ：’ ｅ、 １＋ｊωＣＲ であり、これをＺ変換すると Ｅ（（ｚ） ＝ １．−ＣＲ／ｆ、４ 。
となる。ここで「Ｓはサンプリング周波数であり、ＫＴ
＝ ｅ ”Ｒ／ｆｓ と置（と同図（ｄｌのようなシグナルフローで表現でき
る。このシグナルフローのローパスフィルタ係数Ｋ（本
例ではに↑）は同図（ｅ）のようにシグナルレベルに応
じて変化する。従って、このＡＴＣ回路はアナログ方式
のみならずデジタル処理方式でも実現できる。
＝ ｅ ”Ｒ／ｆｓ と置（と同図（ｄｌのようなシグナルフローで表現でき
る。このシグナルフローのローパスフィルタ係数Ｋ（本
例ではに↑）は同図（ｅ）のようにシグナルレベルに応
じて変化する。従って、このＡＴＣ回路はアナログ方式
のみならずデジタル処理方式でも実現できる。
しかしながら、従来はアナログ方式が主流であり、デジ
タル処理によるＡＴＣ回路の実例は少ない。本発明は各
種の信号処理が可能なデジタル信号処理プロセッサ（Ｄ
Ｓ Ｐ）の１機能として、簡単な構成（１０ステップ
程度のプログラム）によるＡＴＣ回路を実現しようとす
るものである。
タル処理によるＡＴＣ回路の実例は少ない。本発明は各
種の信号処理が可能なデジタル信号処理プロセッサ（Ｄ
Ｓ Ｐ）の１機能として、簡単な構成（１０ステップ
程度のプログラム）によるＡＴＣ回路を実現しようとす
るものである。
本発明は、ＦＭ受信機から得られるシグナルレベルを制
御用マイクロコンピュータに入力すると共に、該受信機
で復調された主副のステレオ音声信号（Ｌ＋Ｒ）、
（Ｌ−Ｒ）をデジタル信号処理プロセッサに入力してそ
のステレオ復調マトリクス処理で左右の信号り、 Ｒに
分離し、更に分離された左右の信号の高域をシグナルレ
ベルに応じて減衰させる音質制御の信号処理時に、該マ
イクロコンピュータ内において該シグナルレベルに対応
する高域減衰量を実現するフィルタ係数に↑を求め、こ
れを前記プロセッサに与えて音質制御の信号処理をさせ
るようにしてなることを特徴とするものである。
御用マイクロコンピュータに入力すると共に、該受信機
で復調された主副のステレオ音声信号（Ｌ＋Ｒ）、
（Ｌ−Ｒ）をデジタル信号処理プロセッサに入力してそ
のステレオ復調マトリクス処理で左右の信号り、 Ｒに
分離し、更に分離された左右の信号の高域をシグナルレ
ベルに応じて減衰させる音質制御の信号処理時に、該マ
イクロコンピュータ内において該シグナルレベルに対応
する高域減衰量を実現するフィルタ係数に↑を求め、こ
れを前記プロセッサに与えて音質制御の信号処理をさせ
るようにしてなることを特徴とするものである。
デジタル信号処理プロセッサ（ＤＳＰ）は入力信号に対
する各種の信号処理をプログラムで行うことができるが
、各処理で使用するフィルタ係数等は制御用マイクロコ
ンピュータから与えられる。
する各種の信号処理をプログラムで行うことができるが
、各処理で使用するフィルタ係数等は制御用マイクロコ
ンピュータから与えられる。
そこで、ＦＭ受信機のシグナルレベルを該マイクロコン
ピュータに入力し、該シグナルレベルから推測される受
信電界にとって最適なフィルタ係数をＤＳＰに与えれば
、ＤＳＰによる自動音質制御（ＡＴＣ）の信号処理（ロ
ーパスフィルタ処理）は１０ステップ程度の簡単なプロ
グラムで実現することができる。
ピュータに入力し、該シグナルレベルから推測される受
信電界にとって最適なフィルタ係数をＤＳＰに与えれば
、ＤＳＰによる自動音質制御（ＡＴＣ）の信号処理（ロ
ーパスフィルタ処理）は１０ステップ程度の簡単なプロ
グラムで実現することができる。
第１図はＦＭチューナ１、ＡＭチューナ２、カセットデ
ツキアンプ３を音源とするオーディオシステムのブロッ
ク図で、チューナ１，２はいずれもスーパーへテロダイ
ン方式のＰＬＬシンセサイザ型である。ＡＮＴはアンテ
ナ、ＲＦは高周波段、ＭＩＸは周波数ミキサ段、ＬＯは
局部発振器、１Ｆは中間周波段、ＤＥＴは検波段で、局
部発振器ＬＯの発振周波数は制御用マイクロコンピュー
タ（ＣＰＵ）４からの分周比Ｎ値によって変更される。
ツキアンプ３を音源とするオーディオシステムのブロッ
ク図で、チューナ１，２はいずれもスーパーへテロダイ
ン方式のＰＬＬシンセサイザ型である。ＡＮＴはアンテ
ナ、ＲＦは高周波段、ＭＩＸは周波数ミキサ段、ＬＯは
局部発振器、１Ｆは中間周波段、ＤＥＴは検波段で、局
部発振器ＬＯの発振周波数は制御用マイクロコンピュー
タ（ＣＰＵ）４からの分周比Ｎ値によって変更される。
つまり、局部発振器ＬＯの出力ＡＭＬＯ／ ＦＭＬＯは
位相同期部ＰＬＬ内の可変分周器で１／Ｎに分周された
後に位相比較器で基準周波数ｆｒと比較され、その誤差
分がローパスフィルタＬＰＦを通過してチューニングバ
イアスＴＢとなる。ＬＯ，ＰＬＬ、ＬＰＦは閉ループを
構成するので、分周比Ｎ値を変更するとＬＯの周波数は
ＬＰＦの出力ＴＢをＯにするように変化する。
位相同期部ＰＬＬ内の可変分周器で１／Ｎに分周された
後に位相比較器で基準周波数ｆｒと比較され、その誤差
分がローパスフィルタＬＰＦを通過してチューニングバ
イアスＴＢとなる。ＬＯ，ＰＬＬ、ＬＰＦは閉ループを
構成するので、分周比Ｎ値を変更するとＬＯの周波数は
ＬＰＦの出力ＴＢをＯにするように変化する。
カセットデツキアンプ３は磁気ヘッドＨＤ、イコライザ
アンプＥＱ ＡＭＰ、フラットアンプＦＬＡＴ Ａ
Ｍ Ｐ 、ノイズリダクション・システムＤＯＬＢＹ
（面積）からなり、カセットデツキ（デツキドライ
バを含む）５が対となる。ＣＰＵ４に対してはキーバッ
ド・マトリクス６から音源選択、音量調節等の各種指示
を入力できる。７は各音源の動作状態を表示するディス
プレイ、８はＣＰＵ４からの指示で音源切換えを行う切
換機能と、選択された音声信号をデジタル信号に量子化
する機能を有する１６ビツトのＡ／Ｄ変換器、９はチュ
ーナ１．２の各シグナルレベル（電界強度を示す）をデ
ジタル信号に量子化してＣＰＵ４に入力する６ビツトの
Ａ／Ｄ変換器、１０はＡ／Ｄ変換器８の出力を信号処理
するデジタル信号処理プロセッサ、１１は量子化されて
いるＤＳＰＩＯの出力をアナログ信号に復元する１６ビ
ントのＤ／Ａ変換器、ＰＯＷ ＡＭＰはパワーアンプ
、ｓｐはスピーカである。
アンプＥＱ ＡＭＰ、フラットアンプＦＬＡＴ Ａ
Ｍ Ｐ 、ノイズリダクション・システムＤＯＬＢＹ
（面積）からなり、カセットデツキ（デツキドライ
バを含む）５が対となる。ＣＰＵ４に対してはキーバッ
ド・マトリクス６から音源選択、音量調節等の各種指示
を入力できる。７は各音源の動作状態を表示するディス
プレイ、８はＣＰＵ４からの指示で音源切換えを行う切
換機能と、選択された音声信号をデジタル信号に量子化
する機能を有する１６ビツトのＡ／Ｄ変換器、９はチュ
ーナ１．２の各シグナルレベル（電界強度を示す）をデ
ジタル信号に量子化してＣＰＵ４に入力する６ビツトの
Ａ／Ｄ変換器、１０はＡ／Ｄ変換器８の出力を信号処理
するデジタル信号処理プロセッサ、１１は量子化されて
いるＤＳＰＩＯの出力をアナログ信号に復元する１６ビ
ントのＤ／Ａ変換器、ＰＯＷ ＡＭＰはパワーアンプ
、ｓｐはスピーカである。
第２図はＤＳＰＩＯのアーキテクチャを示す概略構成図
で、プログラムバス２０にはプログラムメモリ （ＲＯ
Ｍ）２１、プログラムカウンタ２２、Ｉ１０インターフ
ェイス２３、クロック発振器。
で、プログラムバス２０にはプログラムメモリ （ＲＯ
Ｍ）２１、プログラムカウンタ２２、Ｉ１０インターフ
ェイス２３、クロック発振器。
４が接続され、インターフェイス２３は更に制御用マイ
クロコンピュータ４やＡ／Ｄ、Ｄ／Ａ変換ａｓ、ｉ工に
接続される。一方、データバス３１にはデータメモリ
（ＲＡＭ）２５やアドレスカウンタ２６、或いは乗算器
２７、加算器２８、アキュムレータ２９、演算器３０が
接続される。
クロコンピュータ４やＡ／Ｄ、Ｄ／Ａ変換ａｓ、ｉ工に
接続される。一方、データバス３１にはデータメモリ
（ＲＡＭ）２５やアドレスカウンタ２６、或いは乗算器
２７、加算器２８、アキュムレータ２９、演算器３０が
接続される。
ＤＳＰＩＯで扱う数は１０進数で０．９９８０４６８７
５〜−１．０、バイナリ数で表示すると０１１１１１１
１１１〜１ｏｏｏｏｏｏｏｏｏ ＜符号付２の補数）、
ヘキサ数ではＩＦＦ〜２００である。このＤＳＰＩＯと
ＣＰＵ４の間の通信はアドレス８ビツト、データ１０ビ
ツトのシリアルクロック同期式で、アドレスはＤＳＰプ
ログラム上に定義付けられたＤＳＰ内ＲＡＭアドレスで
ある。データ（係数値）はＤＳＰ内ＲＡＭアドレスで指
示されたアドレスに格納され、ＤＳＰプログラムに従っ
て各種フィルタの係数値として使用される。
５〜−１．０、バイナリ数で表示すると０１１１１１１
１１１〜１ｏｏｏｏｏｏｏｏｏ ＜符号付２の補数）、
ヘキサ数ではＩＦＦ〜２００である。このＤＳＰＩＯと
ＣＰＵ４の間の通信はアドレス８ビツト、データ１０ビ
ツトのシリアルクロック同期式で、アドレスはＤＳＰプ
ログラム上に定義付けられたＤＳＰ内ＲＡＭアドレスで
ある。データ（係数値）はＤＳＰ内ＲＡＭアドレスで指
示されたアドレスに格納され、ＤＳＰプログラムに従っ
て各種フィルタの係数値として使用される。
第３図はＤＳＰＩＯの処理を示すシグナルフローで、ス
テレオ入力Ｌ−Ｒ，Ｌ＋Ｒを対象としている。図中、ｘ
印は乗算器、■は加算器、ｚｌは■サンプル遅れを示す
。入力段はステレオｆＪｊｔｌｌマトリクスで、その後
段に１９ＫＨｚのパイロットフィルタ、ディエンファシ
ス回路、ＡＴＣ（自動音質制御）回路が順次配列される
。後３者は傾斜の異なるローパスフィルタで、更にトー
ンコントロール回路、ボリュームコントロール回路を通
して左右の音声信号り、Ｒが出力される。ステレオ復調
マトリクスでは４つの係数が用いられ、ＫＳＯ−＝０．
５．ＫＳ、＝０．５．ＫＳ２ ＝−０，５，ＫＳ３＝０
．５に設定するとり、Ｒが完全に分離される。
テレオ入力Ｌ−Ｒ，Ｌ＋Ｒを対象としている。図中、ｘ
印は乗算器、■は加算器、ｚｌは■サンプル遅れを示す
。入力段はステレオｆＪｊｔｌｌマトリクスで、その後
段に１９ＫＨｚのパイロットフィルタ、ディエンファシ
ス回路、ＡＴＣ（自動音質制御）回路が順次配列される
。後３者は傾斜の異なるローパスフィルタで、更にトー
ンコントロール回路、ボリュームコントロール回路を通
して左右の音声信号り、Ｒが出力される。ステレオ復調
マトリクスでは４つの係数が用いられ、ＫＳＯ−＝０．
５．ＫＳ、＝０．５．ＫＳ２ ＝−０，５，ＫＳ３＝０
．５に設定するとり、Ｒが完全に分離される。
第４図は本発明のＡＴＣ回路の説明図で、（ａ）はシグ
ナルフローである。このＡＴＣ回路の伝達関数は で、係数ＫＡ、に↑は次の関係に設定しである。
ナルフローである。このＡＴＣ回路の伝達関数は で、係数ＫＡ、に↑は次の関係に設定しである。
Ｋへ＝＋Ｓｖ
Ｋ↑＝１−ＫＡ
このＡＴＣ回路の１０ＫＨｚにおける減衰量は同１ｆｆ
ｌ （ｂｌに示すようにシグナルレベルＳＶによって変
化する。但し、領域Ａは強電界域なので減衰させない。
ｌ （ｂｌに示すようにシグナルレベルＳＶによって変
化する。但し、領域Ａは強電界域なので減衰させない。
また領域Ｃは弱電界域なので減衰量を一２４ｄＢ一定に
する。これらの中間の領域Ｂがリニアな変化領域になる
。
する。これらの中間の領域Ｂがリニアな変化領域になる
。
上述した１０ＫＨｚでの減衰量を実現する係数にΔ、Ｋ
Ｔは下表の通りである。
Ｔは下表の通りである。
表 ２
上表の主な係数ＫＡをパラメータとしたＯ〜２０ＫＨｚ
の周波数特性を第４図（Ｃ）に示す。
の周波数特性を第４図（Ｃ）に示す。
第５図は制御用マイクロコンピュータのフローチャート
で、ここではＦＭ処理の一部としてシグナルレベルＳｖ
の判別および係数ＫＡ、ＫＴの設定、ＤＳＰへの転送が
行われる。
で、ここではＦＭ処理の一部としてシグナルレベルＳｖ
の判別および係数ＫＡ、ＫＴの設定、ＤＳＰへの転送が
行われる。
以上述べたように本発明によれば、デジタル信号処理プ
ロセッサ内の簡単なプログラムでＡＴＣ機能を実現でき
、安価に且つ精度良〈実施できる利点がある。
ロセッサ内の簡単なプログラムでＡＴＣ機能を実現でき
、安価に且つ精度良〈実施できる利点がある。
第１図は本発明を通用したオーディオシステムのブロッ
ク図、第２図および第３図はデジタル信号処理プロセッ
サの概略構成図およびシグナルフローの説明図、第４図
は本発明のＡＴＣ回路の説明図、第５図は制御用マイク
ロコンピュータのフローチャート、第６図はＦＭ受信機
のブロック図、第７図は従来のＡＴＣ回路の説明図であ
る。 図中、１はＦＭチューナ、４は制御用マイクロコンピュ
ータ、８，９はＡ／Ｄ変換器、１０はデジタル信号処理
プロセッサである。
ク図、第２図および第３図はデジタル信号処理プロセッ
サの概略構成図およびシグナルフローの説明図、第４図
は本発明のＡＴＣ回路の説明図、第５図は制御用マイク
ロコンピュータのフローチャート、第６図はＦＭ受信機
のブロック図、第７図は従来のＡＴＣ回路の説明図であ
る。 図中、１はＦＭチューナ、４は制御用マイクロコンピュ
ータ、８，９はＡ／Ｄ変換器、１０はデジタル信号処理
プロセッサである。
Claims (1)
- ＦＭ受信機から得られるシグナルレベルを制御用マイク
ロコンピュータに入力すると共に、該受信機で復調され
た主副のステレオ音声信号（Ｌ＋Ｒ）、（Ｌ−Ｒ）をデ
ジタル信号処理プロセッサに入力してそのステレオ復調
マトリクス処理で左右の信号Ｌ、Ｒに分離し、更に分離
された左右の信号の高域をシグナルレベルに応じて減衰
させる音質制御の信号処理時に、該マイクロコンピュー
タ内において該シグナルレベルに対応する高域減衰量を
実現するフィルタ係数Ｋ＿Ｔを求め、これを前記プロセ
ッサに与えて音質制御の信号処理をさせるようにしてな
ることを特徴とする自動音質制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5015886A JPH0716140B2 (ja) | 1986-03-07 | 1986-03-07 | 自動音質制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5015886A JPH0716140B2 (ja) | 1986-03-07 | 1986-03-07 | 自動音質制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62207014A true JPS62207014A (ja) | 1987-09-11 |
| JPH0716140B2 JPH0716140B2 (ja) | 1995-02-22 |
Family
ID=12851384
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5015886A Expired - Fee Related JPH0716140B2 (ja) | 1986-03-07 | 1986-03-07 | 自動音質制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0716140B2 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0198326A (ja) * | 1987-10-09 | 1989-04-17 | Alpine Electron Inc | Ａｍラジオ受信機 |
| JPH01186026A (ja) * | 1988-01-20 | 1989-07-25 | Sanyo Electric Co Ltd | ステレオ復調回路 |
| JP2001186032A (ja) * | 1999-11-16 | 2001-07-06 | Motorola Inc | 無線バックエンド回路 |
| JP2001189669A (ja) * | 1999-11-16 | 2001-07-10 | Motorola Inc | 無線バックエンド回路 |
-
1986
- 1986-03-07 JP JP5015886A patent/JPH0716140B2/ja not_active Expired - Fee Related
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0198326A (ja) * | 1987-10-09 | 1989-04-17 | Alpine Electron Inc | Ａｍラジオ受信機 |
| JPH01186026A (ja) * | 1988-01-20 | 1989-07-25 | Sanyo Electric Co Ltd | ステレオ復調回路 |
| JP2001186032A (ja) * | 1999-11-16 | 2001-07-06 | Motorola Inc | 無線バックエンド回路 |
| JP2001189669A (ja) * | 1999-11-16 | 2001-07-10 | Motorola Inc | 無線バックエンド回路 |
| JP4713726B2 (ja) * | 1999-11-16 | 2011-06-29 | フリースケール セミコンダクター インコーポレイテッド | 無線バックエンド回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0716140B2 (ja) | 1995-02-22 |
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| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |