JPS62198595U - - Google Patents
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- Publication number
- JPS62198595U JPS62198595U JP8616386U JP8616386U JPS62198595U JP S62198595 U JPS62198595 U JP S62198595U JP 8616386 U JP8616386 U JP 8616386U JP 8616386 U JP8616386 U JP 8616386U JP S62198595 U JPS62198595 U JP S62198595U
- Authority
- JP
- Japan
- Prior art keywords
- main body
- external memory
- data storage
- storage section
- memory pack
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000013500 data storage Methods 0.000 claims 3
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
Description
第1図はこの考案の機能ブロツク図、第2図は
この考案をワードプロセツサに適用した場合の全
体構成図、第3図はこの考案の一実施例の要部を
示すインターフエース回路の構成図、第4図は一
文書が複数枚のRAMカードにまたがる場合の各
RAMカードのマツプを例示する図、第5図は第
4図と対応し、各RAMカードにおける複数ボリ
ユームの文書の管理情報のフオーマツトを例示す
る図、第6図、第7図は文書メモリよりRAMカ
ードにデータを転送する場合の実施例の動作のフ
ローチヤート、第8図、第9図はRAMカードよ
り文書メモリにデータを転送する場合のフローチ
ヤートである。 1…CPU、2…文書メモリ、10…インター
フエース回路、10e…アドレスラツチ、10f
…データバスバツフア、10g…リードライトバ
ツフア、10i…ゲート制御線、12…蓋セツト
スイツチ。
この考案をワードプロセツサに適用した場合の全
体構成図、第3図はこの考案の一実施例の要部を
示すインターフエース回路の構成図、第4図は一
文書が複数枚のRAMカードにまたがる場合の各
RAMカードのマツプを例示する図、第5図は第
4図と対応し、各RAMカードにおける複数ボリ
ユームの文書の管理情報のフオーマツトを例示す
る図、第6図、第7図は文書メモリよりRAMカ
ードにデータを転送する場合の実施例の動作のフ
ローチヤート、第8図、第9図はRAMカードよ
り文書メモリにデータを転送する場合のフローチ
ヤートである。 1…CPU、2…文書メモリ、10…インター
フエース回路、10e…アドレスラツチ、10f
…データバスバツフア、10g…リードライトバ
ツフア、10i…ゲート制御線、12…蓋セツト
スイツチ。
Claims (1)
- データ記憶部を有する装置本体と、この装置本
体に着脱自在に装着される外部メモリパツクと、
上記装置本体に接続され、上記装置本体のデータ
記憶部と上記外部メモリパツクとの電気的接続を
制御するゲート手段と、上記装置本体に装着され
た外部メモリパツクの交換を指示する指示手段と
、この指示手段からの指示により上記ゲート手段
による上記データ記憶部と上記外部メモリパツク
との電気的接続を遮断するゲート遮断手段とを具
備してなる外部メモリ制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8616386U JPS62198595U (ja) | 1986-06-06 | 1986-06-06 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8616386U JPS62198595U (ja) | 1986-06-06 | 1986-06-06 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62198595U true JPS62198595U (ja) | 1987-12-17 |
Family
ID=30942220
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8616386U Pending JPS62198595U (ja) | 1986-06-06 | 1986-06-06 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62198595U (ja) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58118078A (ja) * | 1981-12-29 | 1983-07-13 | Fanuc Ltd | メモリカセツトの信号・電源供給方式 |
-
1986
- 1986-06-06 JP JP8616386U patent/JPS62198595U/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS58118078A (ja) * | 1981-12-29 | 1983-07-13 | Fanuc Ltd | メモリカセツトの信号・電源供給方式 |
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