JPH0299423U - - Google Patents
Info
- Publication number
- JPH0299423U JPH0299423U JP603489U JP603489U JPH0299423U JP H0299423 U JPH0299423 U JP H0299423U JP 603489 U JP603489 U JP 603489U JP 603489 U JP603489 U JP 603489U JP H0299423 U JPH0299423 U JP H0299423U
- Authority
- JP
- Japan
- Prior art keywords
- storage medium
- voltage
- main body
- interface circuit
- connects
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
- Power Sources (AREA)
- Stored Programmes (AREA)
Description
第１図は本考案の一実施例を示す回路構成図で
ある。 １……本体、２，７……データバス、３，８…
…アドレスバス、４，９……信号バス、５……バ
スラインバツフア、５２，５３……アンド回路、
６……ＲＡＭカード、１０……電源オンオフ回路
、１２……スイツチ。
ある。 １……本体、２，７……データバス、３，８…
…アドレスバス、４，９……信号バス、５……バ
スラインバツフア、５２，５３……アンド回路、
６……ＲＡＭカード、１０……電源オンオフ回路
、１２……スイツチ。
Claims (1)
- 本体と外部記憶媒体を接続するインターフエー
ス回路において、上記外部記憶媒体を本体に着脱
する時のみ動作されるスイツチ手段と、このスイ
ツチ手段の動作により上記記憶媒体側の各バスラ
インを固定レベルの電圧に設定する電圧設定手段
とを具備したことを特徴とするインターフエース
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP603489U JPH0299423U (ja) | 1989-01-24 | 1989-01-24 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP603489U JPH0299423U (ja) | 1989-01-24 | 1989-01-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0299423U true JPH0299423U (ja) | 1990-08-08 |
Family
ID=31209927
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP603489U Pending JPH0299423U (ja) | 1989-01-24 | 1989-01-24 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0299423U (ja) |
-
1989
- 1989-01-24 JP JP603489U patent/JPH0299423U/ja active Pending
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