JPS62161414U - - Google Patents

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JPS62161414U
JPS62161414U JP5053186U JP5053186U JPS62161414U JP S62161414 U JPS62161414 U JP S62161414U JP 5053186 U JP5053186 U JP 5053186U JP 5053186 U JP5053186 U JP 5053186U JP S62161414 U JPS62161414 U JP S62161414U
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resistor
input terminal
input
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  • Control Of Amplification And Gain Control (AREA)

Description

【図面の簡単な説明】
第１図は本考案の第一実施例を示す回路図。第
２図は本考案の第二実施例を示す回路図。第３図
および第４図はそれぞれ従来例を示す回路図。 １…可変利得増幅回路、２…ピーク検出回路、
３…差動増幅器、４，５，６，８，９，１０，１
３，１４…抵抗器、７…ＮＰＮトランジスタ、１
１…コンデンサ、１２…ＰＮＰトランジスタ、１
５…ダイオード、１００…入力信号、１０１…出
力信号、１０２…ピーク検出信号、ａ…正電圧電
源端子、ｂ…負電圧電源端子、ｃ，ｄ…点。

Claims (1)

  1. 【実用新案登録請求の範囲】 可変利得増幅回路と、この可変利得増幅回路の
    出力信号の振幅値を検出するピーク検出回路と、
    このピーク検出回路からのピーク検出信号を上記
    可変利得増幅回路の制御入力に帰還する負帰還回
    路とを備え、 上記負帰還回路は、一方の入力端子が接地電位
    以外の所定の参照電位に保持され他方の入力端子
    に入力回路を介して上記ピーク検出信号を供給す
    るトランジスタ回路が接続された差動増幅器を含
    む自動利得制御回路において、 上記入力回路は、一端が上記トランジスタ回路
    が他端が上記差動増幅器の他方の入力端子にそれ
    ぞれ接続された第一の抵抗器９と、一端が上記差
    動増幅器の他方の入力端子に他端が接地電位にそ
    れぞれ接続されたコンデンサとを有し、 抵抗値が上記第一の抵抗器の抵抗値よりも小さ
    い第二の抵抗器５とダイオードとの直列接続回路
    が上記第一の抵抗器の両端に並列に接続された ことを特徴とする自動利得制御回路。
JP5053186U 1986-04-04 1986-04-04 Expired - Lifetime JPH0522974Y2 (ja)

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JP5053186U JPH0522974Y2 (ja) 1986-04-04 1986-04-04

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JPS62161414U true JPS62161414U (ja) 1987-10-14
JPH0522974Y2 JPH0522974Y2 (ja) 1993-06-14

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