JPH01111325U - - Google Patents
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- Publication number
- JPH01111325U JPH01111325U JP345988U JP345988U JPH01111325U JP H01111325 U JPH01111325 U JP H01111325U JP 345988 U JP345988 U JP 345988U JP 345988 U JP345988 U JP 345988U JP H01111325 U JPH01111325 U JP H01111325U
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- JP
- Japan
- Prior art keywords
- power supply
- differential amplifier
- voltage
- reference voltage
- supply voltage
- Prior art date
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- Pending
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- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案の１実施例のリセツト回路図、
第２図はロジツク回路を使用して構成した本考案
の実施例の回路図である。 １，２，３，４…ＮＰＮ形トランジスタ、５，
６…ＰＮＰ形トランジスタ、７，８，９，１０，
１１，１２，１３，２３，２４，２５，２６…抵
抗体、１４，１５，１６…定電流源、Ｖ１７，Ｖ
１８，Ｖ３０，Ｖ３１…比較電圧、Ｖｒｅｆ１９
，Ｖｒｅｆ２７…基準電圧、２０，２９…出力電
圧端子、２１…第１のコンパレータ、２２…第２
のコンパレータ、２８…ＯＲ回路。
第２図はロジツク回路を使用して構成した本考案
の実施例の回路図である。 １，２，３，４…ＮＰＮ形トランジスタ、５，
６…ＰＮＰ形トランジスタ、７，８，９，１０，
１１，１２，１３，２３，２４，２５，２６…抵
抗体、１４，１５，１６…定電流源、Ｖ１７，Ｖ
１８，Ｖ３０，Ｖ３１…比較電圧、Ｖｒｅｆ１９
，Ｖｒｅｆ２７…基準電圧、２０，２９…出力電
圧端子、２１…第１のコンパレータ、２２…第２
のコンパレータ、２８…ＯＲ回路。
Claims (1)
- 基準電圧源と、第１、第２の２個の差動増幅器
と、電源電圧を抵抗で分圧して得られる比較電圧
の回路部とを有し、前記第１の差動増幅器は、そ
の＋入力端子が前記基準電圧源に接続されかつ−
入力端子が電源電圧の正常な時に基準電圧より大
きい比較電圧の回路部に接続され、前記第２の差
動増幅器は、その＋入力端子が電源電圧の正常な
時に基準電圧より小さい比較電圧の回路部に接続
されかつ−入力端子が基準電圧源に接続されてお
り、これら第１、第２の差動増幅器の出力はそれ
ぞれオープンコレクタ構成となつており、コレク
タの負荷を共通としてＯＲ機能を有することを特
徴とする電源電圧変動式リセツト回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP345988U JPH01111325U (ja) | 1988-01-14 | 1988-01-14 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP345988U JPH01111325U (ja) | 1988-01-14 | 1988-01-14 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01111325U true JPH01111325U (ja) | 1989-07-27 |
Family
ID=31205110
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP345988U Pending JPH01111325U (ja) | 1988-01-14 | 1988-01-14 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01111325U (ja) |
-
1988
- 1988-01-14 JP JP345988U patent/JPH01111325U/ja active Pending