JPS62133894A - 分割型デイジタル構内交換装置 - Google Patents
分割型デイジタル構内交換装置Info
- Publication number
- JPS62133894A JPS62133894A JP27455085A JP27455085A JPS62133894A JP S62133894 A JPS62133894 A JP S62133894A JP 27455085 A JP27455085 A JP 27455085A JP 27455085 A JP27455085 A JP 27455085A JP S62133894 A JPS62133894 A JP S62133894A
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- Sub-Exchange Stations And Push- Button Telephones (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は分割型ディジタル構内交換装置に関する。
１′従来の技術〕
一般にディジタル構内交換装置には電話機のみならず各
種データ端末も収容され、それらの制御が行われており
、ディジタル横内交換装置と音声系電話機及びデータ端
末間での伝送損失及び信号受信能力で線路距離に制限が
出てくる。このディジタル構内交換装置では、電話機及
び各種データ端末はすべて該構内交換装置に集中的に接
続されているので、そのゲーブル覗は争なる音声系交換
装置より増大の傾向にある。
種データ端末も収容され、それらの制御が行われており
、ディジタル横内交換装置と音声系電話機及びデータ端
末間での伝送損失及び信号受信能力で線路距離に制限が
出てくる。このディジタル構内交換装置では、電話機及
び各種データ端末はすべて該構内交換装置に集中的に接
続されているので、そのゲーブル覗は争なる音声系交換
装置より増大の傾向にある。
従来、この種のディジタル構内交換装置においては、ラ
イン回路、各種トランク、中央処理装置。
イン回路、各種トランク、中央処理装置。
゛メモリ等はそれぞれユニット化されてすべて同−架枠
内に収容され、電源装置とともに併置され、電話代及び
各種データ端末は該構内交換装置の１ケ所に集結接続さ
れて交換接続を行っていた。
内に収容され、電源装置とともに併置され、電話代及び
各種データ端末は該構内交換装置の１ケ所に集結接続さ
れて交換接続を行っていた。
１］発明が解決しようとする問題点〕
上述した従来のディジタル横内交換装置は、一体型であ
るため、電源装置及び本配線盤等の必要装置を併置でき
る交換機室等の専用室を設ける必要がある。また、ユニ
ッＩ・化された各機器がすべて同−架枠内に実装される
ので、ディジタル通話信号伝送路における雑音、レベル
変動、伝送損失か少ないというディジタル交換の特長か
生かされないに点があった。
るため、電源装置及び本配線盤等の必要装置を併置でき
る交換機室等の専用室を設ける必要がある。また、ユニ
ッＩ・化された各機器がすべて同−架枠内に実装される
ので、ディジタル通話信号伝送路における雑音、レベル
変動、伝送損失か少ないというディジタル交換の特長か
生かされないに点があった。
［問題点を解決するための手段〕
本発明の分割型ディジタル構内交換装置は、ライン回路
とその制御回路を含む第１のブロックと、各種トランク
とその制御回路を含む第２のプロ・７りと、中央処理装
置とメモリと時分割スイ・・Ｉチを含む第３のブロック
とに分割し、前記第１．第２゜第３のブロックをそれぞ
れ別枠に実装しこれら枠間をディジタル回線で結合して
いる。
とその制御回路を含む第１のブロックと、各種トランク
とその制御回路を含む第２のプロ・７りと、中央処理装
置とメモリと時分割スイ・・Ｉチを含む第３のブロック
とに分割し、前記第１．第２゜第３のブロックをそれぞ
れ別枠に実装しこれら枠間をディジタル回線で結合して
いる。
し実施例Ｉ
次に、本発明について図面を参照して説明する７第１図
は本発明の分割型ディジタル構内交換装置の一実施例を
示すプロ・ツク実装図、第２図は第１図における各小プ
ロ・ツクを組み合わせてなるディジタル横内交換装置の
一例を示すブロック図である。
は本発明の分割型ディジタル構内交換装置の一実施例を
示すプロ・ツク実装図、第２図は第１図における各小プ
ロ・ツクを組み合わせてなるディジタル横内交換装置の
一例を示すブロック図である。
第１図において、（ａ）、（ｂ）、（ｃ）はそれぞれ第
１プロ・・ｌり（以下ＳＢ）、第２ブロツク（以ＦＳＢ
Ｍ）、第３ブロツク（以下Ｍ Ｂ ）を示す。
１プロ・・ｌり（以下ＳＢ）、第２ブロツク（以ＦＳＢ
Ｍ）、第３ブロツク（以下Ｍ Ｂ ）を示す。
ＳＢＩは数回路のライン回路（データ端末用回路を古む
）又はレジスタセンダ回路（以下ＬＣ又はＲＳＴ）と、
これを制御する通話路制御部（以下５ＰＣ）と、ディジ
タル信号送受信回路（以下ＤＲＶ・ＲＣＶ）と、交流・
直流電源装置（以下ＡＣ−ＤＣ）と、外部ケーブル接続
端子（以下ＴＥＲＭ）とを１つの小形枠に実装して１ブ
ロツクを構成している。
）又はレジスタセンダ回路（以下ＬＣ又はＲＳＴ）と、
これを制御する通話路制御部（以下５ＰＣ）と、ディジ
タル信号送受信回路（以下ＤＲＶ・ＲＣＶ）と、交流・
直流電源装置（以下ＡＣ−ＤＣ）と、外部ケーブル接続
端子（以下ＴＥＲＭ）とを１つの小形枠に実装して１ブ
ロツクを構成している。
また、Ｓ Ｂ Ｍ ２は数回路の各種トランク回路（以
下ＴＲＫ）と、ｓｐｃと、ＤＲＶ・Ｒ，ＣＶと、ＡＣ−
ＤＣと、Ｔ Ｅ ＲＭとを１つの小形枠に実装してＪブ
ロックを構成している。
下ＴＲＫ）と、ｓｐｃと、ＤＲＶ・Ｒ，ＣＶと、ＡＣ−
ＤＣと、Ｔ Ｅ ＲＭとを１つの小形枠に実装してＪブ
ロックを構成している。
更に、ＭＢ３は中央処理装置（以下ＣＰＵ）と、メモリ
部（以下ＭＥＭ＞と、監視回路・マンマシンインタフェ
ース制御回路・時分割スイッチ（以下ＳＵＰ・ｌ ＱＣ
−ＴＤＳＷ）と、ＤＲ，Ｖ−ＲＣＶと、ＡＣ−ＤＣと、
ＴＥＲＭとを１つの小形枠に実装して１制御ブロツクを
構成している。
部（以下ＭＥＭ＞と、監視回路・マンマシンインタフェ
ース制御回路・時分割スイッチ（以下ＳＵＰ・ｌ ＱＣ
−ＴＤＳＷ）と、ＤＲ，Ｖ−ＲＣＶと、ＡＣ−ＤＣと、
ＴＥＲＭとを１つの小形枠に実装して１制御ブロツクを
構成している。
第２図に示すようにｍ個の５ＢＩ１．〜５８１ｍとｎ１
Ｉｌｉｌの９８Ｍ２１．〜ＳＢＭ２ｎをそれぞれ時分割
ディジタル回線４１．〜４ｍ、５１．〜５ｎを介してＭ
Ｂ ３と接続してディジタル構内交換装置を構成すれ
ば、ＭＢ３とＴＤＳＷには各５Ｂ１１、〜ＳＢ１ｍのＬ
Ｃ又はＲＳＴ及び９８Ｍ２１゜〜２ｎのＴ ＲＫが時分
割ディジタル回線によりディジタル信号で直結され、各
テロツクＳＢ１．ＳＢＭ２．ＭＢ３のＤＲＶ 、ＲＣＶ
（第１図に図示）間で数本の制御線により制御信号の
送受信が行われる。
Ｉｌｉｌの９８Ｍ２１．〜ＳＢＭ２ｎをそれぞれ時分割
ディジタル回線４１．〜４ｍ、５１．〜５ｎを介してＭ
Ｂ ３と接続してディジタル構内交換装置を構成すれ
ば、ＭＢ３とＴＤＳＷには各５Ｂ１１、〜ＳＢ１ｍのＬ
Ｃ又はＲＳＴ及び９８Ｍ２１゜〜２ｎのＴ ＲＫが時分
割ディジタル回線によりディジタル信号で直結され、各
テロツクＳＢ１．ＳＢＭ２．ＭＢ３のＤＲＶ 、ＲＣＶ
（第１図に図示）間で数本の制御線により制御信号の
送受信が行われる。
なお、各ブロックＳＢＩ １．−３Ｂ１ｎはそれぞれに
接続される電話機（以装置）やデータ端末装置（以下Ｄ
ＴＥ）の設置場所の近くに設置する。また各ブロックＳ
Ｂ１．．ＳＢＭ２．ＭＢ３のＡＣ−ＤＣ（第１図に図示
）はＡＣｌｏｏＶから一４８Ｖ、 ＋５Ｖ等の各種直流
電圧および発信音１話中信号等の各種信号を得る電源部
であり、必要があれば蓄電池を内蔵させる。特にＳＢ１
゜Ｓ Ｂ Ｍ ２においては容量の小さいものとなる。
接続される電話機（以装置）やデータ端末装置（以下Ｄ
ＴＥ）の設置場所の近くに設置する。また各ブロックＳ
Ｂ１．．ＳＢＭ２．ＭＢ３のＡＣ−ＤＣ（第１図に図示
）はＡＣｌｏｏＶから一４８Ｖ、 ＋５Ｖ等の各種直流
電圧および発信音１話中信号等の各種信号を得る電源部
であり、必要があれば蓄電池を内蔵させる。特にＳＢ１
゜Ｓ Ｂ Ｍ ２においては容量の小さいものとなる。
［発明の効果〕
以上説明したように本発明は、ディジタル構内交換装置
全体に対する機器占有率で７０〜ｓ Ｏｑ６にもなるラ
イン回路やトランク回路を小プロ・ツクに分割してそれ
ぞれ別枠に実装し、これらを電話機等の近くに設置して
中間端末化し、制御ブロック内の時分割スイッチのディ
ジタル伝送距離を延長接続することにより、ディジタル
交換の特長を生かした上、ライン回路、トランク回路等
とそれらの制御回路間は同一ブロック内の接続となりケ
ーブル量が大幅に削減されるのでケーブル布設工事等の
経済化が実現されるばかりでなく、制御ブロックが小形
されるため特に交換機専用室が不要となるので床面積は
大幅に削減される効果かある。
全体に対する機器占有率で７０〜ｓ Ｏｑ６にもなるラ
イン回路やトランク回路を小プロ・ツクに分割してそれ
ぞれ別枠に実装し、これらを電話機等の近くに設置して
中間端末化し、制御ブロック内の時分割スイッチのディ
ジタル伝送距離を延長接続することにより、ディジタル
交換の特長を生かした上、ライン回路、トランク回路等
とそれらの制御回路間は同一ブロック内の接続となりケ
ーブル量が大幅に削減されるのでケーブル布設工事等の
経済化が実現されるばかりでなく、制御ブロックが小形
されるため特に交換機専用室が不要となるので床面積は
大幅に削減される効果かある。
【図面の簡単な説明】
第１図は本発明の分割型ディジタル構内交換装置の一実
施例を示すブロック実装図、第２図は第１図における各
小ブロックを組み合わせてなるディジタル構内交換装置
の一例を示すブロック図である。 １ 、１１ 、〜１ ｍ−＝第１プロ”／り（ＳＢ）、
２゜２１、〜２ ｎ・・・第２ブロツク（ＳＢＭ＞−３
・・・第３ブ０ ツク（Ｍ Ｂ ） 、４１ 、〜４
ｍ 、 ５１ 、〜５ｎ・・・時分割ティジタル回線。 代理人 弁理士 内 原 音 第１図
施例を示すブロック実装図、第２図は第１図における各
小ブロックを組み合わせてなるディジタル構内交換装置
の一例を示すブロック図である。 １ 、１１ 、〜１ ｍ−＝第１プロ”／り（ＳＢ）、
２゜２１、〜２ ｎ・・・第２ブロツク（ＳＢＭ＞−３
・・・第３ブ０ ツク（Ｍ Ｂ ） 、４１ 、〜４
ｍ 、 ５１ 、〜５ｎ・・・時分割ティジタル回線。 代理人 弁理士 内 原 音 第１図
Claims (1)
- ライン回路とその制御回路を含む第１のブロックと、各
種トランクとその制御回路を含む第２のブロックと、中
央処理装置とメモリと時分割スイッチを含む第３のブロ
ックとに分割し、前記第１、第２、第３のブロックをそ
れぞれ別枠に実装しこれら枠間をディジタル回線で結合
してなることを特徴とする分割型ディジタル構内交換装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27455085A JPS62133894A (ja) | 1985-12-05 | 1985-12-05 | 分割型デイジタル構内交換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27455085A JPS62133894A (ja) | 1985-12-05 | 1985-12-05 | 分割型デイジタル構内交換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62133894A true JPS62133894A (ja) | 1987-06-17 |
Family
ID=17543281
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27455085A Pending JPS62133894A (ja) | 1985-12-05 | 1985-12-05 | 分割型デイジタル構内交換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62133894A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60117991A (ja) * | 1983-11-30 | 1985-06-25 | Hitachi Ltd | 分散制御交換方式 |
-
1985
- 1985-12-05 JP JP27455085A patent/JPS62133894A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60117991A (ja) * | 1983-11-30 | 1985-06-25 | Hitachi Ltd | 分散制御交換方式 |
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