JPS62133542A - バツクアツプメモリ制御方式 - Google Patents
バツクアツプメモリ制御方式Info
- Publication number
- JPS62133542A JPS62133542A JP60273977A JP27397785A JPS62133542A JP S62133542 A JPS62133542 A JP S62133542A JP 60273977 A JP60273977 A JP 60273977A JP 27397785 A JP27397785 A JP 27397785A JP S62133542 A JPS62133542 A JP S62133542A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- data
- transfer
- memory
- signal
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明はバックアップメモリ制御方式に関し、特に蓄積
プログラム制御システムのファイルメ［りの揮発性保護
回路メモリを具備しｌｃバックアップファイルメモリの
バックアップメモリ制御方式従来、蓄積プログラムメモ
リ装置のシステムに使用され、プログラムやデータなど
を格納している主記憶装置は主として高速読み／壽き動
作が可能’ｊ ＲＡＭ（ランダムアクセスメモリ）集積
回路により構成されている。しかし、ＲへＭは電源断し
た時に内容がすべて消滅してしまう性質、すなわち揮発
性をもっているため、プログラムやデータを常にファイ
ルメモリ装置にセーブして４３ ＜必要があるが、ファ
イルメモリ装置が同様に揮発性メモリを使用しているた
め、ファイルメモリ装置のバックアップメモリ用として
固定ディスクに常に書込む動作が必要である。
プログラム制御システムのファイルメ［りの揮発性保護
回路メモリを具備しｌｃバックアップファイルメモリの
バックアップメモリ制御方式従来、蓄積プログラムメモ
リ装置のシステムに使用され、プログラムやデータなど
を格納している主記憶装置は主として高速読み／壽き動
作が可能’ｊ ＲＡＭ（ランダムアクセスメモリ）集積
回路により構成されている。しかし、ＲへＭは電源断し
た時に内容がすべて消滅してしまう性質、すなわち揮発
性をもっているため、プログラムやデータを常にファイ
ルメモリ装置にセーブして４３ ＜必要があるが、ファ
イルメモリ装置が同様に揮発性メモリを使用しているた
め、ファイルメモリ装置のバックアップメモリ用として
固定ディスクに常に書込む動作が必要である。
このような装置では、ファイルメ゛ｔり装置から固定デ
ィスク装置への書込みは固定ディスク装置の転送動作が
低速であるため、書込み動作が終了するまで次アクセス
は侍ら合せられ、侍ら合Ｕ中に電源断になったりすると
持ら合けられていたデータ（、Ｌ書込められず、最新情
報が１１られないという欠点がある。
ィスク装置への書込みは固定ディスク装置の転送動作が
低速であるため、書込み動作が終了するまで次アクセス
は侍ら合せられ、侍ら合Ｕ中に電源断になったりすると
持ら合けられていたデータ（、Ｌ書込められず、最新情
報が１１られないという欠点がある。
発明の目的
本発明は上記のよう４丁従来のものの欠点を除去すべく
なされたもので、バッファ回路を２面以上持たせること
により一方のバッファ回路が転送中ぐも他方により最新
データの占込み読出しができるバツクアツプメ−しり制
御方式を提供す゛ることを目的としている。
なされたもので、バッファ回路を２面以上持たせること
により一方のバッファ回路が転送中ぐも他方により最新
データの占込み読出しができるバツクアツプメ−しり制
御方式を提供す゛ることを目的としている。
発明の構成
本発明によるバックアップメモリ制御方式は、揮発性メ
モリのメモリ内容をディスク装■に書込むことによって
メモリバックアップをなすようにしｌζバックアップメ
モリ制御方式であって、複数のバッファを設け、前記揮
発性メモリの内容を順次読出して前記バッファの各々へ
占込み、前記バッファの各々に泪込まれた内容を前記デ
ィスク装置へ順次書込み制御するようにしたことを特徴
とする。
モリのメモリ内容をディスク装■に書込むことによって
メモリバックアップをなすようにしｌζバックアップメ
モリ制御方式であって、複数のバッファを設け、前記揮
発性メモリの内容を順次読出して前記バッファの各々へ
占込み、前記バッファの各々に泪込まれた内容を前記デ
ィスク装置へ順次書込み制御するようにしたことを特徴
とする。
実施例
次に本発明の実施例を示した図面を参照して、本発明を
より詳細に説明する。
より詳細に説明する。
第１図は本発明によるバックアップメモリ制御方式の一
実施例を示すブロック図である。ホストシステム１は本
システムのプロセッサを示し、揮発性メ℃す２は本シス
テムの主記憶ｉ置で書込制御回路３よりホストシステム
１の指示によりデータを蓄える。アンドゲート回路４及
びアンドゲート回路５はバッフ２回路６及びバッファ回
路７への入力ゲートである。アンドゲート回路８及びア
ントゲ−１−回路９はバッファ回路６及びバッファ回路
７の出力ゲートである。バッファ回路６及びバッファ回
路７は揮発性メモリ２よりのデータを一担蓄えるバッフ
ァ回路である。、Ａアゲート回路１６は両出力ゲート８
及び９の出力を２人力とするゲートである。固定ディス
ク１０は揮発性メモリのバックアップ用メモリである。
実施例を示すブロック図である。ホストシステム１は本
システムのプロセッサを示し、揮発性メ℃す２は本シス
テムの主記憶ｉ置で書込制御回路３よりホストシステム
１の指示によりデータを蓄える。アンドゲート回路４及
びアンドゲート回路５はバッフ２回路６及びバッファ回
路７への入力ゲートである。アンドゲート回路８及びア
ントゲ−１−回路９はバッファ回路６及びバッファ回路
７の出力ゲートである。バッファ回路６及びバッファ回
路７は揮発性メモリ２よりのデータを一担蓄えるバッフ
ァ回路である。、Ａアゲート回路１６は両出力ゲート８
及び９の出力を２人力とするゲートである。固定ディス
ク１０は揮発性メモリのバックアップ用メモリである。
入力ゲート信号１１はゲート回路４及びゲート回路５０
選択信号である。出力ブート信号１２はグー１〜回路８
及びゲート回路９の選択信号である。
選択信号である。出力ブート信号１２はグー１〜回路８
及びゲート回路９の選択信号である。
転送完了信号１３は揮発性メモリ２．バッファ回路６．
バッファ回路７及び固定ディスク１０への転送が完了し
に時用る信号である。書込指示信号１４は揮発性メモリ
２．バッファ回路６．バッファ回路７及び固定ディスク
１０への書込指示を与える信号である。データ信＠１５
は揮発性メモリ２へのデータである。
バッファ回路７及び固定ディスク１０への転送が完了し
に時用る信号である。書込指示信号１４は揮発性メモリ
２．バッファ回路６．バッファ回路７及び固定ディスク
１０への書込指示を与える信号である。データ信＠１５
は揮発性メモリ２へのデータである。
ホス１〜システム１より書込制御回路３に書込指示信号
１４を送出すると、データ信号１５よりＩ込制御回路３
を経由して揮発性メモリ２にデータを転送する。転送終
了により書込ｔ、ｌＩ御回路３より転送完了信号１３を
ホス１へシステム１へ送出すると、■込制御回路３はゲ
ート回路４の入力ゲート信号１１を有効にし揮発性メＥ
す２よりデータをバッファ回路６へ書込み、転送が終了
しだら書込制御回路３より転送完了信号１３をホストシ
ステム１へ返送するど共に書込制御回路３より固定ディ
スク１０のゲート回路８の出力ゲート信号１２をイ１効
にし〔、固定ディスク１０ヘデータ転送を行い、転送が
終了した侵、書込制御回路３よりホストシステム１に転
送完了信号１３を返送する。
１４を送出すると、データ信号１５よりＩ込制御回路３
を経由して揮発性メモリ２にデータを転送する。転送終
了により書込ｔ、ｌＩ御回路３より転送完了信号１３を
ホス１へシステム１へ送出すると、■込制御回路３はゲ
ート回路４の入力ゲート信号１１を有効にし揮発性メＥ
す２よりデータをバッファ回路６へ書込み、転送が終了
しだら書込制御回路３より転送完了信号１３をホストシ
ステム１へ返送するど共に書込制御回路３より固定ディ
スク１０のゲート回路８の出力ゲート信号１２をイ１効
にし〔、固定ディスク１０ヘデータ転送を行い、転送が
終了した侵、書込制御回路３よりホストシステム１に転
送完了信号１３を返送する。
次に新しいデータを占込む時（よ前記同様、ホストシス
テム１より書込制御回路３に書込指示信号１／Ｉを送出
すると、データ信号１５より書込制御３を経由して揮発
性メモリ２ヘデータ転送を行い、データの転送が終了す
ると転送完了信号１３をホストシステム１へ返送し、書
込制御回路３はバッファ回路６ど固定ディスク１０との
間が転送中であるか判断する。転送４１であればバッフ
ァ回路７のゲート回路５の入力ゲート信号１１を有効に
し、揮発性メモリ２のデータをバッファ回路７へ転送を
行い、転送が終了すれば書込制御回路３よりホス１〜シ
ステム１へ転送完了信号１３を返送する。
テム１より書込制御回路３に書込指示信号１／Ｉを送出
すると、データ信号１５より書込制御３を経由して揮発
性メモリ２ヘデータ転送を行い、データの転送が終了す
ると転送完了信号１３をホストシステム１へ返送し、書
込制御回路３はバッファ回路６ど固定ディスク１０との
間が転送中であるか判断する。転送４１であればバッフ
ァ回路７のゲート回路５の入力ゲート信号１１を有効に
し、揮発性メモリ２のデータをバッファ回路７へ転送を
行い、転送が終了すれば書込制御回路３よりホス１〜シ
ステム１へ転送完了信号１３を返送する。
書込１ｄｌ ＩＥ回路３はゲート回路９の出力ゲート信
号１２を有効にして固定ディスク１０にデータ転）スを
行い、転送が終了した時点で転送完了信号１３をホス１
−システム１に返送を行う。ここでバッファ回路６ど固
定ディスク１０の間が転送中で４ｊりれば同一ゲート回
路４を選択し、バッファ回路６を使用して固定ディスク
１０へ転送づ゛る。
号１２を有効にして固定ディスク１０にデータ転）スを
行い、転送が終了した時点で転送完了信号１３をホス１
−システム１に返送を行う。ここでバッファ回路６ど固
定ディスク１０の間が転送中で４ｊりれば同一ゲート回
路４を選択し、バッファ回路６を使用して固定ディスク
１０へ転送づ゛る。
従来方式では、バッファが１１ｉに一面のみであったの
で、このバッファと固定ディスクとの間のデ−夕転送が
完了するまでは、ホストシステムは揮発性メモリに対し
てのデータアクセスができず待つ必要があったが、本発
明の如く、２面以上のバッファを設（）ることにより、
１つのバッファが固定ディスクとデータの転送中であっ
ても、ボス１へシステム【、Ｌ揮発性メモリに対しＣデ
ータアクセスを１１って伯のバッファへ当該データを転
送可能となる。よって、ホストシステムはデータアクセ
スを何等侍ら合けることなく続行可能となって、固定デ
ィスクへは常に最新データが書込み可能どなるのである
。
で、このバッファと固定ディスクとの間のデ−夕転送が
完了するまでは、ホストシステムは揮発性メモリに対し
てのデータアクセスができず待つ必要があったが、本発
明の如く、２面以上のバッファを設（）ることにより、
１つのバッファが固定ディスクとデータの転送中であっ
ても、ボス１へシステム【、Ｌ揮発性メモリに対しＣデ
ータアクセスを１１って伯のバッファへ当該データを転
送可能となる。よって、ホストシステムはデータアクセ
スを何等侍ら合けることなく続行可能となって、固定デ
ィスクへは常に最新データが書込み可能どなるのである
。
発明の詳細
な説明したように、本発明によれば、バッファ回路を２
面以上待たせることにより一方のバッファ回路が転送中
でも他方のバッファ回路に’Ｆ −タを予め転送してお
くことにより、ホストシステムからのアクヒスを何等侍
ら合せることなく、最新データを常に固定ディスク上に
書込めるという効果がある。
面以上待たせることにより一方のバッファ回路が転送中
でも他方のバッファ回路に’Ｆ −タを予め転送してお
くことにより、ホストシステムからのアクヒスを何等侍
ら合せることなく、最新データを常に固定ディスク上に
書込めるという効果がある。
１１１図は本発明のブロック図である。
主要部分の符号の説明
１・・・・・・ホス１−システム
２・・・・・・揮発性メモリ
３・・・・・・丙込制伶０回路
６．７・・・・・・バッファ回路
１０・・・・・・固定ディスク
Claims (1)
- 揮発性メモリのメモリ内容をディスク装置に書込むこと
によってメモリバックアップをなすようにしたバックア
ップメモリ制御方式であって、複数のバッファを設け、
前記揮発性メモリの内容を順次読出して前記バッファの
各々へ書込み、前記バッファの各々に書込まれた内容を
前記ディスク装置へ順次書込み制御するようにしたこと
を特徴とするバックアップメモリ制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60273977A JPS62133542A (ja) | 1985-12-05 | 1985-12-05 | バツクアツプメモリ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60273977A JPS62133542A (ja) | 1985-12-05 | 1985-12-05 | バツクアツプメモリ制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62133542A true JPS62133542A (ja) | 1987-06-16 |
Family
ID=17535210
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60273977A Pending JPS62133542A (ja) | 1985-12-05 | 1985-12-05 | バツクアツプメモリ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62133542A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0736788A (ja) * | 1993-07-19 | 1995-02-07 | Nec Corp | 主記憶ファイルシステム |
-
1985
- 1985-12-05 JP JP60273977A patent/JPS62133542A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0736788A (ja) * | 1993-07-19 | 1995-02-07 | Nec Corp | 主記憶ファイルシステム |
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