JPS62104319A - アナログ・デイジタル変換器 - Google Patents
アナログ・デイジタル変換器Info
- Publication number
- JPS62104319A JPS62104319A JP24478085A JP24478085A JPS62104319A JP S62104319 A JPS62104319 A JP S62104319A JP 24478085 A JP24478085 A JP 24478085A JP 24478085 A JP24478085 A JP 24478085A JP S62104319 A JPS62104319 A JP S62104319A
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- JP
- Japan
- Prior art keywords
- analog
- circuit
- input
- arithmetic
- channel
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はマイクロ・コンピュータの入力に接続して利用
するに適するアナログ・ディジタル変換器に関する。
するに適するアナログ・ディジタル変換器に関する。
複数のアナログ入力チャンネルを備え、この複数のアナ
ログ人力チャンネルを選択してアナログ・ディジタル変
換装置において、 各アナログ入力チャンネルにサンプル・ホールド回路を
挿入し、アナログ・ディジタル変換回路の後に簡単な演
算回路を挿入することにより、複数のアナログ入力に対
する簡単な演算をアナログ・ディジタル変換と同時にで
きるようにしたものである。
ログ人力チャンネルを選択してアナログ・ディジタル変
換装置において、 各アナログ入力チャンネルにサンプル・ホールド回路を
挿入し、アナログ・ディジタル変換回路の後に簡単な演
算回路を挿入することにより、複数のアナログ入力に対
する簡単な演算をアナログ・ディジタル変換と同時にで
きるようにしたものである。
従来のアナログ入力チャンネルを複数持つアナログ・デ
ィジタル変換器では、外部よりそのアナログ入力チャン
ネルをその都度設定できる構成となっているものが知ら
れている。
ィジタル変換器では、外部よりそのアナログ入力チャン
ネルをその都度設定できる構成となっているものが知ら
れている。
第２図にその従来例アナログ・ディジタル変換器の構成
を示す。これは、マイコンインターフェイスを持つアナ
ログ・ディジタル変換器の例である。図面符号Ａ０〜Ａ
ゎはアナログ入力チャンネル、図面符号１はチャンネル
切換制御部、２はチャンネル切換回路、３はアナログ・
ディジタル変換回路、Ｄはデータ入出力線である。デー
タ入出力線りを通して、チャンネル選択データがチャン
ネル切換制御部１にセットされると、チャンネル切換回
路２が、アナログ入力チャンネルＡ ｏ ＝ Ａ −を
切換え、それぞれ一つのアナログ入力に対しアナログ・
ディジタル変換を実行する構成である。
を示す。これは、マイコンインターフェイスを持つアナ
ログ・ディジタル変換器の例である。図面符号Ａ０〜Ａ
ゎはアナログ入力チャンネル、図面符号１はチャンネル
切換制御部、２はチャンネル切換回路、３はアナログ・
ディジタル変換回路、Ｄはデータ入出力線である。デー
タ入出力線りを通して、チャンネル選択データがチャン
ネル切換制御部１にセットされると、チャンネル切換回
路２が、アナログ入力チャンネルＡ ｏ ＝ Ａ −を
切換え、それぞれ一つのアナログ入力に対しアナログ・
ディジタル変換を実行する構成である。
この従来のアナログ・ディジタル変換器は、アナログ入
力チャンネルの選択が任意に行えるが、複数のアナログ
入力を同時にサンプリングするためには、外部に専用の
回路が必要であり、また複数のアナログ入力チャンネル
に対するアナログ・ディジタル変換結果に対し、何らか
の演算、例えば、差・和などを演算する場合にはこの回
路の外部で行う必要があり、外部回路に対する負担が大
きくなる欠点があった。
力チャンネルの選択が任意に行えるが、複数のアナログ
入力を同時にサンプリングするためには、外部に専用の
回路が必要であり、また複数のアナログ入力チャンネル
に対するアナログ・ディジタル変換結果に対し、何らか
の演算、例えば、差・和などを演算する場合にはこの回
路の外部で行う必要があり、外部回路に対する負担が大
きくなる欠点があった。
たとえば変換データに対して演算を行う場合はすべて外
部回路マイコン内部にてそのプログラムで処理を行う必
要があった。
部回路マイコン内部にてそのプログラムで処理を行う必
要があった。
本発明は上記問題点を解決するものであり、マイクロコ
ンピュータの入力回路として便利であり、全体としてハ
ードウェア規模の低減が可能なアナログ・ディジタル変
換器を提供することを目的とする。
ンピュータの入力回路として便利であり、全体としてハ
ードウェア規模の低減が可能なアナログ・ディジタル変
換器を提供することを目的とする。
本発明は、複数のアナログ入力チャンネルと、この複数
のアナログ入力チャンネルを選択するチャンネル切換回
路と、このチャンネル切換回路の出力アナログ信号をデ
ィジタル信号に変換するアナログ・ディジタル変換回路
とを備えたアナログ・ディジタル変換器において、上記
複数のアナログ入力チャンネルの各々に対応して上記チ
ャンネル切換回路の入力に挿入されたサンプル・ホール
ド回路と、上記アナログ・ディジタル変換回路の出力に
接続されその出力を一時保持する記憶回路と、この記憶
回路の出力および上記アナログ・ディジタル変換回路の
出力を入力する演算回路と、外部制御入力にしたがって
この演算回路を制御する演算制御回路とを備えたことを
特徴とする。
のアナログ入力チャンネルを選択するチャンネル切換回
路と、このチャンネル切換回路の出力アナログ信号をデ
ィジタル信号に変換するアナログ・ディジタル変換回路
とを備えたアナログ・ディジタル変換器において、上記
複数のアナログ入力チャンネルの各々に対応して上記チ
ャンネル切換回路の入力に挿入されたサンプル・ホール
ド回路と、上記アナログ・ディジタル変換回路の出力に
接続されその出力を一時保持する記憶回路と、この記憶
回路の出力および上記アナログ・ディジタル変換回路の
出力を入力する演算回路と、外部制御入力にしたがって
この演算回路を制御する演算制御回路とを備えたことを
特徴とする。
アナログ入力チャンネルにサンプル・ホールド回路を設
けることにより、一つのアナログ・ディジタル変換周期
に複数の入力チャンネルをとり込むことができる。また
、アナログ・ディジタル変換回路の出力に簡単な記憶回
路および演算回路を設けることにより、ディジタル出力
を一時保持して、複数のディジタル出力について簡単な
演算を行うことができる。
けることにより、一つのアナログ・ディジタル変換周期
に複数の入力チャンネルをとり込むことができる。また
、アナログ・ディジタル変換回路の出力に簡単な記憶回
路および演算回路を設けることにより、ディジタル出力
を一時保持して、複数のディジタル出力について簡単な
演算を行うことができる。
この装置は一つの集積回路に形成して、同一の基板に配
置されたマイクロ・コンピュータの入力回路に利用する
場合には、マイクロ・コンピュータからの制御信号を利
用して、マイクロ・コンピュータの負担を軽減する有用
な回路となる。
置されたマイクロ・コンピュータの入力回路に利用する
場合には、マイクロ・コンピュータからの制御信号を利
用して、マイクロ・コンピュータの負担を軽減する有用
な回路となる。
次に本発明の実施例について図面を参照して説明する。
第１図は本発明の実施例を示すブロック構成図である。
アナログ入力チャンネルＡ０〜Ａ、ｌはそれぞれサンプ
ルホールド回路４゜〜４．．を介してチャンネル切換回
路２に入力する。このチャンネル切換回路２の出力はア
ナログ・ディジタル変換回路３を介して記憶回路５に入
力する。この記憶回路５の演算回路７を介する出力はデ
ータ入出力ｖＡＤであり、チャンネル制御部１および演
算制御部６に帰還入力する。この演算制御部６の出力は
記憶部５および演算回路７に帰還結合する。さらに上記
チャンネル制御部１の出力はチャンネル切換回路２およ
びサンプル・ホールド回路４゜〜４．。
ルホールド回路４゜〜４．．を介してチャンネル切換回
路２に入力する。このチャンネル切換回路２の出力はア
ナログ・ディジタル変換回路３を介して記憶回路５に入
力する。この記憶回路５の演算回路７を介する出力はデ
ータ入出力ｖＡＤであり、チャンネル制御部１および演
算制御部６に帰還入力する。この演算制御部６の出力は
記憶部５および演算回路７に帰還結合する。さらに上記
チャンネル制御部１の出力はチャンネル切換回路２およ
びサンプル・ホールド回路４゜〜４．。
のそれぞれに結合する。これらの各回路は一つの集積回
路として構成する。
路として構成する。
以下、ｎチャンネル中の任意の２チヤンネル、たとえば
アナログ人力チャンネルＡ（１、ＡＩを選択した場合の
動作について説明する。データ入出力ｖＡＤからチャン
ネル制御部１のアナログ入力チャンネルＡ ｏ 、Ａ
＋を選択するデータを入力すると、選択されたチャンネ
ルのアナログ入力は、サンプル・ホールド回路４゜〜４
．．により、それぞれサンプリングされ、アナログ入力
レベルを保持する。次にチャンネル制御部１はアナログ
入力チャンネルＡ０に対するチャンネル切換回路２の切
換えおよびアナログ・ディジタル変換のスタート指令を
アナログ・ディジタル変換回路３へ出し、変換されたデ
ータは切換回路５に記憶される。アナログ入力チャンネ
ルＡ、に対しても同様の動作を行う。選択されたアナロ
グ入力チャンネルＡ０、Ａ１の変換が終了するとデータ
入出力線りから演算制御部６へ人力されていた演算制御
データに従って演算回路７により計算されデータ入出力
線りより結果を出力する。
アナログ人力チャンネルＡ（１、ＡＩを選択した場合の
動作について説明する。データ入出力ｖＡＤからチャン
ネル制御部１のアナログ入力チャンネルＡ ｏ 、Ａ
＋を選択するデータを入力すると、選択されたチャンネ
ルのアナログ入力は、サンプル・ホールド回路４゜〜４
．．により、それぞれサンプリングされ、アナログ入力
レベルを保持する。次にチャンネル制御部１はアナログ
入力チャンネルＡ０に対するチャンネル切換回路２の切
換えおよびアナログ・ディジタル変換のスタート指令を
アナログ・ディジタル変換回路３へ出し、変換されたデ
ータは切換回路５に記憶される。アナログ入力チャンネ
ルＡ、に対しても同様の動作を行う。選択されたアナロ
グ入力チャンネルＡ０、Ａ１の変換が終了するとデータ
入出力線りから演算制御部６へ人力されていた演算制御
データに従って演算回路７により計算されデータ入出力
線りより結果を出力する。
以上説明したように、本発明はチャンネル選択データお
よびそのチャンネルへ入力されているアナログ入力レベ
ルに対する演算処理を専用の外付回路の必要がなく、単
純な外部からの制御信号により自由に行うことができる
。これにより装置全体のハードウェアの規模の低減が可
能である。また、本発明によるアナログ・ディジタル変
換器を一つの集積回路に構成し、マイコンと接続する場
合はマイコンの負担が軽減され、ひいてはシステムのパ
フォーマンスの向上に効果がある。
よびそのチャンネルへ入力されているアナログ入力レベ
ルに対する演算処理を専用の外付回路の必要がなく、単
純な外部からの制御信号により自由に行うことができる
。これにより装置全体のハードウェアの規模の低減が可
能である。また、本発明によるアナログ・ディジタル変
換器を一つの集積回路に構成し、マイコンと接続する場
合はマイコンの負担が軽減され、ひいてはシステムのパ
フォーマンスの向上に効果がある。
第１図は本発明実施例装置のブロック構成図。
第２図は従来例のブロック構成図。
Ａ０〜Ａ、、・・・アナログ入力チャンネル、Ｄ・・・
データ入出力線、Ｉ・・・チャンネル切換制御部、２・
・・チャンネル切換回路、３・・・アナログ・ディジタ
ル変換回路、４゜〜４７・・・サンプル・ホールド回路
、５・・・記憶回路、６・・・演算制御部、７・・・演
算回路。
データ入出力線、Ｉ・・・チャンネル切換制御部、２・
・・チャンネル切換回路、３・・・アナログ・ディジタ
ル変換回路、４゜〜４７・・・サンプル・ホールド回路
、５・・・記憶回路、６・・・演算制御部、７・・・演
算回路。
Claims (2)
- （１）複数のアナログ入力チャンネルと、 この複数のアナログ入力チャンネルを選択するチャンネ
ル切換回路と、 このチャンネル切換回路の出力アナログ信号をディジタ
ル信号に変換するアナログ・ディジタル変換回路と を備えたアナログ・ディジタル変換器において、上記複
数のアナログ入力チャンネルの各々に対応して上記チャ
ンネル切換回路の入力に挿入されたサンプル・ホールド
回路と、 上記アナログ・ディジタル変換回路の出力に接続されそ
の出力を一時保持する記憶回路と、この記憶回路の出力
および上記アナログ・ディジタル変換回路の出力を入力
する演算回路と、外部制御入力にしたがってこの演算回
路を制御する演算制御回路と を備えたことを特徴とするアナログ・ディジタル変換器
。 - （２）チャンネル切換回路、アナログ・ディジタル変換
回路、サンプル・ホールド回路、記憶回路、演算回路お
よび演算制御回路が一つの集積回路として形成された特
許請求の範囲第（１）項に記載のアナログ・ディジタル
変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24478085A JPS62104319A (ja) | 1985-10-31 | 1985-10-31 | アナログ・デイジタル変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24478085A JPS62104319A (ja) | 1985-10-31 | 1985-10-31 | アナログ・デイジタル変換器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62104319A true JPS62104319A (ja) | 1987-05-14 |
Family
ID=17123808
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24478085A Pending JPS62104319A (ja) | 1985-10-31 | 1985-10-31 | アナログ・デイジタル変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62104319A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63163190U (ja) * | 1987-07-07 | 1988-10-25 |
-
1985
- 1985-10-31 JP JP24478085A patent/JPS62104319A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63163190U (ja) * | 1987-07-07 | 1988-10-25 | ||
| JPH0514792Y2 (ja) * | 1987-07-07 | 1993-04-20 |
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