JPS6189741A - 双方向デ−タ伝送回路 - Google Patents
双方向デ−タ伝送回路Info
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- JPS6189741A JPS6189741A JP21108484A JP21108484A JPS6189741A JP S6189741 A JPS6189741 A JP S6189741A JP 21108484 A JP21108484 A JP 21108484A JP 21108484 A JP21108484 A JP 21108484A JP S6189741 A JPS6189741 A JP S6189741A
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- Japan
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- transmission
- transmission line
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
- H04L5/1423—Two-way operation using the same type of signal, i.e. duplex for simultaneous baseband signals
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Bidirectional Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、電圧の有無および方向性を有する電流の有無
の組合せを利用することにより、１本の伝送線で２値デ
ータの全２重通信を可能とした双方向データ伝送回路に
関する。
の組合せを利用することにより、１本の伝送線で２値デ
ータの全２重通信を可能とした双方向データ伝送回路に
関する。
現在の車載用オーディオシステムはカセット優先になっ
ているので、ラジオ受信中でもカセットデツキにカセッ
トバンクを挿入するとラジオ受信は中断され、代りにカ
セット演奏が開始される。
ているので、ラジオ受信中でもカセットデツキにカセッ
トバンクを挿入するとラジオ受信は中断され、代りにカ
セット演奏が開始される。
この状態はデツキ例の操作でカセットパンクを排出する
まで継続し、ラジオ受信機側のスイッチ操作で変更する
ことはできない。しかしながら、このような連動関係は
不便である。特にオーディオソースが３以上になると、
次に演奏を希望するソース側での操作によって現在演奏
中のソースを停止させ得ることが好ましい。かかるスイ
ッチング制御系を構成する際に、対向する装置間で相互
にＨ（ハイ） 、Ｌ （ロー）２値のデータを送受信す
る場合、その間の伝送線が第３図のように１本であれば
伝送ケーブル３上でのデータの衝突を避けるために、装
ｗ１，２の送信可能期間を互いに相手方からの受信デー
タがない時期に制限する必要が生ずる。装置１．２はそ
の入出力端だけを図示したもので、ＤＶＬＤＶ２は出力
へソファ（トライバ）、ＲＶ＋・、ＲＶ２は入力バッフ
ァ（レシバ゛２；、二ニーｙ；＝“：：７ぶれ 。
まで継続し、ラジオ受信機側のスイッチ操作で変更する
ことはできない。しかしながら、このような連動関係は
不便である。特にオーディオソースが３以上になると、
次に演奏を希望するソース側での操作によって現在演奏
中のソースを停止させ得ることが好ましい。かかるスイ
ッチング制御系を構成する際に、対向する装置間で相互
にＨ（ハイ） 、Ｌ （ロー）２値のデータを送受信す
る場合、その間の伝送線が第３図のように１本であれば
伝送ケーブル３上でのデータの衝突を避けるために、装
ｗ１，２の送信可能期間を互いに相手方からの受信デー
タがない時期に制限する必要が生ずる。装置１．２はそ
の入出力端だけを図示したもので、ＤＶＬＤＶ２は出力
へソファ（トライバ）、ＲＶ＋・、ＲＶ２は入力バッフ
ァ（レシバ゛２；、二ニーｙ；＝“：：７ぶれ 。
−プル信号である。送信イネーブル信号ＳＥＩ。
ＳＦ３は出カバソファＤＶ ＋ 、ＤＶ２を有効にする
ものであるが、それらは受信データＲＤ２．ＲＤ１が無
い状態でのみオンとなる。従って、伝送路上のデータフ
ォーマットは第４図のようになり、データＳＤＬＳＤ２
の衝突は回避される。尚、３１、Ｓ２はデータＳＤＬＳ
Ｄ２の送信開始ビット、Ｅｌ、Ｅ２は送信終了ビットで
ある。
ものであるが、それらは受信データＲＤ２．ＲＤ１が無
い状態でのみオンとなる。従って、伝送路上のデータフ
ォーマットは第４図のようになり、データＳＤＬＳＤ２
の衝突は回避される。尚、３１、Ｓ２はデータＳＤＬＳ
Ｄ２の送信開始ビット、Ｅｌ、Ｅ２は送信終了ビットで
ある。
上述した伝送方法では装置１．２が同時にデータを送信
することはできないので、＋１１伝送効率が悪＜ 、（
２１特にスイッチング制御系では制御のタイミングを逸
することがある、等の欠点を有する。
することはできないので、＋１１伝送効率が悪＜ 、（
２１特にスイッチング制御系では制御のタイミングを逸
することがある、等の欠点を有する。
本発明は、伝送線上の電圧の有無と、電圧有りの場合の
方向性を有する電流の有無との組合せを利用して、共通
の伝送線で双方向からＨ，Ｌ２値のデータを同時に伝送
可能とするものである。
方向性を有する電流の有無との組合せを利用して、共通
の伝送線で双方向からＨ，Ｌ２値のデータを同時に伝送
可能とするものである。
本発明は、対向する装置間を１本のデータ伝送′ 線”
で接続し、各装置内には、送信データＨで所定の電圧を
出力し、また送信データして抵抗接地されたアース電位
を出力する送信部と、該送信部から該伝送線側へ出力す
る電流の有無を検出する電流検出部と、該送信データの
Ｈ，Ｌと該電流検出部の出力と該伝送線上の電圧の有無
から受信データのＨ，Ｌを復調する復調部とを設け、該
装置間で同時にデータ伝送を行い得るようにしてなるこ
とを特徴とするものである。
で接続し、各装置内には、送信データＨで所定の電圧を
出力し、また送信データして抵抗接地されたアース電位
を出力する送信部と、該送信部から該伝送線側へ出力す
る電流の有無を検出する電流検出部と、該送信データの
Ｈ，Ｌと該電流検出部の出力と該伝送線上の電圧の有無
から受信データのＨ，Ｌを復調する復調部とを設け、該
装置間で同時にデータ伝送を行い得るようにしてなるこ
とを特徴とするものである。
送信データのＨを所定の電圧で出力し、また送信データ
のＬを抵抗接地したアース電位として出力すると、伝送
線上の電圧は送信データし、受信データＬのときのみ無
しとなる。また送信データが１１で受信データがしてあ
れば伝送線に向けて出力電流が流れるので、電流検出部
に出力が生ずる。
のＬを抵抗接地したアース電位として出力すると、伝送
線上の電圧は送信データし、受信データＬのときのみ無
しとなる。また送信データが１１で受信データがしてあ
れば伝送線に向けて出力電流が流れるので、電流検出部
に出力が生ずる。
従って、これらの条件下では受信データをＬとして復調
できる。これに対し、受信データがＨのときは送信デー
タのＨ，Ｌによらず伝送線上の電圧が有りとなるが、電
流検出部に出力は生じない□。
できる。これに対し、受信データがＨのときは送信デー
タのＨ，Ｌによらず伝送線上の電圧が有りとなるが、電
流検出部に出力は生じない□。
従って、この条件下では受信データをＨとして復調でき
る。下表はこの復調論理をまとめたものである。
る。下表はこの復調論理をまとめたものである。
表 １
但し、Ｌ＊は適当な抵抗（後述の負荷抵抗）で接地きれ
たアース電位を示す。また、送信型□圧は送信□データ
と同義であるが、受信信号は相手方の送信電圧を復調部
によってＨ，Ｌ２値に復調したものを指す。°以下、図
示の実施例を参照しながらこれを詳細に説明する。
たアース電位を示す。また、送信型□圧は送信□データ
と同義であるが、受信信号は相手方の送信電圧を復調部
によってＨ，Ｌ２値に復調したものを指す。°以下、図
示の実施例を参照しながらこれを詳細に説明する。
第１図は本発明の原理図で、装置１．２は異なるオーデ
ィオソースの一部或いはＣＰＵの一部である。１１．２
１は送信部、１２’、２２は電流検出部、１３．２３は
復調部である。送信部１１は連動する切換スイッチＳｌ
ｌ 、 ｓ、 ２を有し、図示のようにスイッチＳ
ｌｌがＡ側に接続されていると負荷抵抗し１で接地され
た送信データＴ＋（このレベルは前述のし であるが、
以下では単に０ということもある）を出力する。このと
きスイッチＳ１２によるアース電位は復調部１３で使用
される。これに対し図示とは逆にスイッチＳ１１゜３１
２がＢ側に接続されると、スイッチＳ１１によって電圧
■−が出力される。この電圧ｖ１はＨレベルの送信デー
タＴ＋となり、電流検出部１２を通して伝送線３に出力
される。電流検出部１２は送信部１１の出力Ｔ１がＨで
伝送線３の電圧ＶがＬのときに流れる方向性を有した電
流だけを検出して出力Ｄ１をＨにする。これ以外の条件
では出力ＤＩをＬにしておき、また逆方向の電流は流さ
ない回路構成（ｆ＆述する）を有する。復調部１３はゲ
ートｃ、ｌ ”Ｇｌ ３からなり、ＲＩ＝ （Ｔ＋ｎＤ
＋）Ｕ （ＴＩ１１Ｖ）なる論理（ｎは論理積、Ｕは論
理和）で受信データＲ１（＝Ｔ２）を復調する。
ィオソースの一部或いはＣＰＵの一部である。１１．２
１は送信部、１２’、２２は電流検出部、１３．２３は
復調部である。送信部１１は連動する切換スイッチＳｌ
ｌ 、 ｓ、 ２を有し、図示のようにスイッチＳ
ｌｌがＡ側に接続されていると負荷抵抗し１で接地され
た送信データＴ＋（このレベルは前述のし であるが、
以下では単に０ということもある）を出力する。このと
きスイッチＳ１２によるアース電位は復調部１３で使用
される。これに対し図示とは逆にスイッチＳ１１゜３１
２がＢ側に接続されると、スイッチＳ１１によって電圧
■−が出力される。この電圧ｖ１はＨレベルの送信デー
タＴ＋となり、電流検出部１２を通して伝送線３に出力
される。電流検出部１２は送信部１１の出力Ｔ１がＨで
伝送線３の電圧ＶがＬのときに流れる方向性を有した電
流だけを検出して出力Ｄ１をＨにする。これ以外の条件
では出力ＤＩをＬにしておき、また逆方向の電流は流さ
ない回路構成（ｆ＆述する）を有する。復調部１３はゲ
ートｃ、ｌ ”Ｇｌ ３からなり、ＲＩ＝ （Ｔ＋ｎＤ
＋）Ｕ （ＴＩ１１Ｖ）なる論理（ｎは論理積、Ｕは論
理和）で受信データＲ１（＝Ｔ２）を復調する。
装置２も同一構成を有し、スイ・ノチＳ２１．Ｓ２２と
負荷抵抗Ｌ２、それに電圧Ｖ２ （−Ｖｌ）の発生源
で送信部２１を構成する（Ｔ２は送信データ）。
負荷抵抗Ｌ２、それに電圧Ｖ２ （−Ｖｌ）の発生源
で送信部２１を構成する（Ｔ２は送信データ）。
復調部２３はゲート０２１〜Ｇ２３からなり、Ｒ２−（
Ｔ２１１Ｄ２）Ｕ （ＴｚｎＶ）なる論理で受信データ
Ｒ２（−ＴＩ）を復調する。
Ｔ２１１Ｄ２）Ｕ （ＴｚｎＶ）なる論理で受信データ
Ｒ２（−ＴＩ）を復調する。
電流検出部２２は送信部２１から伝送線３側へ流れる電
流を検出して出力Ｄ２をＨにする。
流を検出して出力Ｄ２をＨにする。
下表はスイッチＳｌ ｌ 、 ｓ、 ２のＡ、Ｂとス
イッチＳ２１．Ｓ２２のＡ、Ｂの４通りの組合せに応じ
た各部の論理値である。
イッチＳ２１．Ｓ２２のＡ、Ｂの４通りの組合せに応じ
た各部の論理値である。
表 ２
但し、電流■の＋１は電／Ｍ、検出部１２で検出される
向きＣＰＩ−Ｐｌ）の電流であり、逆に−１は電流検出
部２２で検出される向き（Ｐｌ−Ｐｌ）の電流である。
向きＣＰＩ−Ｐｌ）の電流であり、逆に−１は電流検出
部２２で検出される向き（Ｐｌ−Ｐｌ）の電流である。
第２図は実施例で、トランジスタは全てｐｎｐである。
装置１の電流検出部１２はトランジスタＱ、 ０と抵抗
ＲＩ２で構成される。抵抗ＲＩ ＋ は負荷抵抗し」に
相当し、抵抗Ｒ１３は受信部１４人力のプルダウン用で
ある。トランジスタＱｌ ２は送信データＴ１と電流検
出出力Ｄ１を入力とするゲーｌ−Ｇ＋ｚに相当し、また
ｌ・ランジスタＱｌｌは送信データＴ１と伝送線３上の
電圧■を入力とするゲートＧＩ Ｉ に相当する。但し
、このトランジスタＱｌ １ にはスイッチＳ１１ の
機能も持たせである。トランジスタＱＩ Ｉ 、 Ｑ
ｌ ２の出力端である両コレクタは接続され、この部分
でゲートＧ１３に相当するワイヤードオアを構成する。
ＲＩ２で構成される。抵抗ＲＩ ＋ は負荷抵抗し」に
相当し、抵抗Ｒ１３は受信部１４人力のプルダウン用で
ある。トランジスタＱｌ ２は送信データＴ１と電流検
出出力Ｄ１を入力とするゲーｌ−Ｇ＋ｚに相当し、また
ｌ・ランジスタＱｌｌは送信データＴ１と伝送線３上の
電圧■を入力とするゲートＧＩ Ｉ に相当する。但し
、このトランジスタＱｌ １ にはスイッチＳ１１ の
機能も持たせである。トランジスタＱＩ Ｉ 、 Ｑ
ｌ ２の出力端である両コレクタは接続され、この部分
でゲートＧ１３に相当するワイヤードオアを構成する。
装置２側についても同様であり、トランジスタＱ２０と
抵抗Ｒ２２で電流検出部２２を構成する。トランジスタ
Ｑ２宜はゲートＧ２＋ とスイッチＳ２１ の機能を
有し、またトランジスタＱ２２はゲートＧ２２に相当す
る。抵抗Ｒ２＋ は負荷抵抗Ｌ２に相当し、また抵抗Ｒ
２３は受信部２４の入力プルダウン用である。トランジ
スタＱ２１ 、Ｑ２２のコレクタ接続点が０２３に相当
するワイヤードオアである。
抵抗Ｒ２２で電流検出部２２を構成する。トランジスタ
Ｑ２宜はゲートＧ２＋ とスイッチＳ２１ の機能を
有し、またトランジスタＱ２２はゲートＧ２２に相当す
る。抵抗Ｒ２＋ は負荷抵抗Ｌ２に相当し、また抵抗Ｒ
２３は受信部２４の入力プルダウン用である。トランジ
スタＱ２１ 、Ｑ２２のコレクタ接続点が０２３に相当
するワイヤードオアである。
動作を説明する。表２の１段目に示すように送信データ
Ｔｌ、Ｔ２かいずれもＯであるとトランジスタＱ＋ ｏ
”Ｑｌ ２ 、 Ｑ２０−Ｑ２２は全てオフであるか
らＶ、ＬＤＬＤ２共にＯであって、受信データＲ１，Ｒ
２はプルダウン抵抗Ｒ１３゜Ｒ２３によってＯになる。
Ｔｌ、Ｔ２かいずれもＯであるとトランジスタＱ＋ ｏ
”Ｑｌ ２ 、 Ｑ２０−Ｑ２２は全てオフであるか
らＶ、ＬＤＬＤ２共にＯであって、受信データＲ１，Ｒ
２はプルダウン抵抗Ｒ１３゜Ｒ２３によってＯになる。
これに対し表２の２段目のように送信データＴＩが１、
Ｔ２が０のときは、トランジスタＱ１０がオンになるの
でＤｌが１になる。またトランジスタＱ２＋ がオンに
なるので抵抗Ｒ２＋ の経路で電流が流れ、伝送線３は
Ｔ２−０でも直接接地されずにルヘルを保つ。
Ｔ２が０のときは、トランジスタＱ１０がオンになるの
でＤｌが１になる。またトランジスタＱ２＋ がオンに
なるので抵抗Ｒ２＋ の経路で電流が流れ、伝送線３は
Ｔ２−０でも直接接地されずにルヘルを保つ。
このルベルがトランジスタＱ２．の１ミ・ツタ、コレク
タ間を通して受信データＲ２となる。一方、装置１側で
はＤｌ−１であるのでトランジスタＱ ｌ ２はオフ、
またＴ＋＝ｌ、Ｖ＝１であるのでトランジスタＱｌ １
はオフであるから受信データＲＩは０である。逆に送
信データＴ１がＯ，Ｔ２が１のときは（表２の３段目）
、ｔ・ランジスタＱｌ ｌ とＱ２０がオン（他はオフ
）になるので、」二記とは逆にＤ２＝１、従ってＲ＋＝
１＋Ｒ２＝０となる。
タ間を通して受信データＲ２となる。一方、装置１側で
はＤｌ−１であるのでトランジスタＱ ｌ ２はオフ、
またＴ＋＝ｌ、Ｖ＝１であるのでトランジスタＱｌ １
はオフであるから受信データＲＩは０である。逆に送
信データＴ１がＯ，Ｔ２が１のときは（表２の３段目）
、ｔ・ランジスタＱｌ ｌ とＱ２０がオン（他はオフ
）になるので、」二記とは逆にＤ２＝１、従ってＲ＋＝
１＋Ｒ２＝０となる。
表２の４段目のケースではＴｌ−１，Ｔ２＝１であるか
らトランジスタＱｌ ２ 、Ｑ２２だけしかオンできず
、Ｒ１＝１．Ｒ２＝１になる。
らトランジスタＱｌ ２ 、Ｑ２２だけしかオンできず
、Ｒ１＝１．Ｒ２＝１になる。
以上述べた本発明の双方向データ伝送回路には次の利点
がある。（１）伝送線一本で送受信を同時に行うことが
できるため、効率の良い双方向データ伝送が可能となり
、また（２）双方向スイッチング制御系においては、制
御のタイミングを逸することがない、さらに（３）簡単
な回路で実現できる。
がある。（１）伝送線一本で送受信を同時に行うことが
できるため、効率の良い双方向データ伝送が可能となり
、また（２）双方向スイッチング制御系においては、制
御のタイミングを逸することがない、さらに（３）簡単
な回路で実現できる。
第１図は本発明の原理説明図、第２図は本発明の一実施
例を示す構成図、第３図は従来のデータ伝送回路の一例
を示す構成図、第４図はそのタイムチャートである。 図中、１．２は装置、３は伝送線、１１．２１は送信部
、Ｌ＋、Ｌ２ｉ Ｒ１１，Ｒ２＋ は接地抵抗、１２
．２２は電流検出部、１３，２３は徨調部、１４．２４
は受信部である。
例を示す構成図、第３図は従来のデータ伝送回路の一例
を示す構成図、第４図はそのタイムチャートである。 図中、１．２は装置、３は伝送線、１１．２１は送信部
、Ｌ＋、Ｌ２ｉ Ｒ１１，Ｒ２＋ は接地抵抗、１２
．２２は電流検出部、１３，２３は徨調部、１４．２４
は受信部である。
Claims (1)
- 対向する装置間を１本のデータ伝送線で接続し、各装置
内には、送信データＨで所定の電圧を出力し、また送信
データＬで抵抗接地されたアース電位を出力する送信部
と、該送信部から該伝送線側へ出力する電流の有無を検
出する電流検出部と、該送信データのＨ、Ｌと該電流検
出部の出力と該伝送線上の電圧の有無から受信データの
Ｈ、Ｌを復調する復調部とを設け、該装置間で同時にデ
ータ伝送を行い得るようにしてなることを特徴とする双
方向データ伝送回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21108484A JPS6189741A (ja) | 1984-10-08 | 1984-10-08 | 双方向デ−タ伝送回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21108484A JPS6189741A (ja) | 1984-10-08 | 1984-10-08 | 双方向デ−タ伝送回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6189741A true JPS6189741A (ja) | 1986-05-07 |
| JPH0238028B2 JPH0238028B2 (ja) | 1990-08-28 |
Family
ID=16600147
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21108484A Granted JPS6189741A (ja) | 1984-10-08 | 1984-10-08 | 双方向デ−タ伝送回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6189741A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2009133633A1 (ja) * | 2008-04-30 | 2009-11-05 | 株式会社ビー・アンド・プラス | 入出力信号制御装置 |
| WO2010109590A1 (ja) * | 2009-03-24 | 2010-09-30 | 株式会社ビー・アンド・プラス | 入出力信号制御装置およびこれを用いた入出力信号制御システム |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5712344A (en) * | 1980-06-26 | 1982-01-22 | Doro Doshitsu Chiyousa Kk | Method and device for horizontal sampling of earth free from disorder |
-
1984
- 1984-10-08 JP JP21108484A patent/JPS6189741A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5712344A (en) * | 1980-06-26 | 1982-01-22 | Doro Doshitsu Chiyousa Kk | Method and device for horizontal sampling of earth free from disorder |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2009133633A1 (ja) * | 2008-04-30 | 2009-11-05 | 株式会社ビー・アンド・プラス | 入出力信号制御装置 |
| JP4589462B2 (ja) * | 2008-04-30 | 2010-12-01 | 株式会社ビー・アンド・プラス | 入出力信号制御装置 |
| US7911232B2 (en) | 2008-04-30 | 2011-03-22 | B & Plus K.K. | Input/output signal controller |
| JPWO2009133633A1 (ja) * | 2008-04-30 | 2011-08-25 | 株式会社ビー・アンド・プラス | 入出力信号制御装置 |
| WO2010109590A1 (ja) * | 2009-03-24 | 2010-09-30 | 株式会社ビー・アンド・プラス | 入出力信号制御装置およびこれを用いた入出力信号制御システム |
| JP4751969B2 (ja) * | 2009-03-24 | 2011-08-17 | 株式会社ビー・アンド・プラス | 入出力信号制御装置およびこれを用いた入出力信号制御システム |
| US8443112B2 (en) | 2009-03-24 | 2013-05-14 | B & Plus K.K. | Input/output signal controller and input/output signal control system employing the input/output controller |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0238028B2 (ja) | 1990-08-28 |
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