JPS61293120A - 電源装置 - Google Patents
電源装置Info
- Publication number
- JPS61293120A JPS61293120A JP60133109A JP13310985A JPS61293120A JP S61293120 A JPS61293120 A JP S61293120A JP 60133109 A JP60133109 A JP 60133109A JP 13310985 A JP13310985 A JP 13310985A JP S61293120 A JPS61293120 A JP S61293120A
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- JP
- Japan
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- power supply
- voltage
- power
- supply device
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- Power Sources (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業上の利用分野」
本発明は電源装置に関し、特に電子式東」−計算機や電
子式個人情報機器等にみられるように、電力源として電
池（その他党電セル等）を有し、該電池等に基づき負荷
に直流電力を供給する電源装置に関するものである。
子式個人情報機器等にみられるように、電力源として電
池（その他党電セル等）を有し、該電池等に基づき負荷
に直流電力を供給する電源装置に関するものである。
［開示の概要］
木明細書及び図面は、負荷に直流電力を供給する電源装
置において、同一電源から得られる電力を同一負荷に供
給するための異種複数の電源回路と、該複数電源回路の
出力電圧の内いずれか高い電圧又は低い電圧を選択して
その電力を負荷に供給する選択手段を備えることにより
、低消費電力の機器を構成可能な電源装置の技術を開示
するものである。
置において、同一電源から得られる電力を同一負荷に供
給するための異種複数の電源回路と、該複数電源回路の
出力電圧の内いずれか高い電圧又は低い電圧を選択して
その電力を負荷に供給する選択手段を備えることにより
、低消費電力の機器を構成可能な電源装置の技術を開示
するものである。
［従来の技術］
電子式卓上計算機（電卓）等の小型電子機器には乾電池
（その他光電セル等）を電力源とするものが多いが、従
来、その表示器を液晶表示器（ＬＣＤ）にするか又は蛍
光表示管にするかによって機器構成法に２種類が存在し
た。即ち、低消費電力、低価格という点ではＬＣＤを用
いるのが有利であり、この場合は、■ＣＭＯ３ＬＳＩＧ
の演算手段とＬＣＤ表示器の組み合わせが用いられてい
た。しかし、ＬＣＤには暗い所で見えないこと、通常で
も表示が見にくいという欠点がある。このため、消費電
力は大きいが表示が見易いという点で有利な蛍光表示管
が用いられ、この場合は、■ＰＮＯＳ ＬＳｒＣの演算
手段と蛍光表示管の組み合わせが用いられていた。とこ
ろで、最近、それ自体が低消費電力である上に表示の見
易い蛍光表示管を駆動可能なＣＭＯ３高耐圧ＬＳＩＣが
開発されたことにより、低消費電力でありかつ表示の見
易い、■ＣＭＯ９高耐圧ＬＳＩＧの演算手段と蛍光表示
管の組み合わせが可能になった。ところで、前記■の場
合、ＣＭＯＳ ＬＳＩＣとＬＣＤはともに駆動電圧は３
■なので乾電池で直接駆動することができるが、前記■
の構成とする場合は、ＰＭＯ９ＬＳＩＣ：が１５Ｖ、蛍
光表示管が２５ｖ〜３０Ｖ必要であるので直接の電池方
式ではまかないきれない。そのため、ＤＣ／ＤＣコンバ
ータを用いて間接的にＰＭＯ３ＬＳＩＧと蛍光表示管を
駆動している。また、■の場合も蛍光表示管を駆動する
ためにＤＣ／ＤＣコンバータが必要である。この場合に
、機器の低消費電力を実現させるためにＬＳＩＣ電源を
ｎｃ／ｎｃコンバータより供給せず他の電源回路から供
給する構成にし、該機器のオフ状態中はＤＣ／ＤＣコン
バータの発振を停止させ、蛍光表示管及び他の不必要な
演算回路部への給電を止め、最小限の記憶回路にのみバ
ックアップルートで直接的に給電する方法が考えられて
いるが、しかし、この方法ではＣＭＯ９高耐圧高耐圧Ｌ
ＳＩ部動電圧が５ｖであるため、例えば乾電池４木を電
池電源とした場合には電池出力にしてほぼ６．４Ｖ〜５
．ＯＶまでの短い寿命のレンジでしか機器動作できず、
又、乾電池２木、３本では機器構成できなという欠点を
有していた。しかもプリンタ駆動するような場合には、
ピークでＩＡ程度電流が流れ、電池内部抵抗の為に瞬間
的に負荷電圧が低下し、ＬＳＩＧが誤動作してしまうと
いう欠点を有していた。
（その他光電セル等）を電力源とするものが多いが、従
来、その表示器を液晶表示器（ＬＣＤ）にするか又は蛍
光表示管にするかによって機器構成法に２種類が存在し
た。即ち、低消費電力、低価格という点ではＬＣＤを用
いるのが有利であり、この場合は、■ＣＭＯ３ＬＳＩＧ
の演算手段とＬＣＤ表示器の組み合わせが用いられてい
た。しかし、ＬＣＤには暗い所で見えないこと、通常で
も表示が見にくいという欠点がある。このため、消費電
力は大きいが表示が見易いという点で有利な蛍光表示管
が用いられ、この場合は、■ＰＮＯＳ ＬＳｒＣの演算
手段と蛍光表示管の組み合わせが用いられていた。とこ
ろで、最近、それ自体が低消費電力である上に表示の見
易い蛍光表示管を駆動可能なＣＭＯ３高耐圧ＬＳＩＣが
開発されたことにより、低消費電力でありかつ表示の見
易い、■ＣＭＯ９高耐圧ＬＳＩＧの演算手段と蛍光表示
管の組み合わせが可能になった。ところで、前記■の場
合、ＣＭＯＳ ＬＳＩＣとＬＣＤはともに駆動電圧は３
■なので乾電池で直接駆動することができるが、前記■
の構成とする場合は、ＰＭＯ９ＬＳＩＣ：が１５Ｖ、蛍
光表示管が２５ｖ〜３０Ｖ必要であるので直接の電池方
式ではまかないきれない。そのため、ＤＣ／ＤＣコンバ
ータを用いて間接的にＰＭＯ３ＬＳＩＧと蛍光表示管を
駆動している。また、■の場合も蛍光表示管を駆動する
ためにＤＣ／ＤＣコンバータが必要である。この場合に
、機器の低消費電力を実現させるためにＬＳＩＣ電源を
ｎｃ／ｎｃコンバータより供給せず他の電源回路から供
給する構成にし、該機器のオフ状態中はＤＣ／ＤＣコン
バータの発振を停止させ、蛍光表示管及び他の不必要な
演算回路部への給電を止め、最小限の記憶回路にのみバ
ックアップルートで直接的に給電する方法が考えられて
いるが、しかし、この方法ではＣＭＯ９高耐圧高耐圧Ｌ
ＳＩ部動電圧が５ｖであるため、例えば乾電池４木を電
池電源とした場合には電池出力にしてほぼ６．４Ｖ〜５
．ＯＶまでの短い寿命のレンジでしか機器動作できず、
又、乾電池２木、３本では機器構成できなという欠点を
有していた。しかもプリンタ駆動するような場合には、
ピークでＩＡ程度電流が流れ、電池内部抵抗の為に瞬間
的に負荷電圧が低下し、ＬＳＩＧが誤動作してしまうと
いう欠点を有していた。
し発明が解決しようとする問題点］
本発明の目的は、上記蛍光表示管を駆動する如く電源多
値出力を要求される場合でも、簡単な構成により低消費
電力で機器駆動可能な電源装置を提供することにある。
値出力を要求される場合でも、簡単な構成により低消費
電力で機器駆動可能な電源装置を提供することにある。
［問題点を解決するための手段］
この課題を解決する一手段として例えば第１図に示す実
施例の直流電源装置は、バッテリ（ＢＡＴ）１２から得
られる電力（電圧Ｖｂａｔ）を入力とし、蛍光表示管に
は電圧Ｅｐ、Ｅｇ、Ｅｆを供給し、及び演算／制御用Ｃ
ＭＯ３高耐圧ＬＳＩＧには電圧Ｖｄｄを供給するための
ＤＣ／ＤＣコンバータ１４と、同じくバッテリ（ＢＡＴ
）１２から得られる電力（電圧ｖｂａｔ）を入力とし、
同一負荷０ＭＯ３高耐圧ＬＳＩＣに電圧Ｖｄｄを供給す
るためのレギュレータ（ＲＥＧ）１３と、該複数電源回
路の出力電圧の内のいずれか低い方の電圧を選択してそ
の電力を共通負荷ＬＳＩＣに供給するダイオードＤ３
、Ｄ４を備える。
施例の直流電源装置は、バッテリ（ＢＡＴ）１２から得
られる電力（電圧Ｖｂａｔ）を入力とし、蛍光表示管に
は電圧Ｅｐ、Ｅｇ、Ｅｆを供給し、及び演算／制御用Ｃ
ＭＯ３高耐圧ＬＳＩＧには電圧Ｖｄｄを供給するための
ＤＣ／ＤＣコンバータ１４と、同じくバッテリ（ＢＡＴ
）１２から得られる電力（電圧ｖｂａｔ）を入力とし、
同一負荷０ＭＯ３高耐圧ＬＳＩＣに電圧Ｖｄｄを供給す
るためのレギュレータ（ＲＥＧ）１３と、該複数電源回
路の出力電圧の内のいずれか低い方の電圧を選択してそ
の電力を共通負荷ＬＳＩＣに供給するダイオードＤ３
、Ｄ４を備える。
「作用」
かかる第１図の構成において、例えばバッテリの使用初
期において電圧Ｖｂａｔが−６，４ｖ〜−５，６ｖと高
い範囲にある間は、負荷電圧Ｖｄｄは効率の良いＲＥＧ
１３から供給され、マタ電圧Ｖｂａｔが−５，８ｖ以下
になると、負荷ＶｄｄはＤＣ／ＤＣ：コンへ−タ１４か
ら供給される。
期において電圧Ｖｂａｔが−６，４ｖ〜−５，６ｖと高
い範囲にある間は、負荷電圧Ｖｄｄは効率の良いＲＥＧ
１３から供給され、マタ電圧Ｖｂａｔが−５，８ｖ以下
になると、負荷ＶｄｄはＤＣ／ＤＣ：コンへ−タ１４か
ら供給される。
ここにおいて、例えば第２図に示すようにＲＥＧ１３の
代りに電源ラインを直結する電源回路とすれば、極めて
効率の高い給電が可能になる。
代りに電源ラインを直結する電源回路とすれば、極めて
効率の高い給電が可能になる。
また、機器オフ状態にするため、例えばＬＳＩＣからの
電源制御信号Ｃ１ｔＴによりＩＩＧ／ＤＣコンバータ１
４の発振を停止させた場合には、ＲＥＧ １３側から負
荷電圧Ｖｄｄが供給されてメモリの情報を維持する。
電源制御信号Ｃ１ｔＴによりＩＩＧ／ＤＣコンバータ１
４の発振を停止させた場合には、ＲＥＧ １３側から負
荷電圧Ｖｄｄが供給されてメモリの情報を維持する。
［実施例］
以下、添付図面に従い実施例の電源装置を詳細に説明す
る。第１図は実施例の電源装置のブロック構成図である
。図において、−１２は電池電源（ＢＡＴ）、１３はＢ
ＡＴ１２を入力源としてｌ、ＳＩＧの駆動電圧Ｖｄｄを
発生するシリ−ズレキュレータ（ＲＥＧ）、１４は同じ
（ＢＡＴ１２を入力源としてＬＳＩＧの駆動電圧Ｖｄｄ
を発生すると共に、その他蛍光表示管駆動用電圧である
陽極印加電圧Ｅｐ、該電圧Ｅｐにグリッド消去電圧を加
えた電圧Ｅｇ及びフィラメント用交流電圧Ｅｆを発生す
るＩＩＣ／ＤＣコンバータである。ここにおいて、レギ
ュレータ（ＲＥＧ）１３の出力はダイオードＤ４を介し
て負荷（ＬＳＩＣ）に供給されるよう構成され、またＤ
Ｃ／ＤＣコンバータ１４のＶｄｄ出力はダイオードＤ３
を介して共通の負荷（ＬＳＩＣ：）に供給されるよう構
成されている。ダイオードＤ１〜Ｄ３及びコンデンサＣ
２〜Ｃ４はＤＣ／ＤＣコンバーター４のトランスの２次
側に生じた交流を整流かつ平滑化するためのものである
。また、ＣＴは蛍光表示管用フィラメント電圧Ｅｆのセ
ンタタップであり、陽極印加電圧Ｅｐと接続することに
よりフィラメント交流電圧Ｅｆに電位を与える。上記構
成により形成される各部電位の一具体例ヲ示セば、Ｖ
ｓｓ＝ ＯＶ 、 Ｅｐ＝ −２４Ｖ 、 Ｅｇ＝ −
２７Ｖ 、 Ｖｄｄ ＝−５Ｖであり、乾電池４本直列
とした場合（７）ＢＡＴ１２（７）有効動作電圧を−３
，０Ｖ 〜−８，４Ｖトすると、この範囲内でＤＣ／Ｄ
Ｃコンバータ１４の出力電圧は上記各電圧値（但し、Ｖ
ｄｄ ＝ −４，９Ｖ）が出力されるように設計されて
いる。また、ＲＥＧ １３は例えばＶｂａｔが−８，４
Ｖ 〜−５，ＥＩＶ（７）間はＬＳＩＣ（７）定格動作
電圧値−５，ＯｖにダイオードＤ４による電圧降下−〇
、６ｖを加えた電圧−５，８ｖを安定的に出力する。従
ッテ、Ｖｂａｔが−８，４Ｖ 〜−５，８Ｖ（７）間は
負荷電圧ｖｄｄカＲＥＧ１３カラ供給され、Ｖｂａｔカ
ー ５゜８ｖ以下になると電圧ＶｄｄはＤＣ／ＤＣコン
バータ１４から供給されるようになる。又、機器オフ状
態の時にはＬＳＩＣからの電源制御信号ＣＮＴによりＤ
Ｃ／ＤＣコンバータ１４の発振を停止させても、ＬＳＩ
ＣにはＲＥＧ １３から電圧Ｖｄｄが供給されるので、
メモリの情報が維持される。
る。第１図は実施例の電源装置のブロック構成図である
。図において、−１２は電池電源（ＢＡＴ）、１３はＢ
ＡＴ１２を入力源としてｌ、ＳＩＧの駆動電圧Ｖｄｄを
発生するシリ−ズレキュレータ（ＲＥＧ）、１４は同じ
（ＢＡＴ１２を入力源としてＬＳＩＧの駆動電圧Ｖｄｄ
を発生すると共に、その他蛍光表示管駆動用電圧である
陽極印加電圧Ｅｐ、該電圧Ｅｐにグリッド消去電圧を加
えた電圧Ｅｇ及びフィラメント用交流電圧Ｅｆを発生す
るＩＩＣ／ＤＣコンバータである。ここにおいて、レギ
ュレータ（ＲＥＧ）１３の出力はダイオードＤ４を介し
て負荷（ＬＳＩＣ）に供給されるよう構成され、またＤ
Ｃ／ＤＣコンバータ１４のＶｄｄ出力はダイオードＤ３
を介して共通の負荷（ＬＳＩＣ：）に供給されるよう構
成されている。ダイオードＤ１〜Ｄ３及びコンデンサＣ
２〜Ｃ４はＤＣ／ＤＣコンバーター４のトランスの２次
側に生じた交流を整流かつ平滑化するためのものである
。また、ＣＴは蛍光表示管用フィラメント電圧Ｅｆのセ
ンタタップであり、陽極印加電圧Ｅｐと接続することに
よりフィラメント交流電圧Ｅｆに電位を与える。上記構
成により形成される各部電位の一具体例ヲ示セば、Ｖ
ｓｓ＝ ＯＶ 、 Ｅｐ＝ −２４Ｖ 、 Ｅｇ＝ −
２７Ｖ 、 Ｖｄｄ ＝−５Ｖであり、乾電池４本直列
とした場合（７）ＢＡＴ１２（７）有効動作電圧を−３
，０Ｖ 〜−８，４Ｖトすると、この範囲内でＤＣ／Ｄ
Ｃコンバータ１４の出力電圧は上記各電圧値（但し、Ｖ
ｄｄ ＝ −４，９Ｖ）が出力されるように設計されて
いる。また、ＲＥＧ １３は例えばＶｂａｔが−８，４
Ｖ 〜−５，ＥＩＶ（７）間はＬＳＩＣ（７）定格動作
電圧値−５，ＯｖにダイオードＤ４による電圧降下−〇
、６ｖを加えた電圧−５，８ｖを安定的に出力する。従
ッテ、Ｖｂａｔが−８，４Ｖ 〜−５，８Ｖ（７）間は
負荷電圧ｖｄｄカＲＥＧ１３カラ供給され、Ｖｂａｔカ
ー ５゜８ｖ以下になると電圧ＶｄｄはＤＣ／ＤＣコン
バータ１４から供給されるようになる。又、機器オフ状
態の時にはＬＳＩＣからの電源制御信号ＣＮＴによりＤ
Ｃ／ＤＣコンバータ１４の発振を停止させても、ＬＳＩ
ＣにはＲＥＧ １３から電圧Ｖｄｄが供給されるので、
メモリの情報が維持される。
第２図は他の実施例の電源装置のブロック構成図であり
、ここではＢＡＴ１２を乾電池２木で構成したため電圧
Ｖｂａｔが低く、このため第１図のＲＥＧ１３を取り除
き、タイオードＤ４を介して直接に負荷電圧Ｖｄｄを供
給できる回路構成になっている。
、ここではＢＡＴ１２を乾電池２木で構成したため電圧
Ｖｂａｔが低く、このため第１図のＲＥＧ１３を取り除
き、タイオードＤ４を介して直接に負荷電圧Ｖｄｄを供
給できる回路構成になっている。
第３図は実施例のＤＣ：／Ｉ）Ｇコンバータ１４の回路
図であり、従来のＤＣ／ｌ１ｌＣコンバータ回路に給電
０Ｎ１０ Ｆ Ｆ制御機能が付加された構成になってい
る。即ち、従来よりあるバイアス抵抗Ｒ２とＶｂａｔの
供給ラインとの間に、スイッチング用トランジスタＴＲ
３と該トランジスタＴＲ３のバイアス抵抗Ｒ３及びＲ４
から成るスイッチング手段を設け、電源制御信号ＣＮＴ
によりトランジスタＴＲ３がオンされない限りトランジ
スタＴＲ，、ＴＲ２が動作しないため、ブロッキング回
路は発振しないように制御される。
図であり、従来のＤＣ／ｌ１ｌＣコンバータ回路に給電
０Ｎ１０ Ｆ Ｆ制御機能が付加された構成になってい
る。即ち、従来よりあるバイアス抵抗Ｒ２とＶｂａｔの
供給ラインとの間に、スイッチング用トランジスタＴＲ
３と該トランジスタＴＲ３のバイアス抵抗Ｒ３及びＲ４
から成るスイッチング手段を設け、電源制御信号ＣＮＴ
によりトランジスタＴＲ３がオンされない限りトランジ
スタＴＲ，、ＴＲ２が動作しないため、ブロッキング回
路は発振しないように制御される。
第４図は実施例の電源装置を備える電子式東上計算機（
電卓）のブロック構成図である。図において、１はキー
ボードであり、０〜９の数値キー、＋、−、Ｘ、÷、−
等のファンクションキー、メモリ関連キー、制御キー等
が配置され、キースキャン信号ＫＳＣＡＮが送られてオ
ペレータがいずれかのキーを押下すると対応するキー人
力信号ＫＩＮを送出する。２は１チツプで構成されたＣ
ＭＯ８高耐圧ＬＳＩＣの演算回路部であり、内部は以下
の各機能部分から構成されている。３は制御プログラム
を記憶しているリード・オンリ・メモリ（ＲＯＭ）、４
はキーボード１から入力される数値データの記憶、四則
演算等を実行するときの演算メモリレジスタ、及び各種
演算制御を行なう際の判定に用いるフラグ等を格納する
ランダム・アクセス・メモリ（’ＲＡＭ ） 、 ５
はＲＯＭ ３の制御プログラムに従って各種演算及び制
御を行なう演算部であり、図示しないが、この部分には
ＲＯＭ ３のマイクロインストラクションを解読するデ
コーダ、演算を行う加算機、キーボード１にキースキャ
ニング信号ＫＳＧＡＮを出力してそのキー人力信号ＫＩ
Ｎを入力することにより入カキ−の判別を行なうキー処
理部、ＲＡＭ ４についてのデータ読書アドレスを保持
するアドレスデコーダ、表示出力を得るための文字パタ
ーン発生用キャラクタジェネレータ、そのためのタイミ
ング信号発生回路等を含む。６は演軍部５からの出力コ
ードにより表示部７のセグメント及びグリッドを駆動す
る表示ドライバ、９は４ビット印字データを一時的に格
納するバッファレジスタ及び文字コードを活字輪の文字
に対応させるタイミングカウンタ等から構成されている
印字制御部、１０は印字制御部９からの指令によりプリ
ンタ１１を駆動するプリンタドライバ、７は蛍光表示管
から成る表示部であり、表示ドライバ６からの信号でセ
グメント及びグリッドを制御することにより、フィラメ
ントに流れる電子を制御し、文字を表示させる。１５は
実施例の電源装置であり、その中で、１２は電力源のバ
ッテリ、１４はバッテリ１２の電圧Ｖｂａｔから表示部
７に係る部分の電圧、即ち、蛍光表示管の陽極印加電圧
Ｅｐ、該電圧Ｅｐにグリッド消去電圧を加えた電圧Ｅｇ
及びフィラメント印加電圧Ｅｆを形成するＤＣ／ＤＣコ
ン／ヘータである。
電卓）のブロック構成図である。図において、１はキー
ボードであり、０〜９の数値キー、＋、−、Ｘ、÷、−
等のファンクションキー、メモリ関連キー、制御キー等
が配置され、キースキャン信号ＫＳＣＡＮが送られてオ
ペレータがいずれかのキーを押下すると対応するキー人
力信号ＫＩＮを送出する。２は１チツプで構成されたＣ
ＭＯ８高耐圧ＬＳＩＣの演算回路部であり、内部は以下
の各機能部分から構成されている。３は制御プログラム
を記憶しているリード・オンリ・メモリ（ＲＯＭ）、４
はキーボード１から入力される数値データの記憶、四則
演算等を実行するときの演算メモリレジスタ、及び各種
演算制御を行なう際の判定に用いるフラグ等を格納する
ランダム・アクセス・メモリ（’ＲＡＭ ） 、 ５
はＲＯＭ ３の制御プログラムに従って各種演算及び制
御を行なう演算部であり、図示しないが、この部分には
ＲＯＭ ３のマイクロインストラクションを解読するデ
コーダ、演算を行う加算機、キーボード１にキースキャ
ニング信号ＫＳＧＡＮを出力してそのキー人力信号ＫＩ
Ｎを入力することにより入カキ−の判別を行なうキー処
理部、ＲＡＭ ４についてのデータ読書アドレスを保持
するアドレスデコーダ、表示出力を得るための文字パタ
ーン発生用キャラクタジェネレータ、そのためのタイミ
ング信号発生回路等を含む。６は演軍部５からの出力コ
ードにより表示部７のセグメント及びグリッドを駆動す
る表示ドライバ、９は４ビット印字データを一時的に格
納するバッファレジスタ及び文字コードを活字輪の文字
に対応させるタイミングカウンタ等から構成されている
印字制御部、１０は印字制御部９からの指令によりプリ
ンタ１１を駆動するプリンタドライバ、７は蛍光表示管
から成る表示部であり、表示ドライバ６からの信号でセ
グメント及びグリッドを制御することにより、フィラメ
ントに流れる電子を制御し、文字を表示させる。１５は
実施例の電源装置であり、その中で、１２は電力源のバ
ッテリ、１４はバッテリ１２の電圧Ｖｂａｔから表示部
７に係る部分の電圧、即ち、蛍光表示管の陽極印加電圧
Ｅｐ、該電圧Ｅｐにグリッド消去電圧を加えた電圧Ｅｇ
及びフィラメント印加電圧Ｅｆを形成するＤＣ／ＤＣコ
ン／ヘータである。
かかる構成において、例えばバッテリの使用初期におい
て電圧Ｖｂａｔが−６，４Ｖ〜−５，８ｖと高い範囲に
ある間は、負荷電圧Ｖｄｃｌは効率の良いダイオードＤ
４のルートから供給され、また電圧Ｖｂａｔが−５，８
ｖ以下ニすると、負荷ＶｄｄはＤＣ／ＤＣ，：１１７バ
ータ１４から供給される。
て電圧Ｖｂａｔが−６，４Ｖ〜−５，８ｖと高い範囲に
ある間は、負荷電圧Ｖｄｃｌは効率の良いダイオードＤ
４のルートから供給され、また電圧Ｖｂａｔが−５，８
ｖ以下ニすると、負荷ＶｄｄはＤＣ／ＤＣ，：１１７バ
ータ１４から供給される。
また、機器オフ状態にするため、例えばＬＳＩＣ２から
の電源制御信号ＣＮＴによりＤＣ／ＤＣコンバータ１４
の発振を停止させた場合には、ダイオードＤ４のルート
で最小限の電力がまかなわれ、 ＲＡＭ３の内容が保持
される。
の電源制御信号ＣＮＴによりＤＣ／ＤＣコンバータ１４
の発振を停止させた場合には、ダイオードＤ４のルート
で最小限の電力がまかなわれ、 ＲＡＭ３の内容が保持
される。
「発明の効果」
以上述べた如く本発明によれば、例えばＬＳＩＧの負荷
電圧ＶｄｄをＤＣ／ＤＣ：コンバータの出力と他のレギ
ュレータ出力のうち大きい方の電圧を供給するようにす
るとともに、タイオードを介し接続することによって、
簡単な回路構成により１例えば表示の見易い蛍光表示管
を具備する低消費電力の電子機器を構成できる。
電圧ＶｄｄをＤＣ／ＤＣ：コンバータの出力と他のレギ
ュレータ出力のうち大きい方の電圧を供給するようにす
るとともに、タイオードを介し接続することによって、
簡単な回路構成により１例えば表示の見易い蛍光表示管
を具備する低消費電力の電子機器を構成できる。
第１図は実施例の電源装置のブロック構成図、
第２図は他の実施例の電源装置のブロック構成図、
第３図は実施例のＤＣ／ＤＣコンバータ１４の回路図、
第４図は実施例の電源装置を備える電子式卓上計算機（
電卓）のブロック構成図である。 図中、１２・・・バッテリ（ＢＡＴ）、１３・・・レギ
ュレータ（ＲＥＧ）、１４・・・ＤＣ／ＤＣ：コンバー
タである。
電卓）のブロック構成図である。 図中、１２・・・バッテリ（ＢＡＴ）、１３・・・レギ
ュレータ（ＲＥＧ）、１４・・・ＤＣ／ＤＣ：コンバー
タである。
Claims (5)
- （１）負荷に直流電力を供給する電源装置において、同
一電源から得られる電力を同一負荷に供給するための異
種複数の電源回路と、該複数電源回路の出力電圧の内い
ずれかの電圧を選択してその電力を負荷に供給する選択
手段を備えることを特徴とする電源装置。 - （２）選択手段は最も高い電圧を選択することを特徴と
する特許請求の範囲第１項記載の電源装置。 - （３）選択手段は最も低い電圧を選択することを特徴と
する特許請求の範囲第１項記載の電源装置。 - （４）選択手段は異種複数の電源回路と同一負荷との間
に各直列接続されるダイオードで構成されることを特徴
とする特許請求の範囲第２項又は第３項記載の電源装置
。 - （５）少なくとも１つの電源回路がＤＣ／ＤＣコンバー
タであることを特徴とする特許請求の範囲第１項乃至第
４項記載の電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60133109A JPS61293120A (ja) | 1985-06-20 | 1985-06-20 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60133109A JPS61293120A (ja) | 1985-06-20 | 1985-06-20 | 電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61293120A true JPS61293120A (ja) | 1986-12-23 |
Family
ID=15097022
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60133109A Pending JPS61293120A (ja) | 1985-06-20 | 1985-06-20 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61293120A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63168711A (ja) * | 1987-01-06 | 1988-07-12 | Alps Electric Co Ltd | ワードプロセッサーの制御方法 |
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1985
- 1985-06-20 JP JP60133109A patent/JPS61293120A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63168711A (ja) * | 1987-01-06 | 1988-07-12 | Alps Electric Co Ltd | ワードプロセッサーの制御方法 |
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