JPS61282944A - ログ縮小方式 - Google Patents
ログ縮小方式Info
- Publication number
- JPS61282944A JPS61282944A JP60123640A JP12364085A JPS61282944A JP S61282944 A JPS61282944 A JP S61282944A JP 60123640 A JP60123640 A JP 60123640A JP 12364085 A JP12364085 A JP 12364085A JP S61282944 A JPS61282944 A JP S61282944A
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- JP
- Japan
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- error information
- memory
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- stored
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
ログ縮小方式であって、エラーログ専用メモリに主制御
部で検出したエラーを時系列的に全て記録していたのに
対応して、事前に記憶しているエラー情報と比較して相
違するもののみ記憶し、同一内容のエラー情報はその発
生回数を更新するように構成し、専用メモリの容量の縮
小化を可能とする。
部で検出したエラーを時系列的に全て記録していたのに
対応して、事前に記憶しているエラー情報と比較して相
違するもののみ記憶し、同一内容のエラー情報はその発
生回数を更新するように構成し、専用メモリの容量の縮
小化を可能とする。
本発明は、少ないメモリ容量で多くのエラーログを記録
するログ縮小方式に関する。
するログ縮小方式に関する。
情報処理システムの発展により、各種の端末装置が開発
され利用されるようになって来たが、これら端末装置に
は各種目的に利用されるメモリが設置されているのが一
般的である。
され利用されるようになって来たが、これら端末装置に
は各種目的に利用されるメモリが設置されているのが一
般的である。
一方、これらの端末装置は何処にでも設置可能なように
その物理的容積に一定の制限があり、かかる端末装置に
設置されているメモリ容量も出来るだけ小容量のもので
、しかも機能も充分に発揮出来るようなものが要求され
ている。
その物理的容積に一定の制限があり、かかる端末装置に
設置されているメモリ容量も出来るだけ小容量のもので
、しかも機能も充分に発揮出来るようなものが要求され
ている。
〔従来の技術と発明が解決しようとする問題点〕第４図
は従来例を説明するブロック図を示す。
は従来例を説明するブロック図を示す。
第４図の本例に示すメモリは発生するエラーを時系列的
に記録するエラーログ専用メモリ３であり、その容量に
一定の制限が設けられている。
に記録するエラーログ専用メモリ３であり、その容量に
一定の制限が設けられている。
更に、この専用メモリ３のメモリ領域は第４図に示すよ
うに（１）〜（Ｎ）領域に分割され、各領域（１）〜（
Ｎ）にはエラーの発生した時刻とエラー情報が記録され
ており、その記録方法は、例えば領域（１）から順番に
記録される。
うに（１）〜（Ｎ）領域に分割され、各領域（１）〜（
Ｎ）にはエラーの発生した時刻とエラー情報が記録され
ており、その記録方法は、例えば領域（１）から順番に
記録される。
又、この専用メモリ３は各領域（１）〜（Ｎ）が一杯に
なると最古のログ情報、即ち領域（１）のエラー情報か
ら最新ログ情報を上書きして行くようにアドレスカウン
タ（エラーポインタ）２がアドレスを発生する。尚、こ
れらの動作制御は主制御部１ （以下ＣＰ旧と称する）
にて行う。
なると最古のログ情報、即ち領域（１）のエラー情報か
ら最新ログ情報を上書きして行くようにアドレスカウン
タ（エラーポインタ）２がアドレスを発生する。尚、こ
れらの動作制御は主制御部１ （以下ＣＰ旧と称する）
にて行う。
上述のような動作処理でメモリ容量の一定の枠のある専
用メモリ３に時系列的に発生したエラーを記録していっ
た場合、同時刻に同種類のエラーが連続して発生すると
専用メモリ３に記録しているエラー情報が同種類のエラ
ー情報で一杯になってしまうと言う問題点がある。
用メモリ３に時系列的に発生したエラーを記録していっ
た場合、同時刻に同種類のエラーが連続して発生すると
専用メモリ３に記録しているエラー情報が同種類のエラ
ー情報で一杯になってしまうと言う問題点がある。
第１図は本発明の原理ブロック図を示す。
第１図は第４図で説明したＣＰＵ１．アドレスカウンタ
（エラーポインタ）２．エラーログ専用メモＩ７３と、 ＣＰＵ１で検出された新たなエラー情報とその検出時刻
に関する情報と、すでにエラーログ専用メモリ３に記録
されているエラー情報とを比較する比較回路４とから構
成されている。
（エラーポインタ）２．エラーログ専用メモＩ７３と、 ＣＰＵ１で検出された新たなエラー情報とその検出時刻
に関する情報と、すでにエラーログ専用メモリ３に記録
されているエラー情報とを比較する比較回路４とから構
成されている。
尚、エラーログ専用メモリ３は分割されている各領域（
１）〜（Ｎ）の「時刻」、「エラー情報」を記録する部
分の他に「回数」を記録する部分を新たに設は構成して
いる。
１）〜（Ｎ）の「時刻」、「エラー情報」を記録する部
分の他に「回数」を記録する部分を新たに設は構成して
いる。
新たにエラーが検出されると比較回路４で専用メモリ３
に記録しているエラー情報と順次比較して行き、一致す
るエラー情報があればそのアドレスに記録されている「
回数」を更新し、不一致であれば専用メモリ３の新たな
記録領域にそのエラー情報（時刻及び回数を含む）を記
録するようにして、少ないメモリ容量で多くのエラーロ
グの記録を可能とする。
に記録しているエラー情報と順次比較して行き、一致す
るエラー情報があればそのアドレスに記録されている「
回数」を更新し、不一致であれば専用メモリ３の新たな
記録領域にそのエラー情報（時刻及び回数を含む）を記
録するようにして、少ないメモリ容量で多くのエラーロ
グの記録を可能とする。
以下本発明の要旨を第２図、第３図に示す実施例により
具体的に説明する。
具体的に説明する。
第２図は本発明の詳細な説明するブロック図、第３図は
本実施例の処理手順を説明する図をそれぞれ示す。尚、
企図を通じて同一符号は同一対象物を示す。
本実施例の処理手順を説明する図をそれぞれ示す。尚、
企図を通じて同一符号は同一対象物を示す。
本実施例のエラーログ専用メモリ３は、第２図に示すよ
うに各分割された領域（１）〜（Ｎ）に「時刻」、「エ
ラー情報」、「回数」を記録する部分を有するもので、
アドレスカウンタ２の指示するアドレスは各領域（１）
〜（Ｎ）に対応する。
うに各分割された領域（１）〜（Ｎ）に「時刻」、「エ
ラー情報」、「回数」を記録する部分を有するもので、
アドレスカウンタ２の指示するアドレスは各領域（１）
〜（Ｎ）に対応する。
比較回路４は新たにエラーが発生し検出される度にその
エラー情報をＣＰＵＩから送出してもらい、事前に発生
して専用メモリ３に記録しているエラー情報の全てと順
次比較して行き、その結果を一致情報■と不一致情報■
として送出する。尚、上述の動作処理の制御は全てｃｐ
ｕｉで制御される。
エラー情報をＣＰＵＩから送出してもらい、事前に発生
して専用メモリ３に記録しているエラー情報の全てと順
次比較して行き、その結果を一致情報■と不一致情報■
として送出する。尚、上述の動作処理の制御は全てｃｐ
ｕｉで制御される。
次に、本実施例の処理手順を第３図に示す処理手順を参
照して説明する。
照して説明する。
エラー発生があり、それをＣＰＵＩが検出するとその発
生時刻及びエラー情報をＣＰＵＩで記憶すると共に比較
回路４に送出する。（ステップ５１）比較回路４はＣＰ
ＵＩから送出されるエラー情報とエラーログ専用メモリ
３に記録されているエラー情報があれば、その記録して
いるエラー情報の全てと順次比較照合して行き、もし一
致したエラー情報があれば比較照合動作を停止する。（
ステップ５２） 比較回路４で比較照合した結果、不一致の場合不一致情
報■はその都度ＣＰＵＩに送出する。一致の場合は一致
情報■をＣＰＵＩと専用メモリ３とに送出する。（ステ
ップ５３） 専用メモリ３に記録されているエラー情報が全て不一致
の場合、ＣＰＵＩはアドレスカウンタ（エラーポインタ
）２から出力する専用メモリ３のアドレスに新たなエラ
ー情報を発生した時刻と共に記録する。尚、その時の「
回数」は“１″とする。
生時刻及びエラー情報をＣＰＵＩで記憶すると共に比較
回路４に送出する。（ステップ５１）比較回路４はＣＰ
ＵＩから送出されるエラー情報とエラーログ専用メモリ
３に記録されているエラー情報があれば、その記録して
いるエラー情報の全てと順次比較照合して行き、もし一
致したエラー情報があれば比較照合動作を停止する。（
ステップ５２） 比較回路４で比較照合した結果、不一致の場合不一致情
報■はその都度ＣＰＵＩに送出する。一致の場合は一致
情報■をＣＰＵＩと専用メモリ３とに送出する。（ステ
ップ５３） 専用メモリ３に記録されているエラー情報が全て不一致
の場合、ＣＰＵＩはアドレスカウンタ（エラーポインタ
）２から出力する専用メモリ３のアドレスに新たなエラ
ー情報を発生した時刻と共に記録する。尚、その時の「
回数」は“１″とする。
（ステップ５４）
次に、ＣＰＵＩはアドレスカウンタ（エラーポインタ）
２をインクリメントして全ての動作処理を終了させる。
２をインクリメントして全ての動作処理を終了させる。
（ステップ５５）
もし、ステップ５３で一致情報■が比較回路４から送出
されるとその時のアドレス領域（ｉ）の「回数」部分が
一致情報■により更新される。（ステップ５６） このようにエラー情報を記録することにより、発生して
いるエラーの種類とその中でどのエラーが一番多く発生
しているか等エラー解析をするうえで必要な情報が容量
の少ない専用メモリ３から得ることが可能となる。
されるとその時のアドレス領域（ｉ）の「回数」部分が
一致情報■により更新される。（ステップ５６） このようにエラー情報を記録することにより、発生して
いるエラーの種類とその中でどのエラーが一番多く発生
しているか等エラー解析をするうえで必要な情報が容量
の少ない専用メモリ３から得ることが可能となる。
以上のような本発明によれば、発生しているエラーを解
析し対策を取るうえで必要とするエラー情報が少ないメ
モリ容量で多くのエラー情報が効率的に得られると言う
効果がある。
析し対策を取るうえで必要とするエラー情報が少ないメ
モリ容量で多くのエラー情報が効率的に得られると言う
効果がある。
第１図は本発明の原理ブロック図、
第２図は本発明の詳細な説明するブロック図、第３図は
本実施例の処理手順を説明する図、第４図は従来例を説
明するブロック図、をそれぞれ示す。 図において、 １はｃｐｕ 。 ２はアドレスカウンタ（エラーポインタ）３はエラーロ
グ専用メモリ、 ４は比較回路、 （１）〜（Ｎ）はメモリ領域、 をそれぞれ示す。 渠Ｚ吋
本実施例の処理手順を説明する図、第４図は従来例を説
明するブロック図、をそれぞれ示す。 図において、 １はｃｐｕ 。 ２はアドレスカウンタ（エラーポインタ）３はエラーロ
グ専用メモリ、 ４は比較回路、 （１）〜（Ｎ）はメモリ領域、 をそれぞれ示す。 渠Ｚ吋
Claims (1)
- 【特許請求の範囲】 発生するエラーを時系列的に記録するエラーログ専用メ
モリ（３）と、 前記メモリ（３）に該エラーを記録するアドレスを発生
するアドレスカウンタ（２）と、 前記メモリ（３）や前記アドレスカウンタ（２）の動作
を制御する主制御部（１）とからなり、前記メモリ（３
）の記憶領域が一杯になると一番古いエラー情報を記憶
している領域から更新する装置において、 データ送受信時にエラーが発生すると、その時のエラー
発生時刻とエラー情報を前記メモリ（３）にすでに記憶
済みのエラー情報と比較する比較回路（４）と、 前記メモリ（３）のエラー記憶領域に同一エラー情報の
発生回数を記憶する領域とを設け、 新たに発生したエラーを前記比較回路（４）で比較した
時、不一致と判定された該エラーは前記メモリ（３）に
記憶し、一致と判定された該エラーは前記メモリ（３）
の前記発生回数領域を更新することを特徴とするログ縮
小方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60123640A JPS61282944A (ja) | 1985-06-07 | 1985-06-07 | ログ縮小方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60123640A JPS61282944A (ja) | 1985-06-07 | 1985-06-07 | ログ縮小方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61282944A true JPS61282944A (ja) | 1986-12-13 |
Family
ID=14865591
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60123640A Pending JPS61282944A (ja) | 1985-06-07 | 1985-06-07 | ログ縮小方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61282944A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5155731A (en) * | 1989-05-11 | 1992-10-13 | Fujitsu Limited | Error logging data storing system |
| JPH08235151A (ja) * | 1995-02-22 | 1996-09-13 | Canon Inc | 情報収集方法及び装置 |
| US7496792B2 (en) | 2002-10-15 | 2009-02-24 | Stmicroelectronics S.A. | Repeat digital message transmission between a microprocessor monitoring circuit and an analyzing tool |
| EP2131283A2 (en) | 2008-06-02 | 2009-12-09 | Fujitsu Limited | Information processing apparatus, program, and medium for recording error notification |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56110164A (en) * | 1980-02-05 | 1981-09-01 | Fujitsu Ltd | Logging error control system |
| JPS57187752A (en) * | 1981-05-13 | 1982-11-18 | Nec Corp | Data gathering device |
-
1985
- 1985-06-07 JP JP60123640A patent/JPS61282944A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56110164A (en) * | 1980-02-05 | 1981-09-01 | Fujitsu Ltd | Logging error control system |
| JPS57187752A (en) * | 1981-05-13 | 1982-11-18 | Nec Corp | Data gathering device |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5155731A (en) * | 1989-05-11 | 1992-10-13 | Fujitsu Limited | Error logging data storing system |
| JPH08235151A (ja) * | 1995-02-22 | 1996-09-13 | Canon Inc | 情報収集方法及び装置 |
| US7496792B2 (en) | 2002-10-15 | 2009-02-24 | Stmicroelectronics S.A. | Repeat digital message transmission between a microprocessor monitoring circuit and an analyzing tool |
| EP2131283A2 (en) | 2008-06-02 | 2009-12-09 | Fujitsu Limited | Information processing apparatus, program, and medium for recording error notification |
| US7992056B2 (en) | 2008-06-02 | 2011-08-02 | Fujitsu Limited | Error monitoring and notification for a replaceable unit |
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