JPS6128186B2 - - Google Patents

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Publication number
JPS6128186B2
JPS6128186B2 JP11794278A JP11794278A JPS6128186B2 JP S6128186 B2 JPS6128186 B2 JP S6128186B2 JP 11794278 A JP11794278 A JP 11794278A JP 11794278 A JP11794278 A JP 11794278A JP S6128186 B2 JPS6128186 B2 JP S6128186B2
Authority
JP
Japan
Prior art keywords
circuit
synchronization signal
signal
odd
vertical synchronization
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP11794278A
Other languages
English (en)
Other versions
JPS5545156A (en
Inventor
Yasunori Kanazawa
Takashi Hoshino
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP11794278A priority Critical patent/JPS5545156A/ja
Publication of JPS5545156A publication Critical patent/JPS5545156A/ja
Publication of JPS6128186B2 publication Critical patent/JPS6128186B2/ja
Granted legal-status Critical Current

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Landscapes

  • Synchronizing For Television (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Description

【発明の詳細な説明】 本発明はデイジタル符号化された音響信号をビ
デオ信号の形態で記録するデイジタル録音機にお
ける奇・偶フイールド判定回路に関し、詳しくは
そのタイミング設定に関するものである。
符号化された音響信号をビデオ信号の形態に変
換して伝送記録する場合、水平・垂直同期信号部
分には情報を記録することが出来ない。このうち
垂直同期信号は奇数フイールドと偶数フイールド
とでは1/2水平周期分位相のずれがある。従来の
デイジタル録音機では映像記録との両立性を考慮
せず専用録音機として使用するため、上記のよう
な奇・偶フイールドを区別する必要がなく、垂直
同期信号およびその前後の等化パルスの配列も、
通常のビデオ信号と異なつていても実用上問題と
はならなかつた。しかしながら、家庭用VTR利
用による録音・録画共用の場合には、複合同期信
号も両立性が要求され、通常の映像信号の場合と
同一の信号形態でなければならない。ここで通常
の映像信号では、奇数フイールド、偶数フイール
ドを常に厳密に区別しておく必要はなく、例えば
編集を行なう際には奇数フイールド(あるいは偶
数フイールド)が連続して来ることもある。これ
に対し、デイジタル録音機のように符号化された
デイジタル信号を記録する場合には、フイールド
の奇・偶を判定し垂直同期信号に対して正しい位
置関係にある場所(所定の水平走査期間)にデー
タを記録しなければならない。従来、VTR等に
おける同期分離回路の一部で奇・偶判定が行なわ
れる例もあつたが、積分回路による垂直同期分離
を必要としない場合には、純デイジタル的な処理
のみで奇・偶判定を行なうことが要求されること
になる。
本発明の目的は、上記したVTR利用デイジタ
ル録音機における問題点を解決し、垂直同期信号
に対して正しい位置関係にある場所にデイジタル
データを記録・再生するための識別信号を発生せ
しめる手段を提供することにある。
上記目的を達するため、本発明においては垂直
同期信号の前後にある等化パルスの数が奇数フイ
ールドと偶数フイールドとで異なつており、かつ
1/2H(Hは一水平走査期間)毎に配置されている ことを利用し、これらの等化パルスの数を計数す
ることにより、奇・偶フイールドの判別パルスを
発生させている。
以下本発明を実施例により説明する。第1図は
複合同期信号の等化パルス部と垂直同期信号の一
部及び本発明の原理を示すためのタイミングチヤ
ートである。
第1図においてa,1は奇数フイールドの等化
パルスと垂直同期信号の一部を示す。まず図に示
すように水平同期信号およびこれと位相の合つた
等化パルスの後縁で時間幅T(H>T>1/2H)の ワンシヨツトマルチバイブレータを駆動すること
により、同図2のゲート信号を作る。ここでHは
一水平走査期間を示す。等化パルスは1/2H間隔で 現れるから、上記ゲート信号で水平走査期間の中
間部にある等化パルスを抜き出すことが出来る。
この抜き出された等価パルスは同図3に示すよう
に垂直同期信号の前では3個あり、最終のパルス
(すなわち3個目のパルス)後H>T′>1/2Hの期 間でのレベルが「0」ならば奇数フイールドであ
る。また「1」ならば同図b,6にて示すように
偶数フイールドを示すことになる。この判定を行
なうためには、第1図a,4に示すように、上記
抜き出された等化パルスの3個目の後縁で時間幅
T(H>T>1/2H)のワンシヨツトマルチバイブ レータを駆動する。この時間幅Tのパルスの後縁
を微分し、微分出力パルスを第1図a−1の同期
信号を反転したものでゲートすることにより、奇
数フイールド判定の信号を得ることができる。
(第1図a−5参照)また偶数フイールドに対し
ては、第1図b−6〜10に示すように、反転し
ない同期信号でゲートすることにより判定信号を
得ることが出来る。
以上の処理を行なうための回路系統図を第2図
に示す。第2図において、複合同期信号はワンシ
ヨツトマルチバイブレータ1に加えられ、時間幅
T(H>T>1/2H)のパルスとなつてAND回路2 の一方の入力に加えられる。AND回路2の他方
の入力には複合同期信号が直接加えられ、第1図
a−1〜3および同図b−6〜8のプロセスが実
行される。AND回路2の出力はカウンタ3で計
数され、3個のカウント終了パルスで次のワンシ
ヨツトマルチバイブレータ4を駆動する。この第
2のワンシヨツトマルチバイブレータ4の出力パ
ルスの時間幅T(H>T>1/2Hに設定する。ワン シヨツトマルチバイブレータ4のボジテイブ出力
は、微分回路5で微分し後縁部を抽出し、さらに
インバータ6で反転整形してAND回路7および
8の入力の一方に供給される。AND回路7の他
方の入力には複合同期信号が直接加えられ、また
AND回路8の他方の入力には、複合同期信号を
インバータ9で反転したものが加えられる。
AND回路7の出力には第1図に示した関係から
奇数フイールドの判定出力が、AND回路8の出
力には偶数フイールドの判定出力が得られること
になる。
本発明によりテレビ信号の形態でデイジタル録
音する際に必要な奇数フイールド、偶数フイール
ドの判定を簡単なデイジタル論理演算処理のみで
実行し得るようになつた。
【図面の簡単な説明】
第1図は複合同期信号の等化パルス部と垂直同
期信号の一部および本発明の原理を示すためのタ
イミングチヤート、第2図は本発明の一実施例ブ
ロツク図である。 1,4……ワンシヨツトマルチバイブレータ、
3……カウンタ、2,7,8……AND回路、
6,9……インバータ、5……微分回路。

Claims (1)

    【特許請求の範囲】
  1. 1 テレビ同期信号のビデオ信号部分にデイジタ
    ル信号を記録するデイジタル録音機において、垂
    直同期信号以前の等化パルス部分を検出しこれを
    計数する回路と、所定の数だけ計数した後所定の
    時間後の同期信号の「1」または「0」の状態を
    判定する回路とからなる奇・偶フイールド判定回
    路。
JP11794278A 1978-09-27 1978-09-27 Odd-even field decision circuit Granted JPS5545156A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP11794278A JPS5545156A (en) 1978-09-27 1978-09-27 Odd-even field decision circuit

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP11794278A JPS5545156A (en) 1978-09-27 1978-09-27 Odd-even field decision circuit

Publications (2)

Publication Number Publication Date
JPS5545156A JPS5545156A (en) 1980-03-29
JPS6128186B2 true JPS6128186B2 (ja) 1986-06-28

Family

ID=14724028

Family Applications (1)

Application Number Title Priority Date Filing Date
JP11794278A Granted JPS5545156A (en) 1978-09-27 1978-09-27 Odd-even field decision circuit

Country Status (1)

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JP (1) JPS5545156A (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5146459A (en) * 1986-11-28 1992-09-08 Canon Kabushiki Kaisha Electronic equipment with check-sum function

Also Published As

Publication number Publication date
JPS5545156A (en) 1980-03-29

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