JPS61248540A - 入力保護装置 - Google Patents
入力保護装置Info
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- JPS61248540A JPS61248540A JP60091446A JP9144685A JPS61248540A JP S61248540 A JPS61248540 A JP S61248540A JP 60091446 A JP60091446 A JP 60091446A JP 9144685 A JP9144685 A JP 9144685A JP S61248540 A JPS61248540 A JP S61248540A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、半導体装置の入力保護装置に関するもので
ある。
ある。
第3図は、従来の半導体装置における入力パッド部分を
示す断面図であシ、図中1は半導体基板、2は酸化膜、
3はパッシベーション膜としての絶縁、膜、4は導電性
の第1ポリシリコン層、5は同じく導電性の第2ポリシ
リコン層である。また6はアルミニウム電極であシ、リ
ード線7を通じて図示しない外部ピンと接続され、さら
に内部回路へも接続されている。
示す断面図であシ、図中1は半導体基板、2は酸化膜、
3はパッシベーション膜としての絶縁、膜、4は導電性
の第1ポリシリコン層、5は同じく導電性の第2ポリシ
リコン層である。また6はアルミニウム電極であシ、リ
ード線7を通じて図示しない外部ピンと接続され、さら
に内部回路へも接続されている。
上記構成において、外部ピンに入力された信号は、リー
ドWA7を介して電極6に到達し、さらに電極Bに接続
された内部回路接続用導電層を通じて内部回路に到達す
る。ポリシリコン層4,5および酸化膜2は、電極6に
リード1li7をボンディングする際に緩衝器の役割り
を果たす。また、リード1li7を電極6にボンディン
グする際に、万一電極6をつきぬけてしまうことがあっ
ても、ポリシリコン層4,5あるいは酸化膜2によって
さえぎられるため、電極6と基板1とがショートするこ
とはない。
ドWA7を介して電極6に到達し、さらに電極Bに接続
された内部回路接続用導電層を通じて内部回路に到達す
る。ポリシリコン層4,5および酸化膜2は、電極6に
リード1li7をボンディングする際に緩衝器の役割り
を果たす。また、リード1li7を電極6にボンディン
グする際に、万一電極6をつきぬけてしまうことがあっ
ても、ポリシリコン層4,5あるいは酸化膜2によって
さえぎられるため、電極6と基板1とがショートするこ
とはない。
しかしながら、このような従来の装置では、電気的には
入力信号が直接に内部回路へ入力されることとなるため
、入力信号が急激に変化すると内部回路が破壊されるお
それがあバそのために電極6と内部回路との間に別に保
護回路を設ける必要があった。
入力信号が直接に内部回路へ入力されることとなるため
、入力信号が急激に変化すると内部回路が破壊されるお
それがあバそのために電極6と内部回路との間に別に保
護回路を設ける必要があった。
この発明は上記のような問題点を解決するためになされ
たもので、その目的は、外部入力信号の急激な変化を吸
収し、内部入力保護回路の負担を軽くすることのできる
入力保護装置を提供することにある。
たもので、その目的は、外部入力信号の急激な変化を吸
収し、内部入力保護回路の負担を軽くすることのできる
入力保護装置を提供することにある。
この発明による入力保護装置は、電極の下に形成された
導電層を基板と接続し、電極畳導電層間にコンデンサを
形成したものである。
導電層を基板と接続し、電極畳導電層間にコンデンサを
形成したものである。
電極・導電層間に形成されるコンデンサが入力信号の急
激な変化を吸収するため、内部回路へ伝わる入力信号の
変化は少なくなる。
激な変化を吸収するため、内部回路へ伝わる入力信号の
変化は少なくなる。
〔実施例〕
第1図はこの発明の一実施例を示す断面図である。同図
において、第3図と対応部分は同一記号を用いて示しで
あるが本実施例では、第1ポリシリコン層4は、接続部
8aを介してシリコンからなる半導体基板1に接続され
ている。この接続部8aは、基板1およびシリコン酸化
膜2の上に薄い絶縁膜3aを形成後、この絶縁膜3aに
エツチングによシ基板1に達する穴3bを形成し、この
穴および第1ポリシリコン層4を形成すべき領域の絶縁
膜3a上に不純物をドーグしたポリシリコンヲテポシシ
ョンすることによシ、第1ポリシリコン層4と同時に形
成される。
において、第3図と対応部分は同一記号を用いて示しで
あるが本実施例では、第1ポリシリコン層4は、接続部
8aを介してシリコンからなる半導体基板1に接続され
ている。この接続部8aは、基板1およびシリコン酸化
膜2の上に薄い絶縁膜3aを形成後、この絶縁膜3aに
エツチングによシ基板1に達する穴3bを形成し、この
穴および第1ポリシリコン層4を形成すべき領域の絶縁
膜3a上に不純物をドーグしたポリシリコンヲテポシシ
ョンすることによシ、第1ポリシリコン層4と同時に形
成される。
このように構成された入力保護装置においては、電極6
と第1ポリシリコン層4との間に形成されるコンデンサ
によって電極6に与えられる入力信号の急激な変化を吸
収できるため、内部入力保護回路にかかる負担を軽減す
ることができ、静電気によるサージパルスに対する耐性
の向上を図ることができる。また、コンデンサを構成す
るのにパッドの電極6の下を使用しているので、新たな
面積を必要とせず、レイアウト上も有利である。
と第1ポリシリコン層4との間に形成されるコンデンサ
によって電極6に与えられる入力信号の急激な変化を吸
収できるため、内部入力保護回路にかかる負担を軽減す
ることができ、静電気によるサージパルスに対する耐性
の向上を図ることができる。また、コンデンサを構成す
るのにパッドの電極6の下を使用しているので、新たな
面積を必要とせず、レイアウト上も有利である。
なお、上述した実施例では第[ポリシリコン層4を基板
1と接続した例を示したが、第2ポリシリコン層5と基
板1とを接続しても同様の効果が得られる。
1と接続した例を示したが、第2ポリシリコン層5と基
板1とを接続しても同様の効果が得られる。
第2図はこの発明の他の実施例を禾す断面図であシ、第
2ポリシリコン層5を接続部8bによ)基板1に接続し
、さらに電極6と第1ポリシリコン層4とを接続部8C
によ多接続したものである。
2ポリシリコン層5を接続部8bによ)基板1に接続し
、さらに電極6と第1ポリシリコン層4とを接続部8C
によ多接続したものである。
本構成を形成するには、例えば薄い絶縁膜3aを形成し
てエツチングによυ穴をあけた後、この穴内および絶縁
膜3a上に不純物をドープしたポリシリコンをデポジシ
ョンして接続部8bの下部と第4ポリシリコン層4とを
形成し、同様に絶縁膜3bを形成して2個の穴をあけた
後接続部8bの上部および接続部8Cの下部と第2ポリ
シリコン層5とを形成し、さらに絶縁膜3Cを形成して
穴をあけた後、この穴内および絶縁膜3c上にアルミニ
ウムをデポジションすることによシ接続部8cの上部お
よび電極Bを形成する。このような構成にすることによ
りさらに大きな容量値のコンデンサが得られ、入力保護
能力を一層読めることができる。
てエツチングによυ穴をあけた後、この穴内および絶縁
膜3a上に不純物をドープしたポリシリコンをデポジシ
ョンして接続部8bの下部と第4ポリシリコン層4とを
形成し、同様に絶縁膜3bを形成して2個の穴をあけた
後接続部8bの上部および接続部8Cの下部と第2ポリ
シリコン層5とを形成し、さらに絶縁膜3Cを形成して
穴をあけた後、この穴内および絶縁膜3c上にアルミニ
ウムをデポジションすることによシ接続部8cの上部お
よび電極Bを形成する。このような構成にすることによ
りさらに大きな容量値のコンデンサが得られ、入力保護
能力を一層読めることができる。
なお、上述した各実施例では、導電層材料としてポリシ
リコンを使用した例を説明したが、その他の導電性材料
を使用した場合も同様の効果が得られる。
リコンを使用した例を説明したが、その他の導電性材料
を使用した場合も同様の効果が得られる。
また、4層層は2層に限らず、1層、または3層以上の
場合にも本発明は同様に適用できる。
場合にも本発明は同様に適用できる。
以上説明したように、この発明によれば、電極下の導電
層を基板と接続してコンデンサを形成したことにより、
レイアウト上訴たな面積を必要とすることもすく、ナー
ジ耐圧の向上を図ることができる効果がある。
層を基板と接続してコンデンサを形成したことにより、
レイアウト上訴たな面積を必要とすることもすく、ナー
ジ耐圧の向上を図ることができる効果がある。
第1図はこの発明の一実施例を示す断面図、第2図はこ
の発明の他の実施例を示す断面図、第3図は従来列を示
す断面図である。 。 1・・・串半導体基板、2・・・・酸化膜、3、3a、
3b+3c a e e *絶縁膜、4.5e**eポ
リシリコン層(導電層)、6・・・・アルミニウム電極
、7・・暑・リード線、aatabsac・・・・接続
部。
の発明の他の実施例を示す断面図、第3図は従来列を示
す断面図である。 。 1・・・串半導体基板、2・・・・酸化膜、3、3a、
3b+3c a e e *絶縁膜、4.5e**eポ
リシリコン層(導電層)、6・・・・アルミニウム電極
、7・・暑・リード線、aatabsac・・・・接続
部。
Claims (2)
- (1)半導体基板上に相互に絶縁層によつて絶縁された
少なくとも一層の導電層を形成し、その上にさらに絶縁
層を介して外部ピンおよび内部回路に接続される電極を
形成してなる入力保護装置において、導電層の少なくと
も一層を半導体基板に接続し当該導電層と電極との間に
コンデンサを形成したことを特徴とする入力保護装置。 - (2)導電層がポリシリコンからなることを特徴とする
特許請求の範囲第1項記載の入力保護装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60091446A JPS61248540A (ja) | 1985-04-26 | 1985-04-26 | 入力保護装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60091446A JPS61248540A (ja) | 1985-04-26 | 1985-04-26 | 入力保護装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61248540A true JPS61248540A (ja) | 1986-11-05 |
Family
ID=14026590
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60091446A Pending JPS61248540A (ja) | 1985-04-26 | 1985-04-26 | 入力保護装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61248540A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0536972A2 (en) * | 1991-10-07 | 1993-04-14 | Maxim Integrated Products, Inc. | An integrated circuit device having improved substrate capacitance isolation |
EP1143513A1 (en) * | 2000-04-03 | 2001-10-10 | Nec Corporation | Semiconductor device and method of fabricating the same |
-
1985
- 1985-04-26 JP JP60091446A patent/JPS61248540A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0536972A2 (en) * | 1991-10-07 | 1993-04-14 | Maxim Integrated Products, Inc. | An integrated circuit device having improved substrate capacitance isolation |
EP1143513A1 (en) * | 2000-04-03 | 2001-10-10 | Nec Corporation | Semiconductor device and method of fabricating the same |
US6781238B2 (en) | 2000-04-03 | 2004-08-24 | Nec Corporation | Semiconductor device and method of fabricating the same |
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