JPS61182163A - プログラム拡張方式 - Google Patents
プログラム拡張方式Info
- Publication number
- JPS61182163A JPS61182163A JP2141585A JP2141585A JPS61182163A JP S61182163 A JPS61182163 A JP S61182163A JP 2141585 A JP2141585 A JP 2141585A JP 2141585 A JP2141585 A JP 2141585A JP S61182163 A JPS61182163 A JP S61182163A
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- Japan
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- program
- host device
- expanding
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- rom
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は上位装置よシ離れて配置された各処理装置の拡
張プログラムを上位装置からロードして拡張するプログ
ラム拡張方式に関するものである。
張プログラムを上位装置からロードして拡張するプログ
ラム拡張方式に関するものである。
従来、処理装置 （ＣＰＵ）の制御下にリードオンリメ
モリ（ＲＯＭ ）にプログラムを内蔵し、ランダムアク
セスメモＩＪ （ＲＡＭ）にはプログラム以外のデータ
を格納して、所望の入出力装置ＣＩｌｏ ）の動作を実
行する第１の方式が多用されている。この方式ではＲＯ
ＭはＲＡＭに比べ格段に安価であるが、現地でのプログ
ラムの拡張が不可である。
モリ（ＲＯＭ ）にプログラムを内蔵し、ランダムアク
セスメモＩＪ （ＲＡＭ）にはプログラム以外のデータ
を格納して、所望の入出力装置ＣＩｌｏ ）の動作を実
行する第１の方式が多用されている。この方式ではＲＯ
ＭはＲＡＭに比べ格段に安価であるが、現地でのプログ
ラムの拡張が不可である。
これに対し、第２の方式として第３図に示すように表面
的には０ＰＵＩの制御下のバス５に几ＯＭ２とＲＡＭ３
を接続し、回線インタフェース４を介して上位装置との
間で情報の授受が行なわれることは、ｇｌの方式と同様
である。
的には０ＰＵＩの制御下のバス５に几ＯＭ２とＲＡＭ３
を接続し、回線インタフェース４を介して上位装置との
間で情報の授受が行なわれることは、ｇｌの方式と同様
である。
しかし、プログラムに関与するものがＲＯＭ ２とＲＡ
Ｍ３に亘る点が異なる。すなわち、 ＲＯＭ上にあるプ
ログラムローダによシ、上位装置よシ運用プログラムを
ＲＡＭ上にロードするものである。この場合は上位装置
からのリモートロードによるプログラムの拡張が可能で
あシ、ユーザ毎に運用プログラムが変わる場合や、高級
言語を使用してユーザが作成したプログラムで動かす場
合等に有用である。しかし運用プログラムを入れるＲＡ
Ｍの容量が前方式に比べ非常に大きいものとなり、高価
となる。
Ｍ３に亘る点が異なる。すなわち、 ＲＯＭ上にあるプ
ログラムローダによシ、上位装置よシ運用プログラムを
ＲＡＭ上にロードするものである。この場合は上位装置
からのリモートロードによるプログラムの拡張が可能で
あシ、ユーザ毎に運用プログラムが変わる場合や、高級
言語を使用してユーザが作成したプログラムで動かす場
合等に有用である。しかし運用プログラムを入れるＲＡ
Ｍの容量が前方式に比べ非常に大きいものとなり、高価
となる。
［発明が解決しようとする問題点〕
上記第１の方式ではプログラムはＲＯＭのみであるから
安価であるがプログラムの拡張が不可である。これに対
し第２の方式では上位装置からのリモートロードによシ
各種のプログラムの拡張、変更が可能であるが高価なも
のとなる。そこで、本発明では前記２方式の欠点を補完
し、比較的安価なプログラムの拡張を図ろうとするもの
である。
安価であるがプログラムの拡張が不可である。これに対
し第２の方式では上位装置からのリモートロードによシ
各種のプログラムの拡張、変更が可能であるが高価なも
のとなる。そこで、本発明では前記２方式の欠点を補完
し、比較的安価なプログラムの拡張を図ろうとするもの
である。
不発明の目的は、ＲＯＭとＲＡＭの一部を有効に用い安
価で拡張可能なプログ２ム拡張方式を提供することにあ
る。
価で拡張可能なプログ２ム拡張方式を提供することにあ
る。
前記目的を達成するため、本発明のプログラム拡張方式
は上位装置よシ離れて配置された各処理装置がそれぞれ
プログラム内蔵のリードオンリメモリ（ＲＯＭ）とデー
タ格納用のランダムアクセスメモ！ｊ （）ＬＡＭ）を
有するシステムにおいて、前記各処理装置のＲＡＭに拡
張プログラム領域を没けておき、上位装置より処理装置
のＲＡＭにプログラムをロードしＲＯＭのプログラムを
変更するようにしたことを特徴とするものである。
は上位装置よシ離れて配置された各処理装置がそれぞれ
プログラム内蔵のリードオンリメモリ（ＲＯＭ）とデー
タ格納用のランダムアクセスメモ！ｊ （）ＬＡＭ）を
有するシステムにおいて、前記各処理装置のＲＡＭに拡
張プログラム領域を没けておき、上位装置より処理装置
のＲＡＭにプログラムをロードしＲＯＭのプログラムを
変更するようにしたことを特徴とするものである。
上記構成によシ、各処理装置のＲＯＭには当初のプログ
ラムのみを内蔵し、ＲＡＭにはその１部に拡張プログラ
ム領域を用意する。従ってＲＡＭは必要な容量に対し若
干の増加領域があればよいから、ここに上位装置から必
要の場合にロードするようにしたものである。このよう
にして安価なプログラム拡張が可能となる。
ラムのみを内蔵し、ＲＡＭにはその１部に拡張プログラ
ム領域を用意する。従ってＲＡＭは必要な容量に対し若
干の増加領域があればよいから、ここに上位装置から必
要の場合にロードするようにしたものである。このよう
にして安価なプログラム拡張が可能となる。
第１図は本発明の実施例の構成説明図であり、第２図は
実施例の要部の詳細説明図である。
実施例の要部の詳細説明図である。
第１図において、第３図と異なる点はＲＡＭ１０の一部
に拡張プログラム領域１０−１を設ける。そしてこの拡
張プログラムの実行を行なうための構成として、まずＲ
ＯＭ Ｚ上ロードプログラムによシ、上位装置から拡張
プログラムをＲＡＭｌ０−１上に、また）ＩＬＯＭ上の
プログラムからＲＡＭ１０−１上の拡張プログラムにジ
ャンプするために必要な変更アドレスを予め登録しであ
る変更アドレスレジスタ群１１にロードする。なお、拡
張プログラムおよび変更アドレスのロードは上位装置に
限らず、自己のＶ。
に拡張プログラム領域１０−１を設ける。そしてこの拡
張プログラムの実行を行なうための構成として、まずＲ
ＯＭ Ｚ上ロードプログラムによシ、上位装置から拡張
プログラムをＲＡＭｌ０−１上に、また）ＩＬＯＭ上の
プログラムからＲＡＭ１０−１上の拡張プログラムにジ
ャンプするために必要な変更アドレスを予め登録しであ
る変更アドレスレジスタ群１１にロードする。なお、拡
張プログラムおよび変更アドレスのロードは上位装置に
限らず、自己のＶ。
装置からも可能である。
拡張グログラムの実行は、ＣＰＵ ｊが現在実行してい
る）ｔＯＭ ２の実行アドレスをプログラムカウンタ１
３の値で検出し、前記変更アドレスレジスタ群１１の中
の値とを比較器１２で比較する。一致した時に緊急割込
信号（ＮＭｆｆｌ）を発生して０ＰＵ１に送シ、ＲＡＭ
１０の拡張プログラム領域の先頭ヘジャンプする。そし
て、該当拡張プログラムブロックへ分岐し、実行終了後
ＲＯＭＺ上の必要な戻シ先にジャンプする。
る）ｔＯＭ ２の実行アドレスをプログラムカウンタ１
３の値で検出し、前記変更アドレスレジスタ群１１の中
の値とを比較器１２で比較する。一致した時に緊急割込
信号（ＮＭｆｆｌ）を発生して０ＰＵ１に送シ、ＲＡＭ
１０の拡張プログラム領域の先頭ヘジャンプする。そし
て、該当拡張プログラムブロックへ分岐し、実行終了後
ＲＯＭＺ上の必要な戻シ先にジャンプする。
第２図は本発明の要部である変更アドレスレジスタ群１
１．比較器１２ 、 ＲＯＭ２ （プログラムカウンタ
１３）、■ＡＭ１０−１の間の動作手順の詳細説明図で
ある。
１．比較器１２ 、 ＲＯＭ２ （プログラムカウンタ
１３）、■ＡＭ１０−１の間の動作手順の詳細説明図で
ある。
いま、ＲＯＭ２に格納されたプログラムコマンドの実行
アドレスをプログラムカラ／り１６で検出し、たとえば
実行アドレス人０３８が変更アドレスレジスタ群１１に
登録されておシ、比較器１２で一致が検出されると、Ｎ
Ｍｔ信号を０ＰＵ１に送る。ここで緊急割込みが行なわ
れ割込み先としてＲＡＭの拡張プログラム領域１０−１
の先頭ヘジャンプする。そして割込み前の実行アドレス
Ａ０３８よシ「テーブルサーチ」〔■〕で変更処理プロ
グラムの先頭へさらに分岐し、ＡＯ３８番地に対応する
「拡張プログラム」〔＠〕を実行する。そしてｒＪｓ
ｍｐＪ （６１）で拡張プログラムの戻シ先のたとえば
Ａ１２６ヘジヤンプする。そしてＲＯＭ２のｒＡｏｓＡ
〜Ａ１２４」〔＠〕 が拡張プログラムで変更される
部分となる。
アドレスをプログラムカラ／り１６で検出し、たとえば
実行アドレス人０３８が変更アドレスレジスタ群１１に
登録されておシ、比較器１２で一致が検出されると、Ｎ
Ｍｔ信号を０ＰＵ１に送る。ここで緊急割込みが行なわ
れ割込み先としてＲＡＭの拡張プログラム領域１０−１
の先頭ヘジャンプする。そして割込み前の実行アドレス
Ａ０３８よシ「テーブルサーチ」〔■〕で変更処理プロ
グラムの先頭へさらに分岐し、ＡＯ３８番地に対応する
「拡張プログラム」〔＠〕を実行する。そしてｒＪｓ
ｍｐＪ （６１）で拡張プログラムの戻シ先のたとえば
Ａ１２６ヘジヤンプする。そしてＲＯＭ２のｒＡｏｓＡ
〜Ａ１２４」〔＠〕 が拡張プログラムで変更される
部分となる。
以上説明したように、本発明によれは、上位装置よシ離
れて配置された各処理装置のＲＡＭの一部に拡張プログ
ラム領域を設け、これに上位装置からロードして当初の
プログラムを拡張することができるものである。これに
よシ、各処理装置では安価なＲＯＭと将来拡張が予想さ
れる最少限の領域の余裕をもたせたＲＡＭを用意してお
けば、必要な時に僅かのプログラムの変更で対応できる
ものでちゃ、経済的なプログラム拡張方式が得られる。
れて配置された各処理装置のＲＡＭの一部に拡張プログ
ラム領域を設け、これに上位装置からロードして当初の
プログラムを拡張することができるものである。これに
よシ、各処理装置では安価なＲＯＭと将来拡張が予想さ
れる最少限の領域の余裕をもたせたＲＡＭを用意してお
けば、必要な時に僅かのプログラムの変更で対応できる
ものでちゃ、経済的なプログラム拡張方式が得られる。
第１図は本発明の実施例の構成説明図、第２図は実施例
の要部の詳細説明図、第６図は従来例の構成説明図であ
り、図中、１はＣＰＵ、２はＲＯＭ。 ４は回線インタフェース、５はパス、１０はＲＡＭ。 １０−１は拡張プログラム鎖酸、１１は変更アドレスレ
ジスタ群、１２は比較器、１３はプログラムカウンタを
示す。
の要部の詳細説明図、第６図は従来例の構成説明図であ
り、図中、１はＣＰＵ、２はＲＯＭ。 ４は回線インタフェース、５はパス、１０はＲＡＭ。 １０−１は拡張プログラム鎖酸、１１は変更アドレスレ
ジスタ群、１２は比較器、１３はプログラムカウンタを
示す。
Claims (1)
- 上位装置より離れて配置された各処理装置がそれぞれプ
ログラム内蔵のリードオンリメモリ（ＲＯＭ）とデータ
格納用のランダムアクセスメモリ（ＲＡＭ）を有するシ
ステムにおいて、前記各処理装置のＲＡＭに拡張プログ
ラム領域を設けておき、上位装置より処理装置のＲＡＭ
にプログラムをロードしＲＯＭのプログラムを変更する
ようにしたことを特徴とするプログラム拡張方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2141585A JPS61182163A (ja) | 1985-02-06 | 1985-02-06 | プログラム拡張方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2141585A JPS61182163A (ja) | 1985-02-06 | 1985-02-06 | プログラム拡張方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61182163A true JPS61182163A (ja) | 1986-08-14 |
Family
ID=12054379
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2141585A Pending JPS61182163A (ja) | 1985-02-06 | 1985-02-06 | プログラム拡張方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61182163A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6466770A (en) * | 1987-09-08 | 1989-03-13 | Fujitsu Ltd | Data storing system for large capacity processor |
| US5923372A (en) * | 1995-08-23 | 1999-07-13 | Samsung Electronics Co., Ltd. | Apparatus and method for controlling an iris according to brightness variation of input signal |
-
1985
- 1985-02-06 JP JP2141585A patent/JPS61182163A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6466770A (en) * | 1987-09-08 | 1989-03-13 | Fujitsu Ltd | Data storing system for large capacity processor |
| US5923372A (en) * | 1995-08-23 | 1999-07-13 | Samsung Electronics Co., Ltd. | Apparatus and method for controlling an iris according to brightness variation of input signal |
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