JPS61169892A - 液晶表示装置の交流映像信号形成回路 - Google Patents
液晶表示装置の交流映像信号形成回路Info
- Publication number
- JPS61169892A JPS61169892A JP1031385A JP1031385A JPS61169892A JP S61169892 A JPS61169892 A JP S61169892A JP 1031385 A JP1031385 A JP 1031385A JP 1031385 A JP1031385 A JP 1031385A JP S61169892 A JPS61169892 A JP S61169892A
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- Japan
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- video signal
- transistors
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は液晶テレビに使用する液晶表示装置の交流映像
信号形成回路に関する。
信号形成回路に関する。
従来の技術
近年、ポケッタブル液晶テレビはメーカ数社から発売さ
れ、今後さらに拡大されるものと考えられる。
れ、今後さらに拡大されるものと考えられる。
液晶パネルは交流駆動が必要となるため映像信号を交流
映像信号形成回路により１フイールド毎に極性を反転さ
せている。以下図面を参照しながら、従来の液晶表示装
置の交流映像信号形成回路の一例について説明する。
映像信号形成回路により１フイールド毎に極性を反転さ
せている。以下図面を参照しながら、従来の液晶表示装
置の交流映像信号形成回路の一例について説明する。
第２図は従来の液晶表示装置の交流映像信号形成回路を
示す。
示す。
第２図において、（１）は電源ライン、（２）は１フイ
ールド毎に極性が反転するパルス入力端子、（３）は映
像入力端子、（４）はパルス入力端子（２）と同極性の
パルス入力端子、（５）は交流映像信号出力端子（以下
出力端子という。）である。パルス入力端子（２）のパ
ルスがハイレベル時にはトランジスタＱ、′、Ｑｔ’が
オフζなる。このときパルス入力端子（４）のパルスも
ハイレベルとなり、トランジスタＱ、１１′、Ｑｏ’は
オンとなり、トランジスタＱａ’、Ｑ＋ｙ’がオフとな
る。したがって映像入力端子（３）の映像信号はトラン
ジスタＱ５’ １１ Ｑ＠’、Ｑ＋４’、Ｑｔｏを通っ
て出力端子（５）に出力される。逆にパルス入力端子（
２）のパルスがローレベル時にはトランジスタＱ１’
、Ｑ４’はオンとなり、トランジスタＱｆ ｓ Ｑ４’
がオフとなる０このときパルス入力端子（４）のパルス
もローレベルとなりトランジスタＱＸ ＳＱｊがオフと
なる。したがって映像入力端子（３）の映像信号はトラ
ンジスタＱ５′、Ｑａ’、Ｑテ′、Ｑ ｓｏ’を通って
出力端子（５）に出力される。このようにして１フイー
ルド毎にパルス入力端子（２）、（４）に加えるパルス
の極性を反転することにより、映像入力端子（３）の映
像信号は１フイールド毎に極性が反転されて出力端子（
５）に出力される。
ールド毎に極性が反転するパルス入力端子、（３）は映
像入力端子、（４）はパルス入力端子（２）と同極性の
パルス入力端子、（５）は交流映像信号出力端子（以下
出力端子という。）である。パルス入力端子（２）のパ
ルスがハイレベル時にはトランジスタＱ、′、Ｑｔ’が
オフζなる。このときパルス入力端子（４）のパルスも
ハイレベルとなり、トランジスタＱ、１１′、Ｑｏ’は
オンとなり、トランジスタＱａ’、Ｑ＋ｙ’がオフとな
る。したがって映像入力端子（３）の映像信号はトラン
ジスタＱ５’ １１ Ｑ＠’、Ｑ＋４’、Ｑｔｏを通っ
て出力端子（５）に出力される。逆にパルス入力端子（
２）のパルスがローレベル時にはトランジスタＱ１’
、Ｑ４’はオンとなり、トランジスタＱｆ ｓ Ｑ４’
がオフとなる０このときパルス入力端子（４）のパルス
もローレベルとなりトランジスタＱＸ ＳＱｊがオフと
なる。したがって映像入力端子（３）の映像信号はトラ
ンジスタＱ５′、Ｑａ’、Ｑテ′、Ｑ ｓｏ’を通って
出力端子（５）に出力される。このようにして１フイー
ルド毎にパルス入力端子（２）、（４）に加えるパルス
の極性を反転することにより、映像入力端子（３）の映
像信号は１フイールド毎に極性が反転されて出力端子（
５）に出力される。
発明が解決しようとする問題点
しかしながら前記のような構成では次のような問題点が
ある。
ある。
（１）１フイールド毎に極性を反転させた映像信号の第
１フイールドと第２フイールドの同一輝度レベルの任意
の電圧がある特定の電圧（以下コモン電圧という。）か
ら極性が逆で同電位差になるようにしなければならない
。ここで出力端子（５）の電圧変化を考察する。（１）
の電源ラインの電圧をＶａａ、映像入力端子（３）の映
像信号の電圧をｖ３、出力端子（５）の出力映像信号の
電圧をｖ５、トランジスタＱ１のベース、エミッタ間電
圧をＶＢＩｅｌ、飽和電圧をＶｃｒ＋（ａａｔ、）ｉ、
ダイオードＤ１の端子電圧をＶＤｉとすると、パルス入
力端子＋２１ 、（４）のパルスがハイレベル時には ＋ ＶＤ２ ＋ｖｃｌ（ｓａｔ）８−７ｍｍｌ０
＋＋＋ ＋＋ １１）パルス入力端子（２＋、（４１
のパルスがローレベル時には、 ＶＢ＝ＶＱＱ ＷＯＥ（８＆ｔ）ｌ（Ｖｃｃ ｖ、
ＶＣｘ（ｓａｔ）ｚとなる。ここでパルス入力端子＋２
）、（４）のパルスのハイ、ローレベルによって切換え
られたｖ５はコモン電圧から極性が逆で同電位差になけ
ればならないが、抵抗値、トランジスタのベース、エミ
ッタ間電圧及び飽和電圧などのバラツキにより正確に設
定するのがむずかしくなる。
１フイールドと第２フイールドの同一輝度レベルの任意
の電圧がある特定の電圧（以下コモン電圧という。）か
ら極性が逆で同電位差になるようにしなければならない
。ここで出力端子（５）の電圧変化を考察する。（１）
の電源ラインの電圧をＶａａ、映像入力端子（３）の映
像信号の電圧をｖ３、出力端子（５）の出力映像信号の
電圧をｖ５、トランジスタＱ１のベース、エミッタ間電
圧をＶＢＩｅｌ、飽和電圧をＶｃｒ＋（ａａｔ、）ｉ、
ダイオードＤ１の端子電圧をＶＤｉとすると、パルス入
力端子＋２１ 、（４）のパルスがハイレベル時には ＋ ＶＤ２ ＋ｖｃｌ（ｓａｔ）８−７ｍｍｌ０
＋＋＋ ＋＋ １１）パルス入力端子（２＋、（４１
のパルスがローレベル時には、 ＶＢ＝ＶＱＱ ＷＯＥ（８＆ｔ）ｌ（Ｖｃｃ ｖ、
ＶＣｘ（ｓａｔ）ｚとなる。ここでパルス入力端子＋２
）、（４）のパルスのハイ、ローレベルによって切換え
られたｖ５はコモン電圧から極性が逆で同電位差になけ
ればならないが、抵抗値、トランジスタのベース、エミ
ッタ間電圧及び飽和電圧などのバラツキにより正確に設
定するのがむずかしくなる。
（２） 次にＶ、のダイナミックレンジを考察する。
抵抗Ｒ１の端子電圧をＶＲｌとすると、パルス入力端子
＋２） 、（４）のパルスがハイレベル時のＶ、のダイ
ナミックレンジは、 ＶＤＩ −１−ＶＤ２ ＋ Ｖａｎ（ｓａｔ） ８−
ＶＢｌｔｌＯ（Ｖ、 ＜ＶＧＱ−ＶＦ６− Ｖｃｌｌ（
ｓａｔ） ４− ｖｎｍｔｏ ｍ ＋＋ （３１とな
り、パルス入力端子ｔ２） 、（４１のパルスがローレ
ベル時には、 Ｖａｎ（ｓａｔ）１１ ＋ ＶＢ２ （Ｖ５ （Ｖｃｃ
−Ｔｅｌ（ｓａｔ） １− Ｖｓｘ １０
− ・・・（４）となる。ここでコモン電圧
を電源電圧Ｖｃｃの１／２とし、第１フイールドのｖ５
のダイナミックレンジの上限を前記（３）式の Ｖａａ
−ＶＢ２− Ｖｃｆｆｉ（ａａｔ）４−ｖｍｍｘｏ
、第２フイールドのＶ、のダイナミックレンジの下限
を前記（４）式のｖＣｘ（ｓａｔ）ｕ ＋ ＶＢ２とす
ると、この上、下限値がコモン電圧から極性が逆で同電
位差にならず、特に映像信号が大きくなりＶ、のダイナ
ミックレンジの上下限値に近い値になった場合、映像信
号のコモン電圧に対しての対称性に間層が生じてくる。
＋２） 、（４）のパルスがハイレベル時のＶ、のダイ
ナミックレンジは、 ＶＤＩ −１−ＶＤ２ ＋ Ｖａｎ（ｓａｔ） ８−
ＶＢｌｔｌＯ（Ｖ、 ＜ＶＧＱ−ＶＦ６− Ｖｃｌｌ（
ｓａｔ） ４− ｖｎｍｔｏ ｍ ＋＋ （３１とな
り、パルス入力端子ｔ２） 、（４１のパルスがローレ
ベル時には、 Ｖａｎ（ｓａｔ）１１ ＋ ＶＢ２ （Ｖ５ （Ｖｃｃ
−Ｔｅｌ（ｓａｔ） １− Ｖｓｘ １０
− ・・・（４）となる。ここでコモン電圧
を電源電圧Ｖｃｃの１／２とし、第１フイールドのｖ５
のダイナミックレンジの上限を前記（３）式の Ｖａａ
−ＶＢ２− Ｖｃｆｆｉ（ａａｔ）４−ｖｍｍｘｏ
、第２フイールドのＶ、のダイナミックレンジの下限
を前記（４）式のｖＣｘ（ｓａｔ）ｕ ＋ ＶＢ２とす
ると、この上、下限値がコモン電圧から極性が逆で同電
位差にならず、特に映像信号が大きくなりＶ、のダイナ
ミックレンジの上下限値に近い値になった場合、映像信
号のコモン電圧に対しての対称性に間層が生じてくる。
問題点を解決するための手段
本発明は、トランジスタＱｔ 、ＱｓおよヒＱａｔカス
ケード接続しカスケード回路を構成し、前記トランジス
タＱ、のベースに映像信号を供給し、トランジスタＱ、
のエミッタ、コレクタを介して映像信号の出力端子に接
続し、ハイ、ロー入力パルスをトランジスタＱ、のコレ
クタ、エミッタに供給し、１フイールド毎に極性を反転
し、第１フイールド信号、第２フイールド信号を前記出
方端子に出力するよう構成した液晶表示装置の交流映像
信号形成回路において、抵抗Ｒ，、Ｒ８およびＲ４の抵
抗直列回路を前記カスケード回路に並列に接続し、接続
端の一方を電源に接続し、トランジスタＱ＋ 、、Ｑｓ
ｅ設け、トランジスタＱ、のエミッタを前記カスケー
ド回路のトランジスタＣＬ２のベースに、トランジスタ
Ｑ、のエミッタをトランジスタＱ４ノヘースに接続し、
トランジスタＱｓ 、Ｑｓのコレクタをそれぞれトラン
ジスタ。、と。、の接続点に、またトランジスタＱ、と
。４の接続点に接続し、前記カスケード回路と出方端子
間に２個のアナログスイッチ素子からなるボルテージホ
ロア回路を設け、前記アナログスイッチ素子のそれぞれ
の一端子をトランジスタＱ、のエミッタとコレクタに接
続し、他端子のそれぞれにパルス信号を供給し、トラン
ジスタＱ＋、Ｑｔ、ＱａおよびＱ４のベース・エツタ電
圧ｖｎｇｔ （１＝ ｔ〜４ ）をＶＢＩＣＩ ＝ＶＢ
Ｋ２ ” ＶＢＭ３ ＝ ７Ｂ１４ 、抵抗Ｒ，＝ Ｒ
，とすると共に前記ボルテージホロア回路へ相互に逆極
性のパルスを供給するものである。
ケード接続しカスケード回路を構成し、前記トランジス
タＱ、のベースに映像信号を供給し、トランジスタＱ、
のエミッタ、コレクタを介して映像信号の出力端子に接
続し、ハイ、ロー入力パルスをトランジスタＱ、のコレ
クタ、エミッタに供給し、１フイールド毎に極性を反転
し、第１フイールド信号、第２フイールド信号を前記出
方端子に出力するよう構成した液晶表示装置の交流映像
信号形成回路において、抵抗Ｒ，、Ｒ８およびＲ４の抵
抗直列回路を前記カスケード回路に並列に接続し、接続
端の一方を電源に接続し、トランジスタＱ＋ 、、Ｑｓ
ｅ設け、トランジスタＱ、のエミッタを前記カスケー
ド回路のトランジスタＣＬ２のベースに、トランジスタ
Ｑ、のエミッタをトランジスタＱ４ノヘースに接続し、
トランジスタＱｓ 、Ｑｓのコレクタをそれぞれトラン
ジスタ。、と。、の接続点に、またトランジスタＱ、と
。４の接続点に接続し、前記カスケード回路と出方端子
間に２個のアナログスイッチ素子からなるボルテージホ
ロア回路を設け、前記アナログスイッチ素子のそれぞれ
の一端子をトランジスタＱ、のエミッタとコレクタに接
続し、他端子のそれぞれにパルス信号を供給し、トラン
ジスタＱ＋、Ｑｔ、ＱａおよびＱ４のベース・エツタ電
圧ｖｎｇｔ （１＝ ｔ〜４ ）をＶＢＩＣＩ ＝ＶＢ
Ｋ２ ” ＶＢＭ３ ＝ ７Ｂ１４ 、抵抗Ｒ，＝ Ｒ
，とすると共に前記ボルテージホロア回路へ相互に逆極
性のパルスを供給するものである。
作用
抵抗Ｒ，、Ｒ３およびＲ４の抵抗直列回路を前記トラン
ジスタ（ｈ 、ＱｓおよびＱ、をカスケード接続したカ
スケード回路に並列に接続し、接続端の一方を電源に接
続し、トランジスタＱ１、Ｑ、を設け、トランジスタＱ
１のエミッタを前記カスケード回路のトランジスタＱ、
のベースに、トランジスタＱ３のエミッタをトランジス
タＱ４のべ〒スに接続し、トランジスタＱ□、Ｑｓのコ
レクタをそれぞれトランジスタＱ、とＱ、の接続点に、
またトランジスタＱ、とＱ４の接続点に接続し、前記カ
スケード回路と出力端子間に２個のアナログスイッチ素
子からなるボルテージホロア回路を設け、前記アナログ
スイッチ素子のそれぞれの一端子をトランジスタＱ、ｓ
のエミッタとコレクタに接続し、他端子のそれぞれにパ
ルス信号を供給し、トランジスタｑ８、Ｑ３、Ｑ、およ
びＱ４のベース蕾エッタ電圧ｖｎｇ１（１＝ １〜４
）をＶＢＩＩ ＝ ＶＢＲ２＝ ７１ｍ３＝ ｙｍｚ４
、抵抗Ｒ，＝Ｒ４とすると共に前記ボルテージホロア
回路へ相互に逆極性のパルスを供給する構成に基いて次
に作用を生ずる。
ジスタ（ｈ 、ＱｓおよびＱ、をカスケード接続したカ
スケード回路に並列に接続し、接続端の一方を電源に接
続し、トランジスタＱ１、Ｑ、を設け、トランジスタＱ
１のエミッタを前記カスケード回路のトランジスタＱ、
のベースに、トランジスタＱ３のエミッタをトランジス
タＱ４のべ〒スに接続し、トランジスタＱ□、Ｑｓのコ
レクタをそれぞれトランジスタＱ、とＱ、の接続点に、
またトランジスタＱ、とＱ４の接続点に接続し、前記カ
スケード回路と出力端子間に２個のアナログスイッチ素
子からなるボルテージホロア回路を設け、前記アナログ
スイッチ素子のそれぞれの一端子をトランジスタＱ、ｓ
のエミッタとコレクタに接続し、他端子のそれぞれにパ
ルス信号を供給し、トランジスタｑ８、Ｑ３、Ｑ、およ
びＱ４のベース蕾エッタ電圧ｖｎｇ１（１＝ １〜４
）をＶＢＩＩ ＝ ＶＢＲ２＝ ７１ｍ３＝ ｙｍｚ４
、抵抗Ｒ，＝Ｒ４とすると共に前記ボルテージホロア
回路へ相互に逆極性のパルスを供給する構成に基いて次
に作用を生ずる。
ここでトランジスタＱ、のエミッタとコレクタの映像信
号について考察する。
号について考察する。
（３）の入力映像信号のＤＣレベルを適当に選べば、こ
のエミッタとコレクタの映像信号を電源電圧の１／２の
コモン電圧に対して対称なものにすることができる。ま
たＶＢＩＩ ：： ＶＢｍ２ ＝ＶＢＨ３” ｖｎｘ４
としであるので、このエミッタ側のダイナミックレンジ
の下限電圧は ＶＯＱ Ｘ Ｒ，＋ Ｒ、＋ Ｒ４トナ
リ、コレクタ側のダイナミックレンジの上限電圧はＶ・
・−Ｖ・・×Ｒ１＋Ｒ，，＋Ｒ４となる・したがってＲ
，＝ Ｒ４とすれば上記ダイナミックレンジの上下限値
はコモン電圧に対して対称に設定できる。
のエミッタとコレクタの映像信号を電源電圧の１／２の
コモン電圧に対して対称なものにすることができる。ま
たＶＢＩＩ ：： ＶＢｍ２ ＝ＶＢＨ３” ｖｎｘ４
としであるので、このエミッタ側のダイナミックレンジ
の下限電圧は ＶＯＱ Ｘ Ｒ，＋ Ｒ、＋ Ｒ４トナ
リ、コレクタ側のダイナミックレンジの上限電圧はＶ・
・−Ｖ・・×Ｒ１＋Ｒ，，＋Ｒ４となる・したがってＲ
，＝ Ｒ４とすれば上記ダイナミックレンジの上下限値
はコモン電圧に対して対称に設定できる。
以上のように本発明の実施例によれば、１フイールド毎
に極性の反転された交流映像信号は、コモン電圧に対し
対称となり、かつこのダイナミックレンジもコモン電圧
に対し対称となる。
に極性の反転された交流映像信号は、コモン電圧に対し
対称となり、かつこのダイナミックレンジもコモン電圧
に対し対称となる。
実施例
第１図は本発明の液晶表示装置の交流映像形成回路の一
実施例を示す回路図である。
実施例を示す回路図である。
図において、前記第２図と同一符号は同一部分を示す。
図において、（６）の破線で囲まれた回路はボルテージ
ホロア回路であり、２個のアナログスイッチ素子からな
るアナ四グスイッチになっている。
ホロア回路であり、２個のアナログスイッチ素子からな
るアナ四グスイッチになっている。
（３）から入力された映像信号はトランジスタＱ、のエ
ミッタとコレクタで互いに逆極性の映像信号となり、ス
イッチ回路（６）に加えられる。パルス入力端子（２）
、（４１のパルスによって１フイールド毎にスイッチ
回路Ｑｓ １Ｑ、ｏ Ｎ Ｃｔｌｔと Ｑｔｏ ％ Ｑ
ｔｔ ％ ＱＣｓがオン１オフし、トランジスタＱ５の
エミッタとコレクタの映像信号がそのまま出力端子（５
）に出力される。
ミッタとコレクタで互いに逆極性の映像信号となり、ス
イッチ回路（６）に加えられる。パルス入力端子（２）
、（４１のパルスによって１フイールド毎にスイッチ
回路Ｑｓ １Ｑ、ｏ Ｎ Ｃｔｌｔと Ｑｔｏ ％ Ｑ
ｔｔ ％ ＱＣｓがオン１オフし、トランジスタＱ５の
エミッタとコレクタの映像信号がそのまま出力端子（５
）に出力される。
なおトランジスタＱ＋５と抵抗Ｒ８゜の回路は出力段の
定電流負荷である。
定電流負荷である。
ここでトランジスタＱ、ｓのエミッタとコレクタ ４
の映像信号について考察する。（３）の入力映像信号の
ＤＣレベルを適当に選べば、このエミッタとコレクタの
映像信号を電源電圧の１／２のコモン電圧に対して対称
なものにすることができる。また’ＶＢｚｌ ＝ ＶＢ
Ｅ２ ＝ ＶＢ＋ｅ３ ＝＝ Ｖｎｘ４としであるので
、このエミッタ側のダイナミックレンジの下限電圧はと
なる。したがって、Ｒ，＝Ｒ４とすれば上記ダイナミッ
クレンジの上下限値はコモン電圧に対して対称に設定で
きる。
の映像信号について考察する。（３）の入力映像信号の
ＤＣレベルを適当に選べば、このエミッタとコレクタの
映像信号を電源電圧の１／２のコモン電圧に対して対称
なものにすることができる。また’ＶＢｚｌ ＝ ＶＢ
Ｅ２ ＝ ＶＢ＋ｅ３ ＝＝ Ｖｎｘ４としであるので
、このエミッタ側のダイナミックレンジの下限電圧はと
なる。したがって、Ｒ，＝Ｒ４とすれば上記ダイナミッ
クレンジの上下限値はコモン電圧に対して対称に設定で
きる。
以上のように１本実施例によれば、１フイールド毎に極
性の反転された交流映像信号は、コモン電圧に対し対称
となり、がっこのダイナミックレンジもコモン電圧に対
し対称となる。
性の反転された交流映像信号は、コモン電圧に対し対称
となり、がっこのダイナミックレンジもコモン電圧に対
し対称となる。
発明の効果
以上のように本発明によれば、１フイールド毎に反転す
る精度の高い交流映像信号を形成できる、などの効果を
生ずる。
る精度の高い交流映像信号を形成できる、などの効果を
生ずる。
第１図は本発明の液晶表示装置の交流映像信号形成回路
の一実施例の構成図、第２図は従来の液晶表示装置の交
流映像信号形成回路図、を示す。 １：電源ライン ２：１フイールド毎に極性が反転す
るパルスの入力端子 ３：映像入力端子４：２のパル
スと逆極性のパルスの入力端子５：交流映像信号出力端
子 ６：アナログスイッチ回路 Ｑ１〜Ｑ１ｓ ’
）ランジスタＲ１〜Ｒ０゜：抵抗 Ｄ１〜Ｄ４：ダ
イオード特許出願人 松下電器産業株式会社 代理人弁理士 阿 部 功 第２図
の一実施例の構成図、第２図は従来の液晶表示装置の交
流映像信号形成回路図、を示す。 １：電源ライン ２：１フイールド毎に極性が反転す
るパルスの入力端子 ３：映像入力端子４：２のパル
スと逆極性のパルスの入力端子５：交流映像信号出力端
子 ６：アナログスイッチ回路 Ｑ１〜Ｑ１ｓ ’
）ランジスタＲ１〜Ｒ０゜：抵抗 Ｄ１〜Ｄ４：ダ
イオード特許出願人 松下電器産業株式会社 代理人弁理士 阿 部 功 第２図
Claims (1)
- トランジスタＱ＿２、Ｑ＿５およびＱ＿４をカスケード
接続しカスケード回路を構成し、前記トランジスタＱ＿
５のベースに映像信号を供給し、トランジスタＱ＿５の
エミツタ、コレクタを介して映像信号の出力端子に接続
し、ハイ、ロー入力パルスをトランジスタＱ＿５のコレ
クタ、エミツタに供給し、１フイールド毎に極性を反転
し、第１フイールド信号、第２フイールド信号を前記出
力端子に出力するよう構成した液晶表示装置の交流映像
信号形成回路において、抵抗Ｒ＿１、Ｒ＿３およびＲ＿
４の抵抗直列回路を前記カスケード回路に並列に接続し
、接続端の一方を電源に接続し、トランジスタＱ＿１、
Ｑ＿３を設け、トランジスタＱ＿１のエミツタを前記カ
スケード回路のトランジスタＱ＿２のベースに、トラン
ジスタＱ＿３のエミツタをトランジスタＱ＿４のベース
に接続し、トランジスタＱ＿１、Ｑ＿３のコレクタをそ
れぞれトランジスタＱ＿２とＱ＿５の接続点に、またト
ランジスタＱ＿５とＱ＿４の接続点に接続し、前記カス
ケード回路と出力端子間に２個のアナログスイツチ素子
からなるボルテージホロア回路を設け、前記アナログス
イツチ素子のそれぞれの一端子をトランジスタＱ＿５の
エミツタとコレクタに接続し、他端子のそれぞれにパル
ス信号を供給し、トランジスタＱ＿１、Ｑ＿２、Ｑ＿３
およびＱ＿４のベース・エツタ電圧Ｖ＿Ｂ＿Ｅ＿ｉ（ｉ
＝１〜４）をＶ＿Ｂ＿Ｅ＿１＝Ｖ＿Ｂ＿Ｅ＿２＝Ｖ＿Ｂ
＿Ｅ＿３＝Ｖ＿Ｂ＿Ｅ＿４、抵抗Ｒ＿１＝Ｒ＿４とする
と共に前記ボルテージホロア回路へ相互に逆極性のパル
スを供給する液晶表示装置の交流映像信号形成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1031385A JPS61169892A (ja) | 1985-01-23 | 1985-01-23 | 液晶表示装置の交流映像信号形成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1031385A JPS61169892A (ja) | 1985-01-23 | 1985-01-23 | 液晶表示装置の交流映像信号形成回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61169892A true JPS61169892A (ja) | 1986-07-31 |
Family
ID=11746753
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1031385A Pending JPS61169892A (ja) | 1985-01-23 | 1985-01-23 | 液晶表示装置の交流映像信号形成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61169892A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63296095A (ja) * | 1987-05-28 | 1988-12-02 | 松下電器産業株式会社 | 液晶表示装置の駆動回路 |
-
1985
- 1985-01-23 JP JP1031385A patent/JPS61169892A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63296095A (ja) * | 1987-05-28 | 1988-12-02 | 松下電器産業株式会社 | 液晶表示装置の駆動回路 |
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