JPS61154305A - 自動利得制御装置 - Google Patents
自動利得制御装置Info
- Publication number
- JPS61154305A JPS61154305A JP27590784A JP27590784A JPS61154305A JP S61154305 A JPS61154305 A JP S61154305A JP 27590784 A JP27590784 A JP 27590784A JP 27590784 A JP27590784 A JP 27590784A JP S61154305 A JPS61154305 A JP S61154305A
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- Japan
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- circuit
- electric field
- agc
- strong electric
- gain
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- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は自動利得制御装置に係り、とくにテレビジョ
ン受信機等の高周波用に適した自動利得制御装置に関す
るものである。
ン受信機等の高周波用に適した自動利得制御装置に関す
るものである。
第５図は、たとえば日本放送出版協会編放送技術双薯第
１２巻放送受信技術３・７項ＡＧＣ回路に示されたテレ
ビジョン受信機における従来の自動利得制御（ＡＧＣ）
装置の構成である。
１２巻放送受信技術３・７項ＡＧＣ回路に示されたテレ
ビジョン受信機における従来の自動利得制御（ＡＧＣ）
装置の構成である。
ここで、（１）は利得制御可能な高周波増幅部と周波数
液＃ｆｆ１ｔ−＊ｆ、Ｂｆ−“−１路・（′）１映像１
−周波増幅回路、（３）は映像検波回路、（４）は第１
映像。
液＃ｆｆ１ｔ−＊ｆ、Ｂｆ−“−１路・（′）１映像１
−周波増幅回路、（３）は映像検波回路、（４）は第１
映像。
幅回路、（６）はＲＦ・ＡＧＣ遅延回路、（６）は直流
増幅回路、（７）は上記直流増幅回路（６）とでＡＧＣ
電圧発生Ｗ＆（２）を構成するへＧＣ検波回路、（８）
は雑音除去回路、（９）は可変抵抗器で構成されたＲＦ
−ＡＧＣ遅延調整回路である。
増幅回路、（７）は上記直流増幅回路（６）とでＡＧＣ
電圧発生Ｗ＆（２）を構成するへＧＣ検波回路、（８）
は雑音除去回路、（９）は可変抵抗器で構成されたＲＦ
−ＡＧＣ遅延調整回路である。
この装置では、受信機入力電界強度に応じてＡＧＣ検波
回路（７）および直流増幅回路（６）は、ＡＧＣ制御電
圧を発生する。この電圧は、中間周波増幅回路（２）お
よびチューナ回路（１）の高周波増幅部に印加され、第
１映像増幅回路（４）の出力が一定となるようにそれぞ
れの利得を制御し、受信電界強度の変動に対するコント
ラストの変Ｓｔ−抑制する。
回路（７）および直流増幅回路（６）は、ＡＧＣ制御電
圧を発生する。この電圧は、中間周波増幅回路（２）お
よびチューナ回路（１）の高周波増幅部に印加され、第
１映像増幅回路（４）の出力が一定となるようにそれぞ
れの利得を制御し、受信電界強度の変動に対するコント
ラストの変Ｓｔ−抑制する。
ところで、この種自動利得制御装置では、ＲＦ・ＡＧＣ
遅延回路（５）を設け、受信機の入力電界強度が６０〜
７０ ｄＢμ以下では、チューナ回路（１）の高周波場
ｔＰｉｓの利得を最大とし、映像中間周波増幅回路（２
）で利得制御を行なう。こうすることにより、チューナ
回路（１）の周波数変換部で生じる変換ノイズの影１１
ヲ抑制させている。
遅延回路（５）を設け、受信機の入力電界強度が６０〜
７０ ｄＢμ以下では、チューナ回路（１）の高周波場
ｔＰｉｓの利得を最大とし、映像中間周波増幅回路（２
）で利得制御を行なう。こうすることにより、チューナ
回路（１）の周波数変換部で生じる変換ノイズの影１１
ヲ抑制させている。
ＲＦ−ＡＧＣを動作させ始める電界強度を設定するため
に、ＲＦ−ＡＧＣ遅延調整回路（９）が設けられている
。これは通常可変抵抗器が用いられ。
に、ＲＦ−ＡＧＣ遅延調整回路（９）が設けられている
。これは通常可変抵抗器が用いられ。
ＲＦ−ＡＧＣ遅延回路（５）に加える直流電圧を変える
ことによりその設定を可能としている。
ことによりその設定を可能としている。
第６図は、いわゆるリバース型自動利得調整装置のＲＦ
−ＡＧＣ遅延回路（５）の発生するＲＦ−ＡＧｏ″Ｉ４
圧と、入力電界強度との関係全示す図であり、入力電界
強度が強くなればＲＦ−ＡＧＣ電圧は低下する特性とな
っている。
−ＡＧＣ遅延回路（５）の発生するＲＦ−ＡＧｏ″Ｉ４
圧と、入力電界強度との関係全示す図であり、入力電界
強度が強くなればＲＦ−ＡＧＣ電圧は低下する特性とな
っている。
従来の自動利得制御装置では、ＲＦ−ＡＧＣ遅延回路（
５）によシ十分な８／Ｎ比が得られない弱電界では、高
周波段の利得を制限しないようになっているため、逆に
強電界時に高周波段の利得が大きすぎて、非直線ひずみ
が生じ、混変調妨害やカラーテレビジョン受信機におけ
る音声ビート妨害等の原因となっていた。逆に、強電界
時に上記の妨害が発生しないように十分に利得を絞ると
、弱電界に８／Ｎ比が悪くなる。
５）によシ十分な８／Ｎ比が得られない弱電界では、高
周波段の利得を制限しないようになっているため、逆に
強電界時に高周波段の利得が大きすぎて、非直線ひずみ
が生じ、混変調妨害やカラーテレビジョン受信機におけ
る音声ビート妨害等の原因となっていた。逆に、強電界
時に上記の妨害が発生しないように十分に利得を絞ると
、弱電界に８／Ｎ比が悪くなる。
この発明は、上記のような問題点を解消するためになさ
れ九もので、弱電界時に十分な８／Ｎ比を確保した上で
強電界に混変調妨害等の発生全防止させることのできる
自動利得制御値ＭＹ得ることを目的とする。
れ九もので、弱電界時に十分な８／Ｎ比を確保した上で
強電界に混変調妨害等の発生全防止させることのできる
自動利得制御値ＭＹ得ることを目的とする。
Ｃ問題点を解決する九めの手段〕
この発明に係る自動利得制御装置は１強電界検出回路を
付設することにより、強電界時に高周波増幅部の利得を
下ける一方、中間周波増幅回路の利得を上げるように構
成し穴ものである。
付設することにより、強電界時に高周波増幅部の利得を
下ける一方、中間周波増幅回路の利得を上げるように構
成し穴ものである。
この発明における自動利得制御装置は、高周波増幅部に
印加されるＡＧＣ制御電圧が電界強度に応じて変化する
ことを利用して強電界であること全検出し、強電界時Ｃ
ＲＦ−八〇〇へ延回路に印加する制御電圧全変化させる
εとによシ高周波増幅部の利得を一段と減少させる。
印加されるＡＧＣ制御電圧が電界強度に応じて変化する
ことを利用して強電界であること全検出し、強電界時Ｃ
ＲＦ−八〇〇へ延回路に印加する制御電圧全変化させる
εとによシ高周波増幅部の利得を一段と減少させる。
Ｃ実施例〕
第１図はこの発明の一実施例による自動利得制御装置１
ｔを適用したテレビジョン受信機の要部のブロック図で
あり、従来装置と同一機能部分には同一符号を付して説
明を省略する。
ｔを適用したテレビジョン受信機の要部のブロック図で
あり、従来装置と同一機能部分には同一符号を付して説
明を省略する。
同図において、α０は強電界検出回路であり、出力端は
ＲＦ・五〇〇遅延調整回路（男に接続されている。ＲＦ
−ＡＧＣ遅延回路（５）の出力端はチューナ回路（１）
および上記強電界検出回路四に接続されている。
ＲＦ・五〇〇遅延調整回路（男に接続されている。ＲＦ
−ＡＧＣ遅延回路（５）の出力端はチューナ回路（１）
および上記強電界検出回路四に接続されている。
第２図に上記強電界検出回路Ｑ□の具体的参回路例を示
す、同図において、ＲＦ −ＡＧＣ遅延回路（６）の出
力は抵抗器（２）および可変抵抗器＠によってレベル調
整され、抵抗器Ｑ３ｔ−介してトランジスタα→のベー
スに印加されるようになっている。トランジスタα→の
エミッタは、電源ライン（至）に接続され九抵抗器αＱ
と、定電圧ダイオードαηとからなる定電圧源に接続さ
れている。トランジスタσ荀のコレクタは、一端が電源
ライン（至）に接続され九ＲＦφＡＧＣ遅延調整回路構
成用可変抵抗器（９）の他端に接続されるとともに、抵
抗器（至）を介して接地されている。
す、同図において、ＲＦ −ＡＧＣ遅延回路（６）の出
力は抵抗器（２）および可変抵抗器＠によってレベル調
整され、抵抗器Ｑ３ｔ−介してトランジスタα→のベー
スに印加されるようになっている。トランジスタα→の
エミッタは、電源ライン（至）に接続され九抵抗器αＱ
と、定電圧ダイオードαηとからなる定電圧源に接続さ
れている。トランジスタσ荀のコレクタは、一端が電源
ライン（至）に接続され九ＲＦφＡＧＣ遅延調整回路構
成用可変抵抗器（９）の他端に接続されるとともに、抵
抗器（至）を介して接地されている。
つきに上記構成の動作を説明する。この実施例では、Ｒ
Ｆ−ＡＧＣ遅延調整回路（９）により発生し、ＲＦ 、
ＡＧＣ遅延回路（５）に入力される電圧が高くなる程、
ＲＦ、ＡＧＣが動作全開始する入力電界強度が弱くなる
ものとする。リバース型自動利得調整装置においては、
ＲＦ ＠ＡＧＣ遅延回路（５）の出力電圧は第６′図屹
示すように、電界強度が強くなるに従って低下子る。す
なわち、この電圧ｔ−ｍべれば、強電界である場合、そ
の検出が可能となる。
Ｆ−ＡＧＣ遅延調整回路（９）により発生し、ＲＦ 、
ＡＧＣ遅延回路（５）に入力される電圧が高くなる程、
ＲＦ、ＡＧＣが動作全開始する入力電界強度が弱くなる
ものとする。リバース型自動利得調整装置においては、
ＲＦ ＠ＡＧＣ遅延回路（５）の出力電圧は第６′図屹
示すように、電界強度が強くなるに従って低下子る。す
なわち、この電圧ｔ−ｍべれば、強電界である場合、そ
の検出が可能となる。
トランジスタｔ１４１のエミッタは、抵抗器Ｑｌと定電
圧ダイオードαηからなる定電圧源に接続されており、
この定電圧ダイオード＜１７）を適当に選ぶことにより
、トランジスタα→はベースへの入力が特定の電圧Ｖｏ
以上のときにＯＮ、Ｖｏ未満でＯＦＦとなる。
圧ダイオードαηからなる定電圧源に接続されており、
この定電圧ダイオード＜１７）を適当に選ぶことにより
、トランジスタα→はベースへの入力が特定の電圧Ｖｏ
以上のときにＯＮ、Ｖｏ未満でＯＦＦとなる。
一方、ＲＦ−ＡＧＣ遅延回路（５）より出力されるＲＦ
−ＡＧＣ電圧は、抵抗器（６）および抵抗器ｏ３ｔ−介
してトランジスタα荀のベースに加えられる。このベー
スに加えられる電圧が、十分な８７Ｎ比が得られる強電
界下で前述の７０未満となるように可変抵抗器（２）で
調整する。この結果トランジスタα場は、十分な８／Ｎ
比の得られる強電界ではＯＦＦ、それ未満の電界ではＯ
Ｎとする。
−ＡＧＣ電圧は、抵抗器（６）および抵抗器ｏ３ｔ−介
してトランジスタα荀のベースに加えられる。このベー
スに加えられる電圧が、十分な８７Ｎ比が得られる強電
界下で前述の７０未満となるように可変抵抗器（２）で
調整する。この結果トランジスタα場は、十分な８／Ｎ
比の得られる強電界ではＯＦＦ、それ未満の電界ではＯ
Ｎとする。
トランジスタα→のコレクタ電圧は、これがＯＦＦのと
きには、ＲＦ−ＡＧＣ遅延調整回路を構成している可変
抵抗器（９）と、抵抗器（至）との分圧比によυ決まる
が、この電圧が前述のＶｏ よりも高くなるようにその
分圧比を決める。こうすることにより、ＲＦ−ＡＧＣ遅
延調整用可変抵抗器（９）からの出力電圧は、トランジ
スタα→がＯＦＦのときの方がＯＮのときよりも高くな
る。すなわち、ＲＦ？ＡＧＣ遅延調整回路（９）の出力
電圧は強電界時には弱電界時より高くなる。
きには、ＲＦ−ＡＧＣ遅延調整回路を構成している可変
抵抗器（９）と、抵抗器（至）との分圧比によυ決まる
が、この電圧が前述のＶｏ よりも高くなるようにその
分圧比を決める。こうすることにより、ＲＦ−ＡＧＣ遅
延調整用可変抵抗器（９）からの出力電圧は、トランジ
スタα→がＯＦＦのときの方がＯＮのときよりも高くな
る。すなわち、ＲＦ？ＡＧＣ遅延調整回路（９）の出力
電圧は強電界時には弱電界時より高くなる。
この結果、トランジスタＣ１４１ＯＦＦにする強電界に
なると、ＲＦ −ＡＧＣ遅延回路（５）からチューナ回
路（１）に加えられるＲＦ−ＡＧＣ電圧は一段と低くな
り、チューナ回路（１）の高周波増幅部の利得は絞９込
まれる。このとき、中間周波増幅回路（２）の利得はそ
のまま上昇するので、総合利得は変化しない。
なると、ＲＦ −ＡＧＣ遅延回路（５）からチューナ回
路（１）に加えられるＲＦ−ＡＧＣ電圧は一段と低くな
り、チューナ回路（１）の高周波増幅部の利得は絞９込
まれる。このとき、中間周波増幅回路（２）の利得はそ
のまま上昇するので、総合利得は変化しない。
第３図に、この実施例における入力電界強度とＲＦ・Ａ
ＧＣ電圧の関係を示す。この特性からも明らかなように
、この例では、入力電界強度の変化に対してＲＦ−ＡＧ
Ｃ！を圧の変化はヒステリシス特性を持つ関係となって
いる。可変抵抗器α′Ｊはこの第３因のＥ３の電界強度
で８／Ｎが悪化しないように一整すればよい。
ＧＣ電圧の関係を示す。この特性からも明らかなように
、この例では、入力電界強度の変化に対してＲＦ−ＡＧ
Ｃ！を圧の変化はヒステリシス特性を持つ関係となって
いる。可変抵抗器α′Ｊはこの第３因のＥ３の電界強度
で８／Ｎが悪化しないように一整すればよい。
なお、第２図において、定電圧ダイオードαηと抵抗器
αＱは必須のものではなく、トランジスタμ畳のエミッ
タを直接接地してもよい。
αＱは必須のものではなく、トランジスタμ畳のエミッ
タを直接接地してもよい。
つぎに、強電界検出回路の変形例としてコンパレータを
用いたもの（転）を第４図に示す。この例では、ＲＦ・
ＡＧＣ遅延回路（５）の出力はチューナ回路（１）およ
びコンパレータ（６）の＋側入力端子に印加される。
用いたもの（転）を第４図に示す。この例では、ＲＦ・
ＡＧＣ遅延回路（５）の出力はチューナ回路（１）およ
びコンパレータ（６）の＋側入力端子に印加される。
一方、コンパレータ（６）の−側入力端子には、抵抗器
（６）および可変抵抗器−によって基準電圧が与えられ
ておシ、上記＋側入力端子への入力がこの基準電圧以下
になると、トランジスターがＯＦＦとなる。以後の動作
は第２図のものと同様である。
（６）および可変抵抗器−によって基準電圧が与えられ
ておシ、上記＋側入力端子への入力がこの基準電圧以下
になると、トランジスターがＯＦＦとなる。以後の動作
は第２図のものと同様である。
なお、上記実施例では、テレビジョン受信機を例に説明
したが、他の受信機にも応用できるものである。
したが、他の受信機にも応用できるものである。
以上のようにこの発明によれば、テレビジョン受信機等
において弱電界時の８／Ｎ比を十分に確保した上で、強
電界時の非直線ひずみを低減し、混変調妨害等ヲ防止す
ることができる。
において弱電界時の８／Ｎ比を十分に確保した上で、強
電界時の非直線ひずみを低減し、混変調妨害等ヲ防止す
ることができる。
第１図はこの発明の一実施例における自動利得制御装置
を適用したテレビジョン受信機の要部のブロック図、第
２図は第１図のものの強電界検出回路の具体的な回路図
、第３図はこの発明の一実施例における入力電界強度と
ＲＦ −ＡＧＣ’ｌ圧との関係金示す図、第４図はこの
発明の装置における強電界検出回路の変形例を示す回路
図である。 第５図は従来のテレビジョン受信機に適用され念自動利
得制御装置のブロック図、第６図は従来の装置における
入力電界強度とＲＦ・ムＧｃ電圧の関係を示す図である
。 （１）・・・高周波増幅部と周波数変換部を含むチュー
ナ回路、（２）・・・映像中間周波増幅回路、（５）・
・・ＲＦ・ＡＧＣ遅低回路、（７）・・・ＡＧＣ検波回
路、（６）・・・直流増幅回路、（９）・・・ＲＦ・Ａ
ＧＣ遅延調整回路、αＣＪ。 輪・・・強電界検出口−１（２）・・・ＡＧＣ電圧発生
部。 なお、図中、同一符号は同一もしくは相当部分を示す。
を適用したテレビジョン受信機の要部のブロック図、第
２図は第１図のものの強電界検出回路の具体的な回路図
、第３図はこの発明の一実施例における入力電界強度と
ＲＦ −ＡＧＣ’ｌ圧との関係金示す図、第４図はこの
発明の装置における強電界検出回路の変形例を示す回路
図である。 第５図は従来のテレビジョン受信機に適用され念自動利
得制御装置のブロック図、第６図は従来の装置における
入力電界強度とＲＦ・ムＧｃ電圧の関係を示す図である
。 （１）・・・高周波増幅部と周波数変換部を含むチュー
ナ回路、（２）・・・映像中間周波増幅回路、（５）・
・・ＲＦ・ＡＧＣ遅低回路、（７）・・・ＡＧＣ検波回
路、（６）・・・直流増幅回路、（９）・・・ＲＦ・Ａ
ＧＣ遅延調整回路、αＣＪ。 輪・・・強電界検出口−１（２）・・・ＡＧＣ電圧発生
部。 なお、図中、同一符号は同一もしくは相当部分を示す。
Claims (1)
- （１）利得制御の可能な高周波増幅部と周波数変換部を
内蔵したチューナ回路と、チューナ回路の出力を受ける
利得制御可能な中間周波増幅回路と、ＡＧＣ検波回路と
直流増幅回路からなり、上記チューナ回路および中間周
波増回路へのＡＧＣ制御電圧を発生するＡＧＣ電圧発生
部と、上記チューナ回路の高周波増幅部の利得を制限し
始める電界強度がＲＦ・ＡＧＣ遅延調整回路により調整
されるＲＦ・ＡＧＣ遅延回路と、上記ＲＦ・ＡＧＣ遅延
回路とＲＦ・ＡＧＣ遅延調整回路とに接続された強電界
検出回路とを備え、強電界時に高周波増幅部の利得を下
げ、中間周波増幅回路の利得を上げるように構成したこ
とを特徴とする自動利得制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27590784A JPS61154305A (ja) | 1984-12-27 | 1984-12-27 | 自動利得制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27590784A JPS61154305A (ja) | 1984-12-27 | 1984-12-27 | 自動利得制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61154305A true JPS61154305A (ja) | 1986-07-14 |
Family
ID=17562090
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27590784A Pending JPS61154305A (ja) | 1984-12-27 | 1984-12-27 | 自動利得制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61154305A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS491124A (ja) * | 1972-04-15 | 1974-01-08 |
-
1984
- 1984-12-27 JP JP27590784A patent/JPS61154305A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS491124A (ja) * | 1972-04-15 | 1974-01-08 |
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