JPS61144834A - 樹脂封止型半導体装置 - Google Patents

樹脂封止型半導体装置

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JPS61144834A
JPS61144834A JP59267170A JP26717084A JPS61144834A JP S61144834 A JPS61144834 A JP S61144834A JP 59267170 A JP59267170 A JP 59267170A JP 26717084 A JP26717084 A JP 26717084A JP S61144834 A JPS61144834 A JP S61144834A
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resin
fin
heat radiating
semiconductor chip
semiconductor device
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Hiromichi Sawatani
沢谷 博道
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は樹脂封止型半導体装置の放熱性向上に関し、特
に平面実装タイプの薄型半導体装置に適用して効果的な
構造に係る。
〔発明の技術的背景〕
樹脂パッケージはセラミックパッケージに比較して廉価
であることから広く用いられているが、放熱性および耐
湿性の点で問題がある。このうち、放熱性の問題につい
ては放熱フィンを設けることにより改善が図られている
第2図(A)は放熱フィンを設けた樹脂封止型半導体装
置の外観を示す斜視図である。同図において、11は樹
脂モールド層からなる外囲器、12・・・はリードピン
、13は放熱フィンである。第2図(B)は、同図(A
)に示した樹脂封止型半導体装置の外囲器11を除去し
て上方から見た平面図を示している。図示のように、リ
ードピン12・・・のインナーリード部には、放熱フィ
ン13上にマウントされた半導体チップ14の内部電極
14a・・・がボンディングワイヤ15・・・を介して
接続される。なお、13aは放熱器の取付は穴である。
第2図(C)は同図(B)のB−B線に沿う断面図であ
る。図示のように、半導体チップ14はマウント材16
を介して放熱フィン13の上にダイボンディングされて
いる。このマウント材として、従来の樹脂封止型半導体
装置では導電性接着剤、特に銀を含有するエポキシ系の
樹脂接着剤が一般に用いられている。
〔背景技術の問題点〕
樹脂外囲器はもともと放熱性が低い上、従来の樹脂封止
型半導体装置においては上記のように熱伝導率の低い導
電性接着剤をマウント材にい用いているため、特に平面
実装タイプの薄型外囲器による樹脂封止型半導体装置で
は充分な放熱性が得難いという問題がある。
即ち、樹脂封止パッケージの放熱効果は基本的に外囲器
の大きさに依存し、例えばDIRパッケージ等のように
比較的大きな外囲器の場合であれば、従来の導電性接着
剤でマウトした構造でもある程度の消費電力を賄い得る
放熱効果が得られる。
しかし、平面実装タイプの薄型外囲器では樹脂モールド
層による放熱量の絶対量が少ないため、導電性接着剤に
よる放熱効果阻害が大きく影響し、たとえ放熱フィンを
設けたとしても充分な放熱性は得難い。従って、従来の
平面実装タイプの薄型外囲器による樹脂封止型半導体装
置は消費電力の小さいものに適用の範囲が限定されざる
を得ないという問題があった。
他方、樹脂封止型半導体装置に対するユーザ側のニーズ
として軽l小形化、多機能化の要求が益々大きく、かな
りの消費電力のものについても平面実装タイプの薄型外
囲器で実装することが求められている。この要求に応え
る上で、上記導電性接着剤による放熱阻害の解決は極め
て重要な課題となっている。
更に、導電性接着剤は電気抵抗が高いことから、従来の
樹脂封止型半導体装置には次のような問題も発生してい
る。即ち、最近のICチップでは基板領域の電極をチッ
プの裏面から取出す構造を採用するものが増加しており
、このようなICチップを導電性接着剤でマウントする
と電極取出しの接触抵抗が増大し、安定した特性が得ら
れないといった問題を生じることになる。
〔発明の目的〕
本発明は上記事情に鑑みてなされたもので、樹脂封止型
半導体装置における半導体チップのマウント構造を改良
することにより放熱効果の増大および接触抵抗の低減を
図り、特に平面実装タイプの薄型外囲器による実装の適
用範囲拡大を目的としてなされたものである。
(発明の概要〕 本発明は、放熱フィンを設けた平面実装タイプの薄型外
囲器による樹脂封止型半導体装置において、半導体チッ
プを前記放熱フィン上にダイボンディングするに際して
半田付けを用いたことを特徴とするものである。
即ち、本発明による樹脂封止型半導体装置は、放熱フィ
ン上にマウント材としての半田層を介してマウントされ
た半導体チップと、該半導体チップの表面に形成された
内部端子にボンディングワイヤを介して接続されたリー
ドピンと、前記半導体チップ、前記放熱フィンの半導体
チップマウント部分、前記リードのワイヤボンディング
部分を封止する樹脂モールド層とを具備し、該樹脂モー
ルド層の厚さが前記リードピンの厚さの15倍以下で且
つ平面実装されるように構成されていることを特徴とす
るものである。
上記本発明によれば、半導体チップが熱伝導性および導
電性に優れた半田層を介してダイボンディングされてい
るため、従来のように導電性接着剤による放熱阻害を受
けることがなく、また接触抵抗も小さくなる。従って、
放熱フィンの効果が充分に発揮されてかなりの程度の消
費電力を有するものについても適用でき、また半導体チ
ップの裏面から基板領域の電極を取出す構造のものに適
用した場合にも安定した特性を得ることができる。
〔発明の実施例〕
第1図(A)は本発明の一実施例になる樹脂封止型半導
体装置の外観を示す斜視図である。同図において、21
は樹脂モールド層からなる外囲器、22・・・はリード
ピン、23は放熱フィンである。
図示のように、この樹脂封止型半導体装置は平面実装タ
イプの薄型外囲器によるもので、外囲器21の厚さはリ
ードピン22および放熱フィン23の厚さの約10程度
度である。また、リードピン22・・・は平面実装が可
能なように外囲器21の底面と同じレベルにまで折り曲
げられている。更に、放熱フィン23も同様に折り曲げ
られ、平面実装したときに放熱器構造に形成されたプリ
ント配線基板に半田付けできるようになっている。
次に、この樹脂封止型半導体装置の内部構造および製造
方法につき、第1図(B)(C)を参照して説明する。
第1図(B)において、3oはリードフレームである。
該リードフレームは金属薄板を打抜き加工することによ
り、リード部22・・・及び放熱フィン23等の所定の
バタンを形成したものである。第1図(A)の樹脂封止
型半導体装1の製造に際しては、まず放熱フィン23.
23の中央部に設けられたベッド部上に半導体チップ2
4を半田付けによりマウントした後、図示のようにワイ
ヤボンディングを施す。第1図(C)はこのアセンブリ
ー構造を示す説明図で、図中25・・・はポンディング
ワイヤ、26はマウント材としての半田層である。
次いで、エポキシ樹脂等のトランスファーモールドによ
り図中一点鎖線で示す領域を封止する樹脂モールド層1
1を形成した後、図中破線に沿って各パターンをリード
フレームの外枠から切り離す。更に、分離されたリード
22・・・および放熱フィン23.23を所定形状に折
り曲げてフォーミングすることにより、第1図(A)に
示した平面実装タイプの樹脂封止型半導体装置が得られ
る。
上記実施例において放熱フィン23に穿設されている透
孔のうち、樹脂封止境界近傍の透孔23a・・・は樹脂
モールド層によるフィンの保持力を強化するためのもの
である。即ち、平面実装タイプでは樹脂モールド層が薄
いため、フィンを折り曲げる際に必要とされる強度を与
えるものである。
また、ベッド部近傍に設けられた透孔23bは半田付け
で半導体チップ24をマウントする際に半田の流れを防
止し、放熱フィンに対するワイヤボンディングに支障を
きたさないようにするものである。更に、放熱フィン2
3.23はベッド部の両側の封止部分が括れており、幅
が細くなっているのは次の理由による。第一の理由は、
プリント配線基板の放熱器部分にフィンを半田付けする
際の熱が半導体チップ14に伝わるのを抑制するためで
ある。また第二の理由は、フィンを折り曲げてフォーミ
ングする際の機械的ストレスが樹脂モールド層の内部に
波及するのを回避し、間隙の発生による耐湿性の低下を
防止するためである。
なお、上記実施例の樹脂封止型半導体装置は放熱フィン
を二方向に設けたものであるが、放熱フィンを四方向に
設ける構成も同様に可能である。
第3図はこのような実施例において、第1図(C)と同
様のアセンブリー構造を示す説明図である。
当然ながら、この場合にも半導体チップ24は半田層2
6を介して放熱フィン23のベッド部上にマウントされ
ている。
次に、上記実施例の樹脂封止型半導体装置により得られ
る効果を説明する。
第一に、熱伝導率の高い半田を介して半導体チップをマ
ウントしているため従来の導電性接着剤のような放熱阻
害がなく、放熱フィンが有効に作用して充分な放熱効果
が得られる。従って、平面実装タイプの薄型外囲器によ
る樹脂封止型半導体装置の適用範囲を中出力程度のもの
にまで拡大することができる。第4図(A)はこの効果
を示すグラフである。図示のように半導体チップの集積
度と消費電力は比例関係にあり、図中の直線Xは上記実
施例になる平面実装タイプ樹脂封止型半導体装置の適用
範囲を示している。他方、Ylは導電性接着剤による放
熱フィン付き平面実装タイプの従来品の適用範囲、Y2
は導電性接着剤による平面実装タイプで放熱フィンなし
の従来品の適用範囲、Ysは導電性接着剤によるDIP
タイプの従来品の適用範囲を夫々示している。図から明
かなように、上記実施例の場合(X)の適用範囲は放熱
フィンを用いた従来の平面実装タイプのもの(Ys )
のみならず、放熱フィンを用いない従来のDIPタイプ
のものより拡大される。従って、平面実装タイプの樹脂
封止型半導体装置に対するユーザの要求に広く応えるこ
とができる。
第二には、半田によるマウントは導電性接着剤によるマ
ウントに比較してベッド部との接触抵抗を1/10〜1
7100程度に低減できることである。
この結果、近年増加しつつあるチップ裏面から基板領域
の電極を取り出す構造のICチップに対しても、何等問
題なく適用することが可能となる。
第三の効果は、導電性接着剤中には塩素イオン等の不純
物が多く含まれるのに対し、半田にはこのような不純物
の含有量が少ないことである。これら不純物は外部から
侵入する水で活性化されて配線腐蝕等の不良を生じる原
因になり、特に平面実装タイプのように樹脂外囲器の薄
いものでは水が侵入し易いから、不純物の少ない半田の
使用は装置の信頼性を向上する上で重要な意味を有する
第4図(B)はこの効果を説明するグラフで、図中点l
I×は半田付はマウントによる実施例品の場合、直線Y
は導電性接着剤マウントによる従来品の場合を示してい
る。
〔発明の効果〕
以上詳述したように、本発明によれば樹脂封止型半導体
装置における半導体チップを半田付けでマウントした構
造とすることにより、放熱効果の増大および接触抵抗の
低減を図り、特に平面実装タイプの薄型樹脂封止半導体
装置の適用範囲拡大を著しく拡大できる等、顕著な効果
が得られるものである。
【図面の簡単な説明】
第1図(A)は本発明の一実施例になる樹脂封止型半導
体装置の外観を示す斜視図であり、第1図(B)はその
製造工程および内部構造を説明するための平面図、第1
図(C)は同図(B)における半導体チップのアセンブ
リー構造を拡大して示す斜視図、第2図(A)〜(C)
は従来の樹脂封止型半導体装置の構造を示す説明図、第
3図は本発明の他の実施例における半導体チップのアセ
ンブリー構造を拡大して示す斜視図、第4図(A)(B
)は本発明の樹脂封止型半導体装置における効果を説明
する線図である。 21・・・樹脂モールド層、22・・・リードピン、2
3・・・放熱フィン、23a、23b・・・透孔、24
・・・半導体チップ、25・・・ボンディングワ・イヤ
、26・・・半田層、30・・・リードフレーム。 第1図 IIl 図 策2WJ 第2図 第3図 第4図 會1L

Claims (1)

    【特許請求の範囲】
  1. 放熱フィン上にマウント材を介してマウントされた半導
    体チップと、該半導体チップの表面に形成された内部端
    子にボンディングワイヤを介して接続されたリードピン
    と、前記半導体チップ、前記放熱フィンの半導体チップ
    マウント部分、前記リードのワイヤボンディング部分を
    封止する樹脂モールド層とを具備し、該樹脂モールド層
    の厚さが前記リードピンの厚さの15倍以下で且つ平面
    実装されるように構成されていおり、しかも前記マウン
    ト材が半田層であることを特徴とする樹脂封止型半導体
    装置。
JP59267170A 1984-12-18 1984-12-18 樹脂封止型半導体装置 Pending JPS61144834A (ja)

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Application Number Priority Date Filing Date Title
JP59267170A JPS61144834A (ja) 1984-12-18 1984-12-18 樹脂封止型半導体装置

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JP59267170A JPS61144834A (ja) 1984-12-18 1984-12-18 樹脂封止型半導体装置

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JP59267170A Pending JPS61144834A (ja) 1984-12-18 1984-12-18 樹脂封止型半導体装置

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JP (1) JPS61144834A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5093281A (en) * 1988-07-13 1992-03-03 Mitsubishi Denki Kabushiki Kaisha method for manufacturing semiconductor devices
EP0872886A3 (en) * 1997-04-17 1999-02-03 Nec Corporation Plastic-encapsulated semiconductor device and fabrication method thereof
KR20010087803A (ko) * 2001-06-07 2001-09-26 김덕중 방열효과를 개선하는 반도체 에스. 오(so) 패키지
TWI408783B (zh) * 2008-02-06 2013-09-11 Sanyo Electric Co 電路裝置及其製造方法

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5093281A (en) * 1988-07-13 1992-03-03 Mitsubishi Denki Kabushiki Kaisha method for manufacturing semiconductor devices
EP0872886A3 (en) * 1997-04-17 1999-02-03 Nec Corporation Plastic-encapsulated semiconductor device and fabrication method thereof
US6175150B1 (en) 1997-04-17 2001-01-16 Nec Corporation Plastic-encapsulated semiconductor device and fabrication method thereof
KR20010087803A (ko) * 2001-06-07 2001-09-26 김덕중 방열효과를 개선하는 반도체 에스. 오(so) 패키지
TWI408783B (zh) * 2008-02-06 2013-09-11 Sanyo Electric Co 電路裝置及其製造方法

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