JPS61120538A - 多方向多重通信装置 - Google Patents
多方向多重通信装置Info
- Publication number
- JPS61120538A JPS61120538A JP59240994A JP24099484A JPS61120538A JP S61120538 A JPS61120538 A JP S61120538A JP 59240994 A JP59240994 A JP 59240994A JP 24099484 A JP24099484 A JP 24099484A JP S61120538 A JPS61120538 A JP S61120538A
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- JP
- Japan
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- clock
- signal
- master station
- code
- circuit
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/24—Radio transmission systems, i.e. using radiation field for communication between two or more posts
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B7/00—Radio transmission systems, i.e. using radiation field
- H04B7/14—Relay systems
- H04B7/15—Active relay systems
- H04B7/204—Multiple access
- H04B7/212—Time-division multiple access [TDMA]
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/02—Speed or phase control by the received code signals, the signals containing no special synchronisation information
- H04L7/033—Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop
- H04L7/0337—Selecting between two or more discretely delayed clocks or selecting between two or more discretely delayed received code signals
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Radio Relay Systems (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、多方向多重通信システムにおいて、子局から
親局へのバースト位置合わせを初期建設段階で最適に合
わせた後の温度又は経年変化によるタイずング点ずれに
よる符号誤り本省化を抑える改良に関する。
親局へのバースト位置合わせを初期建設段階で最適に合
わせた後の温度又は経年変化によるタイずング点ずれに
よる符号誤り本省化を抑える改良に関する。
（従来の技術）
第３図に地上固定無線用時分割多方向多重通信システム
の構成を示す。親局は、ある角度の範囲内の地域に点在
す゛る複数の子局との間を広帯域ビームアンテナでカバ
ーし通信する。親局からは一般のディジタル固定無線と
同様にフレーム同期信号と各子局別の信号を時分割多重
（Ｔｉｍｅ ］）ｉｖｉｓｉｏｎ Ｍｕｌｔｉｐｌｅｘ
） して該子局へ放送モードで送シ出す。各子局は受
信した信号列の中から自局向けの信号のみを取シ出す一
方、親局からのフレーム同期信号を時間基準として第４
図の様にあらかじめ自局に割シ当てられた時間位置のみ
間歇的に送信を行う、そして親局受信機には、第５図の
様にあたかも、１つの局からの信号を受信した様に整然
と並びポイント・マルチポイント間の通信が行われる。
の構成を示す。親局は、ある角度の範囲内の地域に点在
す゛る複数の子局との間を広帯域ビームアンテナでカバ
ーし通信する。親局からは一般のディジタル固定無線と
同様にフレーム同期信号と各子局別の信号を時分割多重
（Ｔｉｍｅ ］）ｉｖｉｓｉｏｎ Ｍｕｌｔｉｐｌｅｘ
） して該子局へ放送モードで送シ出す。各子局は受
信した信号列の中から自局向けの信号のみを取シ出す一
方、親局からのフレーム同期信号を時間基準として第４
図の様にあらかじめ自局に割シ当てられた時間位置のみ
間歇的に送信を行う、そして親局受信機には、第５図の
様にあたかも、１つの局からの信号を受信した様に整然
と並びポイント・マルチポイント間の通信が行われる。
一般に、地上固定無線用時分割多方向多重通信システム
は衛星利用ＴＤＭ人シ人士ステムけるような衛星の日周
期変動等が無いので、親局受信機の復調出力の符合再生
回路（１”０”判定回路ともいう）Ｋ加える受信クロッ
クは、親局送信の基準として使用している親局基準クロ
ックを用い、受信バースト前方のプリアンプル信号部分
よシ、クロックを抽出して１”″′０″判定を行う衛星
利用ＴＤＭＡシステムに比べてプリアンプル信号が無い
分、冗長度を減らし周波数の有り利用度を上げている。
は衛星利用ＴＤＭ人シ人士ステムけるような衛星の日周
期変動等が無いので、親局受信機の復調出力の符合再生
回路（１”０”判定回路ともいう）Ｋ加える受信クロッ
クは、親局送信の基準として使用している親局基準クロ
ックを用い、受信バースト前方のプリアンプル信号部分
よシ、クロックを抽出して１”″′０″判定を行う衛星
利用ＴＤＭＡシステムに比べてプリアンプル信号が無い
分、冗長度を減らし周波数の有り利用度を上げている。
第６図は、固定無線用時分割多方向多重通信システムに
おける親局の多方向多重通信装置の従来の構成を示すプ
ロ、り図である。従来の装置においては復調器８の出力
信号の１″、”ｏｎを判定する符号再生回路９は１個で
あシ、符号再生回路９に供給される判定クロックも親局
クロック又は親局クロックを基準として一定時間だけ位
相遅延を受けいる一種類のクロック信号だけである。
おける親局の多方向多重通信装置の従来の構成を示すプ
ロ、り図である。従来の装置においては復調器８の出力
信号の１″、”ｏｎを判定する符号再生回路９は１個で
あシ、符号再生回路９に供給される判定クロックも親局
クロック又は親局クロックを基準として一定時間だけ位
相遅延を受けいる一種類のクロック信号だけである。
（発明が解決しようとする問題点）
従って、上記のようなシステムにおいては親局送信機→
子局受信機→親局へのバースト送信タイミング設定回路
→子局送信機→親局受信機の一巡絶対遅延時間の変動が
そのまま符号再生回路における復調信号と判定クロック
の判定タイミングのズレとなり、即、符号誤シ率の劣化
をもたらす。このため、温度変化による遅延時間の変動
を極力抑えるため子局装置に各種の温度補償回路を設け
たシ、入念な温度試験を行なったシするために１装置が
複雑になシ更に多くの調整工数を要するという問題があ
った。
子局受信機→親局へのバースト送信タイミング設定回路
→子局送信機→親局受信機の一巡絶対遅延時間の変動が
そのまま符号再生回路における復調信号と判定クロック
の判定タイミングのズレとなり、即、符号誤シ率の劣化
をもたらす。このため、温度変化による遅延時間の変動
を極力抑えるため子局装置に各種の温度補償回路を設け
たシ、入念な温度試験を行なったシするために１装置が
複雑になシ更に多くの調整工数を要するという問題があ
った。
（問題点を解決するための手段）
本発明は、各部回路の絶対遅延変動を抑える特別な調整
を不要とし、ある程度の変動は許容しつつ、符号誤シ率
の劣化を与えないシステムを構成する事を目的としてい
る。
を不要とし、ある程度の変動は許容しつつ、符号誤シ率
の劣化を与えないシステムを構成する事を目的としてい
る。
本発明は上記の目的を達成するために次の構成を有する
。
。
即ち、親局からは各子局向けの信号を時分割多重の放送
モードにて送出し、各子局は、クロック抽出の後、自局
向けの信号を抽出すると共に１子局からの電波が親局に
到達した時に、他の子局の信号と重ならずにあたかも一
列の時分割多重列となるタイミングに初期調整の上、間
歇的に自局よりの信号を送出する多方向多重通信システ
ムの親局の多方向多重通信装置であって、復調器出力信
号のディジタル信号としての１およびＯを判定しディジ
タル信号を出力する複数の符号再生回路と、該複数の符
号再生回路毎に各符号再生回路の出力信号を一時記憶す
る複数の一時記憶メモリと、親局クロック信号を受けて
親局クロックタイピングに対してそれぞれ異なった位相
遅延を受けた複数のクロック信号を発生し前記複数の符
号再生回路へそれぞれ異なったタイミングの判定用クロ
ック信号を供給するクロック位相遅延器と、前記復調器
出力信号から受信クロック信号を抽出するクロック抽出
回路と、該クロック抽出回路の出力クロック信号と親局
クロック信号との位相を比較する位相比較器と、該位相
比較器の出力信号を各バースト毎にサンプルホールドす
るサンプルホールド回路と、該サンプルホールド回路か
らの出力信号によって前記複数の一時記憶メモリのうち
符号誤シ率が最小の一時記憶メモリの出力を選択して出
力する選択回路を有する多方向多重通信装置である。
モードにて送出し、各子局は、クロック抽出の後、自局
向けの信号を抽出すると共に１子局からの電波が親局に
到達した時に、他の子局の信号と重ならずにあたかも一
列の時分割多重列となるタイミングに初期調整の上、間
歇的に自局よりの信号を送出する多方向多重通信システ
ムの親局の多方向多重通信装置であって、復調器出力信
号のディジタル信号としての１およびＯを判定しディジ
タル信号を出力する複数の符号再生回路と、該複数の符
号再生回路毎に各符号再生回路の出力信号を一時記憶す
る複数の一時記憶メモリと、親局クロック信号を受けて
親局クロックタイピングに対してそれぞれ異なった位相
遅延を受けた複数のクロック信号を発生し前記複数の符
号再生回路へそれぞれ異なったタイミングの判定用クロ
ック信号を供給するクロック位相遅延器と、前記復調器
出力信号から受信クロック信号を抽出するクロック抽出
回路と、該クロック抽出回路の出力クロック信号と親局
クロック信号との位相を比較する位相比較器と、該位相
比較器の出力信号を各バースト毎にサンプルホールドす
るサンプルホールド回路と、該サンプルホールド回路か
らの出力信号によって前記複数の一時記憶メモリのうち
符号誤シ率が最小の一時記憶メモリの出力を選択して出
力する選択回路を有する多方向多重通信装置である。
（作 用）
本発明は上記構成の通シ、復調器の出力信号から、ディ
ジタル信号としての′１”、”０”を判定してディジタ
ル信号を再生する符号再生回路とその出力信号を一時記
憶させておくための一時記憶メモリの組合せを複数個具
備している。
ジタル信号としての′１”、”０”を判定してディジタ
ル信号を再生する符号再生回路とその出力信号を一時記
憶させておくための一時記憶メモリの組合せを複数個具
備している。
そして、クロック位相遅延器は、親局クロック信号をも
とに、復調器出力信号のタイミング変動に対応できるよ
うにタイばングを異ならせた複数の判定用クロック信号
を作り、前記複数の符号再生回路へ供給している。即ち
、復調器出力信号のタイミング変動が予想される範囲で
、複数、の異なったタイミング点有する判定クロックに
よシ並行して′１”、”Ｏ”判定（符号再生）を行わせ
、該再生結果を符号再生装置に続くそ１ れぞれの
一時記憶メモリに記憶させるっ一方、クロック抽出回路
では復調器出力信号の中から受信クロック信号を抽出し
、位相比較器で受信クロック信号の位相を親局クロック
と比較して受信クロック信号の位相のズレを検出する。
とに、復調器出力信号のタイミング変動に対応できるよ
うにタイばングを異ならせた複数の判定用クロック信号
を作り、前記複数の符号再生回路へ供給している。即ち
、復調器出力信号のタイミング変動が予想される範囲で
、複数、の異なったタイミング点有する判定クロックに
よシ並行して′１”、”Ｏ”判定（符号再生）を行わせ
、該再生結果を符号再生装置に続くそ１ れぞれの
一時記憶メモリに記憶させるっ一方、クロック抽出回路
では復調器出力信号の中から受信クロック信号を抽出し
、位相比較器で受信クロック信号の位相を親局クロック
と比較して受信クロック信号の位相のズレを検出する。
そしてこのズレに対して最も適したタイば／グ即ち、符
号誤り率が最も小さくなる判定クロック信号によって”
１”、”０”判定を行なっている符号再生回路の出力を
選択するようにしている。
号誤り率が最も小さくなる判定クロック信号によって”
１”、”０”判定を行なっている符号再生回路の出力を
選択するようにしている。
即ち位相比較器の出力をバースト毎にす／プルホールド
回路でサンプルホールドし、このサンプルホールドされ
た値が分かれば最もタイミングが一致する判定クロック
信号がどれであるかは予め知ることができるので、前記
サンプルホールド回路の出力信号を受けた選択回路が前
記出力信号に予め対応付けられた符号再生回路の出力を
選択する６ 各符号再生回路の後に設けられている一時記憶メモリは
受信クロック信号の位相ズレを検出するために成る程度
の時間を必要とするのでそく の間の符号再生信号を保持しておネ必要がある丸めに設
けられているものである。
回路でサンプルホールドし、このサンプルホールドされ
た値が分かれば最もタイミングが一致する判定クロック
信号がどれであるかは予め知ることができるので、前記
サンプルホールド回路の出力信号を受けた選択回路が前
記出力信号に予め対応付けられた符号再生回路の出力を
選択する６ 各符号再生回路の後に設けられている一時記憶メモリは
受信クロック信号の位相ズレを検出するために成る程度
の時間を必要とするのでそく の間の符号再生信号を保持しておネ必要がある丸めに設
けられているものである。
（実施例）
以下、本発明の実施例を図面に基づいて説明する。
第１図は本発明の実施例の構成を示すブロック図である
。親局に入力したベースバンド信号ハ、無線フレーム／
ベースバンドインタフェースフレーム変換メモリ回路１
７によシ、各子局側バースト状の無線フレームに変換さ
れ、送信機５にて変調され、子局へ向は送信される。一
方受信信号は、受信機７を経て復調器８の出力に第２図
の様なアイパターン（ｅｙｅ ｐａｔｔｅｒｎ ）が得
られる。
。親局に入力したベースバンド信号ハ、無線フレーム／
ベースバンドインタフェースフレーム変換メモリ回路１
７によシ、各子局側バースト状の無線フレームに変換さ
れ、送信機５にて変調され、子局へ向は送信される。一
方受信信号は、受信機７を経て復調器８の出力に第２図
の様なアイパターン（ｅｙｅ ｐａｔｔｅｒｎ ）が得
られる。
このアイパターン信号は、従来例であれば、単一の符号
再生回路９にて、１”０″の符号再生が行われるのであ
るが、本発明実施例では、クロック位相遅延器１４にて
作られた親局クロックより少しづつタイミングの遅延し
たクロック信号を判定クロックとする複数の符号再生回
路９を具備し、各々の判定信号列は、少なくとも１バ一
スト以上のビット数の容量を持つ一時記憶メモリ１０に
貯えられる、 一方、到達したバーストの最適判定タイミングを知る為
に、復調器８の出力は夕／り回路等のクロック抽出回路
１１にも分岐されており、抽出された受信クロックは、
親局クロックと位相比較器１２にて比較され、サンプル
ホールド回路１３により保持され、その直流電圧値によ
り、あらかじめ電圧対最適タイミングの対応が校正され
ている選択回路１６は、複数の一時記憶メモリ１０に貯
えられた信号列の中から最も符号誤シ率が低いと思われ
るタイミングで判定した信号列を選択し、無線フレーム
／ベースバンドインタフェースフレーム変換メモリ回路
１７へ送シ、変換後、ベースバンド信号は、親局と接続
する装置へ送られる。
再生回路９にて、１”０″の符号再生が行われるのであ
るが、本発明実施例では、クロック位相遅延器１４にて
作られた親局クロックより少しづつタイミングの遅延し
たクロック信号を判定クロックとする複数の符号再生回
路９を具備し、各々の判定信号列は、少なくとも１バ一
スト以上のビット数の容量を持つ一時記憶メモリ１０に
貯えられる、 一方、到達したバーストの最適判定タイミングを知る為
に、復調器８の出力は夕／り回路等のクロック抽出回路
１１にも分岐されており、抽出された受信クロックは、
親局クロックと位相比較器１２にて比較され、サンプル
ホールド回路１３により保持され、その直流電圧値によ
り、あらかじめ電圧対最適タイミングの対応が校正され
ている選択回路１６は、複数の一時記憶メモリ１０に貯
えられた信号列の中から最も符号誤シ率が低いと思われ
るタイミングで判定した信号列を選択し、無線フレーム
／ベースバンドインタフェースフレーム変換メモリ回路
１７へ送シ、変換後、ベースバンド信号は、親局と接続
する装置へ送られる。
第２図の例で言うと、タイミング点（ハ）が、アイパタ
ーンの開口度が、一番高いので、タイミング点儒）のパ
ルスを１” ｌＴｏ”判定パルスとして、判定し、貯え
られた信号列を選択することとなる。もし次のバースト
のアイパターンの開ロ度がタイミング点（ロ）で−書間
いている様なら次のバーストの読み出しく関しては選択
回路は、タイミング点が（す：のパルスを″１１″、″
′０″判定パルスとした信号列を選択することとなる。
ーンの開口度が、一番高いので、タイミング点儒）のパ
ルスを１” ｌＴｏ”判定パルスとして、判定し、貯え
られた信号列を選択することとなる。もし次のバースト
のアイパターンの開ロ度がタイミング点（ロ）で−書間
いている様なら次のバーストの読み出しく関しては選択
回路は、タイミング点が（す：のパルスを″１１″、″
′０″判定パルスとした信号列を選択することとなる。
（発明の効果）
以上説明したように、本発明の多方向多重通信装置を適
用することにより、親局送信機→子局受信機→親局への
バースト送信タイミング設定回路→子局送信機→親局受
信機の一巡絶対遅延時間が機器の環境条件の変動によシ
変動して：も親局ではこの変動に適合したタイミングを
有する判定クロックによシ符号再生を行っている符号再
生回路の出力を選択できるのでシステム全体としては符
号誤シ率を低下させないで通信を行なうことができる。
用することにより、親局送信機→子局受信機→親局への
バースト送信タイミング設定回路→子局送信機→親局受
信機の一巡絶対遅延時間が機器の環境条件の変動によシ
変動して：も親局ではこの変動に適合したタイミングを
有する判定クロックによシ符号再生を行っている符号再
生回路の出力を選択できるのでシステム全体としては符
号誤シ率を低下させないで通信を行なうことができる。
このため子局装置の遅延時間変動を極力抑えるため用い
られて来た多くの複雑な温度補償回路を減らすことがで
き、従ってまたその調整のための手数も大幅に軽減する
ことができる。そして、１つの親局を中心とする子局の
数は非常に多いので、１つの親局を中心としたシステム
全体で考えた場合、低減することのできる回路部品の数
や調整時間は非常に膨大なものとなシその経済効果には
多大なものがある。
られて来た多くの複雑な温度補償回路を減らすことがで
き、従ってまたその調整のための手数も大幅に軽減する
ことができる。そして、１つの親局を中心とする子局の
数は非常に多いので、１つの親局を中心としたシステム
全体で考えた場合、低減することのできる回路部品の数
や調整時間は非常に膨大なものとなシその経済効果には
多大なものがある。
第１図は本発明の多方向多重通信装置の実施例の構成を
示すブロック図、第２図は復調器出力波形（アイ・パタ
ーン）Ｋ対して符号再生回路に加えられる判定用クロッ
クパルスのタイミングを示す図、第３図は地上固定無線
用時分割多方向多重通信システムの構成を示す図、第４
図は時分割多方向多重通信システムの子局発射バースト
例を示す図、ｇ５図は時分割多方向多重通信システムの
親局受信バースト例を示す図、第６図は時分割多方向多
重通信システムの親局装置の従来の構成を示す図である
。 １・・・親局装置、 ２・°・・親局広角ビームアン
テナ及び給電系、 ３・・・狭ビームアンテナ、
４・・・子局装置、 ５・・・送信機、 ６・・・
変調器、７・・・受信機、 ８・・・復調器、 ９・
・・符号再生回路、 １０・・・一時記憶メモリ、
１１・・・クロック抽出回路、 １２・・・位相比
較器、 １３・・・サンプルホールド回路、 １４
・・・クロック位相遅延器、 １５・・・親局フレー
ムタイミング回路、１６・・・選択回路、 １７・・
・無線フレーム／ペースパ／ドインタフェースフレーム
変換メモリ回路
示すブロック図、第２図は復調器出力波形（アイ・パタ
ーン）Ｋ対して符号再生回路に加えられる判定用クロッ
クパルスのタイミングを示す図、第３図は地上固定無線
用時分割多方向多重通信システムの構成を示す図、第４
図は時分割多方向多重通信システムの子局発射バースト
例を示す図、ｇ５図は時分割多方向多重通信システムの
親局受信バースト例を示す図、第６図は時分割多方向多
重通信システムの親局装置の従来の構成を示す図である
。 １・・・親局装置、 ２・°・・親局広角ビームアン
テナ及び給電系、 ３・・・狭ビームアンテナ、
４・・・子局装置、 ５・・・送信機、 ６・・・
変調器、７・・・受信機、 ８・・・復調器、 ９・
・・符号再生回路、 １０・・・一時記憶メモリ、
１１・・・クロック抽出回路、 １２・・・位相比
較器、 １３・・・サンプルホールド回路、 １４
・・・クロック位相遅延器、 １５・・・親局フレー
ムタイミング回路、１６・・・選択回路、 １７・・
・無線フレーム／ペースパ／ドインタフェースフレーム
変換メモリ回路
Claims (1)
- 親局からは各子局向けの信号を時分割多重の放送モード
にて送出し、各子局は、クロック抽出の後、自局向けの
信号を抽出すると共に、子局からの電波が親局に到達し
た時に、他の子局の信号と重ならずにあたかも一列の時
分割多重列となるタイミングに初期調整の上、間歇的に
自局よりの信号を送出する多方向多重通信システムの親
局の多方向多重通信装置であつて、復調器出力信号のデ
ィジタル信号としての１および０を判定しディジタル信
号を出力する複数の符号再生回路と、該複数の符号再生
回路毎に各符号再生回路の出力信号を一時記憶する複数
の一時記憶メモリと、親局クロック信号を受けて親局ク
ロックタイミングに対してそれぞれ異なつた位相遅延を
受けた複数のクロック信号を発生し前記複数の符号再生
回路へそれぞれ異なつたタイミングの判定用クロック信
号を供給するクロック位相遅延器と、前記復調器出力信
号から受信クロック信号を抽出するクロック抽出回路と
、該クロック抽出回路の出力クロック信号と親局クロッ
ク信号との位相を比較する位相比較器と、該位相比較器
の出力信号を各バースト毎にサンプルホールドするサン
プルホールド回路と、該サンプルホールド回路からの出
力信号によつて前記複数の一時記憶メモリのうち符号誤
り率が最小の一時記憶メモリの出力を選択して出力する
選択回路を有することを特徴とする多方向多重通信装置
。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59240994A JPS61120538A (ja) | 1984-11-15 | 1984-11-15 | 多方向多重通信装置 |
| AU49785/85A AU573709B2 (en) | 1984-11-15 | 1985-11-12 | Multi-direction tdm communication apparatus |
| US06/796,857 US4703479A (en) | 1984-11-15 | 1985-11-12 | Multi-direction time division multiplex communication apparatus |
| DE8585308267T DE3569318D1 (en) | 1984-11-15 | 1985-11-13 | Multi-direction time division multiplex communication apparatus |
| EP85308267A EP0182601B1 (en) | 1984-11-15 | 1985-11-13 | Multi-direction time division multiplex communication apparatus |
| CA000495308A CA1244973A (en) | 1984-11-15 | 1985-11-14 | Multi-direction time division multiplex communication apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59240994A JPS61120538A (ja) | 1984-11-15 | 1984-11-15 | 多方向多重通信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61120538A true JPS61120538A (ja) | 1986-06-07 |
Family
ID=17067739
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59240994A Pending JPS61120538A (ja) | 1984-11-15 | 1984-11-15 | 多方向多重通信装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4703479A (ja) |
| EP (1) | EP0182601B1 (ja) |
| JP (1) | JPS61120538A (ja) |
| AU (1) | AU573709B2 (ja) |
| CA (1) | CA1244973A (ja) |
| DE (1) | DE3569318D1 (ja) |
Families Citing this family (16)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4937843A (en) * | 1986-03-28 | 1990-06-26 | Ampex Corporation | Digital data block synchronizer |
| US4805196A (en) * | 1987-04-29 | 1989-02-14 | Gte Laboratories Incorporated | Line delay compensation for digital transmission systems utilizing low power line drivers |
| US4979170A (en) * | 1988-01-19 | 1990-12-18 | Qualcomm, Inc. | Alternating sequential half duplex communication system |
| JPH0618337B2 (ja) * | 1988-02-23 | 1994-03-09 | 日本電気株式会社 | 衛星通信方式 |
| GB8807050D0 (en) * | 1988-03-24 | 1988-04-27 | British Telecomm | Communication system |
| US4932070A (en) * | 1988-08-22 | 1990-06-05 | Scientific Atlanta | Mechanism for deriving accurate frequency reference for satellite communications burst demodulator |
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