JPS61114629A - 共通バス型伝送系のドライバ離脱回路 - Google Patents
共通バス型伝送系のドライバ離脱回路Info
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- JPS61114629A JPS61114629A JP59236950A JP23695084A JPS61114629A JP S61114629 A JPS61114629 A JP S61114629A JP 59236950 A JP59236950 A JP 59236950A JP 23695084 A JP23695084 A JP 23695084A JP S61114629 A JPS61114629 A JP S61114629A
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- Japan
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- circuit
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/40006—Architecture of a communication node
- H04L12/40013—Details regarding a bus controller
-
- H—ELECTRICITY
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- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/40006—Architecture of a communication node
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明は、バス型のローカルエリアネットワーク等で使
用される共通バス型伝送系において、バスに接続されて
いるトランシーバのドライバで短絡事故が生じたとき、
そのドライバをバスから自動的に切り離すドライバ離脱
回路に関する。
用される共通バス型伝送系において、バスに接続されて
いるトランシーバのドライバで短絡事故が生じたとき、
そのドライバをバスから自動的に切り離すドライバ離脱
回路に関する。
〈従来技術〉
バス型ローカルエリアネットワークで使用される共通バ
ス型伝送系は一般に、第２図の構成図にｑ；すように、
同軸ケーブルで構成されたバス２に度数のステーション
４．・をそれぞれイノターフエースであるトランシーバ
１を介して設け、各トランシーバｌのレンーバ３および
ドライバ５をバス２に並列に接続したもので、各トラン
シーバ１のドライバ５は、第３図の回路図に示すような
構成を有している。
ス型伝送系は一般に、第２図の構成図にｑ；すように、
同軸ケーブルで構成されたバス２に度数のステーション
４．・をそれぞれイノターフエースであるトランシーバ
１を介して設け、各トランシーバｌのレンーバ３および
ドライバ５をバス２に並列に接続したもので、各トラン
シーバ１のドライバ５は、第３図の回路図に示すような
構成を有している。
即ち、各トランシーバＩのドライバ５は、スイッチング
素子であるトランジスタ６と、このトランジスタ６のコ
レクタとバス２との間に接続されたダイオード７とを備
え、抵抗８を介して前記ダイオード７に逆バイアス電圧
をかけるようにしたもので、ステーンヨノ４からの送信
すべきデータ信号かトラ７ノスタ６のベースに入力する
と、該トランジスタ６のコレクタ、エミッタ間が導通し
てバス２に電流が流れて、バス２上には前記データ信号
に応じた負の電圧が誘起され、ステーンヨン４からのデ
ータ信号を反転した形の負論理の送出データ信号がバス
２上に送出されるようになっている。
素子であるトランジスタ６と、このトランジスタ６のコ
レクタとバス２との間に接続されたダイオード７とを備
え、抵抗８を介して前記ダイオード７に逆バイアス電圧
をかけるようにしたもので、ステーンヨノ４からの送信
すべきデータ信号かトラ７ノスタ６のベースに入力する
と、該トランジスタ６のコレクタ、エミッタ間が導通し
てバス２に電流が流れて、バス２上には前記データ信号
に応じた負の電圧が誘起され、ステーンヨン４からのデ
ータ信号を反転した形の負論理の送出データ信号がバス
２上に送出されるようになっている。
さて、前記ドライバ５において、落雷その他の原因によ
りスイッチング素子であるトランジスタ６が短絡した場
合を考えてみる。今、伝送系の一つのドライバ５、例え
ばＡ位置のドライバ５でかかる短絡事故が生じたとして
、他のＮ位置のドライバ５においてそのトランジスタ６
にデータ信号が入力すると、該トランジスタ６が導通す
るか、バス２からはＡ４１Ｌ置のドライバ５の短絡した
トランジスタ６を通じて既に負の電流が流れているから
、バス上で短絡による電流とデータ信号を示す電流が重
なり、正常なＮ位置のトライバ６からのデータ信号を判
別することができない。
りスイッチング素子であるトランジスタ６が短絡した場
合を考えてみる。今、伝送系の一つのドライバ５、例え
ばＡ位置のドライバ５でかかる短絡事故が生じたとして
、他のＮ位置のドライバ５においてそのトランジスタ６
にデータ信号が入力すると、該トランジスタ６が導通す
るか、バス２からはＡ４１Ｌ置のドライバ５の短絡した
トランジスタ６を通じて既に負の電流が流れているから
、バス上で短絡による電流とデータ信号を示す電流が重
なり、正常なＮ位置のトライバ６からのデータ信号を判
別することができない。
また、このバス２の最大伝送遅延時間（最も遠い２台の
ステー７３７４．４間での信号伝送にがかる時間）かデ
ータのヒツトレートより充分に大きい場合、バス２上で
反射障害を起こし、エコー雑音を発生する。
ステー７３７４．４間での信号伝送にがかる時間）かデ
ータのヒツトレートより充分に大きい場合、バス２上で
反射障害を起こし、エコー雑音を発生する。
さらに、ドライバ５内でダイオード７が短絡しても同様
の不都合が生じるのであって、トランジスタ６のオフ抵
抗が比較的大きく設定されているが、電圧降下用の抵抗
８がバス２に並列に挿入されているため、バス２上で反
射障害を起こし、エコー雑音を発生する。
の不都合が生じるのであって、トランジスタ６のオフ抵
抗が比較的大きく設定されているが、電圧降下用の抵抗
８がバス２に並列に挿入されているため、バス２上で反
射障害を起こし、エコー雑音を発生する。
このように、伝送系の一つのドライバにおいてスイッチ
ング素子やダイオードの短絡事故が発生すると、伝送系
の他のすべてのステージョン間でデータ伝送が不可能に
なる。
ング素子やダイオードの短絡事故が発生すると、伝送系
の他のすべてのステージョン間でデータ伝送が不可能に
なる。
く目的〉
本発明は、上述の問題点に鑑みてなされたものであって
、バスに接続されたドライバにおいてスイッチング素子
等の短絡の発生を検出し、その検出に応じて該ドライバ
をバスから自動的に切り離すことによって、伝送系の他
のステージョン間の不通事故を回避し、伝送系の信頼性
の向上を図ることを目的とする。
、バスに接続されたドライバにおいてスイッチング素子
等の短絡の発生を検出し、その検出に応じて該ドライバ
をバスから自動的に切り離すことによって、伝送系の他
のステージョン間の不通事故を回避し、伝送系の信頼性
の向上を図ることを目的とする。
〈実施例〉
以下、本発明を図面に示す実施例に基づいて詳細に説明
する。
する。
第１図は本発明のドライバ離脱回路を備えたトランノー
バのブロック図で、該トランノーバ１は、バス２上のデ
ータ信号を受信するレノーバ３と、ステー７ョン４から
の送信データをバス２上に送出するドライバ５とを有す
る。
バのブロック図で、該トランノーバ１は、バス２上のデ
ータ信号を受信するレノーバ３と、ステー７ョン４から
の送信データをバス２上に送出するドライバ５とを有す
る。
ドライバ５は、従来のトライバと同様に、スイッチング
素子であるトランジスタ６と、このトランジスタ６のデ
ータ出力端子であるコレクタ端子とバス２との間に接続
されたダイオード７と、前記トランジスタ６のコレクタ
に接続された電圧降下用抵抗８とを有し、前記トランジ
スタ６は、ステー７ョン４からの人力するデータ信号に
応して動作し該データ信号に対応する送出データ信号を
出力し、またダイオード７は、前記抵抗８を介して印加
される逆バイアス電圧によりバス２からの受信データ信
号を阻止するものであるが、ドライバ５はこのほかに、
前記トランジスタ６のデータ入力端子であるベース端子
に接続され、該ベース側におけるデータ信号の有無を検
出する第１データ検出回路９と、前記トランジスタ６の
データ出力端子であるコレクタ端子と前記ダイオード７
との間に接続され、該接続部におけるデータ信号の有無
を検出する第２データ検出回路ＩＯと、前記第１および
第２のデータ検出回路９．ｌＯからそれぞれその検出信
号を導入し両検出信号に基づいて短絡発生の判定をする
判定回路１１と、この判定回路１１の出力によりトラン
ジスタ６のコレクタとバス２との伝送経路を開閉する開
閉器１２とを有する。
素子であるトランジスタ６と、このトランジスタ６のデ
ータ出力端子であるコレクタ端子とバス２との間に接続
されたダイオード７と、前記トランジスタ６のコレクタ
に接続された電圧降下用抵抗８とを有し、前記トランジ
スタ６は、ステー７ョン４からの人力するデータ信号に
応して動作し該データ信号に対応する送出データ信号を
出力し、またダイオード７は、前記抵抗８を介して印加
される逆バイアス電圧によりバス２からの受信データ信
号を阻止するものであるが、ドライバ５はこのほかに、
前記トランジスタ６のデータ入力端子であるベース端子
に接続され、該ベース側におけるデータ信号の有無を検
出する第１データ検出回路９と、前記トランジスタ６の
データ出力端子であるコレクタ端子と前記ダイオード７
との間に接続され、該接続部におけるデータ信号の有無
を検出する第２データ検出回路ＩＯと、前記第１および
第２のデータ検出回路９．ｌＯからそれぞれその検出信
号を導入し両検出信号に基づいて短絡発生の判定をする
判定回路１１と、この判定回路１１の出力によりトラン
ジスタ６のコレクタとバス２との伝送経路を開閉する開
閉器１２とを有する。
前記第１および第２のデータ検出回路９．１０は、例え
ば単安定マルチバイブレークらしくはローパスフィルタ
で構成される。また、開閉器１２はバス２とトラ７ノス
タ６のコレクタとの間に直列に挿入されておればよく、
該開閉器１２としては、機械式のリレー、電子式のリレ
ー、その他外部からの制御信号により開閉するしのであ
れば、とのような構成のらのでしよい。
ば単安定マルチバイブレークらしくはローパスフィルタ
で構成される。また、開閉器１２はバス２とトラ７ノス
タ６のコレクタとの間に直列に挿入されておればよく、
該開閉器１２としては、機械式のリレー、電子式のリレ
ー、その他外部からの制御信号により開閉するしのであ
れば、とのような構成のらのでしよい。
次に上記構成の動作を説明する。今、トラ７ノスタ６お
よびダイオード７が短絡していない状態で、ステーショ
ン４からデータ信号がトランジスタ６のベースに人力す
ると、トランジスタ６のコレクタ側に、該データ信号を
反転した形の負論理の送出データ信号が現われる。その
ため、トランジスタ６のベース側では、第１データ検出
回路９がデータ信号を検出して「データあり」の検出信
号“を出力し、トランジスタ６のコレクタ側では、第２
データ検出回路ｌＯが負論理の送出データ信号を検出し
て、同じく「データあり」の検出信号を出力する。判定
回路１１は、第１および第２のデータ検出回路９．１０
からの両検出信号がともに１データあり」であるときは
、「短絡なし」と判定する。
よびダイオード７が短絡していない状態で、ステーショ
ン４からデータ信号がトランジスタ６のベースに人力す
ると、トランジスタ６のコレクタ側に、該データ信号を
反転した形の負論理の送出データ信号が現われる。その
ため、トランジスタ６のベース側では、第１データ検出
回路９がデータ信号を検出して「データあり」の検出信
号“を出力し、トランジスタ６のコレクタ側では、第２
データ検出回路ｌＯが負論理の送出データ信号を検出し
て、同じく「データあり」の検出信号を出力する。判定
回路１１は、第１および第２のデータ検出回路９．１０
からの両検出信号がともに１データあり」であるときは
、「短絡なし」と判定する。
短絡が発生していなければ、ドライバ５をバス２から切
り離す必要はないから、この「短絡なし」の１’ＪＩ定
信号により開閉器１２はオンの状態に保たれる。
り離す必要はないから、この「短絡なし」の１’ＪＩ定
信号により開閉器１２はオンの状態に保たれる。
同じくトランジスタ６およびダイオード７が短絡してい
ない場合で、トランジスタ６へのデータ信号の人力がな
いときは、トランジスタ６のコレクタ側にもデータ信号
が現われない。そのため、第１および第２のデータ検出
回路９，１０の両検出信号は、いずれら「データなし」
である。また、このように送信すべきデータ信号かない
場合でも、レンーバ３とドライバ５とがバス２に共通に
接続されているので、バス２を介して他のステーシヨン
からのデータ信号がレンーバ３のみならず、ドライバ５
の伝送経路にも入ってくる。しかし、この場合の外部か
らのデータ信号は、逆バイアスのダイオード７により該
伝送経路に入ることを阻止されるから、外部からのデー
タ信号があっても、第２データ検出回路１０の検出信号
は「データなし」である。判定回路１１は、このように
第１お （よび第２のデータ
検出回路９．１０からの検出信号がともに「データなし
」であるときは、「短絡なし」と判定する。このときら
、ドライバ５をバス２から切り離す必要はないから、こ
の「短絡なし」の判定信号により、開閉器■２はオンの
状態に保たれる。
ない場合で、トランジスタ６へのデータ信号の人力がな
いときは、トランジスタ６のコレクタ側にもデータ信号
が現われない。そのため、第１および第２のデータ検出
回路９，１０の両検出信号は、いずれら「データなし」
である。また、このように送信すべきデータ信号かない
場合でも、レンーバ３とドライバ５とがバス２に共通に
接続されているので、バス２を介して他のステーシヨン
からのデータ信号がレンーバ３のみならず、ドライバ５
の伝送経路にも入ってくる。しかし、この場合の外部か
らのデータ信号は、逆バイアスのダイオード７により該
伝送経路に入ることを阻止されるから、外部からのデー
タ信号があっても、第２データ検出回路１０の検出信号
は「データなし」である。判定回路１１は、このように
第１お （よび第２のデータ
検出回路９．１０からの検出信号がともに「データなし
」であるときは、「短絡なし」と判定する。このときら
、ドライバ５をバス２から切り離す必要はないから、こ
の「短絡なし」の判定信号により、開閉器■２はオンの
状態に保たれる。
次にトランジスタ６が短絡している場合、トランジスタ
６のベースにデータ信号が入力しなくても、トランジス
タ６のコレクタ側の電圧はローレベルに降下していて、
ダイオード２を通じて電流が流れるから、第２データ検
出回路１０の検出信号は「データあり」になる。このと
き、第１データ検出回路９の検出信号は「データなし」
である。このように、第１および第２のデータ検出回路
９゜１０の両検出信号が互いに異なるときは、判定回路
１２は「短絡あり」と判定し、それに応じた判定信号を
出力する。短絡が発生すれば、他のステーション間のデ
ータ伝送を阻害するから、「短絡あり」の判定信号によ
り開閉器１２がオフに切り換わり、該ドライバ５全体が
バス２から切り離されまた、ダイオード７が短絡した場
合は、このダイオード７を通じて他のステー７ョンのデ
ータ信号がトランジスタ６のコレクタ側に現われ、これ
が第２データ検出回路１０に検出される。ステーシヨン
４からトランジスタ６の入力端子にデータ信号が入力せ
ず、第１データ検出回路９でデータ信号が検出されない
ときも、府述のように第２データ検出回路ｌＯではデー
タ信号が検出されるから、トランジスタ６が短絡した場
合と同様に、第１データ検出回路９の検出信号は「デー
タなし」で、第２データ検出回路１０の検出信号は１−
データあり」となり、両検出信号は互いに異なる。この
ため、判定回路１１は「短絡あり」の判定信号を出力し
、この判定信号により開閉器１２がオフに切り換わり、
ドライバ５全体がバスから切り離されることになる。
６のベースにデータ信号が入力しなくても、トランジス
タ６のコレクタ側の電圧はローレベルに降下していて、
ダイオード２を通じて電流が流れるから、第２データ検
出回路１０の検出信号は「データあり」になる。このと
き、第１データ検出回路９の検出信号は「データなし」
である。このように、第１および第２のデータ検出回路
９゜１０の両検出信号が互いに異なるときは、判定回路
１２は「短絡あり」と判定し、それに応じた判定信号を
出力する。短絡が発生すれば、他のステーション間のデ
ータ伝送を阻害するから、「短絡あり」の判定信号によ
り開閉器１２がオフに切り換わり、該ドライバ５全体が
バス２から切り離されまた、ダイオード７が短絡した場
合は、このダイオード７を通じて他のステー７ョンのデ
ータ信号がトランジスタ６のコレクタ側に現われ、これ
が第２データ検出回路１０に検出される。ステーシヨン
４からトランジスタ６の入力端子にデータ信号が入力せ
ず、第１データ検出回路９でデータ信号が検出されない
ときも、府述のように第２データ検出回路ｌＯではデー
タ信号が検出されるから、トランジスタ６が短絡した場
合と同様に、第１データ検出回路９の検出信号は「デー
タなし」で、第２データ検出回路１０の検出信号は１−
データあり」となり、両検出信号は互いに異なる。この
ため、判定回路１１は「短絡あり」の判定信号を出力し
、この判定信号により開閉器１２がオフに切り換わり、
ドライバ５全体がバスから切り離されることになる。
以上の動作をまとめて表にすれば、別表第１表の通りで
ある。
ある。
以下余白
〈第１表〉
第１検出回路；第２検出回路； 短絡 １開閉器検出信
号 １ 検出信号 ｊ 判定 ｊオンオｌ■データ有
１ データ有 １ 無 １ オン■データ無 ］ デ
ータ無 ｌ 無 １ オン■データ無 １ データ有
ｌ 何 １ オー第り表において、■がトランジス
タ６およびダイオード７に短絡が生じていない状態で、
トランジスタ６にデータ信号が入力した場合であり、■
が同じく短絡が生じていない状態で、トラ７ノスタ６に
データ信号が入力していない場合であＣ）、■がトラン
ジスタ６らしくはダイオード７が短絡した場合である。
号 １ 検出信号 ｊ 判定 ｊオンオｌ■データ有
１ データ有 １ 無 １ オン■データ無 ］ デ
ータ無 ｌ 無 １ オン■データ無 １ データ有
ｌ 何 １ オー第り表において、■がトランジス
タ６およびダイオード７に短絡が生じていない状態で、
トランジスタ６にデータ信号が入力した場合であり、■
が同じく短絡が生じていない状態で、トラ７ノスタ６に
データ信号が入力していない場合であＣ）、■がトラン
ジスタ６らしくはダイオード７が短絡した場合である。
〈効果〉
以上のように、本発明によれば、ドライバ内のスイッチ
ング素子やダイオードに短絡事故が発生すると、その短
絡が検出されて、自動的にそのドライバがバスから切り
離されるから、一つのドライバでの短絡事故の悪影響が
伝送系の池のステーションに及ぶようなことがなく、ド
ライバでの短絡発生に伴なう伝送系全体の不通事故を未
然に回避することができ、伝送系の信頼性の向上を図り
うる。
ング素子やダイオードに短絡事故が発生すると、その短
絡が検出されて、自動的にそのドライバがバスから切り
離されるから、一つのドライバでの短絡事故の悪影響が
伝送系の池のステーションに及ぶようなことがなく、ド
ライバでの短絡発生に伴なう伝送系全体の不通事故を未
然に回避することができ、伝送系の信頼性の向上を図り
うる。
第１図は本発明のトライバ離脱回路を備えｒコトランン
ーバのブロック図、第２図は共通ハス型伝送系の構成図
、第３図は従来のトランシーバの回路図である。 １・・トランシーバ、２ ・バス、４ ・ステーション
、５・・ドライバ、６・・トランジスタ（スイッチング
素子）、７ ダイオード、９・・第１データ検出回路、
ＩＯ・・・第２データ検出回路、ｌｌ ・・判定回路、
１２・・・開閉器。
ーバのブロック図、第２図は共通ハス型伝送系の構成図
、第３図は従来のトランシーバの回路図である。 １・・トランシーバ、２ ・バス、４ ・ステーション
、５・・ドライバ、６・・トランジスタ（スイッチング
素子）、７ ダイオード、９・・第１データ検出回路、
ＩＯ・・・第２データ検出回路、ｌｌ ・・判定回路、
１２・・・開閉器。
Claims (1)
- （１）バスに接続されているドライバに設けられ、該ド
ライバで短絡事故が生じたとき、この短絡発生を検出し
て該ドライバをバスから切り離す回路であって、ステー
ションからのデータ信号に対応する送出データ信号を出
力するスイッチング素子の入力側においてデータ信号の
有無を検出する第１データ検出回路と、前記スイッチン
グ素子の出力端子とバスからの受信データ信号を阻止す
るダイオードとの間においてデータ信号の有無を検出す
る第２データ検出回路と、前記第１および第２のデータ
検出回路からそれぞれその検出信号を導入し両検出信号
が互いに異なるとき短絡発生と判定する判定回路と、こ
の判定回路の出力により前記スイッチング素子とバスと
の伝送経路を開閉する開閉器とを備えた共通バス型伝送
系のドライバ離脱回路。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59236950A JPS61114629A (ja) | 1984-11-09 | 1984-11-09 | 共通バス型伝送系のドライバ離脱回路 |
| US06/785,516 US4685113A (en) | 1984-11-09 | 1985-10-08 | Driver isolating circuit for common bus-type transmission of local area network |
| CA000492540A CA1248194A (en) | 1984-11-09 | 1985-10-09 | Driver isolation circuit for common bus-type transmission of local area network |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59236950A JPS61114629A (ja) | 1984-11-09 | 1984-11-09 | 共通バス型伝送系のドライバ離脱回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61114629A true JPS61114629A (ja) | 1986-06-02 |
Family
ID=17008157
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59236950A Pending JPS61114629A (ja) | 1984-11-09 | 1984-11-09 | 共通バス型伝送系のドライバ離脱回路 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4685113A (ja) |
| JP (1) | JPS61114629A (ja) |
| CA (1) | CA1248194A (ja) |
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| JP2509632B2 (ja) * | 1987-09-07 | 1996-06-26 | 株式会社東芝 | デ―タ入出力装置 |
| US4939730A (en) * | 1988-10-11 | 1990-07-03 | Gilbarco Inc. | Auto isolation circuit for malfunctioning current loop |
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-
1984
- 1984-11-09 JP JP59236950A patent/JPS61114629A/ja active Pending
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1985
- 1985-10-08 US US06/785,516 patent/US4685113A/en not_active Expired - Fee Related
- 1985-10-09 CA CA000492540A patent/CA1248194A/en not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5585156A (en) * | 1978-12-22 | 1980-06-26 | Toshiba Corp | Protective unit of transmission system |
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|---|---|---|---|---|
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Also Published As
| Publication number | Publication date |
|---|---|
| US4685113A (en) | 1987-08-04 |
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