JPS61113332A - 監視回路 - Google Patents
監視回路Info
- Publication number
- JPS61113332A JPS61113332A JP23455384A JP23455384A JPS61113332A JP S61113332 A JPS61113332 A JP S61113332A JP 23455384 A JP23455384 A JP 23455384A JP 23455384 A JP23455384 A JP 23455384A JP S61113332 A JPS61113332 A JP S61113332A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- test
- signals
- types
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M3/00—Automatic or semi-automatic exchanges
- H04M3/22—Arrangements for supervision, monitoring or testing
- H04M3/26—Arrangements for supervision, monitoring or testing with means for applying test signals or for measuring
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は複数の被監視回路を監視する監視回路に関する
。
。
複数の被監視回路が複雑な組み合せＫより１つの総合被
監視回路を構成する場合における従来技術による監視回
路は、その総合被監視回路で常時監視できうる試験を実
行し、該試験結果を表示し、その表示とあらかじめ用意
した被監視回路の障害表と照合することＫより前記総合
被監視回路を構成する前記複数の被監視回路のうちの障
害回路の判定を人間の判断で行うものである。
監視回路を構成する場合における従来技術による監視回
路は、その総合被監視回路で常時監視できうる試験を実
行し、該試験結果を表示し、その表示とあらかじめ用意
した被監視回路の障害表と照合することＫより前記総合
被監視回路を構成する前記複数の被監視回路のうちの障
害回路の判定を人間の判断で行うものである。
従りて複数の被監視回路の複雑な構成による１つの総合
被監視回路を監視する従来の監視回路は、障害表示と被
監視回路の障害表との対照と判定という人間が判断する
部分が残され、該人間の判断による誤りの発生とま走保
守活動に重要な即応性の低下をまねく欠点を有する。
被監視回路を監視する従来の監視回路は、障害表示と被
監視回路の障害表との対照と判定という人間が判断する
部分が残され、該人間の判断による誤りの発生とま走保
守活動に重要な即応性の低下をまねく欠点を有する。
本発明の目的は、ＣＰＵ４の複雑な回路を使用せず、複
数の被ｑｉ視回路の監視・保守活動を簡略化、正確化、
即応化する監視回路を提供することにある。
数の被ｑｉ視回路の監視・保守活動を簡略化、正確化、
即応化する監視回路を提供することにある。
本発明の監視回路は、オン／オフスイッチと、このオン
／オフスイッチにより駆動される基本パルス発生器と、
この基本パルス発生器の出力にｎ種類の遅延をほどこす
遅延回路と、このｎ種類の遅延した信号を基に、ｎ種の
パルス信号を発生するパルス発生器と、このパルス発生
器からのｎ種類のパルス信号により実行されるｎ種類の
被監視回路の試験結果を保持する保持回路と、この保持
回路出力を優先順位をつけ比較、判定する比較器とを有
する。一 本発明を図面を参照して詳細に説明する。本発明のブロ
ック図は第１図に、またタイムチャートは第２図に示さ
れる。ス〉／オフ スイッチ１の切替により、基本パル
ス発生器７は駆動されその出力信号をもとに遅延回路２
によりｎ種類の遅延信号２１〜２ｎを発生する。パルス
発生器３は、該ｎ種類の遅延信号のうち、まず、第１番
目の遅延信号２１を基に第１のパルス信号３１を発生し
、この信号３１を基に第１の監視回路の試験を行い、該
試験結果４１は、保持回路５により第１番目試験結果５
１として保持される。以下同様に前記遅延回路によるｎ
種類までの遅延信号２２〜２ｎを基Ｋ パルス信号を発
生させ該信号にょシ＠ｎ種類までの被監視回路４の試験
を実行し、該ｎ種類の試験結果５１．５２・・・５ｎを
統合しあらかじめ優先順位をもつ比較器６により、該１
〜ｎ番目までの吃合試験結果を比較・判定する。
／オフスイッチにより駆動される基本パルス発生器と、
この基本パルス発生器の出力にｎ種類の遅延をほどこす
遅延回路と、このｎ種類の遅延した信号を基に、ｎ種の
パルス信号を発生するパルス発生器と、このパルス発生
器からのｎ種類のパルス信号により実行されるｎ種類の
被監視回路の試験結果を保持する保持回路と、この保持
回路出力を優先順位をつけ比較、判定する比較器とを有
する。一 本発明を図面を参照して詳細に説明する。本発明のブロ
ック図は第１図に、またタイムチャートは第２図に示さ
れる。ス〉／オフ スイッチ１の切替により、基本パル
ス発生器７は駆動されその出力信号をもとに遅延回路２
によりｎ種類の遅延信号２１〜２ｎを発生する。パルス
発生器３は、該ｎ種類の遅延信号のうち、まず、第１番
目の遅延信号２１を基に第１のパルス信号３１を発生し
、この信号３１を基に第１の監視回路の試験を行い、該
試験結果４１は、保持回路５により第１番目試験結果５
１として保持される。以下同様に前記遅延回路によるｎ
種類までの遅延信号２２〜２ｎを基Ｋ パルス信号を発
生させ該信号にょシ＠ｎ種類までの被監視回路４の試験
を実行し、該ｎ種類の試験結果５１．５２・・・５ｎを
統合しあらかじめ優先順位をもつ比較器６により、該１
〜ｎ番目までの吃合試験結果を比較・判定する。
高速演算処理技術を使用しているトランスマルチプレク
サを被監視回路とする本発明の実施例を第３図を参照し
て説明する。トランスマルチプレクサは、第３図に示す
如（、Ａ／Ｄ変換器１２と、Ｄ／Ａ変換部８と、Ｔ／Ｆ
ディジタル処理部９（ディジタルからアナログへ゛の変
換）、Ｆ／Ｔディジタル処理部１１（アナログからディ
ジタルへの変換）の高速演算処理部と、ＴＤＭインター
フェイス１０とから構成される。高速演算処理部での監
視は容易でな（、Ａ／Ｄ変換器に試験信号を挿入し、Ｄ
／Ａ変換部で監視する方法がトランスマルチプレクサで
は一番容易である。基本パルス発生器と、２種類の遅延
信号を発生する遅延回路と、該２種類の遅延信号を基に
パルス信号を発生する発生器と、該パルス信号によシ実
行される試験結果を保持する保持回路と、該２徨類の試
験結果を比較・判定する比較器とによる監視回路をトラ
ンスマルチプレクサに適用することにより、まず第３図
中のループＬ１とループＬ２での被監視回路の試験の切
り椰えを、２種類の遅延信号を基にパルス発生器の発生
する第１．第２のパルス信号によシ実現する。このＬ１
ループでの試験結果とＬ２ループでの試験結果とを前記
保持回路で保持し、その出力を前記比較器によシ比較判
定することによシ、高速演算処理を使用しているトラン
スマルチプレクサの自己監視を簡略化できる。
サを被監視回路とする本発明の実施例を第３図を参照し
て説明する。トランスマルチプレクサは、第３図に示す
如（、Ａ／Ｄ変換器１２と、Ｄ／Ａ変換部８と、Ｔ／Ｆ
ディジタル処理部９（ディジタルからアナログへ゛の変
換）、Ｆ／Ｔディジタル処理部１１（アナログからディ
ジタルへの変換）の高速演算処理部と、ＴＤＭインター
フェイス１０とから構成される。高速演算処理部での監
視は容易でな（、Ａ／Ｄ変換器に試験信号を挿入し、Ｄ
／Ａ変換部で監視する方法がトランスマルチプレクサで
は一番容易である。基本パルス発生器と、２種類の遅延
信号を発生する遅延回路と、該２種類の遅延信号を基に
パルス信号を発生する発生器と、該パルス信号によシ実
行される試験結果を保持する保持回路と、該２徨類の試
験結果を比較・判定する比較器とによる監視回路をトラ
ンスマルチプレクサに適用することにより、まず第３図
中のループＬ１とループＬ２での被監視回路の試験の切
り椰えを、２種類の遅延信号を基にパルス発生器の発生
する第１．第２のパルス信号によシ実現する。このＬ１
ループでの試験結果とＬ２ループでの試験結果とを前記
保持回路で保持し、その出力を前記比較器によシ比較判
定することによシ、高速演算処理を使用しているトラン
スマルチプレクサの自己監視を簡略化できる。
以上の説明の如く複数の複雑な被監視回路を有する自己
監視において、本発明は、簡単な回路構成で、１回のオ
ン／オフスイッチ切Ｗｅ作だけで実際の保守活動に適す
る優先順位のついた試験結果が得られ、被監視回路の保
守活動を簡略化、正確化、即応化した保守活動を可能に
する効果を有する。
監視において、本発明は、簡単な回路構成で、１回のオ
ン／オフスイッチ切Ｗｅ作だけで実際の保守活動に適す
る優先順位のついた試験結果が得られ、被監視回路の保
守活動を簡略化、正確化、即応化した保守活動を可能に
する効果を有する。
第１図は、複数の被監視回路を監視する本発明による監
視回路を示すブロック図、第２図は第１図の動作を示す
タイムチャーと、第３図は本発明の実施例における被監
視回路としてのトランスマルチプレクサを示すブロック
図である。 １・・・・・・オン／オフスイッチ、２・・・・・・ｎ
種類の遅延信号を出力する遅延回路、吐・・・・・パル
ス発生器、４・・・・・・ｎ個の被監視回路、５・・・
・・・保持回路、６・・・・・・優先順位を有する比較
器、７・・・・・・基本パルス発生器、８・・・・・・
Ｄ／Ａ変換器、９・・・・・・Ｔ／Ｆディジタル処理部
、１０・・・・・・ＴＤＭインターフェイス、１１・・
・・・・Ｆ／Ｔディジタル処理部、１２・・・・・・〜
Φ変換器、Ｌｌ・・・・・・ループ、Ｌ２・・・・・・
ループ。７．−−一、＋Ｃ− 窮 Ｉ 記 茅 ２ 図
視回路を示すブロック図、第２図は第１図の動作を示す
タイムチャーと、第３図は本発明の実施例における被監
視回路としてのトランスマルチプレクサを示すブロック
図である。 １・・・・・・オン／オフスイッチ、２・・・・・・ｎ
種類の遅延信号を出力する遅延回路、吐・・・・・パル
ス発生器、４・・・・・・ｎ個の被監視回路、５・・・
・・・保持回路、６・・・・・・優先順位を有する比較
器、７・・・・・・基本パルス発生器、８・・・・・・
Ｄ／Ａ変換器、９・・・・・・Ｔ／Ｆディジタル処理部
、１０・・・・・・ＴＤＭインターフェイス、１１・・
・・・・Ｆ／Ｔディジタル処理部、１２・・・・・・〜
Φ変換器、Ｌｌ・・・・・・ループ、Ｌ２・・・・・・
ループ。７．−−一、＋Ｃ− 窮 Ｉ 記 茅 ２ 図
Claims (1)
- オン／オフスイッチと、このオン／オフスイッチにより
駆動される基本パルス発生器と、この基本パルス発生器
の出力に、ｎ種類の遅延をほどこす遅延回路と、この１
〜ｎ種類の遅延した信号を基に、ｎ種類のパルス信号を
発生するパルス発生器と、このパルス発生器からのｎ種
類のパルス出力信号を基に１つの優先順位に従い実行さ
れる、ｎ種類の被監視回路の試験結果を保持する保持回
路と、この保持回路出力を先の優先順位により比較、判
定する比較器とを有することを特徴とする監視回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23455384A JPS61113332A (ja) | 1984-11-07 | 1984-11-07 | 監視回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23455384A JPS61113332A (ja) | 1984-11-07 | 1984-11-07 | 監視回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61113332A true JPS61113332A (ja) | 1986-05-31 |
Family
ID=16972824
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23455384A Pending JPS61113332A (ja) | 1984-11-07 | 1984-11-07 | 監視回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61113332A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0419960A2 (de) * | 1989-09-29 | 1991-04-03 | Siemens Aktiengesellschaft | Schaltungsanordnung zur Prüfung von Teilen einer digitalen Zeitmultiplex-Fernmeldevermittlungsstelle, insbesondere Fernsprechvermittlungsstelle |
-
1984
- 1984-11-07 JP JP23455384A patent/JPS61113332A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0419960A2 (de) * | 1989-09-29 | 1991-04-03 | Siemens Aktiengesellschaft | Schaltungsanordnung zur Prüfung von Teilen einer digitalen Zeitmultiplex-Fernmeldevermittlungsstelle, insbesondere Fernsprechvermittlungsstelle |
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