JPS6093482A - 表示装置 - Google Patents
表示装置Info
- Publication number
- JPS6093482A JPS6093482A JP58201469A JP20146983A JPS6093482A JP S6093482 A JPS6093482 A JP S6093482A JP 58201469 A JP58201469 A JP 58201469A JP 20146983 A JP20146983 A JP 20146983A JP S6093482 A JPS6093482 A JP S6093482A
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- JP
- Japan
- Prior art keywords
- shift register
- display
- matrix
- output
- outputs
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）発明の技術分野
本発明は１画面メモリに記憶する表示情報をラスタスキ
ャンによって表示画面に表示する方式の表示装置に関す
る。
ャンによって表示画面に表示する方式の表示装置に関す
る。
（ｂ）技術の背景
陰極線管（ＣＲ’ｒ ’Ｊ等を表示面として用いる表示
装置は、ストレージ管式・ベクトルスキャン式およびラ
スタスキャン式に大別されるが、電子計算機システム用
にはラスタスキャン式が最も多く用いられ、また、中央
処理装置と表示装置との動作速度の差を調整するため２
通常、バッファとして画面メモリを備え１表示情報を常
に表示面に対応さ一ヒて７１−リソクス状に配列される
画素単位に記憶し５ これを直列に読み取ると共にラス
タスキャンによって表示面に表示している。
装置は、ストレージ管式・ベクトルスキャン式およびラ
スタスキャン式に大別されるが、電子計算機システム用
にはラスタスキャン式が最も多く用いられ、また、中央
処理装置と表示装置との動作速度の差を調整するため２
通常、バッファとして画面メモリを備え１表示情報を常
に表示面に対応さ一ヒて７１−リソクス状に配列される
画素単位に記憶し５ これを直列に読み取ると共にラス
タスキャンによって表示面に表示している。
（ｃ）従来技術と問題点
前記ラスタスキャン式の表示装置、たとえばＣＲ７表示
装置においては、たとえば垂直偏向コイルに６０Ｉｌｚ
ののこぎり波を流すと共に水平偏向コイルに１５．７５
ｋ ｌｌｙ、ののこぎり波を流すことによって。
装置においては、たとえば垂直偏向コイルに６０Ｉｌｚ
ののこぎり波を流すと共に水平偏向コイルに１５．７５
ｋ ｌｌｙ、ののこぎり波を流すことによって。
第１図に例示するように、電子線を表示面の左上隅から
右に振ら−Ｕ、右端に達したら少し下がって再び右に振
らせ、これを繰り返しながら右下隅に至って１画面分の
表示情報を表示するのであるが。
右に振ら−Ｕ、右端に達したら少し下がって再び右に振
らせ、これを繰り返しながら右下隅に至って１画面分の
表示情報を表示するのであるが。
従来、電子ビームを左から右に振らセたあと点線にて示
すように左に戻す期間（水平帰線期間）には電子線を止
めてデータを表示していない。このため１表示画面に「
ちらつき」あるいは表示速度の制約等の問題があった。
すように左に戻す期間（水平帰線期間）には電子線を止
めてデータを表示していない。このため１表示画面に「
ちらつき」あるいは表示速度の制約等の問題があった。
（ｄ）発明の目的
本発明の目的は２画面メモリ備える表示装置における前
記「ちらつきｊの減少と表示速度の増大にある。
記「ちらつきｊの減少と表示速度の増大にある。
（ｅ）発明の構成
すなわち２本発明になる表示装置は１表示情報を表示面
に対応させてマトリックス状に配列される画素単位に記
憶する画面メモリと、前記画面メモリに記憶する表示情
報のうち前記マトリックスの１行分を並列に読み取って
所定の方向に直列に出力する第一のシフトレジスタと、
前記画面メモ１ リに記憶する表示情報のうち前記マト
リックスの１行分を並列に読み取って前記第一のシフト
レジスタの出力方向に対し反対方向に直列に出力する第
二のシフトレジスタと、前記第一のシフトレジスタの出
力と前記第二のシフトレジスタの出力を前記マトリック
スの１行分ずつ交互に選択して出力する選択回路とを備
えるものである。
に対応させてマトリックス状に配列される画素単位に記
憶する画面メモリと、前記画面メモリに記憶する表示情
報のうち前記マトリックスの１行分を並列に読み取って
所定の方向に直列に出力する第一のシフトレジスタと、
前記画面メモ１ リに記憶する表示情報のうち前記マト
リックスの１行分を並列に読み取って前記第一のシフト
レジスタの出力方向に対し反対方向に直列に出力する第
二のシフトレジスタと、前記第一のシフトレジスタの出
力と前記第二のシフトレジスタの出力を前記マトリック
スの１行分ずつ交互に選択して出力する選択回路とを備
えるものである。
（ｆ）発明の実施例
以下に本発明の要旨を実施例によって具体的に説明する
。
。
第２図は本発明一実施例の構成図を示し、１は表示情報
を表示面に対応させてマトリックス状に配列される画素
単位に記憶する画面メモリ、２は後記ビデオ制御回路６
が発生する水平垂直同期信号に同期して画面メモリ１の
アドレスを前記マトリックスの１打型位に順次に指定す
ると共に指定した各アドレスを交互に後記第一のシフト
レジスタ３および第二のシフトレジスタ４に通知するア
ドレス制御回路、３は画面メモリ１に記憶する表示情報
のうち前記マトリックスの１行分を並列に読み則って表
示画面に関し右方向に直列に出力する第一のシフトレジ
スタ、３は画面メモリ１に記憶する表示情報のうち前記
マトリックスの１行分を並列に読み取って第一のシフト
レジスタ３の出力方向に対し反対方向すなわち表示画面
に関し左方向に直列に出力する第二のシフトレジスタ、
５は第一のシフトレジスタ３の出力と第二のシフトレジ
スタ４の出力を前記マトリックスの１行分ずつ交互に選
択して出力する選択回路、６は水平垂直同期信号を含む
ビデオ制御信号を発生するビデオ制御回路、７は選択回
路５を介してえられる表示情報をビデオ信号に変換する
ビデオ変換回路。
を表示面に対応させてマトリックス状に配列される画素
単位に記憶する画面メモリ、２は後記ビデオ制御回路６
が発生する水平垂直同期信号に同期して画面メモリ１の
アドレスを前記マトリックスの１打型位に順次に指定す
ると共に指定した各アドレスを交互に後記第一のシフト
レジスタ３および第二のシフトレジスタ４に通知するア
ドレス制御回路、３は画面メモリ１に記憶する表示情報
のうち前記マトリックスの１行分を並列に読み則って表
示画面に関し右方向に直列に出力する第一のシフトレジ
スタ、３は画面メモリ１に記憶する表示情報のうち前記
マトリックスの１行分を並列に読み取って第一のシフト
レジスタ３の出力方向に対し反対方向すなわち表示画面
に関し左方向に直列に出力する第二のシフトレジスタ、
５は第一のシフトレジスタ３の出力と第二のシフトレジ
スタ４の出力を前記マトリックスの１行分ずつ交互に選
択して出力する選択回路、６は水平垂直同期信号を含む
ビデオ制御信号を発生するビデオ制御回路、７は選択回
路５を介してえられる表示情報をビデオ信号に変換する
ビデオ変換回路。
８はビデオ表示部である。
以上のような構成によって１画面メモリｌに記憶されて
いる表示情報は、前記マトリックスの行単位に第１行目
から順次交互に第一のシフトレジスタ３および第二のシ
フトレジスタ４に記憶され。
いる表示情報は、前記マトリックスの行単位に第１行目
から順次交互に第一のシフトレジスタ３および第二のシ
フトレジスタ４に記憶され。
第一のシフトレジスタ３に記憶された表示情報は右方向
に出力され、引き続いて第二のシフトレジスタ４に記憶
された表示情報が左方向に出力される。
に出力され、引き続いて第二のシフトレジスタ４に記憶
された表示情報が左方向に出力される。
第一のシフトレジスタ３の出力および第二〇シフトレジ
スタ４の出力は選択回路５によって順次交互に選択され
、したがって画面メモリ１の画像情報は第３図のような
順序で読み取られてビデオ変換回路７に供給される。
スタ４の出力は選択回路５によって順次交互に選択され
、したがって画面メモリ１の画像情報は第３図のような
順序で読み取られてビデオ変換回路７に供給される。
ビデオ変換部７では、ｉ！！沢回路５の出力にビデオ制
御回路６から与えられる垂直帰線消去信号（ブランキン
グ信号）を加え、これらをビデオ表示部８に供給する。
御回路６から与えられる垂直帰線消去信号（ブランキン
グ信号）を加え、これらをビデオ表示部８に供給する。
ビデオ表示部８では、ビデオ制御回路６から与えられる
水平同期信号によって、第４図に例示するように電子線
を左右（水平）に等速度で振らせ。
水平同期信号によって、第４図に例示するように電子線
を左右（水平）に等速度で振らせ。
電子線を右方向に振らせるとき前記マトリックスの１行
分の表示情報を表示し、電子線を引続き左方向に振らせ
るときにも次の１行分の表示情報を表示する。
分の表示情報を表示し、電子線を引続き左方向に振らせ
るときにも次の１行分の表示情報を表示する。
すなわち、」−記実施例によれば水平走査の全期間を利
用して表示情報を表示するので１画面の「ちらつき」を
防止するほか表示時間を短縮することができる。
用して表示情報を表示するので１画面の「ちらつき」を
防止するほか表示時間を短縮することができる。
（ｇ）発明の効果
以上説明したように２本発明によれば表示画面の「ちら
つき」を防止すると共に表示時間を短縮することができ
る。
つき」を防止すると共に表示時間を短縮することができ
る。
第１図は従来例の説明図、第２図は本発明一実施例の構
成図、第３図と第４図は前記実施例の動作の説明図であ
る。 図中２１は画面メモリ、３は第一のシフトレジスタ、４
は第二のシフトレジスタ、５は選択回路である。 早 １ 囚 羊 ２ 冒 茶 ３ 目 茅 ４ 聞
成図、第３図と第４図は前記実施例の動作の説明図であ
る。 図中２１は画面メモリ、３は第一のシフトレジスタ、４
は第二のシフトレジスタ、５は選択回路である。 早 １ 囚 羊 ２ 冒 茶 ３ 目 茅 ４ 聞
Claims (1)
- 【特許請求の範囲】 表示情報を表示面に対応させてマトリックス状に配列さ
れる画素単位に記憶する画面メモリと。 前記画面メモリに記憶する表示情報のうち前記マトリッ
クスの１行分を並列に読み取って所定の方向に直列に出
力する第一のシフトレジスタと、前記画面メモリに記憶
する表示情報のうち前記マトリックスの１行分を並列に
読み取って前記第一のシフトレジスタの出力方向に対し
反対方向に直列に出力する第二のシフトレジスタと、前
記第一のシフトレジスタの出力と前記第二のシフトレジ
スタの出力を前記マトリックスの１行分ずつ交互に選択
して出力する選択回路とを備えることを特徴とする表示
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58201469A JPS6093482A (ja) | 1983-10-27 | 1983-10-27 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58201469A JPS6093482A (ja) | 1983-10-27 | 1983-10-27 | 表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6093482A true JPS6093482A (ja) | 1985-05-25 |
Family
ID=16441597
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58201469A Pending JPS6093482A (ja) | 1983-10-27 | 1983-10-27 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6093482A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61263371A (ja) * | 1985-04-29 | 1986-11-21 | ボ−ル、コ−パレイシヤン | 陰極線管の両方向走査方法および両方向走査表示システム |
-
1983
- 1983-10-27 JP JP58201469A patent/JPS6093482A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61263371A (ja) * | 1985-04-29 | 1986-11-21 | ボ−ル、コ−パレイシヤン | 陰極線管の両方向走査方法および両方向走査表示システム |
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