JPS6086592A - カ−ソル表示制御方式 - Google Patents

カ−ソル表示制御方式

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Publication number
JPS6086592A
JPS6086592A JP58194683A JP19468383A JPS6086592A JP S6086592 A JPS6086592 A JP S6086592A JP 58194683 A JP58194683 A JP 58194683A JP 19468383 A JP19468383 A JP 19468383A JP S6086592 A JPS6086592 A JP S6086592A
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JP
Japan
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cursor
display
address
data
video memory
Prior art date
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Pending
Application number
JP58194683A
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English (en)
Inventor
藤川 芳孝
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
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Publication date
Application filed by Ricoh Co Ltd filed Critical Ricoh Co Ltd
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Publication of JPS6086592A publication Critical patent/JPS6086592A/ja
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  • Controls And Circuits For Display Device (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 技監分」 この発明は、オフィスコンピュータやワードプロセッサ
その他各種のデータ処理装置に接続されるCRTコンソ
ールターミナル等で使用するのし;好適な、ビットマツ
プ表示を行うCRT表示装置のカーソル表示制御方式に
係り、特し;、二次元(q置指示装置によってカーソル
の表示イ装置を指示するに際し、カーソルの表示処理を
高速化するとともに、カーソル画像が表示画像と重なっ
たときでも、ビットマツプ表示上のカーソル位置力〜容
易釦;確認できるように表示することにより、各種デー
タ処理装置におけるオペレーションの能率を向上させた
カーソル表示制御方式に関する。
従来抗生 イメージやグラフ等の作成が可能なオフィスコンピュー
タその他のデータ処理装置では、CRT表示装置を用い
たビットマツプ表示が行われており、オペレータは、こ
の表示画面を見ながら、対話形式による操作で、データ
の入出力や、訂正、削除等の必要な処理を行っている。
この場合に、従来から、画面上の操作対象の位置を指示
するため、二次元位置指示装置を使用して、カーソルの
表示位置を指示するようにしたCRT表示装置が知られ
ている。
このような二次元位置指示装置によるカーソルの表示方
式として従来から用いられている方法は。
大別すると2種類である。すなわち、その第1は、カー
ソルが移動される度ごとに、カーソル表示データを映像
メモリへ書込む方法であり、その第2は、映像メモリに
書込む代りに、カーソルアドレスレジスタを使用して、
表示アドレスがこのカーソルアドレスと一致したときに
、カーソル表示データと合成して表示する方法である。
まず、第1の表示方法では、二次元位置指示装置によっ
て指示されたカーソル位置をCPUで検出し、CPUが
CRTコントローラを介して、カーソルが表示されるべ
き映像メモリ上の所定のアドレスに、カーソルのビット
パターンによる表示データを書込むようにしている。
第1図は、従来の第1のカーソル表示方法で使用される
表示制御回路の一例を示す機能ブロック図である。図面
において、1はVRAM (映像メモリ)、2はCRT
コントローラ、3はCP tJ、4はP/S (パラレ
ル/シリアル)変換器、5はCRTユニットを示し、ま
た、H5VNCは水平同期信号、VSYNCは垂直同期
信号、 VIDEOは映像信号を示す。
このVRAM1に対しては、表示タイミング期間中、す
なわちCRTの水平同期信号+1sYNc、垂直同期信
号VSVNC、およびそれらのフロントポーチ、バック
ポーチを除くタイミングで、画像表示データを読出すた
めの表示アドレスが与えられる。
この表示アドレスは、同期信号に同期したタイミングで
順次インクリメントされる。
従来の第1の表示方法では、二次元位置指示装置によっ
てカーソルの表示位置が指示されると、この第1図のC
PU3が、指示されたカーソル位置に対応するVRAM
1上のアドレスを検出して。
CRTコントローラ2へ通知する。そして、CRTコン
トローラ2により、VRAM1の該当アドレスにカーソ
ル表示データを書込む。
ところが、特にイメージやグラフ表示の場合には、カー
ソルの表示位置が、背景画面すなわち地肌の色との関係
で容易に判別できないというケースが生じる。
例えば、白黒2値のモノクロ表示の場合に、地肌を白、
文字や画像等の表示データを黒、また通常のカーソルを
黒で表示するとき、カーソルが文字や画像の表示部分と
重なると、その判別が困難になる。
そこで、カーソルが背景の黒画像と重なったときは、そ
の重なった部分を白表示にし、また、白画像と重なった
ときは、その重なった部分を黒表示にすることにより、
カーソルの表示位置が見え易いように表示している。
すなわち、CR”r=+ントローラ2は、VRAM1に
カーソルパターンを書込む場合に、その内部に設けられ
たイクスクルーシブ・オアゲート(排他的論理和)回路
へ、表示画像データとカーソルのパターンデータとを入
力し、表示画像データとカーソル表示データとの同一レ
ベルのデータ重畳部分では、そのデータを反転させて、
VRAM1上書込むようにしている。
このような処理を行えば、カーソル画像は見易く表示さ
れるが、カーソルの移動の都度、このような処理を行う
必要があるので、CPU3の負担が増加するとともに、
カーソル表示のための処理時間も長くなる、という不都
合がある。
次に、第2の表示方法では、別にカーソルアドレスレジ
スタと表示アドレス比較手段とを設けておき、二次元位
置指示装置により指示されたカーソル位置をCPUが検
出し、CPUの制御によって、このカーソルアドレスレ
ジスタへカーソルが表示されるべき映像メモリのアドレ
スを書込み、CRTに表示するための表示アドレスとカ
ーソルアドレスレジスタに書込まれたアドレスとを、表
示アドレス比較手段により常に比較して、両者が一致し
たとき、カーソルパターンと合成してCR1画面上に表
示するようにしている。
第2図は、従来の第2のカーソル表示方法で使用される
表示制御回路の一例を示す機能ブロック図である。図面
における符号は第1図と同様であり、また、6は表示ア
ドレスコンパレータ、7はカーソルアドレスレジスタ、
8は第2のP/S変′変器換器はカーソルパターンジェ
ネレータ、10はオアゲート回路、Dlは画像表示デー
タ、D2はカーソル表°示データを示す。
この第2の表示方法を実施する制御回路では、カーソル
アドレスレジスタ7と、カーソルパターンジェネレータ
9、および表示アドレスコンパレータ6とが設けられて
いる。
VRAM1から読出された画像表示データは。
P/S変換器4ヘパラレルにロードされ、図示されない
シフトクロックによりシリアルの両像表示データS1に
変換されて、1ビツトずつオアゲート回路10へ入力さ
れる。
また、カーソル表示データD2を発生するカーソルパタ
ーンジェネレータ9には、表示アドレスコンパレータ6
から一致検出出力が与えられ、表示アドレスがカーソル
アドレスレジスタに書込まれたアドレスと一致したとき
、カーソルパターンデータが読出される。
したがって1表示アドレスとカーソルのアドレスとが一
致したときだけ、オアゲート回路1oへ画像データDI
とカーソル表示データD2とが与えられることになる。
そして、このオア出力によって、映像信号VIDEOが
発生され、CRTユニット5へ与えられる。
この従来の第2の表示方法によれば、カーソルの移動の
度ごとに、VRAM1へカーソル表示データを書込む必
要はないので、カーソル表示のための処理時間は、第1
の方法に比べて短縮される。
しかし、映像信号VIDEOは、画像表示データDIと
カーソル表示データD2とのオア処理による出力である
から、カーソルのパターンデータとそれに重畳される表
示画像のデータとが同一レベル、すなわち両者がともに
論理゛′1′″で黒表示のときには、カーソルが表示画
像の中にとけ込んでしまい、非常に判別しにくい、とい
う不都合があった。
■−−作 そこで、この発明のカーソル表示制御方式においては、
従来のカーソル表示方法におけるこのような不都合を解
決し、カーソルの移動ごとに行われる映像メモリへのカ
ーソル画像データの書込みを不要にして、表示処理を高
速化するとともに、カーソルの表示位置が背景の画像と
重なったときでも、見え易いカーソル表示が得られるよ
うにして、オペレータの負担を軽減させることにより、
各種データ処理装置のオペレーションの能率を向上させ
ることを目的とする。
璽−−」え そのために、この発明のカーソル表示制御方式では、映
像メモリと、カーソルの表示位置を指示する二次元位置
指示装置と、カーソルアドレスレジスタと、カーソルパ
ターンジェネレータと、表示アドレス比較手段と、映像
メモリから出力される画像データをパラレル/シリアル
変換するシフトレジスタと、同じくカーソルパターンジ
ェネレータから出力されるカーソル表示データをパラレ
ル/シリアル変換するシフトレジスタとを備え、CPU
の制御によってビットマツプ表示を行うCRT表示装置
において、映像メモリからの画像データとカーソルパタ
ーンジェネレータからのカーソル表示データとのイクス
クルーシブ・オア処理を行うゲート回路手段を設け、二
次元位置指示装置から出力されるカーソル位置情報をC
P TJによって検出し、この位置情報に対応する映倫
メモリのアドレスをカーソルアドレスレジスタへ書込み
、このカーソルアドレスと表示読出しのために映像メモ
リに順次与えられる表示アドレスとを、表示アドレス比
較手段によって常に比較−し、両アドレスが一致したと
き、カーソルパターンジェネレータからのカーソル表示
データがイクスクルーシブ・オア処理手段へ入力される
ように制御している。
次に、図面を参照しながら、この発明のカーソル表示制
御方式の一実施例について説明する。
第3図は、この発明のカーソル表示制御方式を実施する
場合に使用される表示制御回路の一例を示す機能ブロッ
ク図である。図面における符号等は第1図および第2図
と同様であり、また、11はイクスクルーシブ・オアゲ
ート回路を示す。
この第3図の動作は、基本的には、先の第2図と同様で
あり、第2図のオアゲート回路の代りに、イクスクルー
シブ・オアゲート回路が設けられていて、イクスクルー
シブ・オア処理される点が相違している。
すなわち、二次元位置指示装置によって、カーソルの表
示位置が指示されると、その位置情報をCPU3が検出
し、カーソルが表示されるべきVRAM1上のアドレス
を、カーソルアドレスレジスタフに書込む。
このカーソルアドレスレジスタ7に書込まれたカーソル
アドレスは、(’、RTの表示タイミングに同期して、
CRTコントローラ2から順次与えられるVRAM1の
表示アドレスと1表示アドレスコンパレータ6によって
常に比較される。
そして、両者のアドレスが一致すると、カーソルのビッ
トパターンデータが記憶されてしするカーソルパターン
ジェネレータ9から、カーソルのビットパターンデータ
が読出されて、第2のP/S変換器8へパラレルに送出
される。
このパラレルデータは、第2のP/S変換器8でシリア
ルデータに変換され、カーソル表示データD2としてイ
クスクルーシブ・オアゲート回路11へ入力される。
この場合に、VRAM1から読出されて、第1のP/S
変換器4ヘパラレルに送出された表示画像データも、シ
リアルの画像データD1として、このイクスクルーシブ
・オアゲート回路11へ入力され、両データのイクスク
ルーシブ・オア処理が行われる。
ここでは、映像信号VIDEOの論理レベルがIt O
IIのとき、CR7画面上で白表示、zt 1 nのと
き、黒表示されるものとする。
次の第4図は、第3図の表示制御回路のイクスクルーン
ブ・オアゲート回路11における真理値表である。
この第4図からも明らかなように、カーソル画像と重な
った画像表示データ部分は、イクスクルーシブ・オアゲ
ート回路11によって反転され、表示画面上では、白部
分として表示される。すなわち、第4図の最下行のよう
に、画像データDIと重なったカーソル表示データD2
は、白表示されることになる。
反対に、白画像上のカーソルは、その第2行に示される
ように、黒表示されることになる。
このようなデータ処理を行うことにより、カーソルの背
景画像がどのような状態でも、カーソル位置の判別が容
易に行える。
効−−−−−果 したがって、この発明のカーソル表示制御方式では、カ
ーソルの移動を検出する度ごとに、VRAMI上にカー
ソルパターンを書込む必要はなく、単に、カーソルが表
示されるべきVRAMll−のアドレスを書込むだけで
よい。
その結果、カーソル表示のための処理時間が短縮され、
同時に、CPUの負担も軽減される。
さらに、カーソル画像と重なった画像表示部分は、イク
スクルーシブ・オア処理によって反転表示されるので、
背景がどのような画像であっても、容易に判別すること
が可能な、見易いカーソル表示が得られる4という優れ
た効果が奏せられる。
【図面の簡単な説明】
第1図は従来の第1のカーソル表示方法で使用される表
示制御回路の一例を示す機能ブロック図、第2図は従来
の第2のカーソル表示方法で使用される表示制御回路の
一例を示す機能ブロック図、第3図はこの発明のカーソ
ル表示制御方式を実施する場合に使用される表示制御回
路の一例を示す機能ブロック図、第4図は第3図の表示
制御回路のイクスクルーシブ・オアゲート回路における
真理値表である。 図面において、1はVRAM (映像メモリ)、2はC
RTコントローラ、3はCPU、4はP/S変換器、5
はCRTユニット、6は表示アドレスコンパレータ、7
はカーソルアドレスレジスタ、8は第2のP/S変換器
、9はカーソルパターンジェネレータを示す。

Claims (1)

    【特許請求の範囲】
  1. 映像メモリと、カーソルの表示位置を指示する二次元位
    置指示装置と、カーソルアドレスレジスタと、カーソル
    パターンジェネレータと、表示アドレス比較手段と、前
    記映像メモリから出力される画像データをパラレル/シ
    リアル変換するシフトレジスタと、前記カーソルパター
    ンジェネレータから出力されるカーソル表示データをパ
    ラレル/シリアル変換するシフトレジスタとを備え、C
    PUの制御によってビットマツプ表示を行うCRT表示
    装置において、前記映像メモリからの画像データと前記
    カーソルパターンジェネレータからのカーソル表示デー
    タとのイクスクルーシブ・オア処理を行うゲート回路手
    段を設け、前記二次元位置指示装置から出力されるカー
    ソル位置情報をCPUによって検出し、この位置情報に
    対応する前記映像メモリのアドレスを前記カーソルアド
    レスレジスタへ書込み、このカーソルアドレスと表示読
    出しのために前記映像メモリに順次与えられる表示アド
    レスとを、前記表示アドレス比較手段番;よって常に比
    較し1両アドレスの一致B存Lm、前記カーソルパター
    ンジェネレータからのカーソル表示データが前記イクス
    クルーシブ・オア処理手段へ入力されるよう”に制御す
    ることを特徴とするカーソル表示制御方式。
JP58194683A 1983-10-18 1983-10-18 カ−ソル表示制御方式 Pending JPS6086592A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58194683A JPS6086592A (ja) 1983-10-18 1983-10-18 カ−ソル表示制御方式

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JP58194683A JPS6086592A (ja) 1983-10-18 1983-10-18 カ−ソル表示制御方式

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JPS6086592A true JPS6086592A (ja) 1985-05-16

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ID=16328546

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JP58194683A Pending JPS6086592A (ja) 1983-10-18 1983-10-18 カ−ソル表示制御方式

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JP (1) JPS6086592A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01181092U (ja) * 1988-06-10 1989-12-27
JPH02165193A (ja) * 1988-12-20 1990-06-26 Sanyo Electric Co Ltd 表示回路

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01181092U (ja) * 1988-06-10 1989-12-27
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