JPS6079435A - プログラム処理装置 - Google Patents
プログラム処理装置Info
- Publication number
- JPS6079435A JPS6079435A JP18820983A JP18820983A JPS6079435A JP S6079435 A JPS6079435 A JP S6079435A JP 18820983 A JP18820983 A JP 18820983A JP 18820983 A JP18820983 A JP 18820983A JP S6079435 A JPS6079435 A JP S6079435A
- Authority
- JP
- Japan
- Prior art keywords
- area
- circuit
- program
- hardware
- instructions
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/48—Program initiating; Program switching, e.g. by interrupt
- G06F9/4806—Task transfer initiation or dispatching
- G06F9/4843—Task transfer initiation or dispatching by program, e.g. task dispatcher, supervisor, operating system
Landscapes
- Engineering & Computer Science (AREA)
- Software Systems (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の屑する技術分野
本発明は、データ処理装置におけるディスパッチ動作の
処理を行なうプログラム処理装置に関する・ 従来技術 従来、この種のデータ処理装置における、プログラム処
理方式では、ナイスパッチを実行する場合、タスク化さ
れないプログラムがシステムのプログラムの一部として
存在しており、ヨ１ζティパッチ処理プログラム自身が
ナイスパッチの対象となり得る。このため、あるクリテ
ィカル処理、すなわち１割込金量けることが禁止的な処
理の実行時には、その実行中は１割込禁止状態にＴるた
々−）に、命令あるいはプログラム状態語により、その
準備をする必要がある。
処理を行なうプログラム処理装置に関する・ 従来技術 従来、この種のデータ処理装置における、プログラム処
理方式では、ナイスパッチを実行する場合、タスク化さ
れないプログラムがシステムのプログラムの一部として
存在しており、ヨ１ζティパッチ処理プログラム自身が
ナイスパッチの対象となり得る。このため、あるクリテ
ィカル処理、すなわち１割込金量けることが禁止的な処
理の実行時には、その実行中は１割込禁止状態にＴるた
々−）に、命令あるいはプログラム状態語により、その
準備をする必要がある。
従って、タスク化されないプログラムが存在することに
よりジョグのスケジュールのアルゴリズムが複雑になり
、またクリティカル処理のプログラムは５割込禁止とな
る期間においては、ディスバッチ対象のプログラムであ
りながら、そのプログラムのストールなどを監視する手
段がとれないという欠点がある・ 発明の目的 本発明の目的は上述の欠点を解決し、高速にディスバッ
チ処理ができるようにしたプログラム処理装置を提供す
ることにある。
よりジョグのスケジュールのアルゴリズムが複雑になり
、またクリティカル処理のプログラムは５割込禁止とな
る期間においては、ディスバッチ対象のプログラムであ
りながら、そのプログラムのストールなどを監視する手
段がとれないという欠点がある・ 発明の目的 本発明の目的は上述の欠点を解決し、高速にディスバッ
チ処理ができるようにしたプログラム処理装置を提供す
ることにある。
発明の構成
不発明の装置は命令を記憶領域から順次とフ出して実行
するプログラム処理装置において、記憶領域全プログラ
ム領域とハードウェア領域とに分割しプログラム領域の
プログラム央行中にティスパ、チング要因が発生したこ
とを検出する検出手段と、 この検出手段によるディスパッチング要因検出に！ｔ；
答してディスパッチ動作全実行１°るハードウェア領域
の命令群のアドレスを与える手段と、前記ハードウェア
領域の命令群の実行中表示状態を保持する保持手段と、 この保持手段の状態に従って記憶徂域に対するアクセス
全ハードウェア領域とプログラム領域とに切り換える切
換手段と、 ハードウェアυ命令群芙イーＳ中６′こ割込み機構會抑
止する抑止手段とを含む・ 発明の実施例 次に不発明について区間を参照して詐細に説明する。
するプログラム処理装置において、記憶領域全プログラ
ム領域とハードウェア領域とに分割しプログラム領域の
プログラム央行中にティスパ、チング要因が発生したこ
とを検出する検出手段と、 この検出手段によるディスパッチング要因検出に！ｔ；
答してディスパッチ動作全実行１°るハードウェア領域
の命令群のアドレスを与える手段と、前記ハードウェア
領域の命令群の実行中表示状態を保持する保持手段と、 この保持手段の状態に従って記憶徂域に対するアクセス
全ハードウェア領域とプログラム領域とに切り換える切
換手段と、 ハードウェアυ命令群芙イーＳ中６′こ割込み機構會抑
止する抑止手段とを含む・ 発明の実施例 次に不発明について区間を参照して詐細に説明する。
第１図全参照すると、メモリ領域は７１−ドウエア領域
とプログラム領域とに区分されている０本実施例におい
ては、一般のプログラムはプログラム領域のなかで実行
されている。
とプログラム領域とに区分されている０本実施例におい
ては、一般のプログラムはプログラム領域のなかで実行
されている。
しかし、フログラム芙イ］中にナイスパラ１要囚を検出
した場合には、第２図に示す機構によりハードウェア領
域に存在する命令群を実行することを可能にし、割込機
１ｉ１を介することなく、プログラム全実行することが
できる。この様子會第２１凶全参照しながら説明する。
した場合には、第２図に示す機構によりハードウェア領
域に存在する命令群を実行することを可能にし、割込機
１ｉ１を介することなく、プログラム全実行することが
できる。この様子會第２１凶全参照しながら説明する。
第２図全参照すると。
不発明の一実施例であるプログラム処理装置１は、記憶
装置２と信号線１０００．１００１．１００９．１０１
０で接続されている。塘たプログラム処理装置１は命令
とり出し回路１００．アドレス変換回路１０３゜実行回
路１０４．モード制御回路１０１．および割込制御回路
１０２全備えている。
装置２と信号線１０００．１００１．１００９．１０１
０で接続されている。塘たプログラム処理装置１は命令
とり出し回路１００．アドレス変換回路１０３゜実行回
路１０４．モード制御回路１０１．および割込制御回路
１０２全備えている。
今、プログラム領域２０２の一般プログラムが走行して
いたとする。命令とり出し回路１００は、命令アドレス
金アドレス変換回路１０３に送り、順次命令をと９出し
ていく、命令実行中に、例えば実行回路１０４が、ティ
スバッチ費因を検出すると、信号線１００６ｉブｒして
モード制御回路１（）１に通知する。通知を受けたモー
ド制御回路１０１は、ハードウェア領域のプログラムの
アドレスを作成し第３図にボす信号線３００１に送出す
るとともに、モードフリップ・フロップ３０２をセット
して、アドレス変換回路に、先の信号線３００１ ’に
介して送出したアドレスから命令をとり出ｊように、信
号線３００２に介して指示を与える。第２図では、信号
線３００１および３００２ はまとめて、信号線１００
５により示している。ハードウェア領域のティスパッチ
処即命令群の実行が終了したことは、実行回路１０４に
より検出され％ ’ＩＢ−号線１００６を弁じてモード
制御回路１０１にノ坦知される。この通知によりモード
・ノリツブフロップ３０２をリセットしてティスパッチ
動作゛ｒ終了する。またハードウェア領域の命令の９４
行は、ディスバッチ処理であるので割込機構が抑止され
ている↓９に見える必要がある（つまりハードウェア領
域の命令の切れ目が見えてはいけない）。従って信号番
号１００７に弁してモードフリップフロップ３０２が６
オン”の間は％動込を発生しないよう割込制御回路１０
２に通知し割込機４７Ｍ ｋ抑止している。
いたとする。命令とり出し回路１００は、命令アドレス
金アドレス変換回路１０３に送り、順次命令をと９出し
ていく、命令実行中に、例えば実行回路１０４が、ティ
スバッチ費因を検出すると、信号線１００６ｉブｒして
モード制御回路１（）１に通知する。通知を受けたモー
ド制御回路１０１は、ハードウェア領域のプログラムの
アドレスを作成し第３図にボす信号線３００１に送出す
るとともに、モードフリップ・フロップ３０２をセット
して、アドレス変換回路に、先の信号線３００１ ’に
介して送出したアドレスから命令をとり出ｊように、信
号線３００２に介して指示を与える。第２図では、信号
線３００１および３００２ はまとめて、信号線１００
５により示している。ハードウェア領域のティスパッチ
処即命令群の実行が終了したことは、実行回路１０４に
より検出され％ ’ＩＢ−号線１００６を弁じてモード
制御回路１０１にノ坦知される。この通知によりモード
・ノリツブフロップ３０２をリセットしてティスパッチ
動作゛ｒ終了する。またハードウェア領域の命令の９４
行は、ディスバッチ処理であるので割込機構が抑止され
ている↓９に見える必要がある（つまりハードウェア領
域の命令の切れ目が見えてはいけない）。従って信号番
号１００７に弁してモードフリップフロップ３０２が６
オン”の間は％動込を発生しないよう割込制御回路１０
２に通知し割込機４７Ｍ ｋ抑止している。
この様子は第３図においてモードフリップ７０゜プ３０
２の出力でを込要因全ゲート３０６で抑止することによ
り笑現し・ｔｉする。この実施例ではモード７リツプ７
０ツグを設けているが、他の状態全保持する手段も考え
られる。
２の出力でを込要因全ゲート３０６で抑止することによ
り笑現し・ｔｉする。この実施例ではモード７リツプ７
０ツグを設けているが、他の状態全保持する手段も考え
られる。
発明の効果
本発明にはディスパッチ要因を検出しその処理業プログ
ラム領域のプログラムからハードウェア領域の命令群に
移すことを口Ｊ能なように構成することにより、ティス
バ、チ処理のオーバヘッドを軽減できるという効果があ
る。
ラム領域のプログラムからハードウェア領域の命令群に
移すことを口Ｊ能なように構成することにより、ティス
バ、チ処理のオーバヘッドを軽減できるという効果があ
る。
第１図は、メモリ領域の分割を示す図、第２図は、不発
明の一実施例葡示す図および第３図は。 本発明の一実施例を部分的に示す図である。 第１図から第３図において、１・・・ テータ処理’Ｈ
４２・−・・−記憶装置、１００ ・・・・命令と９出
し回路、１０１・・・・・モード制御回路、１０２・・
・・割込制御回路、１０３・・・・・・アドレス変換回
路、１０４・・ ・実行回路、３０２，３０３・・・・
・・フリップ・フ第 １ 図 単 ２ 図Ｘ φ ノ［り 奉３ 図
明の一実施例葡示す図および第３図は。 本発明の一実施例を部分的に示す図である。 第１図から第３図において、１・・・ テータ処理’Ｈ
４２・−・・−記憶装置、１００ ・・・・命令と９出
し回路、１０１・・・・・モード制御回路、１０２・・
・・割込制御回路、１０３・・・・・・アドレス変換回
路、１０４・・ ・実行回路、３０２，３０３・・・・
・・フリップ・フ第 １ 図 単 ２ 図Ｘ φ ノ［り 奉３ 図
Claims (1)
- 【特許請求の範囲】 命令を記憶領域から順次とり出して実行するプログラム
処理装置において、 記憶領域を、プログラム領域とハードウェア領域とに分
割しプログラム領域のプログラム全実行中にティスバッ
チング要因が発生したことを検出する検出手段と、 この検出手段によるディスパッチング要因検出に応答し
てナイスパッチ動作全実行するノ・−ドウエア領域の命
令群のアドレスを与える手段と。 前記ハードウェア領域の命令群の実行中表示状態を保持
する保持手段と。 この保持手段の状態に従って記憶領域に対するアクセス
をハードウェア領域とプログラム領域とに切り換える切
換手段と。 前記ハードウェアの命令群実行中に割り込み機構を抑止
する抑止手段とを含むこと金時１政とするプログラム処
理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18820983A JPS6079435A (ja) | 1983-10-07 | 1983-10-07 | プログラム処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18820983A JPS6079435A (ja) | 1983-10-07 | 1983-10-07 | プログラム処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6079435A true JPS6079435A (ja) | 1985-05-07 |
Family
ID=16219672
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18820983A Pending JPS6079435A (ja) | 1983-10-07 | 1983-10-07 | プログラム処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6079435A (ja) |
-
1983
- 1983-10-07 JP JP18820983A patent/JPS6079435A/ja active Pending
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