JPS6020773A - パワ−トランジスタのベ−スドライバ−回路 - Google Patents
パワ−トランジスタのベ−スドライバ−回路Info
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- JPS6020773A JPS6020773A JP58126513A JP12651383A JPS6020773A JP S6020773 A JPS6020773 A JP S6020773A JP 58126513 A JP58126513 A JP 58126513A JP 12651383 A JP12651383 A JP 12651383A JP S6020773 A JPS6020773 A JP S6020773A
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- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
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- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
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- H02M7/537—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters
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- Power Engineering (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はパワートランジスターを使用したインバーター
に利用されるもので、同ノくワートランジぶターのペー
スドライバー回路に関する０従来例の構成とその問題点 インバーターの負荷として接続されるのは、抵抗負荷で
はなく、はとんど全てがリアクトルやモーター等の誘導
性負荷である。単相インノく一ターの一例を第１図に示
す。第１図において、Ｑ１〜Ｑ４はパワートランジスタ
ー、Ｄ１〜Ｄ４はノくワードランシスタ０１〜Ｑ４にそ
れぞれ逆並列に接続した高速ダイオード、Ｌは誘導性負
荷で、端字Ａ、Ｂ間に直流電源を接続する０ 第２図はパワートランジスター〇１〜Ｑ４のペースをド
ライブするペースドライノく一回路の一例を示すもので
“あるＯ 第２図において、Ｑ２ 、Ｄ２は第１図におけるＱ２．
Ｄ２と同一である。Ｑ５．Ｑ６．Ｑ、７はトランジスタ
、Ｒ１，Ｒ２，Ｒ３は固定抵抗器で、トランジスタＱ７
のベース端子がドライブ信号入力となる。
に利用されるもので、同ノくワートランジぶターのペー
スドライバー回路に関する０従来例の構成とその問題点 インバーターの負荷として接続されるのは、抵抗負荷で
はなく、はとんど全てがリアクトルやモーター等の誘導
性負荷である。単相インノく一ターの一例を第１図に示
す。第１図において、Ｑ１〜Ｑ４はパワートランジスタ
ー、Ｄ１〜Ｄ４はノくワードランシスタ０１〜Ｑ４にそ
れぞれ逆並列に接続した高速ダイオード、Ｌは誘導性負
荷で、端字Ａ、Ｂ間に直流電源を接続する０ 第２図はパワートランジスター〇１〜Ｑ４のペースをド
ライブするペースドライノく一回路の一例を示すもので
“あるＯ 第２図において、Ｑ２ 、Ｄ２は第１図におけるＱ２．
Ｄ２と同一である。Ｑ５．Ｑ６．Ｑ、７はトランジスタ
、Ｒ１，Ｒ２，Ｒ３は固定抵抗器で、トランジスタＱ７
のベース端子がドライブ信号入力となる。
以上の構成において、トランジスタＱ２をオンとするに
は、トランジスタＱ７へのベース電流を流さずトランジ
スタＱ７がオフになっている時で、トランジスタＱ２の
ベース電流は直流電源Ｖｃのプラス側より抵抗Ｒ１、ト
ランジスタＱ５、パワートランジスターＱ２を通じて直
流電源ＶＣのマイナス側に流れる。
は、トランジスタＱ７へのベース電流を流さずトランジ
スタＱ７がオフになっている時で、トランジスタＱ２の
ベース電流は直流電源Ｖｃのプラス側より抵抗Ｒ１、ト
ランジスタＱ５、パワートランジスターＱ２を通じて直
流電源ＶＣのマイナス側に流れる。
ドライブ電流は抵抗Ｒ１によって制限する。パフ
ｌ−トランジスタＱ２をオフとするには、トランジスタ
Ｑ７にベース電流を流してトランジスタａがオンになっ
ている時で、パワートランジスタＱ２のベースの余剰キ
ャリアを直流電源ＶＥのプラス側からトランジスタＱ２
、トランジスタＱ６、抵抗Ｒ２を通して直流電源■Ｅの
マイナス側に引き込み、トランジスタＱ２のベース、エ
ミッター間に直流電源■Ｅにより逆バイ″アス電圧−■
ＢＥを印加するものである。
Ｑ７にベース電流を流してトランジスタａがオンになっ
ている時で、パワートランジスタＱ２のベースの余剰キ
ャリアを直流電源ＶＥのプラス側からトランジスタＱ２
、トランジスタＱ６、抵抗Ｒ２を通して直流電源■Ｅの
マイナス側に引き込み、トランジスタＱ２のベース、エ
ミッター間に直流電源■Ｅにより逆バイ″アス電圧−■
ＢＥを印加するものである。
この様子を第３図に示す。
第３図において、ＩＢはパワートランジスター０２のベ
ースＮ流、ＶＢ ｉ’；ｉ：ベース、エミッター間電圧
で、Ｐ点でトランジスタＱ２がオン、０点でオフとなる
。Ｇはゼロボルトラインである。
ースＮ流、ＶＢ ｉ’；ｉ：ベース、エミッター間電圧
で、Ｐ点でトランジスタＱ２がオン、０点でオフとなる
。Ｇはゼロボルトラインである。
第１図のトランジスタＱ２以外の０１’、Ｑ３゜Ｑ４の
各パワートランジスターのベースにも第２図のＱ ２．
Ｄ ２に置き換えて同じベースドライバー回路が接続さ
れている。
各パワートランジスターのベースにも第２図のＱ ２．
Ｄ ２に置き換えて同じベースドライバー回路が接続さ
れている。
第１図において、ＰＷＭ制御にて０点の平均電圧を変え
るには、トランジスタＱ１と０２を交互にオン、オフさ
せ、そのオン、オフの比率を変えることにより行なうが
、実際にはトランジスタＱｚ 、Ｑ２のスイッチング時
間による動作遅れがあるだめにオン、オフ動作がトラン
ジスタＱ１と０２間で切り換わる場合、タイミング時間
Ｔｄをとったドライバーへのドライブ信号にてトランジ
スタＱ１．Ｑ２が同時にオンとなるタイミングがないよ
うにする。トランジスタＱ３．Ｑ４のペアーでも全く同
一である。
るには、トランジスタＱ１と０２を交互にオン、オフさ
せ、そのオン、オフの比率を変えることにより行なうが
、実際にはトランジスタＱｚ 、Ｑ２のスイッチング時
間による動作遅れがあるだめにオン、オフ動作がトラン
ジスタＱ１と０２間で切り換わる場合、タイミング時間
Ｔｄをとったドライバーへのドライブ信号にてトランジ
スタＱ１．Ｑ２が同時にオンとなるタイミングがないよ
うにする。トランジスタＱ３．Ｑ４のペアーでも全く同
一である。
この様子を第４図に示す。
第４図において、Ｑｌは第１図のパワートランジスタＱ
１のドライバーへのドライブ信号で、■は第１のパワー
トランジスタＱ２のドライバーへのドライブ信号である
。
１のドライバーへのドライブ信号で、■は第１のパワー
トランジスタＱ２のドライバーへのドライブ信号である
。
トランジスタＱ１のオンからトランジスタＱ２のオンあ
るいはトランジスタＱ２のオンからトランジスタＱ１の
オンへ交互に切換わる場合はタイミング時間Ｔｄ をと
って、トランジスタＱＮ 、Ｑ２が同時オンにならない
ようにする。
るいはトランジスタＱ２のオンからトランジスタＱ１の
オンへ交互に切換わる場合はタイミング時間Ｔｄ をと
って、トランジスタＱＮ 、Ｑ２が同時オンにならない
ようにする。
トランジスタＱ１．Ｑ２がオン、オフを交互に繰り返え
しており、わかりやすくするためトランジスタＱ４が連
続してオンの状態で、チョッパー周波数に対して負荷り
のインダクタンスが大きい場合、この時のトランジスタ
Ｑ１．Ｑ２のト；ライバーへのドライブ信号と、トラン
ジスタＱ１．Ｑ２のベース電流、トランジスタＱ１のコ
レクター電流、高速ダイオードＤ２の順方向電流をチョ
ッパーの１サイクルにて考えると第６図のようになる。
しており、わかりやすくするためトランジスタＱ４が連
続してオンの状態で、チョッパー周波数に対して負荷り
のインダクタンスが大きい場合、この時のトランジスタ
Ｑ１．Ｑ２のト；ライバーへのドライブ信号と、トラン
ジスタＱ１．Ｑ２のベース電流、トランジスタＱ１のコ
レクター電流、高速ダイオードＤ２の順方向電流をチョ
ッパーの１サイクルにて考えると第６図のようになる。
第５図において、Ｑｌ、Ｑ２は第１図のパワートランジ
スター０１ 、Ｑ２のそれぞれのドライバーへのドライ
ブ信号、ＩＢｌ ＋ より２は同じくトランジスタＱ１
．Ｑ２へのベース電流、工しハ負荷りへの負荷電流、Ｉ
ｃ１はトランジスタＱ１のコレクター電流、■Ｄ２は高
速ダイオードＤ２の順方向電流である。
スター０１ 、Ｑ２のそれぞれのドライバーへのドライ
ブ信号、ＩＢｌ ＋ より２は同じくトランジスタＱ１
．Ｑ２へのベース電流、工しハ負荷りへの負荷電流、Ｉ
ｃ１はトランジスタＱ１のコレクター電流、■Ｄ２は高
速ダイオードＤ２の順方向電流である。
Ｑｌのドライバーへのドライブ信号にてトランジスタＱ
１がオンとなると、負荷りへの電流は電源端Ａからトラ
ンジスタＱ１ 、負荷ＬトランジスタＱ４を通って電源
端Ｂにもど）、トランジスタＱ１のドライバーへのドラ
イブ信号が加わっているＰ、０間では、トランジスタＱ
１のコレクター電流■Ｃ１が流れ、トランジスタＱ１の
ドライバーへのドライブ信号がオフになると、負荷りに
だくわえられたエネルギーは電流となってパワートラン
ジスタＱ４、高速ダイオードＤ２を通してフリーホイー
ル電流が流れる。これが第５図においてＱ、１間に相当
し高速ダイオードＤ２の順方向電流ＩＤ２が流れる。
１がオンとなると、負荷りへの電流は電源端Ａからトラ
ンジスタＱ１ 、負荷ＬトランジスタＱ４を通って電源
端Ｂにもど）、トランジスタＱ１のドライバーへのドラ
イブ信号が加わっているＰ、０間では、トランジスタＱ
１のコレクター電流■Ｃ１が流れ、トランジスタＱ１の
ドライバーへのドライブ信号がオフになると、負荷りに
だくわえられたエネルギーは電流となってパワートラン
ジスタＱ４、高速ダイオードＤ２を通してフリーホイー
ル電流が流れる。これが第５図においてＱ、１間に相当
し高速ダイオードＤ２の順方向電流ＩＤ２が流れる。
ここで、’Ｄ２が流れているＱ、Ｒ間のトランジスタＱ
２のベース電流より２は第２図のドライバ一部の構成図
において電源■ｃのプラス側よシ抵抗Ｒ１、トランジス
タＱ５を通してパワートランジスターＱ２のベースから
コレクターへ流れ負荷りを通ってパワートランジスタＱ
４がらドライブ電源Ｖｃのマイナス側へもどることにな
る。通常、パワートランジスタ０１〜Ｑ４は電流の大き
さからダーリントントランジスターが使用されることが
多く、トランジスタＱ２のベースエミッター間は、約１
．４■の順方向電圧に対してベース、コレクター間は約
０．７Ｖの順方向電圧で、しかもコレクタがエミッター
に対してマイナスの電位になるだめ、ベースドライブ電
流がベースからコレクターへ流れる方が、ベースからエ
ミッターに流れる通常の場合よりも大きくなることにな
る。ドライブ電流が流れると、〔ドライブ電流〕×〔電
源Ｖｃの電圧〕の損失を生じることになシ、ドライブ電
流が必要のない時にドライブ電流を流すのはドライバ一
部電源容量、および発熱の点で全くムダである。
２のベース電流より２は第２図のドライバ一部の構成図
において電源■ｃのプラス側よシ抵抗Ｒ１、トランジス
タＱ５を通してパワートランジスターＱ２のベースから
コレクターへ流れ負荷りを通ってパワートランジスタＱ
４がらドライブ電源Ｖｃのマイナス側へもどることにな
る。通常、パワートランジスタ０１〜Ｑ４は電流の大き
さからダーリントントランジスターが使用されることが
多く、トランジスタＱ２のベースエミッター間は、約１
．４■の順方向電圧に対してベース、コレクター間は約
０．７Ｖの順方向電圧で、しかもコレクタがエミッター
に対してマイナスの電位になるだめ、ベースドライブ電
流がベースからコレクターへ流れる方が、ベースからエ
ミッターに流れる通常の場合よりも大きくなることにな
る。ドライブ電流が流れると、〔ドライブ電流〕×〔電
源Ｖｃの電圧〕の損失を生じることになシ、ドライブ電
流が必要のない時にドライブ電流を流すのはドライバ一
部電源容量、および発熱の点で全くムダである。
特に負荷りが大きなもので例えば１ｏＯＡの電流を流す
場合、パワートランジスターにダーリントントランジス
ターを使用したとしてもそのＨＦＥが現在のところ１０
０倍を保証できる程度で、ベース電流として１００Ａ／
１００−１Ａもの電流をドライブ電流として流す必要が
あり、１Ａのドライブ電流を流したとしてドライバーの
電源電圧をいｉ７Ｖに設定すると１ＡＸ７Ｖ＝７Ｗもの
損失を生じる。
場合、パワートランジスターにダーリントントランジス
ターを使用したとしてもそのＨＦＥが現在のところ１０
０倍を保証できる程度で、ベース電流として１００Ａ／
１００−１Ａもの電流をドライブ電流として流す必要が
あり、１Ａのドライブ電流を流したとしてドライバーの
電源電圧をいｉ７Ｖに設定すると１ＡＸ７Ｖ＝７Ｗもの
損失を生じる。
現在パワーＭＯ８ＦＥＴやＳＩＴなどドライブ電力がト
ランジスターに比べて大巾に小さくてすむパワーディバ
イスが提案され、そろそろ市場にでまわっているが、オ
ン抵抗や、価格の点でまだまだパワーダーリントントラ
ンジスターが現在のところ主流である。大電力のインバ
ーターをパワーダーリントントランジスターを使用して
構成する場合、そのベースドライブ電力も大電力化に伴
なって増加し１００Ａ以上になるとドライバー〇電源容
量２発熱も無視できない程になってくる。
ランジスターに比べて大巾に小さくてすむパワーディバ
イスが提案され、そろそろ市場にでまわっているが、オ
ン抵抗や、価格の点でまだまだパワーダーリントントラ
ンジスターが現在のところ主流である。大電力のインバ
ーターをパワーダーリントントランジスターを使用して
構成する場合、そのベースドライブ電力も大電力化に伴
なって増加し１００Ａ以上になるとドライバー〇電源容
量２発熱も無視できない程になってくる。
発明の目的
本発明は以上のような点に鑑みてなされたもの−で、そ
の目的はパワートランジスターを使用した誘導性負荷を
制御するインバーターのドライバ一部の省エネルギー化
をはかってドライバーの電源容量と発熱の低減を見るも
のである。
の目的はパワートランジスターを使用した誘導性負荷を
制御するインバーターのドライバ一部の省エネルギー化
をはかってドライバーの電源容量と発熱の低減を見るも
のである。
発明の構成
本発明は、パワートランジスターのコレクター・エミッ
ター間に接続されたフリホイールダイオードである高速
ダイオードに順方向電流が流れることにより生ずる順方
向電圧を検出し動作する第１のスイッチ手段を具備し、
そのスイッチ手段により、高速ダイオードに順方向電圧
が生じた時にパワートランジスターにドライバー電源よ
り順方向ベースドライブ電流を供給する第２のスイッチ
手段をドライブ信号にかかわらず優先的にオフとし、パ
ワートランジスターのベースエミッター間を逆バイアス
することにある。
ター間に接続されたフリホイールダイオードである高速
ダイオードに順方向電流が流れることにより生ずる順方
向電圧を検出し動作する第１のスイッチ手段を具備し、
そのスイッチ手段により、高速ダイオードに順方向電圧
が生じた時にパワートランジスターにドライバー電源よ
り順方向ベースドライブ電流を供給する第２のスイッチ
手段をドライブ信号にかかわらず優先的にオフとし、パ
ワートランジスターのベースエミッター間を逆バイアス
することにある。
実施例の説明
以下、本発明の実施例をｉ６図を参照して説明する。第
６図の構成において、パワートランジスタＱ２．トラン
ジスタＱ５ 、Ｑｅ 、Ｑ７ 、高速ダイオードＤ２．
固定抵抗器Ｒ１，Ｒ２，Ｒ３は第２図の従来例の構成と
同じで、゛トランジスターｓ。
６図の構成において、パワートランジスタＱ２．トラン
ジスタＱ５ 、Ｑｅ 、Ｑ７ 、高速ダイオードＤ２．
固定抵抗器Ｒ１，Ｒ２，Ｒ３は第２図の従来例の構成と
同じで、゛トランジスターｓ。
Ｑ９ 、Ｑｌｏ、固定抵抗器Ｒ４、Ｒ５、Ｒ６，Ｒ７、
コンデンサＣと高速ダイオードＤ５を加えたものである
。
コンデンサＣと高速ダイオードＤ５を加えたものである
。
第６図において、高速ダイオードＤ２に順方向電流が流
れると、パワートランジスター０２のコレクターには、
エミッターを基準にしてマイナスの高速ダイオードＤ２
の順方向電圧を生じることになシ、それ以外のトランジ
スタＱ２がオン、あるいは、オフしている時はコレクタ
ー電圧はプラスの電位をもつことになる。
れると、パワートランジスター０２のコレクターには、
エミッターを基準にしてマイナスの高速ダイオードＤ２
の順方向電圧を生じることになシ、それ以外のトランジ
スタＱ２がオン、あるいは、オフしている時はコレクタ
ー電圧はプラスの電位をもつことになる。
トランジスタＱ９はドライノ（−電源ＶＣから抵抗器Ｒ
４、Ｒ６を通してベース電流を供給されており、抵抗器
Ｒ４とＲ５の接続点と）くワードランシスターＱ２のコ
レクターを高速ダイオードＤ６により接続する。
４、Ｒ６を通してベース電流を供給されており、抵抗器
Ｒ４とＲ５の接続点と）くワードランシスターＱ２のコ
レクターを高速ダイオードＤ６により接続する。
トランジスタＱ９めコレクターは抵抗器Ｒ６を通してド
ライブ電源■ｃに接続する。トランジスター０９はパワ
ートランジスターＱ２のコレクター′がマイナスの電位
をもつ時、即ちフリーホイールダイオードである高速ダ
イオードＤ２の順方向に電流が流れている時にトランジ
スタＱ９のベース電流は抵抗器Ｒ４、高速ダイオードＤ
５を通してバイパスされ、トランジスタＱ９はオフとな
り、それ以外のパワートランジスタＱ２のコレクターの
電位がプラスの極性をもつ時には１トランジスタＱ９は
オンとなる。
ライブ電源■ｃに接続する。トランジスター０９はパワ
ートランジスターＱ２のコレクター′がマイナスの電位
をもつ時、即ちフリーホイールダイオードである高速ダ
イオードＤ２の順方向に電流が流れている時にトランジ
スタＱ９のベース電流は抵抗器Ｒ４、高速ダイオードＤ
５を通してバイパスされ、トランジスタＱ９はオフとな
り、それ以外のパワートランジスタＱ２のコレクターの
電位がプラスの極性をもつ時には１トランジスタＱ９は
オンとなる。
トランジスター〇９がオフになると、トランジスタＣＮ
ｏはオン、トランジスタＱ８がオンとなり、パワートラ
ンジスター０２へドライブ電流を供給するトランジスタ
Ｑ５をトランジスターＱ７のオン、オフにかかわらず優
先的にオフとし、トランジスタＱ６をオンとしてパワー
トランジスターＱ２のベースエミッター間を逆バイアス
する。
ｏはオン、トランジスタＱ８がオンとなり、パワートラ
ンジスター０２へドライブ電流を供給するトランジスタ
Ｑ５をトランジスターＱ７のオン、オフにかかわらず優
先的にオフとし、トランジスタＱ６をオンとしてパワー
トランジスターＱ２のベースエミッター間を逆バイアス
する。
トランジスタＱ９がオンの場合はトランジスタＱ１０゜
Ｑ８はオフで、この場合はドライブ信号によジオンオン
するトランジスタＱ７によりノくワードランシスター０
２のベースドライブ電流が制御可能となる。なお、コン
デンサＣは高速ダイオードＤ５の逆電圧が印加されると
きの逆回復電流をノくイ・くスし、トランジスタＱ９へ
過大なベース電流が流れないようにするだめのものであ
る。
Ｑ８はオフで、この場合はドライブ信号によジオンオン
するトランジスタＱ７によりノくワードランシスター０
２のベースドライブ電流が制御可能となる。なお、コン
デンサＣは高速ダイオードＤ５の逆電圧が印加されると
きの逆回復電流をノくイ・くスし、トランジスタＱ９へ
過大なベース電流が流れないようにするだめのものであ
る。
この様子を第５図の従来のドライノく−によった場合の
チョッパーの１サイクルの各部の波形と対比させ、本発
明によった場合のチョツノクーの１サイクルの各部の波
形を第７図に示す。
チョッパーの１サイクルの各部の波形と対比させ、本発
明によった場合のチョツノクーの１サイクルの各部の波
形を第７図に示す。
第７図の０１ 、 Ｑ２ 、 ＩＢｌ、ＩＢ２． ＩＬ
、 ＩＣ１゜■Ｄ２は第６図のｏ １ ＋ ０２ Ｉ
Ｂ、１ 、 より ２ 、 Ｉ Ｌ 。
、 ＩＣ１゜■Ｄ２は第６図のｏ １ ＋ ０２ Ｉ
Ｂ、１ 、 より ２ 、 Ｉ Ｌ 。
”ＣＩ ＋ ■Ｄ２ と同じである。第７図のＱ９は第
６図のトランジスタＱ９のコレクタ電圧である。第５図
、と第７図のパワートランジスタＱ２へのドライブ電流
ＩＢ２．を比較すると高し゛イオードＤ２に順方向電流
ＩＤ２が流れているＱ、Ｈの区間ではパワートランジス
ターＱ２のドライノく−へのドライブ信号Ｑ２が入力さ
れているにもＱ１かわらず、本発明を実施した場合の第
７図ではトランジスタＱ２へのベースドライブ電流ＩＢ
２が従来の構成例の第６図のように流れることはない。
６図のトランジスタＱ９のコレクタ電圧である。第５図
、と第７図のパワートランジスタＱ２へのドライブ電流
ＩＢ２．を比較すると高し゛イオードＤ２に順方向電流
ＩＤ２が流れているＱ、Ｈの区間ではパワートランジス
ターＱ２のドライノく−へのドライブ信号Ｑ２が入力さ
れているにもＱ１かわらず、本発明を実施した場合の第
７図ではトランジスタＱ２へのベースドライブ電流ＩＢ
２が従来の構成例の第６図のように流れることはない。
以上のような構成、動作によるが、′本発明を実際の３
相誘導電動機の駆動用インバーターに実施した場合のベ
ースドライブ電流波形を第８図に示す。
相誘導電動機の駆動用インバーターに実施した場合のベ
ースドライブ電流波形を第８図に示す。
使用したインバーターは不等巾ＰＷＭによるダーリント
ントランジスターを使用したもので、負荷として１．６
ＫＷ汎用３相誘導電動機を接続した。
ントランジスターを使用したもので、負荷として１．６
ＫＷ汎用３相誘導電動機を接続した。
第８図において、Ａは本発明を実施する前のベースドラ
イブ電流波形、Ｂは本発明を実施した場合のベースドラ
イブ電流波形である。
イブ電流波形、Ｂは本発明を実施した場合のベースドラ
イブ電流波形である。
本発明を実施する前では平均ドライブ電流が実測値で０
．３１Ａに対して、本発明を実施しだ場合は０．１７Ａ
となり、平均ドライブ電流が本発明を実施することによ
り０．１７Ａ１０．３１Ａ＝０．５４８で５５％に低減
されている。
．３１Ａに対して、本発明を実施しだ場合は０．１７Ａ
となり、平均ドライブ電流が本発明を実施することによ
り０．１７Ａ１０．３１Ａ＝０．５４８で５５％に低減
されている。
発明の効果
以上の説明から明らかなように本発明によれば、ドライ
バ一部の電源容量を従来に比べて低減することができる
。また電源容量の低下から従来に比べてドライバ一部の
コストダウンを期待できる。
バ一部の電源容量を従来に比べて低減することができる
。また電源容量の低下から従来に比べてドライバ一部の
コストダウンを期待できる。
さらに、ドライバ一部の発熱量も従来に比べて低下し装
置の小型化ＪＳはかれる。
置の小型化ＪＳはかれる。
第１図はパワートランジスタをパワースイッチに使用し
た単相インバーターの構成例を示す回路図、第２図は第
１図のパワートランジスターをドライブするだめのベー
スドライバーの構成例を示す回路図、第３図は第２図の
ペースドライバーを使用した時のパワートランジスター
のベース電流とベースエミッター間の電圧波形図、第４
図はＰＷＭ制御した時の第１図のパワートランジスター
Ｑ１ 、Ｑ２のそれぞれのドライバーへのドライブ信号
波形図、第６図は第１図においてパワートランジスター
０４をオンとし、パワートランジスター０１．Ｑ２をチ
ョッピングさせた時の各部の信号波形図、第６図は本発
明の実施例にかかる回路図、第７図は第６図のドライバ
ーを使用し、第１図においてパワートランジスタＱ４を
オンとし、パワートランジスタＱ１．Ｑ２をチョッピン
グさせた時の各部の信号波形図、第８図は本発明を実施
した場合と実施しない場合のベースドライブ電流波形図
である。 Ｑ１〜Ｑ４・・・・・・パワートランジスタ、Ｄ１〜Ｄ
４・・・・・・フリーホイールダイオード、Ｑ５・・・
・・トランジスタ（第２のスイッチ手段）、Ｑ９・・・
・・・トランジスタ（第１のスイッチ手段）、Ｒ４’、
Ｒ５・・・・・・抵抗器、Ｄ５・・・・・・ダイオード
。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第６
図 第７図
た単相インバーターの構成例を示す回路図、第２図は第
１図のパワートランジスターをドライブするだめのベー
スドライバーの構成例を示す回路図、第３図は第２図の
ペースドライバーを使用した時のパワートランジスター
のベース電流とベースエミッター間の電圧波形図、第４
図はＰＷＭ制御した時の第１図のパワートランジスター
Ｑ１ 、Ｑ２のそれぞれのドライバーへのドライブ信号
波形図、第６図は第１図においてパワートランジスター
０４をオンとし、パワートランジスター０１．Ｑ２をチ
ョッピングさせた時の各部の信号波形図、第６図は本発
明の実施例にかかる回路図、第７図は第６図のドライバ
ーを使用し、第１図においてパワートランジスタＱ４を
オンとし、パワートランジスタＱ１．Ｑ２をチョッピン
グさせた時の各部の信号波形図、第８図は本発明を実施
した場合と実施しない場合のベースドライブ電流波形図
である。 Ｑ１〜Ｑ４・・・・・・パワートランジスタ、Ｄ１〜Ｄ
４・・・・・・フリーホイールダイオード、Ｑ５・・・
・・トランジスタ（第２のスイッチ手段）、Ｑ９・・・
・・・トランジスタ（第１のスイッチ手段）、Ｒ４’、
Ｒ５・・・・・・抵抗器、Ｄ５・・・・・・ダイオード
。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第６
図 第７図
Claims (2)
- （１）パワートランジスターのコレクターエミッター間
に接続されたフリーホイールダイオードに順方向電流が
流れることにより生ずる順方向電圧を検出し動作する第
１のスイッチ手段と、前記パワートランジスターにドラ
イバー電源よりベースドライブ電流を供給する第２のス
イッチ手段を具備し、前記フリーホイールダイオードに
順方向電圧が生じた時にドライブ信号にかかわらず第１
のスイッチ手段の出力によシ第２のスイッチ手段をオフ
トシ、前記パワートランジスターのペースエミッタＴ間
を逆バイアスするよう構成したパワートランジスターの
ペースドライバー回路。 - （２）第１のスイッチ手段は、ドライバー電源より直列
に接続された第１と第２の抵抗器によυベース電流を供
給されるトランジスタと、前記第１と第２の抵抗器の接
続点とパワートランジスターのコレクター間に接続され
たダイオードからなる特許請求の範囲第１項記載のノく
ワードランシスターのペースドライバー回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58126513A JPH0683579B2 (ja) | 1983-07-12 | 1983-07-12 | パワートランジスターのベースドライバー回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58126513A JPH0683579B2 (ja) | 1983-07-12 | 1983-07-12 | パワートランジスターのベースドライバー回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6020773A true JPS6020773A (ja) | 1985-02-02 |
| JPH0683579B2 JPH0683579B2 (ja) | 1994-10-19 |
Family
ID=14937063
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58126513A Expired - Lifetime JPH0683579B2 (ja) | 1983-07-12 | 1983-07-12 | パワートランジスターのベースドライバー回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0683579B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010246175A (ja) * | 2009-04-01 | 2010-10-28 | Denso Corp | 電力変換回路の駆動装置 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55131281A (en) * | 1979-03-30 | 1980-10-11 | Tech Res & Dev Inst Of Japan Def Agency | Driving circuit for power transistor |
| JPS579270A (en) * | 1980-06-18 | 1982-01-18 | Shinko Electric Co Ltd | Controlling circuit for transistor inverter |
| JPS57151278A (en) * | 1981-03-14 | 1982-09-18 | Fuji Electric Co Ltd | Base driving circuit for transistor |
| JPS586080A (ja) * | 1981-06-30 | 1983-01-13 | Matsushita Electric Works Ltd | トランジスタ・インバ−タのベ−スドライバ回路 |
-
1983
- 1983-07-12 JP JP58126513A patent/JPH0683579B2/ja not_active Expired - Lifetime
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55131281A (en) * | 1979-03-30 | 1980-10-11 | Tech Res & Dev Inst Of Japan Def Agency | Driving circuit for power transistor |
| JPS579270A (en) * | 1980-06-18 | 1982-01-18 | Shinko Electric Co Ltd | Controlling circuit for transistor inverter |
| JPS57151278A (en) * | 1981-03-14 | 1982-09-18 | Fuji Electric Co Ltd | Base driving circuit for transistor |
| JPS586080A (ja) * | 1981-06-30 | 1983-01-13 | Matsushita Electric Works Ltd | トランジスタ・インバ−タのベ−スドライバ回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010246175A (ja) * | 2009-04-01 | 2010-10-28 | Denso Corp | 電力変換回路の駆動装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0683579B2 (ja) | 1994-10-19 |
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