JPS60204051A - 割込み優先度制御方式 - Google Patents

割込み優先度制御方式

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Publication number
JPS60204051A
JPS60204051A JP5915484A JP5915484A JPS60204051A JP S60204051 A JPS60204051 A JP S60204051A JP 5915484 A JP5915484 A JP 5915484A JP 5915484 A JP5915484 A JP 5915484A JP S60204051 A JPS60204051 A JP S60204051A
Authority
JP
Japan
Prior art keywords
interrupt
interrupt request
request signal
time
waiting time
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP5915484A
Other languages
English (en)
Inventor
Seiji Nishihata
西畑 誠司
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP5915484A priority Critical patent/JPS60204051A/ja
Publication of JPS60204051A publication Critical patent/JPS60204051A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/20Handling requests for interconnection or transfer for access to input/output bus
    • G06F13/24Handling requests for interconnection or transfer for access to input/output bus using interrupt
    • G06F13/26Handling requests for interconnection or transfer for access to input/output bus using interrupt with priority control

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Bus Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は、実時間処理システムにおりて中央処理部が実
行する複数の割込み処理に対して、ハードウェアにより
割込み優先度の・a理を行うことによって処理優先度を
決定する割込み優先度制御方式に関する。
(従来技術) 従来の割込み優先度制御方式においては、外部から入力
される割込み要求信号の優先度は、接続する場所に対応
して固定的に上位から下位へと決定されて−た。このよ
うな方式においては、上位の優先度を有する割込みが多
数存在した場合には、下位の優先度の割込み処理を実行
する能力が著しく低下し、場合によっては、処理を行う
ことができなくなるとbう欠点があつた。また、接続に
よって固定的に優先度が決定されるため、実行中に優先
度を変更することはできな−と云う欠点もあった。
(発明の目的) 本発明の目的は、外部から入力された許容待ち時間と、
外部から割込みが発生した時点から待たされた時間とを
比較し、多数の割込み要求信号の優先度を決定するとと
くより上記欠点を解決し、複数の割込み要因が存在する
システムの割込み処理を短時間内に有効に行うことがで
きるように構成した割込み優先度制御方式を提供するこ
とにある。
(発明の構成) 本発明による割込み優先度制御方式は入力部と、割込み
要求信号制御部と、割込み優先度決定部と、出力部とを
具備して構成することにより実現したものである。
入力部は、複数の割込み要求信号をそれぞれの許容待ち
時間データに対応させて入力するためのものである。
割込み要求信号制御部は、入力部からの複数の割込み要
求信号を受付け、肯定の場合には肯定返答を発生するた
めのものである。
割込み優先度決定部は、割込み要求信号制御部により発
生した肯定返答を通知されると、外部からの複数の割込
み要求信号が発生した時点からの経過時刻をカウントし
、カウント値と許容待ち時間データとを比較し、カウン
ト値が許容待ち時間データを越えた特定のチャネルに対
してダイナミックに高い優先度を与え、特定のチャネル
に対するチャネル番号を送出するためのものである。
出力部は、割込み要求信号制御部により発生した肯定返
答、ならびに割込み優先度決定部により与えられたチャ
ネル番号を外部に送出するためのものである。
(実施例) 以下、図面により本発明の詳細な説明する。
第1図は本発明の一実施例を実現するブロック構成であ
って、1は入力部、2は割込み要求信号制御部、3は割
込み優先度決定部、4は出力部、5〜7は割込み要求信
号線、8〜10は許容待ち時間データ信号線、11は割
込み信号線、12は割込みチャンネル番号信号線である
。入力部lは割込み要求信号制御部2、および割込み優
先決定部3に接続されている。割込み要求信号制御部2
は出力部4、および割込み優先度決定部3に接続されて
いる。割込み優先度決定部3は出力部4、および割込み
要求信号制御部2に接続されてl、nる。
上記装置を動作するには、割込み要求信号線5〜7上の
複数の割込み要求信号を許容待ち時間データ信号線8〜
10上のそれぞれの許容待ち時間データと対応させて入
力部2に入力し、割込み要求信号線5〜7上の割込み要
求信号を割込み信号制御部2に送出する。この時、許容
待ち時間データ信号線8〜10上の許容待ち時間データ
は、割込み優先度決定部3に送出される。
割込み信号制御部2では、送出された割込み要求信号に
対して肯定の返答を外部へ送出する場合には、肯定の返
答を出力部4へ送出すると共に、割込み優先度決定部3
にも送出して外部からの割込み要求発生を通知する。通
知を受けた割込み優先度決定部3では、外部からの割込
み要求発生時点からの経過時刻をカウントし、そのカウ
ント値、つまり待たされている時間と許容待ち時間デー
タとを比較し、待たされている時間が許容待ち時間をオ
ーバーしたチャンネルに対してダイナミックに高い割込
み優先度を与え、そのチャンネル番号を外部へ通知する
ため、出力部4へこれを送出する。出力部4は、割込み
信号制御2の出力と割込み優先度決定部3の出力を外部
に送出する。
このように、割込み優先順位を固定し麿いで、許容待ち
時間と待たされている時間との要素を含んだ優先度を決
定することより、割込み処理が効率的圧実行でき、シス
テム全体の処理能力の向上をはかることができる。
(発明の効果) 以上説明したように本発明によれば、外部から入力され
た許容待ち時間と、外部から割込みが発生した時点から
待たされた時間とを比較し、多数の割込み要求信号の優
先度を決定することにより、実時間処理システムの複数
の割込み要求に対する処理の優先度を決定する場合に、
外部との接続により固定的な優先順位を割当てることに
より生ずる高位の処理で許容待ち時間が大きく、低位の
処理で許容待ち時間が小さい場合のシステム処理速度の
低下を防ぐことができ、随時、許容待ち時間データを付
加することによって割込み優先順位を可変にでき、シス
テム処理能力を向上させることができると云う効果があ
る。
【図面の簡単な説明】
第1図は、本発明による割込み優先度制御方式を実現す
るためのブロック構成図である。 1・・・入力部 2・・・割込み要求信号制御部3・・
・割込み優先度決定部 4・・・出力部5〜7・・・割
込み要求信号 8〜10・・・許容待ち時間データ 11・・・割込み信号 12・・・割込みチャンネル番号 特許出願人 日本電気株式会社 代理人 弁理士 井 ノ ロ 壽

Claims (1)

    【特許請求の範囲】
  1. 複数の割込み要求信号をそれぞれの許容待ち時間データ
    に対応させて入力するための入力部と、前記入力部から
    の前記複数の割込み要求信号を受付け、肯定の場合には
    肯定返答を発生するための割込み要求信号制御部と、前
    記割込み要求信号制御部により発生した肯定返答を通知
    されると、外部からの前記複数の割込み要求信号が発生
    した時点からの経過時刻をカウントし、前記カウント値
    と前記許容待ち時間データとを比較し、前記カウント値
    が前記許容待ち時間データを越えた特定のチャネルに対
    してダイナミックに高し優先度を与え、前記特定のチャ
    ネルに対するチャネル番号を送出するための割込み優先
    度決定部と、前記割込み要求信号制御部により発生した
    前記肯定返答、ならびに前記割込み優先度決定部により
    与えられた前記チャネル番号を外部に送出するための出
    力部とを具備して構成することにより実現したことを特
    徴とする割込み優先度制御方式。
JP5915484A 1984-03-27 1984-03-27 割込み優先度制御方式 Pending JPS60204051A (ja)

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Application Number Priority Date Filing Date Title
JP5915484A JPS60204051A (ja) 1984-03-27 1984-03-27 割込み優先度制御方式

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JP5915484A JPS60204051A (ja) 1984-03-27 1984-03-27 割込み優先度制御方式

Publications (1)

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JPS60204051A true JPS60204051A (ja) 1985-10-15

Family

ID=13105149

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5915484A Pending JPS60204051A (ja) 1984-03-27 1984-03-27 割込み優先度制御方式

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