JPS60201745A - 符号誤り検出方式 - Google Patents
符号誤り検出方式Info
- Publication number
- JPS60201745A JPS60201745A JP5798484A JP5798484A JPS60201745A JP S60201745 A JPS60201745 A JP S60201745A JP 5798484 A JP5798484 A JP 5798484A JP 5798484 A JP5798484 A JP 5798484A JP S60201745 A JPS60201745 A JP S60201745A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- code error
- circuit
- conversion
- binary digital
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Error Detection And Correction (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、２値ディジタル通信方式において発生する
符号誤りを検出する符号誤り検出方式に関するものであ
る。
符号誤りを検出する符号誤り検出方式に関するものであ
る。
〈背景〉
従来から、ディジタル通信回線の品質は、伝送路の符号
誤りを監視して一定の基準を維持するようにされる。伝
送路をオンラインで監視するために、従来では、パリテ
ィ検出方式が採用されている。パリティ検出方式では、
数ブロックで構成される１フレ一ム分の信号をチェック
し、１”の個数が偶数か奇数かで判断するため、伝送さ
れる全信号をチェックするものの、回路規模が大きくな
り、検出するのに時間がかかる欠点を有していた。
誤りを監視して一定の基準を維持するようにされる。伝
送路をオンラインで監視するために、従来では、パリテ
ィ検出方式が採用されている。パリティ検出方式では、
数ブロックで構成される１フレ一ム分の信号をチェック
し、１”の個数が偶数か奇数かで判断するため、伝送さ
れる全信号をチェックするものの、回路規模が大きくな
り、検出するのに時間がかかる欠点を有していた。
〈発明の概要〉
この発明はこれらの欠点を除去するため、送信側で２値
ディジタル信号に対しｍビットごとにＩＩ ＩＩ＋を挿
入し、その信号を和分変換して送信し、受信側では（＋
ｎ ＋ １ ）ビット間に挿入した″１″信号を利用し
て、符号誤りを検出することを特徴とし、その目的は、
回路規模が小さく、さらに、検出時間も早く、簡易な符
号誤り検出方式を提供することにある。
ディジタル信号に対しｍビットごとにＩＩ ＩＩ＋を挿
入し、その信号を和分変換して送信し、受信側では（＋
ｎ ＋ １ ）ビット間に挿入した″１″信号を利用し
て、符号誤りを検出することを特徴とし、その目的は、
回路規模が小さく、さらに、検出時間も早く、簡易な符
号誤り検出方式を提供することにある。
〈実施例）
以下、この発明の一実施例を図面を参照して説明する０
Ｄｉｆｆｅｒｅｎｔｉａｌ ｍ−１３１Ｍ符号を用いた
伝送方式のブロック構成の一部を第１図に示す。
Ｄｉｆｆｅｒｅｎｔｉａｌ ｍ−１３１Ｍ符号を用いた
伝送方式のブロック構成の一部を第１図に示す。
送信側は（ｍ ＋ １ ） ／ ｍ倍速度変換及び゛１
″信号挿入回路１と和分変換回路２とから構成される。
″信号挿入回路１と和分変換回路２とから構成される。
伝送路３を介して送信側と結合された受信側は差分変換
回路４と誤り検出回路５とから構成されている。各部の
パルス列のタイムチャートを第２図に示す。
回路４と誤り検出回路５とから構成されている。各部の
パルス列のタイムチャートを第２図に示す。
第２図（ａ）に示す通常の２値ディジタル信号は入力端
子１１を介して回路１に妻入力され、回路１では、（ｍ
＋ １ ） ／ １１１倍の速度変換が行われると共
に′１”′信号が挿入されて第２図（１））の波形とな
る。つまり（ｍ＋１）ビットのかたまりを１ブロツクと
すると、１ブロツクには必ず１ビツトの１１１１＋信号
が挿入された２値ディジタル信号が回路１から出力され
る。この回路１の出力は回路２で法２の和分変換が行わ
れ、第２図（Ｃ）に示す出力が得られ、（Ｉｎ＋１）ピ
ットに一度は、符号の１１ Ｑ ＩＩ 、ＩＩ １°”
が反転する。
子１１を介して回路１に妻入力され、回路１では、（ｍ
＋ １ ） ／ １１１倍の速度変換が行われると共
に′１”′信号が挿入されて第２図（１））の波形とな
る。つまり（ｍ＋１）ビットのかたまりを１ブロツクと
すると、１ブロツクには必ず１ビツトの１１１１＋信号
が挿入された２値ディジタル信号が回路１から出力され
る。この回路１の出力は回路２で法２の和分変換が行わ
れ、第２図（Ｃ）に示す出力が得られ、（Ｉｎ＋１）ピ
ットに一度は、符号の１１ Ｑ ＩＩ 、ＩＩ １°”
が反転する。
伝送路３を伝搬した信号は、中継器等で波形整形され、
受信側入力点では送信側の出力点と同一の波形（ｄ）が
得られる。ここで採用している符号では、受信側でまず
、差分変換回路４により、差分変換され、回路１の出力
と同一の波形（ｅ）が得られる。このパルス信号列（ｅ
）では、伝送路で符号誤りがなければ（ｍ ＋ １ ）
ビット毎に必ず″１′信号が存在する。
受信側入力点では送信側の出力点と同一の波形（ｄ）が
得られる。ここで採用している符号では、受信側でまず
、差分変換回路４により、差分変換され、回路１の出力
と同一の波形（ｅ）が得られる。このパルス信号列（ｅ
）では、伝送路で符号誤りがなければ（ｍ ＋ １ ）
ビット毎に必ず″１′信号が存在する。
仮に、ランダム誤りが発生する伝送路上で第２図（Ｃ）
に示したブロック切換点の前後どちらか１ビツトが誤ま
ると、差分変換回路４の出力は、挿入した゛１″信号は
”０°′となる。つまりこの方式では誤り検出回路５は
、挿入した″１″信号のみをチェックし、０″が検出さ
れた時に、符号誤りがあったとする。この方式の符号誤
り検出確率は２／ｍ＋１となり、全ビットをチェックす
る場合に比較し、検出確立は劣化する。しかし、伝送路
上での誤りがランダムに発生する場合には確率的に問題
はない。
に示したブロック切換点の前後どちらか１ビツトが誤ま
ると、差分変換回路４の出力は、挿入した゛１″信号は
”０°′となる。つまりこの方式では誤り検出回路５は
、挿入した″１″信号のみをチェックし、０″が検出さ
れた時に、符号誤りがあったとする。この方式の符号誤
り検出確率は２／ｍ＋１となり、全ビットをチェックす
る場合に比較し、検出確立は劣化する。しかし、伝送路
上での誤りがランダムに発生する場合には確率的に問題
はない。
〈効果〉
以上説明したように、この発明は、（ｍ＋１）ビット毎
に存在する゛１″信号を利用して符号誤 −りを検出す
るだめ、フレーム構成、フレーム同期等の大規模な回路
が必要なく、比較的小規模な回路で実現できる。又、百
数十ビット毎に誤りを検出するパリティ方式に比較して
も、符号誤りを早期に検出でき、伝送系に存在する中継
器へも設置が容易なため、伝送回線の信頼性向上、保守
効率向上等にも効果がある。
に存在する゛１″信号を利用して符号誤 −りを検出す
るだめ、フレーム構成、フレーム同期等の大規模な回路
が必要なく、比較的小規模な回路で実現できる。又、百
数十ビット毎に誤りを検出するパリティ方式に比較して
も、符号誤りを早期に検出でき、伝送系に存在する中継
器へも設置が容易なため、伝送回線の信頼性向上、保守
効率向上等にも効果がある。
第１図は、この発明による符号誤り検出方式の一例を示
すブロック図、第２図は、第１図の各部の波形を示すタ
イムチャートである。 １’（ｍ＋１）／ｍ倍速度変換と”１°信号挿入回路、
２：和分変換回路、３：伝送路、４：差分変換回路、５
：誤り検出回路、１１：信号入゛力端子。 特許出願人 日本電信電話公社 代理人 草野 卓
すブロック図、第２図は、第１図の各部の波形を示すタ
イムチャートである。 １’（ｍ＋１）／ｍ倍速度変換と”１°信号挿入回路、
２：和分変換回路、３：伝送路、４：差分変換回路、５
：誤り検出回路、１１：信号入゛力端子。 特許出願人 日本電信電話公社 代理人 草野 卓
Claims (1)
- （１）２値ディジタル信号にｍピッ）（ｍは１以上の整
数）で構成されるブロック毎に１つのｆｆ ＩＩ＋（マ
ーク）信号を挿入し、その″１′信号が挿入された２値
ディジタル信号に対し和分変換を行って送信し、受信側
にて、同期を取った後に受信信号に対し差分変換を行い
、（ｍ ＋ １ ）ビット毎に挿入されたＩＩ Ｉ Ｉ
＋倍信号利用して、符号誤りを検出することを特徴とす
る符号誤り検出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5798484A JPS60201745A (ja) | 1984-03-26 | 1984-03-26 | 符号誤り検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5798484A JPS60201745A (ja) | 1984-03-26 | 1984-03-26 | 符号誤り検出方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60201745A true JPS60201745A (ja) | 1985-10-12 |
Family
ID=13071273
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5798484A Pending JPS60201745A (ja) | 1984-03-26 | 1984-03-26 | 符号誤り検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60201745A (ja) |
-
1984
- 1984-03-26 JP JP5798484A patent/JPS60201745A/ja active Pending
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