JPS60179782A - パタ−ン発生方式 - Google Patents

パタ−ン発生方式

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Publication number
JPS60179782A
JPS60179782A JP59035205A JP3520584A JPS60179782A JP S60179782 A JPS60179782 A JP S60179782A JP 59035205 A JP59035205 A JP 59035205A JP 3520584 A JP3520584 A JP 3520584A JP S60179782 A JPS60179782 A JP S60179782A
Authority
JP
Japan
Prior art keywords
pattern
section
character
patterns
basic
Prior art date
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Pending
Application number
JP59035205A
Other languages
English (en)
Inventor
岸本 晋弥
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Canon Inc
Original Assignee
Canon Inc
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Filing date
Publication date
Application filed by Canon Inc filed Critical Canon Inc
Priority to JP59035205A priority Critical patent/JPS60179782A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [技術分野] 本発明はパターン発生方式に関し、特に多種類のパター
ン、例えば文字パターン等を発生させる際に必要なパタ
ーン記憶領域を軽減したパターン発生方式に関するもの
である。
[従来技術] 従来の文字発生方法の1つに文字パターンをすべてドツ
トパターンでもち、それをROM或いはRAMの記憶領
域に登録しておき、ホストコンピュータ等から送出され
た文字コードに対応してこの登録されている文字パター
ン記憶域からドツトパターンを読み出し、それをCRT
やプリンタ等の出力装置に出力する方法がある。
しかしこの方法に於いては文字の種類が増大するに比例
して文字パターンの記憶領域の増大が必茨となるという
欠点があった。
[目的コ 本発明は上述の従来技術の欠点に鑑みなされたもので、
パターンを記憶する記憶領域を軽減したパターン発生方
式を提供することを目的とする。
[実施例] 以下図面を用いて本発明の一実施例を説明する。
第1図は本発明に係る一実施例の文字発生装置のブロッ
ク図で、図中1は制御部、2はコード入力部、3は加/
減算部、4はメモリ部、5は拡大/縮小部、6は基本パ
ターン部、7はテーブル部である。
第2図(A)〜(J)に基本パターン部6にある基本パ
ターンの数種類を例として示し、第3図(A)にテーブ
ル部7に於ける文字コードに対応した情報パラメータの
いくつかの例を示す。
また第4図(A)〜(C)に文字がどんな基本パターン
より構成されるかの例を示す。例えば“E゛′という文
字は第2図(A)、(’C)。
(I)に示す基本パターンのSl、S3.S9を第4図
(A)図示の如くに加減することによって構成される。
第5図(A)〜(C)には、第4図(A)〜(C)に位
置情報をイづ加した例を示す。(XO。
yo)は文字を埋め込むべき領域の原点を示し、X、Y
はヨコ方向とタテ方向のそれぞれの長ざを示す。(XE
I 、YEI)、(XE2 。
YF3 )、(XE3 、YF3)等は原点(Xo 。
yo)よりの位置を表わし、基本パターンが配置される
べき左上の隅の点である。
次の全体制御の流れを第6図のフローチャートも参照し
て説明する。
まずステップP1でメモリ部4をクリアし、ステップP
2で中央処理装置等のホストよりコード入力部2に文字
コードが入力されるのを待つ。
コード入力部2に文字コードが入力されるとステップP
3に進み、制御部1はテーブル部7の入力文字コードに
対応した情報パラメータを読み込む。例えば文字コード
“45″′ (文字” E ” )が入力されると第3
図(A)に示すテーブル部7中の“45′°に対応した
パラメータを読み込む。
以下、この文字コード°“45′′が入力された場合を
例として説明とする。
そしてステップP5で処理する最初のパラメータを読み
出し解析する。文字コード゛45°′の場合には最初は
(XEI 、YEI)、Sl、l、+であり、第2図(
A)に示す基本パターンSlからなり、それが位置(X
EI 、YEI)に位置し、倍率lで加算することが分
る。
ステップP7でパラメータ、解析の結果、コードが0゛
°の場合にはステップP9でエンドフラグをセットする
。これはコードが0′″の場合にはこのパラメータに対
する処理を終了すると、当該文字コードに対応した文字
パターンの展開が終了することを表わすためである。
そしてステップFilでメモリ部4へ文字全体サイズ情
報(X、Y)及びパラメータの位置情報、この場合には
(XEI、YEI)を知らせる。
その後、ステップP13でパラメータで指定した基本パ
ターン(31)の−性分のパターンを基本パターン部6
より読み出し、拡大/縮小部5へ出力し、拡大/縮小部
ではステップP15で倍率に従い基本パターンを拡大、
縮小して結果を加/減算部3に出力する。
同時にステップP17でメモリ部4の位置情報にて指定
された領域からその内容を読み出し、加/減算部3へ入
力する。加/′g、算部3ではステップP19で双方よ
りの入力を加減情報に従い演算し、メモリ部4に出力す
る。この例では“+′′であり、最初はメモリ部4がク
リアされているので基本パターンのSLがそのままメモ
リ部4に出力されることになる。
メモリ部4ではステップP21でこの出力情報に従い一
性分のパターンを書き込み、その後ステップP23で基
本パターンの全ての書き込みが終了したか否か調べ、終
了していなけれは再びステップP13に戻り次の行の基
本バター′ンに対しての処理を行う。
また、以トの説明では1行分のパターンを一度に展開し
たが、パターンが(XE+ 、 Y E I ) 。
(XE 、+l、y E 、) 、 (XE 、+2.
 Y E、、) ・・・ ゛の順てくるものとし、1行
分のパターンの書き込みが終了すると拡大/縮小部5よ
りエンドライン信号を加/減算部3とメモリ部4に送り
、メモリ部4はこの信号で次に読み書きする位置が(X
E+、Ypi+1)から始まることを検知する様に制御
してもよい。
順次パターンの展開を行い、例えばS1パターンの最終
ラインまでこの処理を終了すると、拡大/m小部5より
制御部lに終了信号が出力されステップP23よりステ
ップP25に進み、エンドフラグがセットされているか
否か調べる。エンドフラグがセットされていなければス
テップP5に戻り、次に処理すべき情報パラメータを読
み解析する。
この例では基本パターンS1に対する処理が終了シタた
め次+7)(XE2 、YE2)S3,1.−を読み込
む。そして、第2図(C)に示す基本パターンS3より
なり、それが位置(XE2゜YE2)に位置し、倍率1
で減算することが分る。
そしてこの基本パターンS3に対する処理を実行スルト
、次は同様に(Xp3 、YE3)。
S9,1.十の処理を行う。
この場合にはコードが“0゛°のためステップP7より
ステップP9に進み、エンドフラグがセットされる。こ
のエンドフラグのセットによりパターン展開後ステップ
P25よりステップF27に進む。これにより制御部1
は文字コード” 45 ”に対応するE°“の文字パタ
ーンの生成が終了したことを知り、ステップP27でメ
モリ部4の(x、y)に相当する領域に生成された文字
パターンを順次出力積器へ出力する。そしてステップP
1に戻り、次の文字コードに対するパターン生成に備え
る。
これによりCRTディスプレイやプリンタ等の出力機器
に文字パターン(例えば“E”′)が出力される。なお
、加/減算部3においては1+1=1.0−1=Oとす
る。
また、第4図(B)に示した“A″゛の文字パターン生
成時は基本パターンの84と84の0.8倍への縮小パ
ターン34′及び基本パターンS10より成される9と
を示している。
以上説明したように文字間の類似性に着目し、基本とな
る基本パターンと文字の構成を表すテーブルとにより文
字が発生出来、文字が増大すればするほど全体の文字記
憶域の軽減に効果を発揮する。これは日本文字、漢字に
於いても全く同様である。
また文字全体の大きさく属性)は第3図CB)に示すテ
ーブル部7の文字の大きさを示すテーブルで示されてい
る。
[効果コ 以上説明した様に本発明によれば、パターンを構成する
基本的なパターン群と各構成要素の組合せを記憶する領
域のみで、各パターン全てを記憶する必要がなくなり、
パターンの記憶領域が大幅に軽減できる。
また、パターンの種類が多くなるほど本発明によるパタ
ーンの記憶領域の軽減効果は増大する。
【図面の簡単な説明】
第1図は本発明に係る一実施例のパターン発生装置のブ
ロック構成図、 第2図(A)〜(J)は本実施例における基本パターン
の例を示す図、 第3図(A)、(B)は本実施例のテーブル部の情報パ
ラメータの記憶例を示す図、 第4図(A、)〜(C)は本実施例の基本パターンより
文字パターンを生成する例を示す図、第5図(A)〜(
C)は第4図(A)〜(C)に示す文字パターンに位置
情報を付加した例を示す図、 第6図は本実施例のパターン発生制御を示すフローチャ
ートである。 図中、■・・・制御部、2・・・コード入力部、3・・
・加/減算部、4・・・メモリ部、5・・・拡大/縮小
部、6・・・基本パターン部、7・・・テーブル部であ
る。 第1図 ノ・0ターン ーーデーり渠良 □鼻せ卸J東 第2図 (Aン (0) (F) 第3図 s+ S3 5g 54 S4’ 5IO 56S6 S9

Claims (2)

    【特許請求の範囲】
  1. (1)パターンの各構成要素の組合せを記憶する第1の
    記憶手段と、簡単な形状からなる基本的なパターン群を
    記憶する第2の記憶手段と、該基本的なパターン群より
    前記各構成要素を生成する生成手段とを備え、該生成手
    段にて生成した構成要素を前記第1の記憶手段に記憶の
    組合せに従って組合せて所望のパターンを発生させるこ
    とを特徴とするパターン発生方式。
  2. (2)生成手段は基本的なパターン群の組合せ又は重ね
    合わせによるパターンの加減により構成要素を生成する
    ことを特徴とする特許請求の範囲第1項記載のパターン
    発生方式。
JP59035205A 1984-02-28 1984-02-28 パタ−ン発生方式 Pending JPS60179782A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59035205A JPS60179782A (ja) 1984-02-28 1984-02-28 パタ−ン発生方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59035205A JPS60179782A (ja) 1984-02-28 1984-02-28 パタ−ン発生方式

Publications (1)

Publication Number Publication Date
JPS60179782A true JPS60179782A (ja) 1985-09-13

Family

ID=12435350

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59035205A Pending JPS60179782A (ja) 1984-02-28 1984-02-28 パタ−ン発生方式

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JP (1) JPS60179782A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0339791A (ja) * 1989-07-06 1991-02-20 Hitachi Ltd 文字処理方式、および、文書編集装置

Cited By (1)

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JPH0339791A (ja) * 1989-07-06 1991-02-20 Hitachi Ltd 文字処理方式、および、文書編集装置

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