JPS6017258B2 - アナログ・ディジタル変換器 - Google Patents
アナログ・ディジタル変換器Info
- Publication number
- JPS6017258B2 JPS6017258B2 JP9059979A JP9059979A JPS6017258B2 JP S6017258 B2 JPS6017258 B2 JP S6017258B2 JP 9059979 A JP9059979 A JP 9059979A JP 9059979 A JP9059979 A JP 9059979A JP S6017258 B2 JPS6017258 B2 JP S6017258B2
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- JP
- Japan
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- analog
- input
- bit
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- Expired
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/38—Analogue value compared with reference values sequentially only, e.g. successive approximation type
- H03M1/46—Analogue value compared with reference values sequentially only, e.g. successive approximation type with digital/analogue converter for supplying reference values to converter
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/66—Digital/analogue converters
- H03M1/74—Simultaneous conversion
- H03M1/80—Simultaneous conversion using weighted impedances
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Description
【発明の詳細な説明】
本発明はアナログ・ディジタル変換器（以下Ａ−Ｄ変換
器と記す）に関し、スピードの早い逐次比較型Ａ−Ｄ変
換器を高分解能の比較器を用いることないこ実現するこ
とを目的とする。
器と記す）に関し、スピードの早い逐次比較型Ａ−Ｄ変
換器を高分解能の比較器を用いることないこ実現するこ
とを目的とする。
逐次比較型Ａ−Ｄ変換器に用いられる重み付けされた基
準電流源はＭＳＢ（ＭＯＳｔＳｉｇｎｉｆｉｃａｎｔＢ
ｉｔ）の電流値に対して沙ｉｔ，神ｉｔ目は１／２，１
／４となり、ｎ．ｂｉｔ目は１／２ｎ‐１となる。
準電流源はＭＳＢ（ＭＯＳｔＳｉｇｎｉｆｉｃａｎｔＢ
ｉｔ）の電流値に対して沙ｉｔ，神ｉｔ目は１／２，１
／４となり、ｎ．ｂｉｔ目は１／２ｎ‐１となる。
・例えば１２ビットのＡ−○変換器において、・ＭＳＢ
の電流値をｌｍＡとするとＬＳＢ（ＬｅａｓｔＳｉｇｎ
ｉｎｃａｎｔＢｉｔ）は１／２ｎｘｌｍＡ＝４胸心とな
る。このように低い電流値の切替えを行う電流切替えス
イッチはスピードが遅くなるという欠点を有するため、
一般には基準電流源および電流切換えスイッチを複数の
ブロックに分け、下位ブロックの電流値を大きくし、ブ
ロック間を抵抗分割で接続し、下位ビットの電流を増し
、電流切替えスイッチのスピードを遠くする方式が取ら
れている。第１図はその構成図である。
の電流値をｌｍＡとするとＬＳＢ（ＬｅａｓｔＳｉｇｎ
ｉｎｃａｎｔＢｉｔ）は１／２ｎｘｌｍＡ＝４胸心とな
る。このように低い電流値の切替えを行う電流切替えス
イッチはスピードが遅くなるという欠点を有するため、
一般には基準電流源および電流切換えスイッチを複数の
ブロックに分け、下位ブロックの電流値を大きくし、ブ
ロック間を抵抗分割で接続し、下位ビットの電流を増し
、電流切替えスイッチのスピードを遠くする方式が取ら
れている。第１図はその構成図である。
図では１２ビットの場合を示している。１０１は入力信
号端子、１０２は入力抵抗、１０３は比較器、１０４は
比較器０出力、１０５〜１０８は分割抵抗、１０９〜１
２０は電流切換えスイッチ、１２１〜１３２は各ビット
基準電流源、１３３は電源ラインである。
号端子、１０２は入力抵抗、１０３は比較器、１０４は
比較器０出力、１０５〜１０８は分割抵抗、１０９〜１
２０は電流切換えスイッチ、１２１〜１３２は各ビット
基準電流源、１３３は電源ラインである。
被変換アナログ入力信号が入力端子１０１に加えられ、
入力抵抗１０２に流れるビット電流による入づ力抵抗１
０２の電圧降下が入力端子１０１の入力信号と等しくな
り、比較器の入力電圧１３４が零ボルトとなるように比
較器出力１０４から蟹流切替スイッチ１０９〜１２０に
帰還がかかり変換が行われる。第１図では１２ビットを
３ブロックに０分け各ブロックの電流値は等しくしてあ
り、分割抵抗１５，１０６を２５５：１：とし、１０７
，１０８を１６：１とし各ビットの電流値を合わせてい
るが、この回路方式では比較器の入力電圧１３４が零ボ
ルトの時にしか分割抵抗１０５〜１０８を夕流れる電流
が抵抗分割比に比例しないので、比較器入力１３４が雰
ボルト以外では分割抵抗１０５〜１０８を流れる電流は
抵抗分割比に比例せず、抵抗１０６，１０８の接地点と
入力点１３４間での電圧差による誤差電流が接地点から
流れ比較器入力１３４には各ビット電流に対応した電圧
が生じなくなり、比較器１０３には分解館が高いものが
要求されることになる。本発明は上述のように比較器に
高い分解能を要求することのないＡ−Ｄ変換器を提供す
るものであり、本発明をその実施例を示す第２図を用い
て説明する。
入力抵抗１０２に流れるビット電流による入づ力抵抗１
０２の電圧降下が入力端子１０１の入力信号と等しくな
り、比較器の入力電圧１３４が零ボルトとなるように比
較器出力１０４から蟹流切替スイッチ１０９〜１２０に
帰還がかかり変換が行われる。第１図では１２ビットを
３ブロックに０分け各ブロックの電流値は等しくしてあ
り、分割抵抗１５，１０６を２５５：１：とし、１０７
，１０８を１６：１とし各ビットの電流値を合わせてい
るが、この回路方式では比較器の入力電圧１３４が零ボ
ルトの時にしか分割抵抗１０５〜１０８を夕流れる電流
が抵抗分割比に比例しないので、比較器入力１３４が雰
ボルト以外では分割抵抗１０５〜１０８を流れる電流は
抵抗分割比に比例せず、抵抗１０６，１０８の接地点と
入力点１３４間での電圧差による誤差電流が接地点から
流れ比較器入力１３４には各ビット電流に対応した電圧
が生じなくなり、比較器１０３には分解館が高いものが
要求されることになる。本発明は上述のように比較器に
高い分解能を要求することのないＡ−Ｄ変換器を提供す
るものであり、本発明をその実施例を示す第２図を用い
て説明する。
２０１は入力端子、２０２〜２０４は入力抵抗、２０５
は比較器、２０６は比較器出力、２０７〜２１８は電流
切替えスイッチ、２１９〜２３０は基準電流源、２３６
は電源ラインである。
は比較器、２０６は比較器出力、２０７〜２１８は電流
切替えスイッチ、２１９〜２３０は基準電流源、２３６
は電源ラインである。
第２図は第１図と同じく１２ビットのＡ−Ｄ変換器を示
しており、電流切替えスイッチおよび基準電流源を３個
の単位構成回路に分割した場合を示す。被変換アナログ
入力信号が入力端子２０１に加えられ、入力抵抗２０２
〜２０４を介して各ビット電流が流れるが、今各単位構
成回路の基準電流源の電流値を同一とすると、入力抵抗
２０２，２０３，２０４の比を１：１５：２４０となる
ように設定しておくと、各ブロック２３３，２３４，２
３５の基準電流源の電流による入力抵抗での電圧降下は
１：１６：２５６となり、比較器の入力端２３２には各
ビットに対応する電圧が生じ、この電圧が雫ボルトとな
るように比較器出力２０６から電流切替えスイッチに帰
還がかかりＡ−○変換が行われる。以上説明したように
本発明によれば、下位の単位構成回路の電流を抵抗分割
で流すのではなく、入力抵抗を各単位構成回路に対応し
た抵抗値に分割しているため従来のように接地点を通っ
て誤差電流が流れないので、比較器の入力端には各ビッ
トに対応した電圧が生じ、比較器にはＡ−○変換器のビ
ット数に即した分解能のものを用いて、電流切替えスイ
ッチのスピードが早いＡ−Ｄ変換器を実現できる。
しており、電流切替えスイッチおよび基準電流源を３個
の単位構成回路に分割した場合を示す。被変換アナログ
入力信号が入力端子２０１に加えられ、入力抵抗２０２
〜２０４を介して各ビット電流が流れるが、今各単位構
成回路の基準電流源の電流値を同一とすると、入力抵抗
２０２，２０３，２０４の比を１：１５：２４０となる
ように設定しておくと、各ブロック２３３，２３４，２
３５の基準電流源の電流による入力抵抗での電圧降下は
１：１６：２５６となり、比較器の入力端２３２には各
ビットに対応する電圧が生じ、この電圧が雫ボルトとな
るように比較器出力２０６から電流切替えスイッチに帰
還がかかりＡ−○変換が行われる。以上説明したように
本発明によれば、下位の単位構成回路の電流を抵抗分割
で流すのではなく、入力抵抗を各単位構成回路に対応し
た抵抗値に分割しているため従来のように接地点を通っ
て誤差電流が流れないので、比較器の入力端には各ビッ
トに対応した電圧が生じ、比較器にはＡ−○変換器のビ
ット数に即した分解能のものを用いて、電流切替えスイ
ッチのスピードが早いＡ−Ｄ変換器を実現できる。
第１図は従来のＡ−○変換器の回路図、第２図は本発明
のＡ−Ｄ変換器の構成図である。 ２０１・・・・・・入力端子、２０２〜２０４・・・・
・・入力抵抗、２０５・・・・・・比較器、２０６・・
・・・・比較器出力、２０７〜２１８・・・・・・電流
切替えスイッチ、２１９〜２３０・・・・・・基準電流
源、２３６・・・・・・電源ライン。 第１図 第２図
のＡ−Ｄ変換器の構成図である。 ２０１・・・・・・入力端子、２０２〜２０４・・・・
・・入力抵抗、２０５・・・・・・比較器、２０６・・
・・・・比較器出力、２０７〜２１８・・・・・・電流
切替えスイッチ、２１９〜２３０・・・・・・基準電流
源、２３６・・・・・・電源ライン。 第１図 第２図
Claims (1)
- １ 被変換アナログ入力信号に接続された入力抵抗に電
流を流すｎ個の重み付けされた基準電流源と電流切換え
スイツチを有し、前記入力抵抗での電圧降下が前記被ア
ナログ入力信号電圧と等しくなるよう前記電流切換えス
イツチを制御し変換を行なうｎビツトのアナログ・デイ
ジタル変換器であつて、前記ｎ個の基準電流源と電流切
換えスイツチをｍ個の単位構成回路に分割すると共に、
前記入力抵抗を前記単位構成回路に対応してｍ分割され
たｍ個の直列抵抗体とし、各分割点より対応する前記単
位構成回路に前記基準電流源の電流を流すことにより、
前記入力抵抗での電圧降下を各ビツトに対応した値とす
ることを特徴とするアナログ・デイジタル変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9059979A JPS6017258B2 (ja) | 1979-07-17 | 1979-07-17 | アナログ・ディジタル変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9059979A JPS6017258B2 (ja) | 1979-07-17 | 1979-07-17 | アナログ・ディジタル変換器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5614719A JPS5614719A (en) | 1981-02-13 |
| JPS6017258B2 true JPS6017258B2 (ja) | 1985-05-01 |
Family
ID=14002927
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9059979A Expired JPS6017258B2 (ja) | 1979-07-17 | 1979-07-17 | アナログ・ディジタル変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6017258B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0248050Y2 (ja) * | 1985-07-03 | 1990-12-17 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4542368A (en) * | 1982-02-23 | 1985-09-17 | Burr-Brown Corporation | Trimmable resistive scaling network suitable for digital to analog converters |
-
1979
- 1979-07-17 JP JP9059979A patent/JPS6017258B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0248050Y2 (ja) * | 1985-07-03 | 1990-12-17 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5614719A (en) | 1981-02-13 |
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