JPS60152031A - エツチング方法 - Google Patents
エツチング方法Info
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- JPS60152031A JPS60152031A JP711184A JP711184A JPS60152031A JP S60152031 A JPS60152031 A JP S60152031A JP 711184 A JP711184 A JP 711184A JP 711184 A JP711184 A JP 711184A JP S60152031 A JPS60152031 A JP S60152031A
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-
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、半導体装置の誘電体膜材料に用いられるタン
タル酸化物のエツチング方法に関するものである。
タル酸化物のエツチング方法に関するものである。
近年半導体装置の高集積化に伴い、個々の素子は微細化
の一途をたどっている。そのため高速バイポーラメモリ
セルや、MOSダイナミックメモリにおいては、電荷蓄
積用キャパシタ面積を縮小することが、集積度を向上さ
せるために必要となってきた。その方法として、従来の
キャパシタ用誘電体として用いられてき7cSiOz膜
の代りに比誘電率が5iOz膜の4倍から5倍もあるタ
ンタル酸化物(Ta20s)を用いてキャパシタ部の面
積を縮小させることが試みられている。
の一途をたどっている。そのため高速バイポーラメモリ
セルや、MOSダイナミックメモリにおいては、電荷蓄
積用キャパシタ面積を縮小することが、集積度を向上さ
せるために必要となってきた。その方法として、従来の
キャパシタ用誘電体として用いられてき7cSiOz膜
の代りに比誘電率が5iOz膜の4倍から5倍もあるタ
ンタル酸化物(Ta20s)を用いてキャパシタ部の面
積を縮小させることが試みられている。
このTa20S膜を加工するさい、ウエットエツ −チ
ング法では弗化水素を含む溶液や水酸化ナトリウムを含
むH2O2を用いることが知られている。
ング法では弗化水素を含む溶液や水酸化ナトリウムを含
むH2O2を用いることが知られている。
しかし、前者についてはT a zOs膜のエツチング
速度はたとえばSiOzMのエツチング速度の1/10
00から1/10000程度となシ、Ta205膜と5
if2膜との選択比が得られない。また、後者のエツチ
ング方法ではナトリウム汚染によってトランジスタ、特
にMOSトランジスタの特性が変動する。したがZ)て
ウェットエツチング法はSiデバイスに適用することは
難しい。
速度はたとえばSiOzMのエツチング速度の1/10
00から1/10000程度となシ、Ta205膜と5
if2膜との選択比が得られない。また、後者のエツチ
ング方法ではナトリウム汚染によってトランジスタ、特
にMOSトランジスタの特性が変動する。したがZ)て
ウェットエツチング法はSiデバイスに適用することは
難しい。
そのため、上記ウェットエツチング法による欠点を解決
するためには+lI a 、 Q5膜のドライエツチン
グ技術が必要である。そのさい、Ta205膜はSrウ
ェハ1−、に形成されたデバイス上などに形成されるこ
とが多く、シたがって、TaxOs膜の下地は5ift
やS r 3 N 4などを用いた層間絶縁膜、ゲート
絶縁膜、素子間分離絶縁膜になる。ところで、通常’C
zOs膜が被着される下地にはデバイスなどによる段差
部がちシ、この段差部に付着しているT840gを除去
するためには平坦な下地上に形成されているTa205
がドライエツチングされたのちにも、さらに長時間のオ
ーバエツチング・ が必要となる。したがって、’ra
*osのエツチング工程において、層間絶縁膜やゲート
絶縁膜などが薄くなったり、消滅したりしてLSIの信
頼性が極めて低下してしまうという問題がある。
するためには+lI a 、 Q5膜のドライエツチン
グ技術が必要である。そのさい、Ta205膜はSrウ
ェハ1−、に形成されたデバイス上などに形成されるこ
とが多く、シたがって、TaxOs膜の下地は5ift
やS r 3 N 4などを用いた層間絶縁膜、ゲート
絶縁膜、素子間分離絶縁膜になる。ところで、通常’C
zOs膜が被着される下地にはデバイスなどによる段差
部がちシ、この段差部に付着しているT840gを除去
するためには平坦な下地上に形成されているTa205
がドライエツチングされたのちにも、さらに長時間のオ
ーバエツチング・ が必要となる。したがって、’ra
*osのエツチング工程において、層間絶縁膜やゲート
絶縁膜などが薄くなったり、消滅したりしてLSIの信
頼性が極めて低下してしまうという問題がある。
T 820 gをドライエツチングした報告は極めて少
ないが、純金属のタンタル(Ta)はフレオン系の反応
ガス、例えばCF4 、CF4 +02でエツチングで
きることが知られている。そこでフレオン系の反応ガス
中での放電によりTa2O3をエツチングすることを試
みた。結果を第1表に示す。
ないが、純金属のタンタル(Ta)はフレオン系の反応
ガス、例えばCF4 、CF4 +02でエツチングで
きることが知られている。そこでフレオン系の反応ガス
中での放電によりTa2O3をエツチングすることを試
みた。結果を第1表に示す。
’razosのエツチングに7レオン系の反応ガスを用
いた場合、下地のSi3N*や5i(hに対しては十分
な選択比が得られない。
いた場合、下地のSi3N*や5i(hに対しては十分
な選択比が得られない。
このため、TazOsのドライエツチングに際し、下地
の5isN4や5iftに対してエツチング速匿の選択
比が少なくとも1より大きくなる反応ガスを開発する必
要が生じた。
の5isN4や5iftに対してエツチング速匿の選択
比が少なくとも1より大きくなる反応ガスを開発する必
要が生じた。
本発明の目的は、TaxOsのエツチングに際して、5
iaN4や5i02に対して大きなエツチング速度の選
択比を有したエツチング方法を提供することにある。
iaN4や5i02に対して大きなエツチング速度の選
択比を有したエツチング方法を提供することにある。
上記目的を達成するために、本発明によるエツチング方
法は、三塩化硼素、四塩化炭素ガスのいずれかまたは該
三塩化硼素ガスに32 vot%以下の7レオンガスを
混合したガス、もしくは該四塩化炭素ガスに50 vo
L%以下の酸素ガスを混合したガスを放電させて、Ta
205を加工することを特徴としている。
法は、三塩化硼素、四塩化炭素ガスのいずれかまたは該
三塩化硼素ガスに32 vot%以下の7レオンガスを
混合したガス、もしくは該四塩化炭素ガスに50 vo
L%以下の酸素ガスを混合したガスを放電させて、Ta
205を加工することを特徴としている。
以下本発明の実施例について説明する。
T a z Osをスパッタ蒸着したウェーハを反応性
スパッタエツチング装置内に順次配置し、反応ガスなら
びにエツチング条件を変えながらエツチングした。調べ
た反応ガスは、BCls 、CC11。
スパッタエツチング装置内に順次配置し、反応ガスなら
びにエツチング条件を変えながらエツチングした。調べ
た反応ガスは、BCls 、CC11。
BCts +CF4 、CCl4 +02である。それ
ぞれの反応ガスで、RFパワーとガス圧力を変化させて
、Si3N4ならびに5iChとのエツチング速度の選
択比を測定した。その結果を第2表に示す。
ぞれの反応ガスで、RFパワーとガス圧力を変化させて
、Si3N4ならびに5iChとのエツチング速度の選
択比を測定した。その結果を第2表に示す。
これらの塩素を含んだ反応ガスを用いると、絶縁膜のS
i3N4および5102に対して数倍のエツチング速度
をTa2011について得られ、フレオン系の反応ガス
を用いた場合に比べ、選択比が大幅に改善された。
i3N4および5102に対して数倍のエツチング速度
をTa2011について得られ、フレオン系の反応ガス
を用いた場合に比べ、選択比が大幅に改善された。
次にB CL 3に混合するC F 4の体積−を変化
させて、Ta205.5isN4およびS i 0zf
) エラf 7グ速度の増減を調べた。結果を第1図に
示す。
させて、Ta205.5isN4およびS i 0zf
) エラf 7グ速度の増減を調べた。結果を第1図に
示す。
CF4の混合量が32 VO1%を越すとTa205と
Si3N<および5i(hとのエツチング速度が同程度
となシ、選択性の有るエツチングができないところから
、本発明では容量比を規定するものでおる。
Si3N<および5i(hとのエツチング速度が同程度
となシ、選択性の有るエツチングができないところから
、本発明では容量比を規定するものでおる。
さらにCCl4に混合する020体9%を変化させて、
エツチング速度の増減を調べた。その結果を第2図に示
した。02の混合量が50 vOt%を越すと前記と同
様にT a z O5を選択的にエツチングできなくな
るところから、本発明での容量比を規定するものである
。
エツチング速度の増減を調べた。その結果を第2図に示
した。02の混合量が50 vOt%を越すと前記と同
様にT a z O5を選択的にエツチングできなくな
るところから、本発明での容量比を規定するものである
。
以上説明したように、本発明によれば、三塩化硼素BC
t3、四塩化炭素CCL 4を主成分とした反応ガスを
用いたドライエツチングで、Ta2011をエツチング
する事によシ、フレオン系の反応ガスでは得られなかっ
た選択性が大幅に改善され、実用土十分な特性を得るこ
とができた。
t3、四塩化炭素CCL 4を主成分とした反応ガスを
用いたドライエツチングで、Ta2011をエツチング
する事によシ、フレオン系の反応ガスでは得られなかっ
た選択性が大幅に改善され、実用土十分な特性を得るこ
とができた。
以上の説明では、反応性スパッタエツチングの場合につ
いて述べたが、プラズマエツチング、マイクロ波エツチ
ングの場合でも同傾向の効果を得ている。
いて述べたが、プラズマエツチング、マイクロ波エツチ
ングの場合でも同傾向の効果を得ている。
またBCl2 、 CC44の代りにP CZ 3 +
S t CZ 4、およびC12等塩素を主成分とす
る反応ガスを用いて’ra、o、をエツチングしても同
様の効果が期待できる。
S t CZ 4、およびC12等塩素を主成分とす
る反応ガスを用いて’ra、o、をエツチングしても同
様の効果が期待できる。
第1図はB CL aにCF4を混合した際のエツチン
グ速度の増減を示すグラフ、第2図はCCl4に02を
混合した際のエツチング速度の増減を示す′fEr 図 1) aCCノミヘfl Ch 混合量 (Vo1gE第 Z
図
グ速度の増減を示すグラフ、第2図はCCl4に02を
混合した際のエツチング速度の増減を示す′fEr 図 1) aCCノミヘfl Ch 混合量 (Vo1gE第 Z
図
Claims (1)
- 【特許請求の範囲】 1、ドライエツチング装置を用いて、タンタル酸化物を
エツチングするに際し、三塩化硼素もしくは四塩化炭素
を含むガス中での放電にょシ加工することを特徴とした
エツチング方法。 2、前記三塩化硼素に、32 voz%以下のフレオン
を混合したガス中での放電にょp加工することを特徴と
する特許請求の範囲第1項記載のエツチング方法。 3、前記四塩化炭素ガスに、50vOA%以下の酸素を
混合したガス中での放電に上り加工することを特徴とす
る特許請求の範囲第1項記載のエツチング方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP711184A JPS60152031A (ja) | 1984-01-20 | 1984-01-20 | エツチング方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP711184A JPS60152031A (ja) | 1984-01-20 | 1984-01-20 | エツチング方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60152031A true JPS60152031A (ja) | 1985-08-10 |
Family
ID=11656973
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP711184A Pending JPS60152031A (ja) | 1984-01-20 | 1984-01-20 | エツチング方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60152031A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01183125A (ja) * | 1988-01-18 | 1989-07-20 | Matsushita Electric Ind Co Ltd | ドライエッチング方法 |
GB2337361A (en) * | 1998-05-06 | 1999-11-17 | United Microelectronics Corp | A method of etching a tantalum oxide layer in the fabrication of a DRAM |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54158343A (en) * | 1978-06-05 | 1979-12-14 | Hitachi Ltd | Dry etching method for al and al alloy |
JPS596541A (ja) * | 1982-07-02 | 1984-01-13 | Nec Corp | 微細パタ−ン形成方法 |
-
1984
- 1984-01-20 JP JP711184A patent/JPS60152031A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54158343A (en) * | 1978-06-05 | 1979-12-14 | Hitachi Ltd | Dry etching method for al and al alloy |
JPS596541A (ja) * | 1982-07-02 | 1984-01-13 | Nec Corp | 微細パタ−ン形成方法 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01183125A (ja) * | 1988-01-18 | 1989-07-20 | Matsushita Electric Ind Co Ltd | ドライエッチング方法 |
GB2337361A (en) * | 1998-05-06 | 1999-11-17 | United Microelectronics Corp | A method of etching a tantalum oxide layer in the fabrication of a DRAM |
GB2337361B (en) * | 1998-05-06 | 2000-03-29 | United Microelectronics Corp | Method of etching tantalum oxide layer |
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