JPS6012869A - Ｃａｔｖコンバ−タ - Google Patents
Ｃａｔｖコンバ−タInfo
- Publication number
- JPS6012869A JPS6012869A JP12037683A JP12037683A JPS6012869A JP S6012869 A JPS6012869 A JP S6012869A JP 12037683 A JP12037683 A JP 12037683A JP 12037683 A JP12037683 A JP 12037683A JP S6012869 A JPS6012869 A JP S6012869A
- Authority
- JP
- Japan
- Prior art keywords
- section
- prescaler
- cal
- cull
- converter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/10—Adaptations for transmission by electrical cable
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、ワンタッチによる選局を可能にするだめのマ
イコン制御によるＰ Ｌ Ｌ （ＰｈａｓｅＬｏｃｋｅ
ｄ Ｌｏｏｐ ）を備えたＣＡＴＶコンバータに関する
ものである。
イコン制御によるＰ Ｌ Ｌ （ＰｈａｓｅＬｏｃｋｅ
ｄ Ｌｏｏｐ ）を備えたＣＡＴＶコンバータに関する
ものである。
周知のようにＣＡＴＶコンバータは、アップダウンコン
バータであり、入力信号を第１０−カルによって、周波
数の高い中間周波数に変換し、さらに第２０−カルによ
って、周波数の低い出力周波数に変換するだめのもので
ある。また、最近は入力信号のチャンネル制御に、第１
０−カル部にＰＬＬをかけマイコンと組み合わせて選局
精度の向上および操作性の改善（ワンタッチ選局）が図
られている。図面にて説明すれば次の通りである。
バータであり、入力信号を第１０−カルによって、周波
数の高い中間周波数に変換し、さらに第２０−カルによ
って、周波数の低い出力周波数に変換するだめのもので
ある。また、最近は入力信号のチャンネル制御に、第１
０−カル部にＰＬＬをかけマイコンと組み合わせて選局
精度の向上および操作性の改善（ワンタッチ選局）が図
られている。図面にて説明すれば次の通りである。
第１図はＣＡＴＶコンバータの回路構成を示すブロック
図である。第１図において、入力信号は入力端子１より
入力され、帯域通過フィルタ（ＢＰＦ）２を通り、第１
ミキサ部６に入る。
図である。第１図において、入力信号は入力端子１より
入力され、帯域通過フィルタ（ＢＰＦ）２を通り、第１
ミキサ部６に入る。
第１ミキサ部６には第１０−カル発振部４の信号をさら
に第１０−カル増幅部５によって増幅されたローカル信
号が注入される。６は第１ ＩＰ”アンプ部であり、７
は第２ミキサ部、８は第２０−カル部である。９は第２
０−カル部８によって得られた出力信号の出力端子であ
るｎしかしながら、ＰＬＬ機能を付加するためには、Ｐ
ＬＬの構成要素の一つであるプログラマブルカウンタが
分周可能であるような周波数にまで、取扱うべき高周波
信号を予め分周して落してやるだめのプリスケーラ部１
０が必要になってくる。第２図（ロ）で示すようにプリ
スケーラ部１０はおもにプリスケーラ用Ｉ Ｃ１１と第
１０−カルアンプ用のトランジスタ１２で構成されてお
り、従来は第２図（ロ）で示すようにグリスケーラ部１
０を、第２図（イ）に示したチューナのシャーシから独
立させ、プリスケーラ−ブロックとして構成していた。
に第１０−カル増幅部５によって増幅されたローカル信
号が注入される。６は第１ ＩＰ”アンプ部であり、７
は第２ミキサ部、８は第２０−カル部である。９は第２
０−カル部８によって得られた出力信号の出力端子であ
るｎしかしながら、ＰＬＬ機能を付加するためには、Ｐ
ＬＬの構成要素の一つであるプログラマブルカウンタが
分周可能であるような周波数にまで、取扱うべき高周波
信号を予め分周して落してやるだめのプリスケーラ部１
０が必要になってくる。第２図（ロ）で示すようにプリ
スケーラ部１０はおもにプリスケーラ用Ｉ Ｃ１１と第
１０−カルアンプ用のトランジスタ１２で構成されてお
り、従来は第２図（ロ）で示すようにグリスケーラ部１
０を、第２図（イ）に示したチューナのシャーシから独
立させ、プリスケーラ−ブロックとして構成していた。
そのために、第１０−カル部の出力信号の出力端子１６
およびプリスケーラ部１０の入力端子１４がそれぞれ必
要となり、プリスケーラ出力信号を端子１５よυ出力し
ていた。
およびプリスケーラ部１０の入力端子１４がそれぞれ必
要となり、プリスケーラ出力信号を端子１５よυ出力し
ていた。
なお、第２図において、１６〜２０は十Ｂ電源供給用の
貫通コンデンサである。
貫通コンデンサである。
したがって、ＰＬＬ機能を付加するためにはプリスク゛
−ラブロックを余計に追加しなければならず、大幅なコ
スト高になるという欠点があった。
−ラブロックを余計に追加しなければならず、大幅なコ
スト高になるという欠点があった。
なお、第２図において、２１は第１０−カル発振用トラ
ンジスタ、２５は第１０−カル増幅用トランジスタであ
る。そして結合綜２４によって、第１０−カル発振部４
と第１０−カル増幅部５とが接続されている。
ンジスタ、２５は第１０−カル増幅用トランジスタであ
る。そして結合綜２４によって、第１０−カル発振部４
と第１０−カル増幅部５とが接続されている。
本発明は、上述のような従来技術における欠点を除去す
るためになされたものであり、従って本発明の目的は、
コスト高を招くことな１−１にプリスケーラ部を備えた
Ｃ Ａ Ｔ Ｖコンバータを提供することにある。
るためになされたものであり、従って本発明の目的は、
コスト高を招くことな１−１にプリスケーラ部を備えた
Ｃ Ａ Ｔ Ｖコンバータを提供することにある。
上記目的を達成するため、本発明においてはプリスケー
ラ部を同一シャーシ内で第１０−カル発振部および第１
０−カル増幅部に対向する如き配置にし、プリスケーラ
部を配置するスペースを確保し、プリスケーラの入力と
して、第１０−カル増幅部に電磁的結合をしたピックア
ップコイルを設は必要なローカル信号を得るようにした
。
ラ部を同一シャーシ内で第１０−カル発振部および第１
０−カル増幅部に対向する如き配置にし、プリスケーラ
部を配置するスペースを確保し、プリスケーラの入力と
して、第１０−カル増幅部に電磁的結合をしたピックア
ップコイルを設は必要なローカル信号を得るようにした
。
次に図を参照して本発明の一実施例を説明する、第６図
（イ）は本発明の一実施例の要部を示す表面図、第６図
（ロ）は四次面図、第４図は第６図（イ）、（ロ）にお
ける（ Ａ −１３）断面図である。これらの図におい
て、第２図におけるのと同等部分は同一記号によって示
す。
（イ）は本発明の一実施例の要部を示す表面図、第６図
（ロ）は四次面図、第４図は第６図（イ）、（ロ）にお
ける（ Ａ −１３）断面図である。これらの図におい
て、第２図におけるのと同等部分は同一記号によって示
す。
さて、第６図において、４は第１０−カル発振部、５は
第１０−カル増幅部である。１０はプリスケーラ部であ
る。２３はプリスケーラ部１０のローカル周波数ピック
アップコイルであり、第４図の断面図に示すように、第
１０−カル増幅部５と電磁結合するように設定しておく
。
第１０−カル増幅部である。１０はプリスケーラ部であ
る。２３はプリスケーラ部１０のローカル周波数ピック
アップコイルであり、第４図の断面図に示すように、第
１０−カル増幅部５と電磁結合するように設定しておく
。
また、プリスケーラ部１０は第１０−カル発振部４およ
び第１０−カル増幅部５と対向するように設定しておく
。
び第１０−カル増幅部５と対向するように設定しておく
。
従って、プリスケーラ部１０がチューナの同一シャーシ
内に取り入れられることから、コンバータ自体を小形化
できる１、 しかも、プリスケーラ入力の信号を従来のように第２図
で示すようなフォノジャック１３．１４を介さず、直接
、第１０−カル増幅部５より電磁結合により取り出すた
め、所要の部品点数が大幅に削除でき、大幅な原価低減
ができる。
内に取り入れられることから、コンバータ自体を小形化
できる１、 しかも、プリスケーラ入力の信号を従来のように第２図
で示すようなフォノジャック１３．１４を介さず、直接
、第１０−カル増幅部５より電磁結合により取り出すた
め、所要の部品点数が大幅に削除でき、大幅な原価低減
ができる。
上述したように、本発明によればプリスケーラ部をチュ
ーナ内部に内蔵でき、ＣＡＴＶコンバータの小形化およ
び大幅な原価低減ができ実用的効果は極めて優れている
。
ーナ内部に内蔵でき、ＣＡＴＶコンバータの小形化およ
び大幅な原価低減ができ実用的効果は極めて優れている
。
第１図は一般的なＣＡＴＶコンバータの回路構成金示す
ブロック図、第２図（イ）はシャーシの表面を示した概
吸図、第２図（ロ）はグリスケーラブロックの正面図、
第３図（イ）は本発明の一実施例の要部を示す表面図、
第６図（ロ）は同裏面図、第４図は第６図（イ）、（ロ
）における（Ａ−Ｂ）断面図、である。 符号の説明 ４・・・第１０−カル発振部 ５・・第１０−カル増幅部 １０・・・プリスケーラ部 ２６・・・プリスケーラ部の入力信号ピックアップ用コ
イル １１・・・プリスケーラＩＣ ■１ 図 （イ） （ロ） 第３図 第４７
ブロック図、第２図（イ）はシャーシの表面を示した概
吸図、第２図（ロ）はグリスケーラブロックの正面図、
第３図（イ）は本発明の一実施例の要部を示す表面図、
第６図（ロ）は同裏面図、第４図は第６図（イ）、（ロ
）における（Ａ−Ｂ）断面図、である。 符号の説明 ４・・・第１０−カル発振部 ５・・第１０−カル増幅部 １０・・・プリスケーラ部 ２６・・・プリスケーラ部の入力信号ピックアップ用コ
イル １１・・・プリスケーラＩＣ ■１ 図 （イ） （ロ） 第３図 第４７
Claims (1)
- 【特許請求の範囲】 １）第１０−カル発振部、第１０−カル増幅部およびプ
リスケーラ部を少なくも備えたＣＡＴＶコンバータにお
いて、前記プリスケーラ部の基板を同一シャーシ内にお
いて前記第１０−カル発振部および第１０−カル増幅部
と対向させて配置したことを特徴とするＣＡＴＶコンバ
ータ。 ２、特許請求の範囲第１項に記載のＣＡＴＶコンバータ
において、前記プリスケーラ部の入力となるローカル周
波数を前記第１０−カル増幅部に電磁結合したピックア
ップコイルから得るようにしたことを特徴とするＣＡＴ
Ｖコンパτり。 ３）特許請求の範囲第１項または第２項に記載のＣＡＴ
Ｖコンバータにおいて、前記第１０−カル発振部をシャ
ーシ内のシールド板上にて立体布線により構成し、前記
第１０−カル増幅部をプリント基板構造にしたことを特
徴とするＣＡＴＶコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12037683A JPS6012869A (ja) | 1983-07-04 | 1983-07-04 | Ｃａｔｖコンバ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12037683A JPS6012869A (ja) | 1983-07-04 | 1983-07-04 | Ｃａｔｖコンバ−タ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6012869A true JPS6012869A (ja) | 1985-01-23 |
Family
ID=14784674
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12037683A Pending JPS6012869A (ja) | 1983-07-04 | 1983-07-04 | Ｃａｔｖコンバ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6012869A (ja) |
-
1983
- 1983-07-04 JP JP12037683A patent/JPS6012869A/ja active Pending
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