JPS60112445A - タイミングパルス発生装置 - Google Patents

タイミングパルス発生装置

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JPS60112445A
JPS60112445A JP59188984A JP18898484A JPS60112445A JP S60112445 A JPS60112445 A JP S60112445A JP 59188984 A JP59188984 A JP 59188984A JP 18898484 A JP18898484 A JP 18898484A JP S60112445 A JPS60112445 A JP S60112445A
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JP
Japan
Prior art keywords
address
pulse generator
timing pulse
data bus
speed data
Prior art date
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Pending
Application number
JP59188984A
Other languages
English (en)
Inventor
フアルク、ブツシユマン
カルル―ハインツ、フエルスター
フオルカー、アイヒラー
ハルトムート、ハイバー
フオルクマー、デイツトリヒ
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Polygraph Leipzig Kombinat Veb
Original Assignee
Polygraph Leipzig Kombinat Veb
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Publication date
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Publication of JPS60112445A publication Critical patent/JPS60112445A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00Programme-control systems
    • G05B19/02Programme-control systems electric
    • G05B19/04Programme control other than numerical control, i.e. in sequence controllers or logic controllers
    • G05B19/045Programme control other than numerical control, i.e. in sequence controllers or logic controllers using logic state machines, consisting only of a memory or a programmable logic device containing the logic for the controlled machine and in which the state of its outputs is dependent on the state of its inputs or part of its own output states, e.g. binary decision controllers, finite state controllers
    • BPERFORMING OPERATIONS; TRANSPORTING
    • B41PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
    • B41FPRINTING MACHINES OR PRESSES
    • B41F33/00Indicating, counting, warning, control or safety devices
    • B41F33/0009Central control units

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Automation & Control Theory (AREA)
  • Ink Jet (AREA)
  • Inking, Control Or Cleaning Of Printing Machines (AREA)
  • Control Of Electric Motors In General (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は印刷機用のタイミングパルス発生装置に関する
〔従来技術〕
印刷機用のタイミングパルス発生装置であって、回転角
増分発生装置と少なくとも1つの単一同期パルス発生装
置とを包含するパルス発生製電と、パルス処理装置とを
備え、このパルス処理装置は、アドレスプリセット装置
に接続され/こ少なくとも1つのアドレス計数装置を備
えた回転角/回転数アドレス発生装置と、回転数データ
バヌ瞥7ヒは回転数データバスと少なくとも1つのアド
レス変換装置とを介してアドレスプリセット装置に接続
された回転数計数装置と、アドレス発生装置ごとに後に
接続され、FROMとして構成された記憶装置とを包含
する形式のものが既に提案されている。
このタイミングパルス発生装置によって、サーボユニッ
トの正の不動時間△ψ=J−)の補償が可能になる。そ
の場合、正の不動時間補償とは、低速度においてはサー
ボユとットが時間的遅延制御を行なうが、高速度におい
てはサーボユニットが時間的先行制御を行なうことを重
味している。
例えば印刷機における不動時間のある測定装置の信号を
処理するのに必要な負の不動時間Δψ=f(−ω)の補
償は不可能である。
〔発明の目的〕
本発明の目的は、印刷機のタイミングパルス発生装置に
おける不動時間補償を完全にするととである。さらに本
発明の目的は、正および負の不動時間補償性能を有する
印刷機用タイミングパルス発生装置を提供することにあ
る。
〔発明の概要〕
この目的は、本発明によれば、回転角増分発生装置と少
なくとも1つの牟−同期パルス発生装置とを包含するパ
ルス発生装置と、パルス処理装置とを備え、このパルス
処理装置は、アドレスプリセット装置に接続された少な
くとも1つのアドレス計数装置を備えた回転角/回転数
アドレス発生装置と、回転数データバスまたは回転数デ
ータバスと少なくとも1つのアドレス変換装置とを介し
てアドレスプリセット装置に接続された回転数計数装置
と、アドレス発生装置ごとに後に接続されFROMとし
て構成された記憶装置とを包含する形式の印刷機用のタ
イ建ングパルス装置において、少なくとも1つのアドレ
スプリセット装置の前に、(3) 入力側および出力側が回転数データバスと接続された変
換装置を接続することによって達成される。
変換装置は、回転数データバスの第1補数を形成する否
定素子、または回転数データバスの第2補数を形成しF
ROMとして構成された記憶装置を包含する相補装置を
備えている。
〔実施例〕
次に、本発明を実施例について一層詳細に説明する。
タイミングパルス発生装置は、回転角度増分発生装置2
と拳−同期パルス発生装aaとを備えたパルス発生装置
lを備えている。
さらに、このタイミングパルス発生装置は、回転角度/
回転数アドレス発生装置8とFROMとして構成された
少なくとも1つの記憶装置16とを備えたパルス処理装
fjjt6を備えている。
回転角度/回転数アドレス発生装置8は、回転数計数装
置加と、アドレスプリセット装#18を装備した少なく
とも1つのアドレス計数装置17とを備えている。
(4) アドレス変換装置18は、直接、回転数データバス13
を介し、または図示されていない少なくとも1つのアド
レス変換装置を介し、回転数計数装置加の出力端子に接
続されている。
本発明に従い、少なくとも1つのアドレスプリセット装
置18の前に、回転数データバス13と入力側および出
力側において接続された変換装置四が設けられている。
変換装置22は、回転数データバス13の各ビットに対
して、第1補数を形成する否定素子23または回転数デ
ータバス13の第2補数を形成しFROMとして構成さ
れた記憶装置を包含する相補装置鴎を備えている。
このタイミングパルス発生装置の動作を次に説明する。
パルス発生装@、lを通しての巣−同期パルスψ。
またはψ畠によるアドレス計数装置17のクリアの後、
回転角増分ψ、がアドレス計数装置17に供給される。
この回転角度増分は、続いてアドレス計数装置17に加
えられ、その結果は、後に接続されFROMとして構成
された1憶装置16に伝送するため、二進符号に符号化
されてアドレス計数装置17の出力端子に得られる。F
ROMに記憶されたビットサンプルに基づいて、次には
、記憶装置16の出力端子に一定のパルス系列が伝達さ
れる。同時に、回転数計数装置かには、速度に依存した
回転角増分が2進形式で準備され、これは回転数データ
バス13を通してプリセット装置18に供給される。ア
ドレス計数装置17の速度に依存したプリセットによっ
て、計数装置の計数が代数的に正の方向に作用し、記憶
されたパルス系列の速度に依存した変位△ψ=f←)が
生じる。
印祠機において例えば不動時間のある測定装置の信号を
処理するのに必要であるように、記憶されたパルス系列
を代数的に負の方向に作用させるため、アドレスプリセ
ット装置18に供給された信号は、変換装置nによって
2進符号に変換される。
変換は、2進符号で出されている信号(数)の第1補数
または第2補数の形成によって行なわれる。
数Xの補数Xは、負の数の処理に使用される。
その場合、1つの数の第1補数は、その数のすべての小
数位の反転によって形成され、次のように数式で表わさ
れる。
X=十X十に、 たソしX(O K1 ・・・・・・・・・ 第1補数を形成するための
補数 に、は次のように定義される。
K、=2−t N・・・回転数アドレスデータバスのワード幅1つの数
の第2補数は、その数のすべての2進位の反転および最
低の桁値に1を加えることによって形成され、次のよう
に数式で表わされる。
x=−4−x−14! ただしX(O K、・・・・・・・・・ 第2補数を形成するための補
数 に8は次のように定義される。
K、=2N アドレスプリセット装fii18およびアドレス割数装
置17におhて、変換されて2進符号で出されて(7) いる負の信号が処理され、それぞれの記憶袋#16に供
給される。これによって、配憶装置16の出力端子に、
次のパルス系列が出される。
ψ、=f(ψ、ニーω)
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック結線図、第2
図は第1図に示す本発明装置を構成する変換装置の内部
構成を示すブロック結線図、第3図は第2図に示す変換
装置の別の実施例を示すブロック結線図である。 l・・・パルス発生装置、2・・・回転角増分発生装置
、3・・・単一同期パルス発生装置、6・・・パルス処
理装置、8・・・回転角/回転数アドレス発生装置、1
3・・・回転数データバス、16・・・記憶装置、17
・・・アドレス計数装置、18・・・アドレスプリセッ
ト装置、加・・・回転数計数装置、ρ・・・変換装置、
久・・・否定素子、U・・・相補装置。 出願人代理人 猪 股 清 (9)−747− (8) 第1頁の続き o発 明 者 カルルーハインツ、フ ドエルスター 
ト 0発 明 者 フォルカー、アイヒラ ドーシ @発明者 ハルトムード、ノ1イバ ドーラ 0発 明 者 フオルクマー、ディン ドトリヒ シ イツ民主共和国8020、ドレスデン、スピッツベーグ
シュラーセ、70 イツ民主共和国8256、バインベーラ、バルトショイ
ゲルユトラーセ、52 イツ民主共和国8122 ラーデポイル、エミールーシ
ューーーシュトラーセ、9 イツ民主共和国8270、コスビヒ、ハンスーバイムラ
ーーユトラーセ、9

Claims (1)

  1. 【特許請求の範囲】 1)印刷機用のタイミングパルス発生装置であって、回
    転角増分発生装置と少なくとも1つの単一同期パルス発
    生装置とを包含するパルス発生装置と、パルス処理装置
    とを備え、このパルス処理装置は、アドレスプリセット
    装置に接続された少なくとも1つのアドレス計数装置を
    備えた回転角/回転数アドレス発生装置と、回転数デー
    タバスまたは回転数データバスと少なくとも1つのアド
    レス変換装置とを介してアドレスプリセット装置に接続
    された回転数計数装置と、アドレス発生装置ごとに後に
    接続されFROMとして構成された記憶装置とを包含す
    る形式のタイミングパルス発生装置において、 少なくとも1つのアドレスプリセット装置α8)の前に
    、入力側および出力側が前記回転数データバス(13)
    と接続された変換装置(22)が接続されていることを
    特徴とするタイミングパルス発生装置。 2)変換装置P2′2)は、回転数データバス(13)
    の第1補数を形成する否定累子力)を包含していること
    を特徴とする特許請求の範囲第1項記載のタイミングパ
    ルス発生装置。 3)変換装置Q2)は、回転数データバスC13)の第
    2補数を形成し、FROMとして構成された記憶装置を
    備えた相補装置f2A)を包含していることを特徴とす
    る特許請求の範囲第1項記載のタイミングパルス発生装
    置。
JP59188984A 1983-11-24 1984-09-11 タイミングパルス発生装置 Pending JPS60112445A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
DD41F/257061.1 1983-11-24
DD25706183 1983-11-24

Publications (1)

Publication Number Publication Date
JPS60112445A true JPS60112445A (ja) 1985-06-18

Family

ID=5552212

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59188984A Pending JPS60112445A (ja) 1983-11-24 1984-09-11 タイミングパルス発生装置

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US (1) US4653077A (ja)
JP (1) JPS60112445A (ja)

Cited By (1)

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JPH056603U (ja) * 1991-07-09 1993-01-29 アルパイン株式会社 押釦装置

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Publication number Publication date
US4653077A (en) 1987-03-24

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