JPS5999505A - 電子ミシンの制御装置 - Google Patents

電子ミシンの制御装置

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JPS5999505A
JPS5999505A JP57208783A JP20878382A JPS5999505A JP S5999505 A JPS5999505 A JP S5999505A JP 57208783 A JP57208783 A JP 57208783A JP 20878382 A JP20878382 A JP 20878382A JP S5999505 A JPS5999505 A JP S5999505A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、半導体記憶素子に書込ｔｈた模様データを
順次読出して所定の模様を縫製する電子ミシンにおいて
その制御装置に関する。
従来のこの種の装置として第１図に示すものがあった。
図において（１）は例えば８ビツトのマイクロコンピュ
ータ、（２）は模様データが書込まれている半導体記憶
素子、（３）は１６ビツトで構成され半導体記憶素子（
２）のデータ記憚場所を特定するためのアドレス線であ
る。尚、半導体記憶素子（２）ハ、他の模様データが書
込まれた他の素子と取替え可能な様に構成されている。
（４）は８ビツトで構成され上記アドレス線（３）で特
定された番地に記憶されているデータをマイクロコンピ
ュータ（１）に出力するためのデータ線、（５）は半導
体記憶素子（２）が必要とする制御信号をマイクロコン
ピュータ（１）より入力するための制御信号線であるア 次に動作について説明する。マイクロコンピュータ（１
）がデータを読取るサイクルの時、Ｃｏ−Ｃ３で示され
る制御信号線（５）には半導体記憶素子（２）のデータ
を読取るために必要な信号がマイクロコンピュータ（１
）より与えられており、千心体記憶素子（２）はデータ
線（４）Ｋデータを送出する準備をしている。この時、
ＡＯ〜ＡＩ５で示される１６ビツトのアドレス線（３）
ハ最初ｏｏｏｏ　　ｏｏｏｏ　　ｏｏｏｏ　　ｏｏ。
Ｏとなって半導体記憶素子（２）の先頭番地がマドレス
され、この番地に記憶されているデータが＝Ｄ。
〜Ｄ７　で示されるデータ線（４）に出力され、マイク
ロコンピュータ（１）によって読取られる。以下、アド
レス線（３）に順次アドレス信号が出力され、このアド
レス信号でアドレスされた番地に記憶されているデータ
が半導体素子（２）からＤＯ〜Ｄ７のデータ線（４）を
介して出力されマイクロコンピュータ（１）に読取られ
る。
この様にして、半導体記憶素子（２）に記憶されていた
例えば縫製のための模様データをマイクロコンピュータ
（１）が読取ると、このマイクロコンピュータ（１）は
読取ったデータに基いて電子ミシンの各部を制御し所定
の模様の縫製を行わせる。データが書込まれた半導体記
憶素子（２）は取替え可能な構造とな−ていて、異−た
模様データの縫製を合うにはそのデータを記憶した半導
体記憶素子を選択すればよい。
従来の電子ミシンの制御装置は以上の様に構成されてい
て、挿々の模様データに半導体記憶素子の取替えのみで
対応し得るようになっている。しかしながら、現在半導
体記憶素子には多くの種類があり、今後とも記憶容量の
大へなものや価格の安いものが開発されるすう勢にある
にもがかわらず、上述した従来の制御装置では現在入手
できる１種類の半導体記憶素子しか利用することができ
ない欠点があり、装置の汎用性に欠ける面がある。
この発明は、上記のような従来装置の欠点を除去するた
めになされたもので、模様データを記憶している半導体
記憶素子の所定の番地にこの素子の種類を判別するキー
ワードを記憶すせておＡ、模様データを読取る前にこの
キーワードヲ読取りて素子の種類を判別し、この種類の
素子に適した論理接続を行い記憶さ−れているデータを
マイクロコンピュータに依って読取るように構成する事
により、異なる種類の半導体記憶素子にも適用可能な電
子ミシンの制御装置を提供中るものである。
以下にこの発明の一実施例を、図について説明する。第
２（￥１はこの発明一実施例装置の構成を示すブロック
図である。図において、’ＡＮ　１図と同一の符号は同
−又は相当部分を示し同様の動作をするので重複した説
明に省略する。ｅｕｉ半導体記憶素子（２）の種類に応
じてアドレス信号、データ信号及び制御信号の接続替え
を行う論理回路、＠は論理回路Ｑ］）の接続替えを行う
ための切替信号線、（３Ａ）　（４Ａ）及び（５Ａ）は
論理回路（２］）によって接続替えを行われた後のアド
レス線、データ線及び制御信号線を示す。
次に動作について説明する。半導体記憶素子（２）には
、その先頭番地に種別を判定するためのキーワードが記
憶されている。今、第１の種類の記憶素子にばＡＡＳ第
２の種類の記憶素子にはＢＢというキーワードが記憶さ
れているものとする。この装置において、まずマイクロ
コンピュータ（１）　ｉｄ端子ＢＯおよびＢ１に第１の
種類の半導体記憶素子（２）をマドレスするための切替
信号を出力し、論理回路Ｑ］）に与える。論坤回１路（
２］）は切替信号に従ってアドレス線（３）、データ線
（４）および制御信号線（５）を接続替えし、各線を第
１枇類の半導体記憶素子（２）を正しくアドレスする、
切替えられたアドレス線（３Ａ）、データ線（４Ａ’）
：に−よび制卸信号線（５Ａ）ＶＣ父換する。次にマイ
クロコンピュータ（１）かラバ先頭アドレスｏｏｏｏ　
ｏｏｏｏ　ｏｏｏｏ　ｏｏｏｏ　番地をアドレスするた
めの信号が出力さね、アドレス線（３）（８Ａ）を介し
半導体記憶素子（２）に与えられる。
この時半導体記憶素子（２）からＤＯ〜Ｄ７で示される
データ線（４Ａ）（４）を介してキーワードＡＡが出力
されると、マイクロコンピュータ（１）は素子（２ンが
第１の種類の記憶素子であることを認識しそのｔ′ま引
続いて素子（２）から模様データを読出すう一方、素子
（２）に第２の種類の記憶素子がセットされている場合
では、マイクロコンピュータ（１）からアドレス線（３
）（３Ａ）を介して素子（２）に先頭番地をマドレスす
る信号が出力されても、データ線Ｄｏ　−Ｂ７にはキー
ワードＡＡが出力されることも寸たキーワードＢＥが出
力されることもない。なぜなら、論理回路シ１）は令弟
１の種類の記憶素子をアドレスするための接続となって
おり、第２の種類の記憶素子を正しくアドレスで衣ない
からである。そのためこの時マイクロコンピュータ（１
）Ｈ１端子ＢＯおよびＢ１に第２の種類の半導体記憶素
子をアドレスするための信号を出力し、切替信号線＠を
介して論理回路（２］）に入力する。論理回路＆］）は
、この切替信号に従って各線（３）（４）および（５）
を接続替えし、素子（２）を正しくアドレスする接続線
（３Ａ）　（４Ａ）およヒ（５Ａ）とする、この後マイ
クロコンピュータ（１）より先頭番地をアドレスする信
号と必要々師御信号が接続線（３）（３Ａ）及び（５）
（５Ａ）を介して出力され素子（２）に与えられると、
素子（２）のＤＯ〜Ｄ７で示される出力端子にキーワー
ドＢＢが出力され、データＴｆＡ　（４Ａ　）　（４）
を介してマイクロコンピュータ（１）に送うれる。マイ
クロコンピュータ（１）はこの信号に依って素子（２）
が第２の種類の素子であることを認識し、次々にアドレ
ス信号を送出してデータの読取を行う。
以上のようにこの発明の制御装置では、データが記憶さ
れている半導体「２憶累子がどの様々種類の素子である
かを自動的に判別し、そｈに合った接続を構成すること
ができるため、データ記憶用の素子として現在市販され
ているいずれの半導体記・慮累子をも使用することがで
六る。
また将来開発され得る素子にも適用でへるため極めて汎
用性に富んだ装置である。尚、切替用の論理回路は簡単
なゲートエＣによって構成することができるので、この
装置自体安価で信頼性が高い。
【図面の簡単な説明】
第１因はこ０キ明従来装置の回路構成を示すブー、・り
図、第２図にこの会明゛シー芙施例の■」賂ｒ７Δ成を
示すブロック図である。 図において、同一符号は同−又は不目当部分を示し、（
１）はにマイクロコンピュータ、（２）は半導体記憶素
子、（３）はアドレス線、（４）はデータ線、（５）は
制御信号線、＜ｇｌ）は論理回路（切替回路）である。 代準人　葛　野　信　− 第１図 獣 第２図 手続補正舎（自発） 事件の表示　　　　特願昭５７−２ρ、５７．５３号補
正をする者 ５　補正の対象 明細書の発明の詳ＭＩｆｒ　説明の欄 ６、補正の内容 明細書中温６頁第７行に１第１」とあるのを、「第１の
１と訂正するう 以上

Claims (3)

    【特許請求の範囲】
  1. （１）縫目模様データが書込まわ、た半導体記憶素子と
    、この半導体記憶素子からデータを読出し所定の縫製を
    行うように電子ミシンを制御するマイクロコンピュータ
    とを備えた電子ミシンの制御装置において、上記半導体
    記憶素子からデータを読取るための上記マイクロコンピ
    ュータの接続線を上記半導体記憶素子の種類に応じて切
    替える切替回路を設けたことを特徴とする電子ミシンの
    制御装置。
  2. （２）切替回路によって切替えらねるマイクロコンピュ
    ータ接続線は、アトＶヌを指定するためのアドレス線、
    半導体記憶素子からデータを送出するためのデータ線、
    データ読取のために上記半導体記憶素子に必要な制御信
    号を送出するための制御信号線であることを特徴とする
    特許請求の範囲第１項記載の電子ミシンの制御装置。
  3. （３）切替回路はゲートエＣで構成される論即回烙であ
    ることを特徴とする特許請求の範囲第１項記載の電子ミ
    シンの制御装置。
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JPH0420201B2 JPH0420201B2 (ja) 1992-04-02

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DE (1) DE3343142A1 (ja)
GB (1) GB2133581B (ja)

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