JPS5974634A - パタ−ン形成方法 - Google Patents

パタ−ン形成方法

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JPS5974634A
JPS5974634A JP18580482A JP18580482A JPS5974634A JP S5974634 A JPS5974634 A JP S5974634A JP 18580482 A JP18580482 A JP 18580482A JP 18580482 A JP18580482 A JP 18580482A JP S5974634 A JPS5974634 A JP S5974634A
Authority
JP
Japan
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resist
pattern
film
thin
thin film
Prior art date
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Pending
Application number
JP18580482A
Other languages
English (en)
Inventor
Noriyoshi Takase
高瀬 則義
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP18580482A priority Critical patent/JPS5974634A/ja
Publication of JPS5974634A publication Critical patent/JPS5974634A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting

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  • Photosensitive Polymer And Photoresist Processing (AREA)
  • Drying Of Semiconductors (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、半導体基板上に施された膜又は半導体基板
などパターン被形成部材の、パターン形成方法に関する
この種のパターン被形成部材として、半導体基板上に施
された薄膜に微細パターンを形成する場合について説明
する。
従来のパターン形成方法は、第1図(A)〜(D)に基
板の薄膜のパターン形成を工程順に示す要部断面図のよ
うにしていた。まず、(A)図のように、半導体基板(
1)の上面に形成されである薄膜(2)上にポジ形レジ
スト(3)を均一に塗布し、紫外線(4)を選択的に照
射する。これにより、ポジ形レジスト(3)が分解する
。続いて、現像処理をしくB)図のように、レジストパ
ターン(3a)を形成する。
このレジストパターン(3a)をマスクにLテ、(0)
図のように、薄膜(2)を化学的エツチング処理をする
。この後、不要になったポジ形レジスト(3)を除去処
理すると、(D)図のように、薄膜(2)のパターンが
形成される。
紫外線に感光する上記ポジ形レジスト(3)は、解像性
がよく2〜3μmの微細パターンの形成が可能であるが
、ノボラック樹脂で硬く、分子量も多くて数千までであ
り、薄膜(2)に対して付着性が悪い。
このため、上記従来の微細パターン形成方法では、ポジ
形レジスト(3)の付着性の不良により、薄膜(2)の
加工精度が低く、特に、ウェットエツチングの場合顕著
であった。
この発明は、エツチング被形成部材上にゴム系のネガ形
レジストを塗布し、この上に解像性のよいレジストを塗
布し、このレジストに分解又は重合させるエネルギ線を
選択的に照射し、現像によりレジストパターンを形成し
、このレジストパターンをマスクにしてネガ形レジスト
にパターン形成処理をし、これらのパターンをマスクに
し上記パターン被形成部材をエツチングし、付着性のよ
いネガ形レジストの効用で、微細パターンが精度良く形
成される、パターン形成方法を提供することを目的とし
ている。
以下、この発明の一実施例によるパターン形成方法を、
第2図(A)〜(E)に基板上の薄膜のパターン形成を
工程順に示す要部断面図につめて説明する。
まず、(A)図のように、半導体基板(1)の上面に形
成されである薄膜(2)上に、この薄膜に対して付着力
の強いゴム系のネガ形しジス) Ql)を均一に塗布す
る。続いて、このネガ形しジメ) αυ上に、微細パタ
ーン形成に高性能をもつ解像性のよいポジ形レジスト(
3)を均一に塗布する。続いて、紫外線(4)を選択的
に照射する。これにより、ポジ形レジスト(3)が分解
する。続いて、現像処理をしくB)図のように、レジス
トパターン(3a)”を形成する。上記照射により、ポ
ジ形レジスト(3)は紫外線(4)で分解され、一方、
ネガ形レジスト01)は重合する。また、現像時には、
ポジ形レジスト(3)の分解領域がポジ形レジスト現像
液に溶解し、他の領域が残る。ネガ形レジスト01)は
重合度合に無関係に、ポジ形現像液に溶解しないので、
ポジ形レジスト(3)だけの微細なレジストパターン(
3a)が形成できる。このようにして形成されたポジ形
レジスト(3)による微細なレジストパターン(3a)
に加えて、ネガ形レジスト(1])の膜厚を有する領域
と、ネガ形レジストαのだけの膜厚差を利用して、基板
(1)上面全体に0□プラズマ処理を施すことにより、
上記レジストパターン(3a)以外のネガ形レジスト(
1])を取り除く。このとき、薄厚のネガ形レジスト0
υの膜厚と同程度の厚さだけポジ形レジスト(3)がレ
ジストパターン(5a)領域からも同時に除去されるが
、その除去厚さはわずかである。この状態を(0)図に
示す。
次に、薄膜(2)の上面に残ったレジストパターン(3
a)、 (lla)をマスクにし、(O)図のように、
薄膜(2)を化学的などのエツチング処理をする。この
後、不要のレジストパターンC3a)、 (11a)を
除去処理すると、(E)図のように薄膜(2)の微細パ
ターンが精度良く形成される。なお、ネガ形レジストα
Dの膜厚は薄い程、パターン精度の制御が容易である。
なお、上記実施例では、微細パターン形成用のレジスト
として、紫外線に感光するポジ形レジスト(3)の場合
を示したが、遠紫外線、X線、イオンビーム、電子ビー
ム等などのエネルギ線にそれぞれ分解又は重合して感度
を示す他の種の、解像性のよいレジストを使用してもよ
い。ただし、上記各レジストの専用現像液に対し、ゴム
系のネガ形レジストが溶解性を示さないようにする。
捷だ、薄膜(2)は−厚膜であってもよく、材質は酸化
膜、窒化膜又は金属膜であってもよい。
さらに、上記実施例ではエツチング被形成部材として、
薄膜(2)の場合を説明したが、半導体基板など自体に
エツチングする場合にも適用できるものである。
上記のように、この発明によitば、エツチング被形成
部材上にゴム系のネガ形レジストを塗布し、この上に解
像性のよいレジストを塗布し、この良解像性レジストを
塗布し、このレジストをエネルギ線の選択的照射により
分解又は重合させ、現像してレジストパターンを形成し
、このレジストパターンをもとにして上記ネガ形レジス
トに同一のパターンを形成処理し、これらのレジストパ
ターンをマスクにして上記被形成部材をエツチング加工
するようにしたので、高精度の微細パターンを形成する
ことができる。
【図面の簡単な説明】
第1図(A)〜(D)は従来の基板の薄膜のパターン形
成方法を工程順に示す要部断面図、第2図(A)〜(B
)はこの発明の一実施例による基板の薄膜のパターン形
成方法全工程順に示す要部断面図である。 1・・・半導体基板、2・・・薄膜、3・・・ポジ形レ
ジスト、3a・・・レジストパターン、4・・・紫外f
f1M、11・・・ネガ形レジスト なお、図中同一符号は同−又は相当部分を示す。 代理人 葛野信 −(外1名) 第11図 特許庁長官殿 1.事件の表示    特願昭5’7−185804号
2、発明の名称    パターン形成方法3、補正をす
る者 事件との関係   特許出願人 住 所     東京都千代田区丸の内二丁目2番3号
名 称(601)   三菱電機株式会社代表者片山仁
八部 4、代理人 住 所     東京都千代田区丸の内二丁目2番3汚
5、 補正の対象 明細書の「発明の詳細な説明」の掴。 6、補正の内容 (1)明細書第3ページ第2〜3行の「ノボラツクー−
一一一であり、」を削除する。 (2)明細書第5ページ第1行の「だけの膜厚差」を「
だけの領域の膜厚差」に補正する。 (3)明細書第5ページ第4行の「薄厚の」を削除する
。 (4〕  明細書第6ページ第11〜12行の「この良
解像−−−−−塗布し、」を削除する。 以上

Claims (2)

    【特許請求の範囲】
  1. (1)パターン被形成部材上に良密着性のゴム系のネガ
    形レジストを塗布し、このネガ形レジスト上に微細パタ
    ーン形成用の高解像性のレジストを塗布し、この高解像
    性レジストをエネルギ線照射により選択的に分解又は重
    合させ、現像処理をして微細パターンを形成し、このレ
    ジストパターンをもとにして上記ネガ形レジストに同一
    パターンを形成処理し、これら双方のレジストパターン
    をマスクにして上記被形成部材をエツチング加工し、後
    、上記各レジストパターンを除去処理する、パターン形
    成方法。
  2. (2)  パターン被形成部材は半導体基板上に施され
    た薄膜からなり、高解像性のレジストはポジ形レジスト
    からなることを特徴とする特許請求の範囲第1項記載の
    パターン形成方法。
JP18580482A 1982-10-20 1982-10-20 パタ−ン形成方法 Pending JPS5974634A (ja)

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