JPS5970333A - 多重伝送システムのデ−タ受信器 - Google Patents

多重伝送システムのデ−タ受信器

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Publication number
JPS5970333A
JPS5970333A JP18164782A JP18164782A JPS5970333A JP S5970333 A JPS5970333 A JP S5970333A JP 18164782 A JP18164782 A JP 18164782A JP 18164782 A JP18164782 A JP 18164782A JP S5970333 A JPS5970333 A JP S5970333A
Authority
JP
Japan
Prior art keywords
data
address
terminal
latch
main device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18164782A
Other languages
English (en)
Inventor
Yoshiyuki Komoda
美行 薦田
Hitoshi Fukagawa
仁 深川
Osamu Tanaka
修 田中
Yasukazu Kinekawa
安一 杵川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Works Ltd filed Critical Matsushita Electric Works Ltd
Priority to JP18164782A priority Critical patent/JPS5970333A/ja
Publication of JPS5970333A publication Critical patent/JPS5970333A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks
    • H04L12/28Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/40Bus networks

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Small-Scale Networks (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は多爪伝汚システムにおいて多数設けられた端本
器からの端本データイマイク0つ029寸等よりなる主
システムに転送するために便用する多重伝送システムの
データ受信器に関するものである。
第1図は多事伝送を用いた迎」御システムの七デル凶で
示すものであって、主装置i11は一般にマイクD″j
11セーリ寸等才用いて構成され、伯ち°ライン(2)
に接続された各端本器(31・・・才制御し捷たこれら
端末器(3)・・・からの端本データにより系全体の制
御で行うものである。上器インターフェイス(4)は、
信号ライフ(2)十の多重伝送イd号で土製↑u(1)
へDジ・ツク@号として伝え、また土製fltlliか
らのロジ・ツク信号により多電伝送信号τ作成し信号ラ
イフ(2)上に送出するような機能を有するものであり
、本発明はこれらの上奏インターフェイス(4)の機能
のうち上記前者の機能に別府する回路部分であるデータ
受信器に関するものである。%2凶は多重伝送信号の信
号フォーマ・ソトの例で示したものであって、信号伝送
は袷時一定時間おきに行なわれるものではなく、例えは
今ある端本器(3)・・・にセンサが接続されているも
のとして、このセンサの状席が変化すると、その状膨変
化の情報が第2凶に示す@り゛フォーマットのデータ部
分に反映されて伝達されることになるものであり、伯り
一ライー)(2)上で伝送される信りはベースバント“
方式や、ASI(あるいはF S Kによる搬送方式な
どの方法で伝送されることになる。
第3凶は従来のデータ受倍器のづDツク凶τ示し、(l
ライン(2)土の伝送佑り°ン堂佑しそのデータイ一旦
各端本アしレス毎にメ七り(5)に記憶し、その後主装
置aill側にこのメモリ(5)内のデータで送出する
ものである。第3凶回路において、データ復調都(6)
は、前述の各神伝送方式に適合して構収され、伝送信号
tロジtリクレベルのシリアル侶りに便換するものであ
り、伝送信り・父伯に必要なタイ三ンタハルスτ発生し
かつデータ叉佃終了τチェ゛ツクするタイ三ンタコント
ロール都(7)の出力により制御されて動作し、このデ
ータ復調@l+の出力はタイミンクコントロール都(7
)出力に回trしてデータシフトレジスタ(8)に入力
され、交信データのシリアル・パラレル変換が行なわれ
る。がく2図倍号フォーマットにJ6した出力が峙られ
るものであり、この並列出力のうち、アドレスコードに
対応する部分の出力データかアドレスラッチ(9)に、
データに対jヒする部分の出力データがデータラ1ソチ
(10jに夫々ラッチされる。メtす[51はアドレス
コード子(9)にうtリチされたアドレス領域に、デー
タうツチ+101 Kラッチされたデータオ8己憶し、
こnτ保持することになる。一方ハシトシェイク都(1
りは各端末器(31・・・力・らの伝送信号の受信後に
主装置(1)からの伯勺に従いメtす(5)に記憶され
た端末データτ土製竹i、]Hl!Iに出力するための
ものであり、主装置jll +1111からのアト“し
スデータtアトしスラッチ(121にラッチしてこ”の
アドレスデータによりメモリ(6)τアクセスし、メ七
りtF+)から読み出さnたデータ子データう゛り子(
131に一旦う゛リチし、ハントシェイク部(Illτ
介して主装置+1+ IUIJに転送するようにしであ
る。
データ受倍器は上述のように構成され、これて主装置α
(1)の子離インターフェイス+41の父侶都として用
いることにより、次々に異なったアドレスのデータで受
信するような@台でもデータはデータ受信器内のメtす
(5)に一旦蓄えられるため、土製1ftll+との間
のデータハントシエイクが低連で行なわれるような場合
にもデータで失なうようなことがないものである。
ところが上述のような従来例システムτ、端末器(31
円に電気錠(141f設けた電気錠システムに利用する
ような場合、上記利点が生かされず、主装置(1)の動
作速度が高速であること才要求される問題があった。即
ちこのような電気錠システムにおいては、10十−より
なるシークレット士−(15)により押された解錠コー
ドナンバーが、あらかじめ定められた何桁かの設定数字
と一致した場合にのみ′慰気’6 (14+ f解錠す
るシステムであり、シー91191士−(16)が押さ
れる毎にその押さnた番号のデータを端末器(3)は土
器インターフェイス(4)で介して主装置t1+に転送
し、主装置tlJはシークレット士−(+57が押され
る毎に入力するデータτ蓄槓して所定の桁数分が集まっ
たときに予め設定さnだ設定数字との比較でし、一致し
たときに端末器(3;飼に解粂信9’;c送出してこt
″Lτダ・佃した端末器(3)が電気錠(141z″i
v@するものである。従ってこの場合、シーフレ・ソト
+−(+5iより入力されたデータ?例えば前述の第2
図信号〕オーマ・ソトのデータ部分に乗せて伝送すると
すると、今仮に1.3.4.5と十−で順次押したとす
ると、信号ライン(2)上には第5凶に示すように伝送
信号が伝送されることになる。そこでこのよう々信号−
で前述の第3凶データ受債棒で受信したとすると、今こ
の′4気@(141付の端末器(3)のアドレスが10
 ch とすると、メ七り(6)の10ch部分のデー
タが次々と1き換えられていくことになる。従ってこn
らの十−人力された番号データを主装置用副で全て知る
ためには、信号ライン(2)上の伝送48号の伝送間隔
よりも知かい時間間隔でメモリ(5)からデータを取り
出す必要があり、結局主装置illの動作速度が高速で
あることか要求されることになる問題があった。
不発用は上述の点に−みて提供したものであって、′屯
気歓システムの゛ような特定の端末器がらのデータをF
IFOに順次入力記憶し、こnを主装置(′A″国から
順次読み出すことができるようにして主装置l’4.1
llllの動作か低速でもデータか失なわれることかな
いようにした多電伝送システムのデータ受イ占器を提供
することを目l・〕とするものである。
第6図は本発明の一失施例を示し、FI F 0(16
)にデータを入力丁べき特定の端本器+31のアドレス
コートを設定記憶するアドレス設定部θカと、111記
アドレスうtリチ(9)にラッチさ!1.た受信データ
のアトしス]−Fと上記アドレス設定部(17)の設定
アドレスコードとを比較しこれら両者が一致したと争F
 I F O(I[liを動作させるアドレス比較部(
18)と、P I F 0(161とて前述の第3図1
」路に付加した構成を廟している。ここでF I F 
0(18)は、俵放のデータを順次入力して記1息し〃
・つこのデータを入力された駒に蛸次出力する機能f胸
すゐバ・ソファであり、このF Ip OH)はアドレ
ス比較fjls jlQが一致出力を生じたのみデータ
の入力を行うものである。
かくて上述の実施例のデータ受信器を用いた多重伝送シ
ステムに2いて、その系の一節にHす述の電気腕システ
ムを自するような場合、今この電気錠(14)を有する
端末器+31のアドレスが10chであるとすると、捷
すアドレス設定部(17)のV定アドレスコートt l
 Ochに土製詩il+両刀・ら設定しておく。従って
このデータ受(、H器(d 10 c h以外の端本器
(31からのデータを9j (niするに除しては、前
述の第3凶従来例と全く同様に動作するものであるか、
今10 chの端本器(3)がらのデータが受信された
場合、アドレス比較部(18)より一致出力が生じるた
めP I F (]+1)か動作し、第4区のように1
.3.4.5とデータが順次入力さnた場8FIF O
(+6)にも1.3.4.5の順にデータが人力される
。この彼土製首(1)がハンドシェイク都(11を介し
てF I F 0(16)がらのデータの航み出しを行
うと、入力の順に従って1.3.4.5の順に出力さn
る。このため設定さnたアドレスに1−y4+ しては
途中のデータを含め最終、状部データとなる萱での過程
がその用自番どおりに出力さnることになり、データが
失なわれることがないものである。
本発明は上述のように構成したものであるがら、FIF
Oは主装置の動作速度が遅い場合にバ゛ソファメtりと
して働き、主装置に要求される速度への匍」約を大巾に
小さくでき、主装置が低速で動作するようなS台にもデ
ータを失うようなことかない効果を有するものである。
【図面の簡単な説明】
第1凶は多値伝送制御システムの七デル図、第2図は同
上の多重伝送@号の信りフォーマット何区、第3図は従
来例のづ0・ツク図、第4図に電気錠システムの構成図
、第5図f″!、市、気錠付の端禾器力・らの伝送信号
の伝送状I説明図、第6図は不発明−実施例のづロtリ
ク凶であり、+11は主装置、f511d メE ’J
 、 (161HF I F O,Q7)はアドレス、
71足部である。 代理人 升坤士  ろ 出 艮 七

Claims (1)

    【特許請求の範囲】
  1. +1+  全ての端末アドレスの端末データを各端末ア
    ドレス毎にラッチするメtすを有し、主装置側からこの
    メ七りrアクセスしてデータτ読み出すようにした多重
    伝送システムのデータ受イ占器において、特定の端末ア
    ドレス?設定するアドレス設定器と、このアドレス設定
    器に設定されたアドレスと一致する端末アドレスのデー
    タの入力時にその端末データを入力するFIFOとて具
    備し、主装置からの上記特定の端末アドレスのデータ読
    み出しに除して上MeFIFOからデータを読み出すよ
    うにして成ることて特徴とする多猷伝送システムのデー
    タ受信器。
JP18164782A 1982-10-15 1982-10-15 多重伝送システムのデ−タ受信器 Pending JPS5970333A (ja)

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JP18164782A JPS5970333A (ja) 1982-10-15 1982-10-15 多重伝送システムのデ−タ受信器

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JPS5970333A true JPS5970333A (ja) 1984-04-20

Family

ID=16104398

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JP18164782A Pending JPS5970333A (ja) 1982-10-15 1982-10-15 多重伝送システムのデ−タ受信器

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS513742A (ja) * 1974-06-28 1976-01-13 Yokogawa Electric Works Ltd
JPS5336105A (en) * 1976-09-16 1978-04-04 Fujitsu Ltd Synchronous circuit connecting system
JPS56107662A (en) * 1980-01-31 1981-08-26 Nec Corp Communication control equipment

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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