JPS5960553A - デイスクデ−タ制御方式 - Google Patents

デイスクデ−タ制御方式

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JPS5960553A
JPS5960553A JP16953282A JP16953282A JPS5960553A JP S5960553 A JPS5960553 A JP S5960553A JP 16953282 A JP16953282 A JP 16953282A JP 16953282 A JP16953282 A JP 16953282A JP S5960553 A JPS5960553 A JP S5960553A
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JP
Japan
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disk
buffer
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control
control information
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JP16953282A
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English (en)
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JPS6255167B2 (ja
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Masaaki Kobayashi
正明 小林
Toshiaki Ii
俊明 井比
Tomoharu Hoshino
星野 智春
Naomichi Kawamura
川村 直道
Takumi Kishino
岸野 琢巳
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Fujitsu Ltd
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Fujitsu Ltd
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Publication date
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Publication of JPS5960553A publication Critical patent/JPS5960553A/ja
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers

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  • Engineering & Computer Science (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (1)発明の技術分野 本発明はディスクデータ制御方式に関する。
(2)技術の背景 コンピュータシステム(上位装置)とディスク装置との
間でデータ転送を行なうためにディスクアダプタがあシ
、このディスクアダプタは、通常、DMA (Dire
ct Memory AccelIg)バッファ)ディ
3り制御部、およびこれらを制御するマイクロプロセッ
サ(MPU)を含んで構成されている。この場合、上位
装置からのデータはそのまま変換せずにディスク装置に
転送され、同様に、ディスク装Uからのデータもそのま
ま変換せずに上位装置に転送される。従って、上述のデ
ィスクアダプタは1つのデータ形式のディスクにしか用
いられない。
しかしながら、最近、同一種類のディスク装置を種々の
データ形式のシステムに適用できるように、つまシ、デ
ィスク装置に互換性をもたせることが望まれるようにな
った。
(3)発明の目的 本発明の目的は、ディスクアダプタ内に中間バッファを
設け、転送情報のうちの制御情報(ID)を中間バッフ
ァを用いて加工してから転送させる一方、転送情報のう
ちのデー°夕情報はそのまま転送させるという構想にも
とづき、ディスク装置に互換性をもたせ、上述の要望に
答えることにある。
(4)発明の構成 上述の目的を達成するために本発明によれば、上位装置
とディスク制御部との間にDMAバッファを設けて制御
情報およびデータ情報の転送を行なうディスクデータ制
御方式において、中間バッファを設け、前記データ情報
の転送は前記DMAバッファと前記ディスク制御部との
間で直接行ない、前記制御情報の書込み転送は、前記D
MAバッファの制御情報を加工して前記中間バッファに
書込んだ上で、該中間バッファと前記ディスク制御部と
の間で行ない、前記制御情報の続出し転送は、前記ディ
スク制御部の制御情報を前記中間バッファに読出した上
で、該中間バッファの制御情報を加工して前記DMAバ
ッファに書込むことによシ行なうことを特徴とするディ
スクデータ制御方式が提供される。
(5)発明の実施例 以下、図面を参照して本発明の詳細な説明するO 第1図は本発明に係るディスクデータ制御方式(ディス
クアダプタ)の一実施例を示すブロック回路図である。
第1図において、1はMl)U、 2は制御命令格納用
メモIJ (ROM)、3は制御情報一時格納用メモリ
(RAM)、4はアダプタ内部制御用レジスタ群であっ
て、たとえハDMA制御、割込みマスク制御、中間バッ
ファ使用制御管のために制御信号C□〜C6を発生する
。5,6は中間バッファ、7,8はDMAバッファ(F
IFO)、9はディスク制御部、10〜15はパスドラ
イバ、16は共通パス17に対してパス占有要求あるい
は上位装置よシのアクセスに応答するための共通パス制
御部である。
また、ディスク制御部9は各制御信号cQ %CSを発
生し、共通パス制御部17は制御信号C7。
C;  、 C;を送受信する。なお、共通パス17は
上位装置すなわちコンピュータシステムに接続されてい
るものとする。
次に、第1図の回路のディスク書込み動作について第2
図のタイミング図を参照して説明する。
この場合、ID情報は、PIFO8→パスドライバ15
→パスドライバ11→MPU 1→中間バッファ6→パ
スドライバ13→ディスク制御部9のルートで流れ、他
方、データ情報は、PIFO8→パスドライバ15→デ
ィスク制御部9のルートで流れる。
始めに、プログラムによ、l MPU 1にディスク書
込み起動がかかると、MPUIはレジスタ群4を介して
制御信号C4によシ中間バッファ6を使用状態にセット
する。
次に、MPUIは図示しない制御信号によJFIFO8
に起動をかけDMA動作を行なわせる。DMA動作によ
シFIFO8にデータが満杯になると、PIFO8はフ
ル状態表示信号C7をMPU 1に送出し、この結果、
MPUIはレジスタ群4を介して制御信号C6によpF
IFO8を読出し状態にすると同時に、レジスタ群4を
介して制御信号C2によシパスドライバ11を有効にす
る。従って、ID情報17IFO8から読出され、MP
UIによって加工される。なお、データ情報は直接ディ
スク制御部9に転送される。
次に、MPUIは加工済のID情報を中間バッファ6に
書込んだ後に、図示しない制御信号によシディスク制御
部9に起動をかける。この結果、ディスク制御部9は制
御信号C;を発生してバスドライバ13を有効にして中
間/?ツソフ6から加工済ID情報を読出すと共に、こ
のID情報とFIFO8から直接転送されてきたデータ
情報とをディスクに書込む。すなわち、ディスク動作を
行なう。ディスク動作の終了後、ディスク制御部9は終
了通知信号をMPUIに送出する。次に、MPUIは各
種ステータス情報を作成すると共に、レジスタ群4を介
して制御信号C2、C6によりDMA動作の終了指示を
行ない、また、レジスタ群4を介して制御信号C4によ
シ中間バッファ6をリセットする。
これによシ一連の動作が終了する。
このようにして、ディスク書込み動作においては、ID
情報は中間バッファ6を用いて加工を行なった上でディ
スク制御部9に転送される。
次に、第1図の回路のディスク読出し動作について第3
図のタイミング図を参照して説明する。
この場合、ID情報は、ディスク制御部9→中間バッフ
ァ5→パスドライバ12→MPU 1→パスドライバ1
0→FIFO7のルートで流れ、他方、データ情報はデ
ィスク制御部9から直接FIFO7に流れる。
始めに、プログラムによ、9 MPU 1にディスク読
出し起動がかかると、MPU 1はレジスタ群4を介し
て制御信号C3によυパスドライバ12を有効にする。
つまシ、中間バッファ5が使用状態にセットされる。
次に、MPUIは図示しない制御信号によfiFIFO
7に起動をかけDMA動作をかけた後に、MPU 1は
図示しない制御信号によシディスク制御部9にも起動を
かける。次に、ディスク制御部9は制御信号C;を発生
して中間バッファ5を書込み可能にすると共に、FIF
O7に劉゛込み信号C−を送出する。
この結果、ディス夛制御部9はディスクからのID情報
を中間バッファ5に書込むと共にデータ情報をFIFO
7にM接書込む。このようなディスク動作が終了すると
、ディスク制御部9はMPU 1に終了通知を送出する
次に、MI’U 1は各種のチェックを行々っだ上で、
中間バッファ5からID情報を読出して加工し、その加
工されたID情報を制御信号C6を用いてFIFO7に
籠込む。
DMA動作が終了すると、FIFO7は終了通知をMP
UIに送出する。この結果、MPU 1はFIFO7に
終了指示を送ると共に、レジスタ群4を介して制御信号
C3によυパスドライバ12を無効にする。つまシ、中
間バッファ5が使用状態からリセットされる。
次に、MPUIは種々のステータス情報を作成し、これ
によシ、一連の動作が終了する。
このようにして、ディスク読出し動作においては、ID
情報は中間バッファ5を用いて加工を行なった上でFI
FO7に転送される。
第1図においては、データ転送ルートとして、往復の2
系統設けておるが、すべての内部パスを双方向に構成し
てデータ転送ルートを1系統にすることも可能である。
また、FIFO7、8と共通パス17とのt14jのデ
ータ転送は、共通パス制御部16によって上述の動作と
は独立に行なわれることもある。たとえば、FIFO7
がフル状態表示信号弓を発生したときには、共通パス占
有要求を上位装置に送出し、この結果、占有許可されれ
ば、共通バス制御部16は制御伯号弓を送出してパスド
ライバ14を有効にする。また、PIFO8がエンシテ
ィ状態表示信号弓を発生したときにも、共通パス占有要
求を行なうこともある。
(6)発明の詳細 な説明したように本発明によれば、ディスクアダプタに
おいて、データ形式にょシ異なるID情報をディスク装
置に応じた一定の変換方法を用いて加工してから転送し
ているので、ディスク装置tに互換性が生ずる。なお、
データ形式が異なるシステムをディスク装置にね(続す
る場合には、より情報変換プログラムが格納されている
第1図のROM 2のみを交換すればよい。
【図面の簡単な説明】
第1図は本発明に係るディスクデータ制御方式の一実施
例を示すブロック回路図、第2図、第3図は第1図の回
路動作を説明するだめのタイミング図である。 1 : MPU、 2 : ROM、 3 : RAM
、 4 :制御用レジスタ群、5,6:中間バッファ、
7,8:DMA)ぐソファ(FIFO)、 10〜15
:パスドライバ、16:共通バス制御部。

Claims (1)

    【特許請求の範囲】
  1. 1、上位装置とディスク制御部との間にDMAノ々ッフ
    ソフ設けて制御情報およびデータ情報の転送を行なうデ
    ィスクデータ制御方式において、中間バッファを設け、
    前記データ情報の転送は前記DMAバッファと前記ディ
    スク制御部との間で直接性ない、前記制御情報の書込み
    転送は、前記DMAバッファの制御情報を加工して前記
    中間バッファに書込んだ上で、該中間バッファと前記デ
    ィスク制御部との間で行ない、前記制御情報の読出し転
    送は、前記ディスク制御部の制御情報を前記中間バッフ
    ァに読出しだ上で、該中間バッファの制御情報を加工し
    て前記DMAバッファに書込むことによシ行なうことを
    特徴とするディスクデータ制御方式。
JP16953282A 1982-09-30 1982-09-30 デイスクデ−タ制御方式 Granted JPS5960553A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP16953282A JPS5960553A (ja) 1982-09-30 1982-09-30 デイスクデ−タ制御方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP16953282A JPS5960553A (ja) 1982-09-30 1982-09-30 デイスクデ−タ制御方式

Publications (2)

Publication Number Publication Date
JPS5960553A true JPS5960553A (ja) 1984-04-06
JPS6255167B2 JPS6255167B2 (ja) 1987-11-18

Family

ID=15888236

Family Applications (1)

Application Number Title Priority Date Filing Date
JP16953282A Granted JPS5960553A (ja) 1982-09-30 1982-09-30 デイスクデ−タ制御方式

Country Status (1)

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JP (1) JPS5960553A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6178343U (ja) * 1984-10-29 1986-05-26

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6178343U (ja) * 1984-10-29 1986-05-26

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JPS6255167B2 (ja) 1987-11-18

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