JPS5932082A - 帳票検出回路 - Google Patents
帳票検出回路Info
- Publication number
- JPS5932082A JPS5932082A JP14070682A JP14070682A JPS5932082A JP S5932082 A JPS5932082 A JP S5932082A JP 14070682 A JP14070682 A JP 14070682A JP 14070682 A JP14070682 A JP 14070682A JP S5932082 A JPS5932082 A JP S5932082A
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- JP
- Japan
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- signal
- slip
- circuit
- pulses
- output
- Prior art date
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- Granted
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K13/00—Conveying record carriers from one station to another, e.g. from stack to punching mechanism
- G06K13/02—Conveying record carriers from one station to another, e.g. from stack to punching mechanism the record carrier having longitudinal dimension comparable with transverse dimension, e.g. punched card
- G06K13/06—Guiding cards; Checking correct operation of card-conveying mechanisms
- G06K13/067—Checking presence, absence, correct position, or moving status of cards
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、帳票を検出する帳票検出回路に関する。
一般的に、光学式文字読取装置に於いては、帳票を走ら
せながら読取りを行わせるため、走行路内の帳票の制御
が必要である。そのために、帳票が走行路内の所定の場
所を通過するときに、光学的に帳票を検出した信号を取
出す帳票検出回路を有している。それは帳票の前縁およ
び後縁のみを取出す回路や、帳票の長さとして取出す回
路がある。
せながら読取りを行わせるため、走行路内の帳票の制御
が必要である。そのために、帳票が走行路内の所定の場
所を通過するときに、光学的に帳票を検出した信号を取
出す帳票検出回路を有している。それは帳票の前縁およ
び後縁のみを取出す回路や、帳票の長さとして取出す回
路がある。
従来の帳票検出回路は、単に帳票が走行路内の所定の場
所に設けた受光素子をおおった時、論理“０”、そうで
ない時論理ゝゝｌ“となる（その逆もある）信号を発生
する回路であった。従って、発光素子の駆動方法も直流
駆動方式がほとんどであった。
所に設けた受光素子をおおった時、論理“０”、そうで
ない時論理ゝゝｌ“となる（その逆もある）信号を発生
する回路であった。従って、発光素子の駆動方法も直流
駆動方式がほとんどであった。
しかし、帳票の状態（折れ１曲がり）や走行の状態（バ
タツキ）によっては帳票の前縁、後縁を検出する時、チ
ャタリングを起こし、誤動作する場合が多々あシ装置の
信頼性を著しく低下させていた。このため、１１とんど
の装置は種々なハードウェア手段により、チャタリング
を除去するために高価になったり、また、ファームウェ
アにより、ある時間経過した彼に再び受光素子からの信
号をサンプリングする手段等かなり複雑な制御を必要と
する欠点があった。
タツキ）によっては帳票の前縁、後縁を検出する時、チ
ャタリングを起こし、誤動作する場合が多々あシ装置の
信頼性を著しく低下させていた。このため、１１とんど
の装置は種々なハードウェア手段により、チャタリング
を除去するために高価になったり、また、ファームウェ
アにより、ある時間経過した彼に再び受光素子からの信
号をサンプリングする手段等かなり複雑な制御を必要と
する欠点があった。
また、光出力の関係から発光素子と受光素子間の実装距
離もせいぜい数センチメートルが限度で、走行路内の実
装スペース等により、形状の違ったものを各々実装する
ことになり、実装効率の低下や、高価になる欠点があっ
た。
離もせいぜい数センチメートルが限度で、走行路内の実
装スペース等により、形状の違ったものを各々実装する
ことになり、実装効率の低下や、高価になる欠点があっ
た。
本発明は、発光素子をパルス駆動し、従来の検出回路に
ラッチ回路を付加することにより、帳票検出時の誤動作
を防ぐことができ、又検出素子の実装効率も向上する等
、より安価な信頼性の高い帳票検出回路を持った装置を
提供すｔ０本発明によれば、相対的に移動する帳票を検
出する検出素子と、パルス信号を反転させるインバータ
回路と、その反転した信号により検出素子をパルス駆動
させるだめのドライバ回路と、検出素子からのパルスを
受け、論理レベルに変換する波形整形回路と波形整形回
路から得られた波形を前記パルス信号のタイミングで所
定の状態にするための７リツプフロツプとを含むことを
特徴とする帳票検出回路が得られる。
ラッチ回路を付加することにより、帳票検出時の誤動作
を防ぐことができ、又検出素子の実装効率も向上する等
、より安価な信頼性の高い帳票検出回路を持った装置を
提供すｔ０本発明によれば、相対的に移動する帳票を検
出する検出素子と、パルス信号を反転させるインバータ
回路と、その反転した信号により検出素子をパルス駆動
させるだめのドライバ回路と、検出素子からのパルスを
受け、論理レベルに変換する波形整形回路と波形整形回
路から得られた波形を前記パルス信号のタイミングで所
定の状態にするための７リツプフロツプとを含むことを
特徴とする帳票検出回路が得られる。
次に本発明を実施例の図面を参照して説明する。
第１図を参照すると、本発明の一実施例において、パル
ス信号Ｔ１は位相反転させるインバータ回路ＩＮＶを通
り、トランジスタＱ１をスイッチングし、発光素子Ｄ１
をパルス駆動させる。光パルス列は受光素子Ｑ２により
電気信号に変換されフォトアンプを通って、論理信号Ａ
を出力する。
ス信号Ｔ１は位相反転させるインバータ回路ＩＮＶを通
り、トランジスタＱ１をスイッチングし、発光素子Ｄ１
をパルス駆動させる。光パルス列は受光素子Ｑ２により
電気信号に変換されフォトアンプを通って、論理信号Ａ
を出力する。
フリップフロップＦＦはパルス信号Ｔ１が′″Ｏ″のと
き予めリセット信号几１によってリセットされている。
き予めリセット信号几１によってリセットされている。
論理信号Ａはパルス信号Ｔに比べ、少し遅延された出力
となり、ＤタイプフリップフロップＦＦのＤ入力端子に
入力される。
となり、ＤタイプフリップフロップＦＦのＤ入力端子に
入力される。
一方、パルス信号Ｔ１は、ＤタイプフリップフロップＦ
ＦのＣＰ入力端子に入力される。従って、Ｄタイプフリ
ップフロップＦＦの出力は、帳票Ｐがない時は、パルス
信号Ｔ１のタイミングより少し遅く出力される論理信号
Ａとパルス信号Ｔ１の後縁により論理′Ｘ１“になりそ
の状態を保持する。
ＦのＣＰ入力端子に入力される。従って、Ｄタイプフリ
ップフロップＦＦの出力は、帳票Ｐがない時は、パルス
信号Ｔ１のタイミングより少し遅く出力される論理信号
Ａとパルス信号Ｔ１の後縁により論理′Ｘ１“になりそ
の状態を保持する。
帳票Ｐが受光素子Ｑ２をおおうと論理信号Ａは１℃“と
なり、フリップフロップＦＦもＴ１のタイミングにより
論理ゝ０“にリセットされる。
なり、フリップフロップＦＦもＴ１のタイミングにより
論理ゝ０“にリセットされる。
次に帳票Ｐが受光素子Ｑ２を通過して、信号Ｔ１のタイ
ミングで信号Ａが“１“になった時点でフリップ７０ツ
ブＦＦはゝゝ１“にセットされ、その後は再び帳票Ｐが
受光素子Ｑ２をおおうまで保持される。
ミングで信号Ａが“１“になった時点でフリップ７０ツ
ブＦＦはゝゝ１“にセットされ、その後は再び帳票Ｐが
受光素子Ｑ２をおおうまで保持される。
次に、第２図、第３図、第４図のタイムチャートにより
、帳票Ｐのバタツキによるチャタリング吸収について説
明する。
、帳票Ｐのバタツキによるチャタリング吸収について説
明する。
第２図は、帳票Ｐのバタツキがパルス信号Ｔ１の中間で
発生した時を想定したものである。パルス信号Ｔ１が発
生すると、通常受光素子の位置に帳票がないときは、フ
ォトからの出力は信号Ａの如くなり、７リツプフロツプ
の出力Ｂは信号Ｔ１の立上りにより論理ゝ１”となり保
持される。次に帳票Ｐが受光素子を通過する時、バタツ
キが発生してもバタツキの位置がパルス信号Ｔ１の中間
のため、信号Ｂには全く影響されず、チャタリングのな
い、きれいな立上り、立下り波形を持った論理出力ゝゝ
０“が得られる。
発生した時を想定したものである。パルス信号Ｔ１が発
生すると、通常受光素子の位置に帳票がないときは、フ
ォトからの出力は信号Ａの如くなり、７リツプフロツプ
の出力Ｂは信号Ｔ１の立上りにより論理ゝ１”となり保
持される。次に帳票Ｐが受光素子を通過する時、バタツ
キが発生してもバタツキの位置がパルス信号Ｔ１の中間
のため、信号Ｂには全く影響されず、チャタリングのな
い、きれいな立上り、立下り波形を持った論理出力ゝゝ
０“が得られる。
第３図、第４図は、帳票Ｐの後縁でバタッキがパルス信
号Ｔ１の発生と同時に起こった場合を想定したものであ
る。張票Ｐのバタッキに同期されて出力される信号Ａが
信号Ｔ１の立下りの時点で論理ゝゝ０“の場合はフリッ
プフロップの出力Ｂは変化するが（第３図の場合）、信
号Ａが信号Ｔ１の立下９の時点で論理“１”の場合はフ
リップ７０ツブの出力Ｂは変化し得えず、次のパルス信
号Ｔ１の立下りの時点まで待たされて出力Ｂが変化する
（第４図の場合）。従って、この場合も、帳票のバタツ
キには影響されず、チャタリングのないきれいな立上り
、立下り波形を持った論理出力が得られる。
号Ｔ１の発生と同時に起こった場合を想定したものであ
る。張票Ｐのバタッキに同期されて出力される信号Ａが
信号Ｔ１の立下りの時点で論理ゝゝ０“の場合はフリッ
プフロップの出力Ｂは変化するが（第３図の場合）、信
号Ａが信号Ｔ１の立下９の時点で論理“１”の場合はフ
リップ７０ツブの出力Ｂは変化し得えず、次のパルス信
号Ｔ１の立下りの時点まで待たされて出力Ｂが変化する
（第４図の場合）。従って、この場合も、帳票のバタツ
キには影響されず、チャタリングのないきれいな立上り
、立下り波形を持った論理出力が得られる。
尚、本実施例によると、帳票Ｐのバタッキによっては、
帳票の正確な長さに対応した信号でなくなる場合がある
が、これは、パルス信号Ｔ１の周期を可変することによ
り、実用上支障ない波形を得ることが可能である。
帳票の正確な長さに対応した信号でなくなる場合がある
が、これは、パルス信号Ｔ１の周期を可変することによ
り、実用上支障ない波形を得ることが可能である。
又、他の本実施例の特徴は、発光勢子のパルス駆動電流
を大きくすることにより、光出力も増加することを利用
し、発光素子と受光素子の距離を大きくとることが可能
（数十センチメートル）となり、実装効率的にも、従来
のものと比較し、大＠に改善できる。
を大きくすることにより、光出力も増加することを利用
し、発光素子と受光素子の距離を大きくとることが可能
（数十センチメートル）となり、実装効率的にも、従来
のものと比較し、大＠に改善できる。
本発明は以上説明したように、発光素子をパルス駆動さ
せ、従来の回路に、ラッチ回路を付加することにより、
帳票のバタツキ等による前縁、後縁の波形のみだれを吸
収することが出来、比較的安価で、しかも信頼性の高い
装置を構成する効果がある。
せ、従来の回路に、ラッチ回路を付加することにより、
帳票のバタツキ等による前縁、後縁の波形のみだれを吸
収することが出来、比較的安価で、しかも信頼性の高い
装置を構成する効果がある。
第１図は本発明の一実施例のブロック図、第２図、第３
図、第４図はその動作を説明するためのタイムチャート
である。 ＩＮＶ・・・・・・インバータ回路、Ｄｌ・・・・・・
光源（発光素子）、Ｑｌ・・・・・・トランジスタ回路
、Ｐ・・・・・・帳票、ＡＭＰ・・・・・・ホトアンプ
回路、ＦＦ・・・・・・フリップ７ｏ、プ０
代理人弁理士内原晋Ｃ昇ｂ
図、第４図はその動作を説明するためのタイムチャート
である。 ＩＮＶ・・・・・・インバータ回路、Ｄｌ・・・・・・
光源（発光素子）、Ｑｌ・・・・・・トランジスタ回路
、Ｐ・・・・・・帳票、ＡＭＰ・・・・・・ホトアンプ
回路、ＦＦ・・・・・・フリップ７ｏ、プ０
代理人弁理士内原晋Ｃ昇ｂ
Claims (1)
- 相対的に移動する帳票を検出する検出素子と、パルス信
号を反転させるインバータ回路と、その反転した信号に
より検出素子をパルス駆動させるだめのドライバ回路と
、検出素子からのパルスを受は論理レベルに変換する波
形整形回路と、波形整形回路から得られた波形を、前記
パルス信号のタイミングで所定の状態にするための７リ
ツプフロツプとを含むことを特徴どする帳票検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14070682A JPS5932082A (ja) | 1982-08-13 | 1982-08-13 | 帳票検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14070682A JPS5932082A (ja) | 1982-08-13 | 1982-08-13 | 帳票検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5932082A true JPS5932082A (ja) | 1984-02-21 |
| JPS6218079B2 JPS6218079B2 (ja) | 1987-04-21 |
Family
ID=15274830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14070682A Granted JPS5932082A (ja) | 1982-08-13 | 1982-08-13 | 帳票検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5932082A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015165620A (ja) * | 2014-03-03 | 2015-09-17 | キヤノン株式会社 | 画像処理装置、画像処理装置の制御方法およびプログラム |
-
1982
- 1982-08-13 JP JP14070682A patent/JPS5932082A/ja active Granted
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015165620A (ja) * | 2014-03-03 | 2015-09-17 | キヤノン株式会社 | 画像処理装置、画像処理装置の制御方法およびプログラム |
| CN110557516A (zh) * | 2014-03-03 | 2019-12-10 | 佳能株式会社 | 信息处理设备和信息处理设备的控制方法 |
| US10523830B2 (en) | 2014-03-03 | 2019-12-31 | Canon Kabushiki Kaisha | Scanner apparatus and printer apparatus having power savings |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6218079B2 (ja) | 1987-04-21 |
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