JPS5932069B2 - タンタル接点及びその形成方法 - Google Patents
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Description
【発明の詳細な説明】
本発明はシリコン半導体基板上に於けるショットキ障壁
夕゛ィオード接点として働くタンタル接点及びその形成
方法に係る。
夕゛ィオード接点として働くタンタル接点及びその形成
方法に係る。
半導体基板上にオーム接点及びショットキ障壁ダイオー
ド接点を形成するために用いられる材料又は材料の組合
わせには電気的及び化学的観点から極めて厳しい条件が
必要とされる。
ド接点を形成するために用いられる材料又は材料の組合
わせには電気的及び化学的観点から極めて厳しい条件が
必要とされる。
従来に於て、多数の金属系がオーム接点及びショットキ
障壁ダイオード接点として提案されそして用いられてい
る。
障壁ダイオード接点として提案されそして用いられてい
る。
シリコン・プレーナ・トランジスタ及び集積回路の相互
接続体に用いられている最も良好な金属はアルミニウム
又は少量の銅をドープされたアルミニウムである。アル
ミニウムはシリコン及び周囲の絶縁層に対して極めて良
好なオーム特性及び機械的特性を有する接点を形成する
。アルミニウムは標準的な蒸着技術又はスパッタリング
技術によつて容易に付着されそして食刻技術又は同様な
技術によつて容易にパターン状にされ得る。しかしなが
ら、アルミュゥ,ょ特.高温処理中に於てシリコンと相
互に作用する傾向を有している。更に、アルミニウム単
独では、極めて高い障壁の高さ又は低い障壁の高さを有
するシヨツトキ障壁ダイオード接点をシリコン上に形成
することが出来なX.′0金属接点として1つ又はそれ
以上の機能を達成する他の種々の金属系が従米の文献に
於て数多く記載されている。
接続体に用いられている最も良好な金属はアルミニウム
又は少量の銅をドープされたアルミニウムである。アル
ミニウムはシリコン及び周囲の絶縁層に対して極めて良
好なオーム特性及び機械的特性を有する接点を形成する
。アルミニウムは標準的な蒸着技術又はスパッタリング
技術によつて容易に付着されそして食刻技術又は同様な
技術によつて容易にパターン状にされ得る。しかしなが
ら、アルミュゥ,ょ特.高温処理中に於てシリコンと相
互に作用する傾向を有している。更に、アルミニウム単
独では、極めて高い障壁の高さ又は低い障壁の高さを有
するシヨツトキ障壁ダイオード接点をシリコン上に形成
することが出来なX.′0金属接点として1つ又はそれ
以上の機能を達成する他の種々の金属系が従米の文献に
於て数多く記載されている。
それらの中で最も良好な金属系の1つは、アルミニウム
とシリコンとの間の障壁層として当技術分野で広く用い
られているチタン−タングステン合金である。しかしな
がら、チタン−タングステン合金は半導体基板上に蒸着
され得ず、スパツタリングされねばならない。従つて、
この合金はリフト・オフ方法を用いてパターン状にされ
得ない。約0.5電子ボルトの低い障壁の高さを有する
シヨツトキ障壁ダイオードが長い間必要とされていた。
とシリコンとの間の障壁層として当技術分野で広く用い
られているチタン−タングステン合金である。しかしな
がら、チタン−タングステン合金は半導体基板上に蒸着
され得ず、スパツタリングされねばならない。従つて、
この合金はリフト・オフ方法を用いてパターン状にされ
得ない。約0.5電子ボルトの低い障壁の高さを有する
シヨツトキ障壁ダイオードが長い間必要とされていた。
例えば、ダイオード・トランジスタ論理(DTL)回路
に於ては、人力ダイオードの障壁の高さは約0.5電子
ボルトであることが望ましい。具体的に云えば、一般に
C3Lと称されているDTL型の回路は、該回路に於て
入力AND機能を行うシヨツトキ障壁ダイオードが上記
の障壁の高さを示すときに、最も有用である。C3L回
路については、19751EEEInternati0
na1S01id−StateCircuitsCOn
ferenee〜DigestOfTechnical
Papersl第168頁乃至第169頁に於てA.W
.Peltierによる1AdvancesinS01
1d−StateLOgic−ANewApprOae
htOBipOlarLSI:C3L” と題する論文
に記載されている。上記論文は、チタン、タングステン
、又はチタン−タングステン合金がいずれも上記の条件
を充たすことを述べている。しかしながら、これらの接
点は前述の欠截を有している。従つて、本発明の目的は
、シリコン半導体基板上に於ける改良されたタンタル接
点及びその形成方法を提供することである。
に於ては、人力ダイオードの障壁の高さは約0.5電子
ボルトであることが望ましい。具体的に云えば、一般に
C3Lと称されているDTL型の回路は、該回路に於て
入力AND機能を行うシヨツトキ障壁ダイオードが上記
の障壁の高さを示すときに、最も有用である。C3L回
路については、19751EEEInternati0
na1S01id−StateCircuitsCOn
ferenee〜DigestOfTechnical
Papersl第168頁乃至第169頁に於てA.W
.Peltierによる1AdvancesinS01
1d−StateLOgic−ANewApprOae
htOBipOlarLSI:C3L” と題する論文
に記載されている。上記論文は、チタン、タングステン
、又はチタン−タングステン合金がいずれも上記の条件
を充たすことを述べている。しかしながら、これらの接
点は前述の欠截を有している。従つて、本発明の目的は
、シリコン半導体基板上に於ける改良されたタンタル接
点及びその形成方法を提供することである。
本発明の他の目的は、改良された単一の金属系を用いて
オーム接点並びに高い及び低い障壁の高さを有するシヨ
ツトキ障壁ダイオード接点を形成するための方法を提供
することである。
オーム接点並びに高い及び低い障壁の高さを有するシヨ
ツトキ障壁ダイオード接点を形成するための方法を提供
することである。
本発明の他の目的は、改良されたタンタル付着方法を用
いて慎重に制御された障壁の高さを有するシヨツトキ障
壁ダイオード接点を形成するための方法を提供すること
である。
いて慎重に制御された障壁の高さを有するシヨツトキ障
壁ダイオード接点を形成するための方法を提供すること
である。
本発明の更に他の目的は、アルミニウムの相互接続金属
と適合し得る金属接点系を用いてタンタル接点を形成す
るための方法を提供することである。
と適合し得る金属接点系を用いてタンタル接点を形成す
るための方法を提供することである。
上記及び他の目的は、シリコン半導体基板上にタンタル
接点を形成するための本発明による方法によつて達成さ
れる。
接点を形成するための本発明による方法によつて達成さ
れる。
本発明による方法は選択可能な、慎重に制御された、低
い障壁の高さを有するショットキ障壁夕゛イオードを形
成する。具体的に云えば、本発明による方法を用いてタ
ンタルがN導電型シリコン上に直接付着されたとき、0
.5電子ボルトの障壁の高さが得られる。このダイオー
ドは長期間Vc匡る応力テストの間極めて安定である。
本発明による方法は、好ましくはタンタルを付着する前
にシリコン半導体基板をHF希薄溶液中に於て制御され
た照射条件の下で清浄化することによつて非晶質のシリ
コンが形成されない様にシリコン半導体基板の表面を処
理し、タンタルが酸化しない様に真空圧中に於て低い圧
力及び基板温度でタンタルを付着し、上記基板と上記タ
ンタルとの間に残つている表面電荷及び被膜を除去する
ために上記構造体を焼結させることを含む。
い障壁の高さを有するショットキ障壁夕゛イオードを形
成する。具体的に云えば、本発明による方法を用いてタ
ンタルがN導電型シリコン上に直接付着されたとき、0
.5電子ボルトの障壁の高さが得られる。このダイオー
ドは長期間Vc匡る応力テストの間極めて安定である。
本発明による方法は、好ましくはタンタルを付着する前
にシリコン半導体基板をHF希薄溶液中に於て制御され
た照射条件の下で清浄化することによつて非晶質のシリ
コンが形成されない様にシリコン半導体基板の表面を処
理し、タンタルが酸化しない様に真空圧中に於て低い圧
力及び基板温度でタンタルを付着し、上記基板と上記タ
ンタルとの間に残つている表面電荷及び被膜を除去する
ために上記構造体を焼結させることを含む。
タンタルの付着は、最高2.5×10−6T0rrの真
空圧及び最高200℃の基板温度に於て電子ビームによ
る蒸着を行うことによつて達成され得る。又、スパツタ
リングの前に始めに4×10−7TOrrの真空圧を有
しているチエンバ内に於て高周波スパツタリングを行う
ことによつても達成され得る。この様にして付着された
タンタルは又、N+導電型シリコン中に形成された金属
珪化物上に付着された場合にはオーム接点として、そし
てN一導電型シリコン中に形成された金属珪化物上に付
着された場合には高い障壁の高さを有するシヨツトキ障
壁ダイオードとしても有用である。アルミニウムが相互
接続金属として用いられる場合にfま、タンタルとアル
ミニウムとの間にクロム層が付着されねばならない。
空圧及び最高200℃の基板温度に於て電子ビームによ
る蒸着を行うことによつて達成され得る。又、スパツタ
リングの前に始めに4×10−7TOrrの真空圧を有
しているチエンバ内に於て高周波スパツタリングを行う
ことによつても達成され得る。この様にして付着された
タンタルは又、N+導電型シリコン中に形成された金属
珪化物上に付着された場合にはオーム接点として、そし
てN一導電型シリコン中に形成された金属珪化物上に付
着された場合には高い障壁の高さを有するシヨツトキ障
壁ダイオードとしても有用である。アルミニウムが相互
接続金属として用いられる場合にfま、タンタルとアル
ミニウムとの間にクロム層が付着されねばならない。
クロム層は、クロム元素を蒸着又はスパツタリングする
間水蒸気を流す方法(Water−Bleedingt
echnique)を用いることによつて形成される。
この金属系の長期間にαる信頼性は極めて著しい。次に
、図面を参照して、本発明による方法をその好実施例に
ついて更に詳細に説明する。
間水蒸気を流す方法(Water−Bleedingt
echnique)を用いることによつて形成される。
この金属系の長期間にαる信頼性は極めて著しい。次に
、図面を参照して、本発明による方法をその好実施例に
ついて更に詳細に説明する。
第1A図は本発明の方法によるシヨツトキ障壁ダイオー
ド(SBD)を含むべき半導体チツプの部分を示してい
る。通常は、何千個ものダイオード、及びトランジスタ
、抵抗等の如き他の半導体素子が同一チツプ内に含まれ
ることを理解されたい。チツプの基板1は例えば典型的
には10Ω一?の抵抗値を有するP一導電型のシリコン
として示されている。上記基板1上に、好ましくは1×
1016乃至8X10−16原子/Cdの導電率を有す
るN一導電型のエピタキシヤル層3が付着されている。
この構造体内【は、各々関連する導通領域5及び7を有
している領域4及び6が埋込まれている。基板1は又、
P+導電型のサブ分離領域2を含み、該領域はp+導電
型の分離領域8とともVC.N+導電型領域を分離させ
ている。領域2,4及び6は、基板1を露出させている
開孔中にそれらの領域を拡散する標準的な方法によつて
有利に形成される。
ド(SBD)を含むべき半導体チツプの部分を示してい
る。通常は、何千個ものダイオード、及びトランジスタ
、抵抗等の如き他の半導体素子が同一チツプ内に含まれ
ることを理解されたい。チツプの基板1は例えば典型的
には10Ω一?の抵抗値を有するP一導電型のシリコン
として示されている。上記基板1上に、好ましくは1×
1016乃至8X10−16原子/Cdの導電率を有す
るN一導電型のエピタキシヤル層3が付着されている。
この構造体内【は、各々関連する導通領域5及び7を有
している領域4及び6が埋込まれている。基板1は又、
P+導電型のサブ分離領域2を含み、該領域はp+導電
型の分離領域8とともVC.N+導電型領域を分離させ
ている。領域2,4及び6は、基板1を露出させている
開孔中にそれらの領域を拡散する標準的な方法によつて
有利に形成される。
典型的なN+導電型不純物は砒素又は燐であり、典型的
なP+導電型不純物は砒素である。それから、基板1か
らマスク層が従来の食刻技術により剥離されそしてエピ
タキシヤル層3が成長されて、領域2,4及び6が層3
中に外方拡散される。
なP+導電型不純物は砒素である。それから、基板1か
らマスク層が従来の食刻技術により剥離されそしてエピ
タキシヤル層3が成長されて、領域2,4及び6が層3
中に外方拡散される。
それから、典型的には2酸化シリコン層9と窒化シリコ
ン層10との複合層であるマスク層が層3の表面上に形
成され、該複合層中に開孔が形成され、そして導通領域
5及び1並びに分離領域8を形成するために各々N+導
電型及びP+導電型の不純物が上記開孔を通して拡散さ
れる。それから、白金層15が層10上及び開孔11,
12,13及び14内に全体的に付着される。好ましく
は、白金層は蒸着又はスバツタリングにより約400A
の厚さに付着される。開孔13中の2酸化シリコン層9
は該開孔内の白金が基板に接触することを防ぐ。第1B
図に於て、白金をシリコンと反応させて開孔11,12
及び14内に珪化白金層15′を形成するために、ウエ
ハが窒素雰囲気中に於て約550℃で20分間暁結され
る。
ン層10との複合層であるマスク層が層3の表面上に形
成され、該複合層中に開孔が形成され、そして導通領域
5及び1並びに分離領域8を形成するために各々N+導
電型及びP+導電型の不純物が上記開孔を通して拡散さ
れる。それから、白金層15が層10上及び開孔11,
12,13及び14内に全体的に付着される。好ましく
は、白金層は蒸着又はスバツタリングにより約400A
の厚さに付着される。開孔13中の2酸化シリコン層9
は該開孔内の白金が基板に接触することを防ぐ。第1B
図に於て、白金をシリコンと反応させて開孔11,12
及び14内に珪化白金層15′を形成するために、ウエ
ハが窒素雰囲気中に於て約550℃で20分間暁結され
る。
それから、2酸化シリコン層9及び窒化シリコン層10
上の白金を含む反応していない白金が王水中に於て食刻
されることにより除去される。周知の如く、パラジウム
、ニッケル、又はハフニウムの如き他の金属も白金の代
りに用いられ得る。第1C図に示されている如く、次の
工程に於て、低い障壁の高さを有するシヨツトキ障壁夕
゛イオード(SBD)の陽極を構成することになる基板
の部分を露出させるために、開孔13中に付着されてい
る2酸化シリコン層9の部分が標準的な湿式又は乾式の
食刻技術によつて除去される。次に、本発明の方法によ
る新規な金属系の付着が開孔11乃至14中に於て行わ
れる。
上の白金を含む反応していない白金が王水中に於て食刻
されることにより除去される。周知の如く、パラジウム
、ニッケル、又はハフニウムの如き他の金属も白金の代
りに用いられ得る。第1C図に示されている如く、次の
工程に於て、低い障壁の高さを有するシヨツトキ障壁夕
゛イオード(SBD)の陽極を構成することになる基板
の部分を露出させるために、開孔13中に付着されてい
る2酸化シリコン層9の部分が標準的な湿式又は乾式の
食刻技術によつて除去される。次に、本発明の方法によ
る新規な金属系の付着が開孔11乃至14中に於て行わ
れる。
その好ましい方法は、本出願人所有の米国特許第400
4044号の明細書に記載されているリフトオフ方法を
含む。
4044号の明細書に記載されているリフトオフ方法を
含む。
この方法は第1D図乃至第1F図に於て概略的に示され
ている。上記リフト・オフ方法の代り【、当技術分野に
於て周知である標準的な湿式の又は反応性イオン(プラ
ズマ)VCよる除去的食刻方法も用いられ得る。しかし
ながら、リフト・オフ方法は金属系を極めて良好に限定
することが出来、従つて配線に要する領域を最小限に留
め得る。 ゛第1D図に於て、リ
フト・オフ方法は、リフトオフ方法を容易にする薄いポ
リエーテル・スルホン層20を全体的に付着することに
よつて開始される。
ている。上記リフト・オフ方法の代り【、当技術分野に
於て周知である標準的な湿式の又は反応性イオン(プラ
ズマ)VCよる除去的食刻方法も用いられ得る。しかし
ながら、リフト・オフ方法は金属系を極めて良好に限定
することが出来、従つて配線に要する領域を最小限に留
め得る。 ゛第1D図に於て、リ
フト・オフ方法は、リフトオフ方法を容易にする薄いポ
リエーテル・スルホン層20を全体的に付着することに
よつて開始される。
ポリエーテル・スルホンの使用は、前述の米国特許に記
載されている技術の変形であり、IBMTechnic
alDisclOsureBulletin〜第19巻
、第4号、1976年9月、第1226頁に於けるUS
trippingPrOmOtOrfOrLift−0
ffMask1と題するCarr等による論文に記載さ
れている。ポリエーテル・スルホン層20上に、非感光
性にするために210乃至230℃の温度でベークされ
た、ノボラック樹脂を基材とするポジテイブ型レジスト
の如き有機重合体材料の層22が配置される。層22上
に、メチルシロキサン樹脂の障壁層24が被覆され、そ
の上に放射線感知レジスタ層26が被覆される。層26
が放射線に対して曝されそして現像されて、第1C図の
開孔11,12,13及び14に対応するパターン状の
レリーフ像が形成される。
載されている技術の変形であり、IBMTechnic
alDisclOsureBulletin〜第19巻
、第4号、1976年9月、第1226頁に於けるUS
trippingPrOmOtOrfOrLift−0
ffMask1と題するCarr等による論文に記載さ
れている。ポリエーテル・スルホン層20上に、非感光
性にするために210乃至230℃の温度でベークされ
た、ノボラック樹脂を基材とするポジテイブ型レジスト
の如き有機重合体材料の層22が配置される。層22上
に、メチルシロキサン樹脂の障壁層24が被覆され、そ
の上に放射線感知レジスタ層26が被覆される。層26
が放射線に対して曝されそして現像されて、第1C図の
開孔11,12,13及び14に対応するパターン状の
レリーフ像が形成される。
このレジスト層26のマスクを用いて、第1C図に示さ
れている開孔に対応する第1E図に示されている開孔1
1″,12″,13゛及び14゛を露出させるために下
の層20,22及び24が選択的に除去される。これら
の開孔が形成された後、珪化白金層15′を含む露出さ
れた基板が15:1又はそれ以下の比率の水と弗化水素
酸とから成る食刻液中に於て制御された放射条件の下で
予め清浄化される。
れている開孔に対応する第1E図に示されている開孔1
1″,12″,13゛及び14゛を露出させるために下
の層20,22及び24が選択的に除去される。これら
の開孔が形成された後、珪化白金層15′を含む露出さ
れた基板が15:1又はそれ以下の比率の水と弗化水素
酸とから成る食刻液中に於て制御された放射条件の下で
予め清浄化される。
5:1の比率が最も有利である。
制御された放射条〜件とは、5000Aよりも短い波長
を有する光が殆ど食刻工程中に於て存在していないこと
を意味する。
を有する光が殆ど食刻工程中に於て存在していないこと
を意味する。
この表面処理工程は、障壁の高さを増加させるので有害
である、接点領域に於ける非晶質シリコンの被膜の形成
を防ぐ。シリコン表面の処理は、低い障壁の高さを有す
る、即ち約0.5電子ボルトのSBDを達成するための
必要条件である。白色光の下で化学的食刻を行う標準的
技術を用いてゾリコン表面を清浄化してみたが、この技
術を用いた場合には、充分に低い障壁の高さを達成し得
ず、約0.61電子ボルトの障壁の高さが得られた。又
、スパッタリング・チエンバ内に於てその場でスパッタ
リングを行うことにより清浄化する技術を試みた。この
技術は約0.5電子ボルトの障壁の高さを達成したが、
その理想係数(IdealityfactOr)ηが高
すぎて約1.15であり、更に障壁の高さに再現性がな
い。第1E図に於て、タンタル層28が基板及びリフト
・オフ・マスク構造体上に全体的に付着される。
である、接点領域に於ける非晶質シリコンの被膜の形成
を防ぐ。シリコン表面の処理は、低い障壁の高さを有す
る、即ち約0.5電子ボルトのSBDを達成するための
必要条件である。白色光の下で化学的食刻を行う標準的
技術を用いてゾリコン表面を清浄化してみたが、この技
術を用いた場合には、充分に低い障壁の高さを達成し得
ず、約0.61電子ボルトの障壁の高さが得られた。又
、スパッタリング・チエンバ内に於てその場でスパッタ
リングを行うことにより清浄化する技術を試みた。この
技術は約0.5電子ボルトの障壁の高さを達成したが、
その理想係数(IdealityfactOr)ηが高
すぎて約1.15であり、更に障壁の高さに再現性がな
い。第1E図に於て、タンタル層28が基板及びリフト
・オフ・マスク構造体上に全体的に付着される。
低い障壁の高さを有するSBD接点を達成するためVc
は、タンタルの付着も又厳密な方法に従つて行われねば
ならない。タンタルの付着は電子ビームによる蒸着によ
つて最も良好に達成される。処理中に於ける蒸着チエン
バ内の最高圧力は2.5X10−6T0rrであり、チ
エンバ内の始めの圧力は4×10−7TOrrよりも低
くされる。基板の最高温度は200℃である。圧力は、
チエンバ内に存在する水蒸気、炭化水素、及び他の気体
汚染物の量に関連して重要である。圧力が高い程、水蒸
気及び汚染物は多くなつて、タンタルを僅かに酸化させ
、その結果0.5電子ボルトよりも高い障壁の高さを生
ぜしめることになる。この値の障壁の高さが許容され得
るならば、チエンバ内の圧力は余り重要ではなく、通常
の方法が用いられ得る。付着方法は、毎秒約2Aの速度
で行われ、600±150Aの厚さが達成される迄続け
られる。この方法を用いて形成されるタンタルぱ体心立
方(B.e.c)である。蒸着方法の代りに、タンタル
は同一の開始圧力及び温度条件の下で高周波スパツタリ
ングにより付着されてもよい。
は、タンタルの付着も又厳密な方法に従つて行われねば
ならない。タンタルの付着は電子ビームによる蒸着によ
つて最も良好に達成される。処理中に於ける蒸着チエン
バ内の最高圧力は2.5X10−6T0rrであり、チ
エンバ内の始めの圧力は4×10−7TOrrよりも低
くされる。基板の最高温度は200℃である。圧力は、
チエンバ内に存在する水蒸気、炭化水素、及び他の気体
汚染物の量に関連して重要である。圧力が高い程、水蒸
気及び汚染物は多くなつて、タンタルを僅かに酸化させ
、その結果0.5電子ボルトよりも高い障壁の高さを生
ぜしめることになる。この値の障壁の高さが許容され得
るならば、チエンバ内の圧力は余り重要ではなく、通常
の方法が用いられ得る。付着方法は、毎秒約2Aの速度
で行われ、600±150Aの厚さが達成される迄続け
られる。この方法を用いて形成されるタンタルぱ体心立
方(B.e.c)である。蒸着方法の代りに、タンタル
は同一の開始圧力及び温度条件の下で高周波スパツタリ
ングにより付着されてもよい。
直流スパツタリングは不適当である。直流スパツタリン
グにより付着されたタンタルは体心正方であり、高周波
スパツタリングにより付着されたタンタルは体心立方で
ある。タンタル層28が蒸着された後、クロム層30、
及びアルミニウム、銅をドープされたアルミニウム、又
は銅をドープされたアルミニウム−シリコンの層32が
好ましくは同一の蒸着チエンバ内に於て付着される。
グにより付着されたタンタルは体心正方であり、高周波
スパツタリングにより付着されたタンタルは体心立方で
ある。タンタル層28が蒸着された後、クロム層30、
及びアルミニウム、銅をドープされたアルミニウム、又
は銅をドープされたアルミニウム−シリコンの層32が
好ましくは同一の蒸着チエンバ内に於て付着される。
クロムは600乃至1000Aの好ましい厚さに付着さ
れる。
れる。
蒸着中、水蒸気が流されねばならない。基板は最高16
00Cに保たれ又は何ら熱を加えられない。クロムの付
着工程に於て、クロムの塊が炉床に配置され、水蒸気が
蒸着チエンバ内に流されて、蒸気チエンバが約10−5
T0rrに保たれる。電子ビームで加熱されると、クロ
ムが炉床から蒸発されて、障壁層の形成に重要なクロム
に変換される。水蒸気を流して蒸着されたクロムは粒子
の境界に酸化クロムを有するクロム粒子を有している。
純粋なクロムはアルミニウムとタンタルとの間の障壁と
して有効ではないことが解つた。アルミニウムは850
0乃至10000Aの厚さに有利に付着される。
00Cに保たれ又は何ら熱を加えられない。クロムの付
着工程に於て、クロムの塊が炉床に配置され、水蒸気が
蒸着チエンバ内に流されて、蒸気チエンバが約10−5
T0rrに保たれる。電子ビームで加熱されると、クロ
ムが炉床から蒸発されて、障壁層の形成に重要なクロム
に変換される。水蒸気を流して蒸着されたクロムは粒子
の境界に酸化クロムを有するクロム粒子を有している。
純粋なクロムはアルミニウムとタンタルとの間の障壁と
して有効ではないことが解つた。アルミニウムは850
0乃至10000Aの厚さに有利に付着される。
純粋なアルミニウムよりも少量の銅をドープされたアル
ミニウムが好ましい。本明細書の説明に於て用いられて
いる”アルミニウム1なる用語は又、銅をドープされた
アルミニウム及び銅をドープされたアルミニウム−シリ
コンをも含んでいる。その結果形成された中間的構造体
第1E図に示されている。残されているリフト・オフ・
マスク構造体及びその上の金属が、第1F図に示されて
いる如く基板又は窒化シリコン層10の表面に付着して
いる金属のパターンが残される様に、N−メチルピロリ
ドン又は他の適当な溶剤を用いて迅速にリフトオフされ
る。
ミニウムが好ましい。本明細書の説明に於て用いられて
いる”アルミニウム1なる用語は又、銅をドープされた
アルミニウム及び銅をドープされたアルミニウム−シリ
コンをも含んでいる。その結果形成された中間的構造体
第1E図に示されている。残されているリフト・オフ・
マスク構造体及びその上の金属が、第1F図に示されて
いる如く基板又は窒化シリコン層10の表面に付着して
いる金属のパターンが残される様に、N−メチルピロリ
ドン又は他の適当な溶剤を用いて迅速にリフトオフされ
る。
次に、構造体が400℃に於て1時間の間焼結され、そ
れから450℃に於て更に2時間の間焼結される。
れから450℃に於て更に2時間の間焼結される。
この焼結工程はシリコン基板とタンタルとの間の界面電
荷及び被膜を減少させるために重要である。上記の特定
の時間及び温度が最も有利であるが、通常の実験により
他の有効な値も得られる。この焼結工程は、クロム及び
アルミニウムを用いずにタンタルだけが接点材料として
用いられる場合でも、0.5電子ボルトの障壁の高さを
達成するために必要である。この様にして本発明による
方法が完成されて、高障壁の高さを有するSBD及び低
い障壁の高さを有するSBDの両者が形成される。
荷及び被膜を減少させるために重要である。上記の特定
の時間及び温度が最も有利であるが、通常の実験により
他の有効な値も得られる。この焼結工程は、クロム及び
アルミニウムを用いずにタンタルだけが接点材料として
用いられる場合でも、0.5電子ボルトの障壁の高さを
達成するために必要である。この様にして本発明による
方法が完成されて、高障壁の高さを有するSBD及び低
い障壁の高さを有するSBDの両者が形成される。
高い障壁の高さを有するSBDの陽極及び陰極は第1F
図に於て各々参照番号34及び35により示されている
。低い障壁の高さを有するSBDの陽極及び陰極は各々
参照番号36及び37により示されている以上の如く、
同一の金属系を用いて3つの異なる型の接点が形成され
る。
図に於て各々参照番号34及び35により示されている
。低い障壁の高さを有するSBDの陽極及び陰極は各々
参照番号36及び37により示されている以上の如く、
同一の金属系を用いて3つの異なる型の接点が形成され
る。
両方のSBDの陰極は層3中の▼導電型の導通領域5及
び7に対するオーム接点である。高い障壁の高さを有す
るSBDの陽極34は珪化白金層155とアルミニウム
層32との間に拡散障壁として働くクロム−タンタル金
属系を用いており、珪化白金層15′は 化白金属を用
いていない低い障壁の高さを有するSBDの陽極36の
場合と比べて障壁の高さを増加させる。陽極36に於て
は、タンタルそれ自体が直接N一導電型シリコンの基板
3に接触している。実際に於て、タンタル層は高割障壁
の高さを有するSBDを形成するために必要なものでは
ない。アルミニウム層、クロム層、及び珪化白金層から
成る接点で充分である。しかしながら、製造条件に於て
は、タンタル層をすべての接点開孔内に全体的に付着す
ることが実際的である。クロム層30はアルミニウムと
タンタルとの間の相互作用を防ぐ障壁として働くので重
要であることが解つた。
び7に対するオーム接点である。高い障壁の高さを有す
るSBDの陽極34は珪化白金層155とアルミニウム
層32との間に拡散障壁として働くクロム−タンタル金
属系を用いており、珪化白金層15′は 化白金属を用
いていない低い障壁の高さを有するSBDの陽極36の
場合と比べて障壁の高さを増加させる。陽極36に於て
は、タンタルそれ自体が直接N一導電型シリコンの基板
3に接触している。実際に於て、タンタル層は高割障壁
の高さを有するSBDを形成するために必要なものでは
ない。アルミニウム層、クロム層、及び珪化白金層から
成る接点で充分である。しかしながら、製造条件に於て
は、タンタル層をすべての接点開孔内に全体的に付着す
ることが実際的である。クロム層30はアルミニウムと
タンタルとの間の相互作用を防ぐ障壁として働くので重
要であることが解つた。
当技術分野に於て周知の如く、アルミニウムはシリコン
との間に有害な反応を生じ、又珪化白金中にも浸透して
シリコンと相互に作用する。しかしながら、当技術分野
に於て予想されなかつたことであるが、タンタルとアル
ミニウムとは焼結工程が行われるとき相互に反応して極
めて抵抗の大きい被膜を形成する。従つて、アルミニウ
ムとタンタルとの間に障壁としてクロムを挿入すること
が必要である。その結果、直列抵抗が相当に減少し、典
型的には約1タグオームから約100Ω迄減少する.又
、白金はアルミニウムとも反応してアルミニウムをタン
タル中に浸透せしめるので、白金はアルミニウムとタン
タルとの間の有効な障壁材料ではないことも解つた。タ
ンタルとアルミニウムとの間に障壁としてクロムを挿入
することが極めて重要であることは、第2図のグラフを
参照することにより説明され得る。
との間に有害な反応を生じ、又珪化白金中にも浸透して
シリコンと相互に作用する。しかしながら、当技術分野
に於て予想されなかつたことであるが、タンタルとアル
ミニウムとは焼結工程が行われるとき相互に反応して極
めて抵抗の大きい被膜を形成する。従つて、アルミニウ
ムとタンタルとの間に障壁としてクロムを挿入すること
が必要である。その結果、直列抵抗が相当に減少し、典
型的には約1タグオームから約100Ω迄減少する.又
、白金はアルミニウムとも反応してアルミニウムをタン
タル中に浸透せしめるので、白金はアルミニウムとタン
タルとの間の有効な障壁材料ではないことも解つた。タ
ンタルとアルミニウムとの間に障壁としてクロムを挿入
することが極めて重要であることは、第2図のグラフを
参照することにより説明され得る。
第2図のグラフは、タンタル層と銅をドープされたアル
ミニウム層との複合層を含むSBDの場合及びタンタル
層と、クロム層と、銅をドープされたアルミニウム層と
の複合層を含むSBDの場合について、順方向電圧に於
ける百分率変化(ΔVF(!))を時間に関して示して
いる。後者の金属系は前者の金属系より4倍乃至6倍も
安定であることが理解され得る。第3図は、本発明によ
る方法に従つて同一チップ上に形成された高い障壁の高
さを有するSBD及び低い障壁の高さを有するSBDV
C於て測定された順方向電流一電圧特性を示すグラフで
ある。
ミニウム層との複合層を含むSBDの場合及びタンタル
層と、クロム層と、銅をドープされたアルミニウム層と
の複合層を含むSBDの場合について、順方向電圧に於
ける百分率変化(ΔVF(!))を時間に関して示して
いる。後者の金属系は前者の金属系より4倍乃至6倍も
安定であることが理解され得る。第3図は、本発明によ
る方法に従つて同一チップ上に形成された高い障壁の高
さを有するSBD及び低い障壁の高さを有するSBDV
C於て測定された順方向電流一電圧特性を示すグラフで
ある。
両SBDの陽極領域は同一である。低い障壁の高さを有
するSBDの障壁の高さφBは略0.5電子ボルトであ
り、理想係数ηは略1.10である。高い障壁の高さを
有するSBDの障壁の高さφBは略0.8電子ボルトで
あり、理想係数ηは略1.06である。前述の如く、本
発明による方法は低い障壁の高さを有するSBDを必要
とする集積回路に於て特に有用である。
するSBDの障壁の高さφBは略0.5電子ボルトであ
り、理想係数ηは略1.10である。高い障壁の高さを
有するSBDの障壁の高さφBは略0.8電子ボルトで
あり、理想係数ηは略1.06である。前述の如く、本
発明による方法は低い障壁の高さを有するSBDを必要
とする集積回路に於て特に有用である。
第4図に示されているその様な回路の1つは、NAND
機能を行う従来技術によるDTL型の回路である。この
回路は本発明による方法それ自体の要旨を成すものでは
なく、当技術分野に於て周知のものである。又、本発明
による方法はチツプに於けるこの特定の回路又は配置に
何ら限定されるものではないことも理解されたい。実際
に於て、本発明による方法ぱTTLl標準的DTL等の
如き種々の回路に適用され得る。この型の回路及びその
変形については、1975IEEEInternati
0na1S01id−StateCircuitsCO
nferenceshDigestOfTechnie
alPapers5第168頁乃至第169頁に於て8
ANewAppr0acht0Bip01arLSI:
C3L”と題するPeltierによる前述の論文に記
載されている。第4図に示されている回路は、単一のト
ランジスタT1、トランジスタT1のベース領域及びコ
レクタ領域に各々接続されている1対のバイアス抵抗R
B及びRCl並びにクランプ・ダイオードとして用いら
れている高い障壁を有するシヨツトキ障壁ダイオードD
Oを含んでいる。ゲートは、Dl,D2,D3,D4,
D5及びD6として示されている低い障壁の高さを有す
るSBDの形で6つの接続可能な出力、並びにCとして
示されているコレクタ領域へのオーム接点を有している
。第5図はDTLセルの断面図であり、当技術分野に於
て周知の如くこの様なセルが半導体チツプ上に同一の形
で数百個設けられている。
機能を行う従来技術によるDTL型の回路である。この
回路は本発明による方法それ自体の要旨を成すものでは
なく、当技術分野に於て周知のものである。又、本発明
による方法はチツプに於けるこの特定の回路又は配置に
何ら限定されるものではないことも理解されたい。実際
に於て、本発明による方法ぱTTLl標準的DTL等の
如き種々の回路に適用され得る。この型の回路及びその
変形については、1975IEEEInternati
0na1S01id−StateCircuitsCO
nferenceshDigestOfTechnie
alPapers5第168頁乃至第169頁に於て8
ANewAppr0acht0Bip01arLSI:
C3L”と題するPeltierによる前述の論文に記
載されている。第4図に示されている回路は、単一のト
ランジスタT1、トランジスタT1のベース領域及びコ
レクタ領域に各々接続されている1対のバイアス抵抗R
B及びRCl並びにクランプ・ダイオードとして用いら
れている高い障壁を有するシヨツトキ障壁ダイオードD
Oを含んでいる。ゲートは、Dl,D2,D3,D4,
D5及びD6として示されている低い障壁の高さを有す
るSBDの形で6つの接続可能な出力、並びにCとして
示されているコレクタ領域へのオーム接点を有している
。第5図はDTLセルの断面図であり、当技術分野に於
て周知の如くこの様なセルが半導体チツプ上に同一の形
で数百個設けられている。
トランジスタT,は細長いサブコレクタ領域104、ベ
ース領域123、及びエミッタ領域124を含んでいる
。
ース領域123、及びエミッタ領域124を含んでいる
。
シヨツトキ障壁ダイオードD1乃至D6はエピタキシヤ
ル層103中にトランジスタTlの両側に対称的に形成
されている。コレクタ領域へのオーム接点Cによつてト
ランジスタTlが完成される。抵抗RB及びRCは示さ
れていない。第5図に示されている如く、実際に回路に
接続されているダイオードだけが、実際にダイオードを
形成するために必要な本発明の方法に於ける新規な金属
系を有している。従つて、実際に用いられている不純物
領域の数は設けられ得るダイオードの最大数よりも少な
く、用いられていないシヨツトキ障壁ダイオードD2及
びD6の位置が点線により示されている。シヨツトキ障
壁ダイオードDl,D3,D4及びD5は本発明による
方法に従つて形成された低い障壁の高さを有するSBD
である。
ル層103中にトランジスタTlの両側に対称的に形成
されている。コレクタ領域へのオーム接点Cによつてト
ランジスタTlが完成される。抵抗RB及びRCは示さ
れていない。第5図に示されている如く、実際に回路に
接続されているダイオードだけが、実際にダイオードを
形成するために必要な本発明の方法に於ける新規な金属
系を有している。従つて、実際に用いられている不純物
領域の数は設けられ得るダイオードの最大数よりも少な
く、用いられていないシヨツトキ障壁ダイオードD2及
びD6の位置が点線により示されている。シヨツトキ障
壁ダイオードDl,D3,D4及びD5は本発明による
方法に従つて形成された低い障壁の高さを有するSBD
である。
それらは、略0.5電子ボルトの障壁の高さφBを達成
するため、N一導電型シリコンのエピタキシヤル層10
3、タンタル層128、クロム層130、及びアルミニ
ウム一銅の相互接続金属層132を有している。クラン
プ・ダイオードD。は、略0.8電子ボルトの障壁の高
さφBを達成するため、珪化白金層115を含んでいる
。金属パターンを形成するためにリフト・オフ方法を用
いる代りに、除去的食刻、反応性イオン(プラズマ)に
よる食刻、又は化学的食刻も用いられ得る。
するため、N一導電型シリコンのエピタキシヤル層10
3、タンタル層128、クロム層130、及びアルミニ
ウム一銅の相互接続金属層132を有している。クラン
プ・ダイオードD。は、略0.8電子ボルトの障壁の高
さφBを達成するため、珪化白金層115を含んでいる
。金属パターンを形成するためにリフト・オフ方法を用
いる代りに、除去的食刻、反応性イオン(プラズマ)に
よる食刻、又は化学的食刻も用いられ得る。
それらの場合にも、同一の表面処理工程、チエンバ内の
真空圧条件、及び焼結工程が必要である。前述の如く、
これらの方法はリフト・オフ方法程有利ではない。これ
らの各食刻方法に於ては、タンタル層、クロム層、銅を
ドーブされたアルミニウム層又は銅をドーブされたアル
ミニウム−シリコン層が第1A図に示されている開孔1
1,12,13及び14中に全体的に付着される。
真空圧条件、及び焼結工程が必要である。前述の如く、
これらの方法はリフト・オフ方法程有利ではない。これ
らの各食刻方法に於ては、タンタル層、クロム層、銅を
ドーブされたアルミニウム層又は銅をドーブされたアル
ミニウム−シリコン層が第1A図に示されている開孔1
1,12,13及び14中に全体的に付着される。
ポジテイブ型のパターンが、Shipley社製のAZ
l35O又はAZlll(商品名)の如きポジテイブ型
レジストを用いて限定される。露出された不要な金属層
が、除去的食刻方法に於ては標準的な湿式の金属食刻剤
によつて、又はプラズマ食刻方法に於てはCct4−A
rガス混合物を含むプラズマ食刻チエンバ内に基板を配
置することによつて除去される。
l35O又はAZlll(商品名)の如きポジテイブ型
レジストを用いて限定される。露出された不要な金属層
が、除去的食刻方法に於ては標準的な湿式の金属食刻剤
によつて、又はプラズマ食刻方法に於てはCct4−A
rガス混合物を含むプラズマ食刻チエンバ内に基板を配
置することによつて除去される。
化学的食刻方法に於ては、露出されたアルミニウムがH
3PO4−HNO3−H2Oの混合物によつて除去され
る。
3PO4−HNO3−H2Oの混合物によつて除去され
る。
次に、露出されたクロムが507のKMnO4と1tf
)Azl35Oの現像剤との混合物によつて除去される
。それから、残されているアルミニウムをマスクとして
タンタルがスパツタリング食刻により除去される。金属
パターンの幅が0.25倫よりも広い場合には、タンタ
ルは1部のHFと、20部のHNO3と、20部のH2
Oとの混合物によつて除去され得る。以上に於て、本発
明による方法をその好実施例について説明したが、他の
変更も可能である。
)Azl35Oの現像剤との混合物によつて除去される
。それから、残されているアルミニウムをマスクとして
タンタルがスパツタリング食刻により除去される。金属
パターンの幅が0.25倫よりも広い場合には、タンタ
ルは1部のHFと、20部のHNO3と、20部のH2
Oとの混合物によつて除去され得る。以上に於て、本発
明による方法をその好実施例について説明したが、他の
変更も可能である。
例えば、以上の説明に於ては、本発明による方法を、オ
ーム接点、高い障壁の高さを有するSBD接点、及び低
い障壁の高さを有するSBD接点を有する集積回路構造
体に関して説明したが、その様な接点のすべてを形成す
る必要はないことを理解されたい。
ーム接点、高い障壁の高さを有するSBD接点、及び低
い障壁の高さを有するSBD接点を有する集積回路構造
体に関して説明したが、その様な接点のすべてを形成す
る必要はないことを理解されたい。
第1A図乃至第1F図は本発明による方法の種種の段階
に於ける半導体素子を示す部分的断面図であり、第2図
はタンタル層とアルミニウム層とを含むシヨツトキ障壁
夕゛イオード(SBD)の場合及びタンタル層と、クロ
ム層と、アルミニウム層とを含むSBDの場合について
応力の下に於ける順方向電圧の百分率変化を時間に関し
て示すグラフであり、第3図は本発明による方法に従つ
て形成された高!障壁の高さを有するSBD及び低い障
壁の高さを有するSBDf)順方向電流一電圧特性を示
ずグラフであり、第4図はダイオード・トランジスタ論
理(DTL)型の回路を示す図であり、第5図は本発明
による方法に従つて形成されたSBDを有する半導体装
置としての上記DTL型の回路を示す断面図である。 1・・・基板、2・・・サブ分離領域、3・・・エピタ
キシヤル層、4,6・・・埋込領域、5,7・・・導通
領域、8・・・分離領域、9・・・2酸化シリコン層、
10・・・窒化シリコン層、11,115、12,12
′,13,13゛,14,14′・・・開孔、15・・
・白金層、15ζ・・珪化白金層、20・・・ポリエー
テル・スルホン層、22・・・非感光性にされた有機重
合体材料の層、24・・・障壁層、26・・・放射線感
知レジスト層、28・・・タンタル層、30・・・クロ
ム層、32・・・アルミニウム層、34・・・高い障壁
の高さを有するSBDの陽極(高い障壁の高さを有する
SBD接点)、35・・・高い障壁の高さを有するSB
Dの陰極(オーム接点)、36・・・低い障壁の高さを
有するSBDの陽極(低い障壁の高さを有するSBDの
接点)、37・・・低い障壁の高さを有するSBDの陰
極(オーム接点)。
に於ける半導体素子を示す部分的断面図であり、第2図
はタンタル層とアルミニウム層とを含むシヨツトキ障壁
夕゛イオード(SBD)の場合及びタンタル層と、クロ
ム層と、アルミニウム層とを含むSBDの場合について
応力の下に於ける順方向電圧の百分率変化を時間に関し
て示すグラフであり、第3図は本発明による方法に従つ
て形成された高!障壁の高さを有するSBD及び低い障
壁の高さを有するSBDf)順方向電流一電圧特性を示
ずグラフであり、第4図はダイオード・トランジスタ論
理(DTL)型の回路を示す図であり、第5図は本発明
による方法に従つて形成されたSBDを有する半導体装
置としての上記DTL型の回路を示す断面図である。 1・・・基板、2・・・サブ分離領域、3・・・エピタ
キシヤル層、4,6・・・埋込領域、5,7・・・導通
領域、8・・・分離領域、9・・・2酸化シリコン層、
10・・・窒化シリコン層、11,115、12,12
′,13,13゛,14,14′・・・開孔、15・・
・白金層、15ζ・・珪化白金層、20・・・ポリエー
テル・スルホン層、22・・・非感光性にされた有機重
合体材料の層、24・・・障壁層、26・・・放射線感
知レジスト層、28・・・タンタル層、30・・・クロ
ム層、32・・・アルミニウム層、34・・・高い障壁
の高さを有するSBDの陽極(高い障壁の高さを有する
SBD接点)、35・・・高い障壁の高さを有するSB
Dの陰極(オーム接点)、36・・・低い障壁の高さを
有するSBDの陽極(低い障壁の高さを有するSBDの
接点)、37・・・低い障壁の高さを有するSBDの陰
極(オーム接点)。
Claims (1)
- 【特許請求の範囲】 1 シリコン半導体基板と、上記基板上に配置されたタ
ンタル層と、上記タンタル層上に配置されたクロム酸化
物を有するクロム層と、上記クロム層上に配置されたア
ルミニウム層とを含むショットキ障壁ダイオード接点を
構成するタンタル接点。 2 非晶質のシリコンが形成されない様にシリコン半導
体基板の少なくとも一部の表面を処理し、上記表面上に
タンタルが酸化しない様に真空チエンバ内に於て低い圧
力及び基板温度でタンタルを付着し、水蒸気雰囲気中で
クロムを蒸着することによりクロム酸化物を有するクロ
ムを上記タンタル上に付着し、上記クロム上にアルミニ
ウムを付着し、上記基板と上記タンタルとの間から界面
電荷及び被膜を除去するために上記構造体を充分な温度
及び時間で焼結させることを含む、シリコン半導体基板
上にショットキ障壁ダイオード接点を構成するタンタル
接点を形成するための方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US05/827,912 US4215156A (en) | 1977-08-26 | 1977-08-26 | Method for fabricating tantalum semiconductor contacts |
US000000827912 | 1977-08-26 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5436178A JPS5436178A (en) | 1979-03-16 |
JPS5932069B2 true JPS5932069B2 (ja) | 1984-08-06 |
Family
ID=25250468
Family Applications (1)
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---|---|---|---|
JP53084103A Expired JPS5932069B2 (ja) | 1977-08-26 | 1978-07-12 | タンタル接点及びその形成方法 |
Country Status (6)
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---|---|
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EP (1) | EP0000743B1 (ja) |
JP (1) | JPS5932069B2 (ja) |
CA (1) | CA1111570A (ja) |
DE (1) | DE2860169D1 (ja) |
IT (1) | IT1158954B (ja) |
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JPH0312134Y2 (ja) * | 1984-06-29 | 1991-03-22 | ||
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