JPS592431A - アナログ・デイジタル変換器 - Google Patents
アナログ・デイジタル変換器Info
- Publication number
- JPS592431A JPS592431A JP10970382A JP10970382A JPS592431A JP S592431 A JPS592431 A JP S592431A JP 10970382 A JP10970382 A JP 10970382A JP 10970382 A JP10970382 A JP 10970382A JP S592431 A JPS592431 A JP S592431A
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- JP
- Japan
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- signal
- input
- voltage
- reference voltage
- converter
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/18—Automatic control for modifying the range of signals the converter can handle, e.g. gain ranging
- H03M1/186—Automatic control for modifying the range of signals the converter can handle, e.g. gain ranging in feedforward mode, i.e. by determining the range to be selected directly from the input signal
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/36—Analogue value compared with reference values simultaneously only, i.e. parallel type
- H03M1/361—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type
- H03M1/362—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type the reference values being generated by a resistive voltage divider
- H03M1/365—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type the reference values being generated by a resistive voltage divider the voltage divider being a single resistor string
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、テレビ（ＴＶ）、ビデオデーグレコーダ（Ｖ
ＴＲ）などにおけるビデオ信号などのアナログ信号をデ
ィジタル信号に変換するためのアナログ・ディジタル変
換器に関するものでちる。
ＴＲ）などにおけるビデオ信号などのアナログ信号をデ
ィジタル信号に変換するためのアナログ・ディジタル変
換器に関するものでちる。
第１図に従来のアナログ・ディジタル変換器をブロック
図で示す。第１図において、アナログ・ディジタル変換
器１（以後ルω変換器とする）の入力端子１０１Ｋｉ’
ｊ、ＴＶ２ 、 Ｖ１’Ｒ５、ヒｙ” 、ｔ ｍ器４な
ど、１ケまたはそれ以上の複数個の機器選択的にりシ換
えて接続される。ルの変換器１の構成について述べる。
図で示す。第１図において、アナログ・ディジタル変換
器１（以後ルω変換器とする）の入力端子１０１Ｋｉ’
ｊ、ＴＶ２ 、 Ｖ１’Ｒ５、ヒｙ” 、ｔ ｍ器４な
ど、１ケまたはそれ以上の複数個の機器選択的にりシ換
えて接続される。ルの変換器１の構成について述べる。
ここでは並列形ルω変換器を図示している。い−ま分解
能をルビットとすると、図で示すように（２−１）個の
比較器１０３を必要とし、それぞれの比較器の入力端子
を並列接続する。また各比較器の基本′電圧として、共
通基準筒１圧源（Ｖｒｇｆ）１０２と直列に接続した２
ｒＬ個の抵抗１０４によ多分割し、それぞれの比較器Ｋ
対応り、 タ基４ｋ Ｎ ）Ｅ ＶＲ＋ 、Ｖａ２．
Ｖａ（２’−２） 、ＦＲ（２”−１）を供給する。各
比！Ｐ！２器の出力（２ｒＬ個）はエンコーディング・
ロジック回路１０５に入力され、２ｎ個の情報をルビッ
トのディジタル・ワードに変換されるう以上が並列形Ａ
１１）変換器１の構成および機能である。に記７４／Ｄ
変換器１の許容入力振幅レベル（以後フル・りくクール
と呼ぶ）は該共通基準電圧源１０２の電圧値により決−
まυ。
能をルビットとすると、図で示すように（２−１）個の
比較器１０３を必要とし、それぞれの比較器の入力端子
を並列接続する。また各比較器の基本′電圧として、共
通基準筒１圧源（Ｖｒｇｆ）１０２と直列に接続した２
ｒＬ個の抵抗１０４によ多分割し、それぞれの比較器Ｋ
対応り、 タ基４ｋ Ｎ ）Ｅ ＶＲ＋ 、Ｖａ２．
Ｖａ（２’−２） 、ＦＲ（２”−１）を供給する。各
比！Ｐ！２器の出力（２ｒＬ個）はエンコーディング・
ロジック回路１０５に入力され、２ｎ個の情報をルビッ
トのディジタル・ワードに変換されるう以上が並列形Ａ
１１）変換器１の構成および機能である。に記７４／Ｄ
変換器１の許容入力振幅レベル（以後フル・りくクール
と呼ぶ）は該共通基準電圧源１０２の電圧値により決−
まυ。
固定の値である。しかるに第１図で示したまうに該ルの
変換器１０入力としては、ＴＶ２およびＶＴＲ５等のビ
デオ機器が複数個選択的に接続される。よって上記ビデ
オ機器のビデオ信号の振幅値はそれぞれ異るために、あ
るビデオ機器のビデオ信号の振幅値が、該、壺ノ変換器
１のフル・スケールよりも大きいと飽和してしまい、上
記ビデオ信号に比例したディジタル信号に変換できない
場合が生じる。
変換器１０入力としては、ＴＶ２およびＶＴＲ５等のビ
デオ機器が複数個選択的に接続される。よって上記ビデ
オ機器のビデオ信号の振幅値はそれぞれ異るために、あ
るビデオ機器のビデオ信号の振幅値が、該、壺ノ変換器
１のフル・スケールよりも大きいと飽和してしまい、上
記ビデオ信号に比例したディジタル信号に変換できない
場合が生じる。
そこで本発明の目的は、上述した従来のルの変換器の欠
点を解決し、各種のビデオ信号レベルに対応できるルω
変換器を提供することにある。
点を解決し、各種のビデオ信号レベルに対応できるルω
変換器を提供することにある。
上記の解決策として、Ａ／Ｄ変換器１の共通基準電圧源
（＃’ｒｇ７）１０２を入力したビデオ信号の振幅レベ
ルに合わせ′〔変。化する可変共通基準電圧源とする。
（＃’ｒｇ７）１０２を入力したビデオ信号の振幅レベ
ルに合わせ′〔変。化する可変共通基準電圧源とする。
その制御方法は、入力したビデオ信号と上記可変共通基
準電圧源の電圧値とを比較検知回路によシ比較し、その
差電圧を上記可変共通基準電圧源の制御信号とする。こ
れにょシ、入力したビデオ信号の振幅レベルはフルスケ
ール以上にはならず、飽和することがないので常に入力
に出側したディジタル信号に変換できる。
準電圧源の電圧値とを比較検知回路によシ比較し、その
差電圧を上記可変共通基準電圧源の制御信号とする。こ
れにょシ、入力したビデオ信号の振幅レベルはフルスケ
ール以上にはならず、飽和することがないので常に入力
に出側したディジタル信号に変換できる。
以下本発明の一実施例を第２図および第３図によ漫説明
する。第２図において第１図と同等の部分、覗いは同一
部分については同じ番号を付し、その詳しい説明は省略
する。第２図において、該ＶＤ変換器１０入力端子１０
１は、１つけ該比較器１０５の入力端子へ接続し、他方
はビデオ信号の同期振幅レベルを検知する検知回路１０
６に接続する。該検知回路１０６の出力信号は制御信号
発生回路１０７の一方の入力端子へ接続する。該制御信
号発生回路１０７の他方の入力端子には、可変共通基準
電圧源１０２の電圧値を、減衰回路１０８を介して得ら
れた信号を接続する。
する。第２図において第１図と同等の部分、覗いは同一
部分については同じ番号を付し、その詳しい説明は省略
する。第２図において、該ＶＤ変換器１０入力端子１０
１は、１つけ該比較器１０５の入力端子へ接続し、他方
はビデオ信号の同期振幅レベルを検知する検知回路１０
６に接続する。該検知回路１０６の出力信号は制御信号
発生回路１０７の一方の入力端子へ接続する。該制御信
号発生回路１０７の他方の入力端子には、可変共通基準
電圧源１０２の電圧値を、減衰回路１０８を介して得ら
れた信号を接続する。
そして該制御信号発生回路１０７の出力を、該可変共通
基準電圧源１０２０制御端子へ印加する。
基準電圧源１０２０制御端子へ印加する。
上記構成のルの変換器１についての動作を詳しく述べる
。入力機器であるＴＶまたはＶＴＲ等の各種ビデオ機器
２，５．４よ多出力されるビデオ信号は第５図で示した
波形であることは周知である。そして、同期（／１号振
幅レベルｒαと輝度信号振幅レベルの最大値Ｖｈとは、
常に一定の比率になるように規格化されている。よって
、ビデオ信号の最大振幅ｌ／ベルｒｃは、 Ｖｃ−Ｖｃｔ＋Ｖｂ−（１＋、Ｋ）Ｖａ タｆｒ： シ
に−Ｖｂ／Ｖａとなる。ゆえに上記同期信号振幅レベル
ｒαを検知し、その値を（トＫ）倍するとビデオ信号の
最大振幅レベルｌ’ｃとなる。いま、該ルの変換器１に
核ビデオ機器２，５．４のうち、いずれか１つが選択さ
れ、そのビデオ信号が該ルの変換器１に入力されると上
記ビデオ信号は、該比較器１０５と該検知回路１０６に
入力される。該検知回路１ｏ６は同期信号の振幅レベル
値ｒαを出方し、該制御信号発生回路１０７の′−°方
へ入力式れる。該制御信号発生回路１０７の他方の入力
端子にｔｄ、該ＶＤ変換器１のフルスケールを決める該
可変共通基準電圧源１０２０電圧値を該減衰器１０８に
ょシ。
。入力機器であるＴＶまたはＶＴＲ等の各種ビデオ機器
２，５．４よ多出力されるビデオ信号は第５図で示した
波形であることは周知である。そして、同期（／１号振
幅レベルｒαと輝度信号振幅レベルの最大値Ｖｈとは、
常に一定の比率になるように規格化されている。よって
、ビデオ信号の最大振幅ｌ／ベルｒｃは、 Ｖｃ−Ｖｃｔ＋Ｖｂ−（１＋、Ｋ）Ｖａ タｆｒ： シ
に−Ｖｂ／Ｖａとなる。ゆえに上記同期信号振幅レベル
ｒαを検知し、その値を（トＫ）倍するとビデオ信号の
最大振幅レベルｌ’ｃとなる。いま、該ルの変換器１に
核ビデオ機器２，５．４のうち、いずれか１つが選択さ
れ、そのビデオ信号が該ルの変換器１に入力されると上
記ビデオ信号は、該比較器１０５と該検知回路１０６に
入力される。該検知回路１ｏ６は同期信号の振幅レベル
値ｒαを出方し、該制御信号発生回路１０７の′−°方
へ入力式れる。該制御信号発生回路１０７の他方の入力
端子にｔｄ、該ＶＤ変換器１のフルスケールを決める該
可変共通基準電圧源１０２０電圧値を該減衰器１０８に
ょシ。
一定の減衰量である”／（＋＋ｚ）に減衰した電圧が、
基準電圧１’ｒとして印加される。該制御信号発生Ｖα
と、上記基準電圧Ｖｒとを比較し、それらの差電圧を出
力する。この差電圧は、該可変共通基準電圧源１０２０
制御端子に印加され、Ｖａ４ｒとなるようにａｏＪ変共
通基準直圧源１０２の電圧値を定める。このときの該可
変共通基準電圧源＋０２の電圧値は、入力したビデオ信
号の最大振幅レベル１ｔ６と等しくなる。よって該Ａ／
Ｄ変換器１０入力に、種々の入力レベルの異なったビデ
オ信号が選択的に入力されても、その人力したビデオ信
号の最大部幅レベルは、該べ、／ｌ）変換器１のフルス
ケール以上には成りえず、飽和することがないので常に
入力されたビデ第４ｇ号に比例したディジタル信号に変
換できる。
基準電圧１’ｒとして印加される。該制御信号発生Ｖα
と、上記基準電圧Ｖｒとを比較し、それらの差電圧を出
力する。この差電圧は、該可変共通基準電圧源１０２０
制御端子に印加され、Ｖａ４ｒとなるようにａｏＪ変共
通基準直圧源１０２の電圧値を定める。このときの該可
変共通基準電圧源＋０２の電圧値は、入力したビデオ信
号の最大振幅レベル１ｔ６と等しくなる。よって該Ａ／
Ｄ変換器１０入力に、種々の入力レベルの異なったビデ
オ信号が選択的に入力されても、その人力したビデオ信
号の最大部幅レベルは、該べ、／ｌ）変換器１のフルス
ケール以上には成りえず、飽和することがないので常に
入力されたビデ第４ｇ号に比例したディジタル信号に変
換できる。
本発明によれば、入力したビデオ信号の最大振幅レベル
が、 ＡＩＤ変換器のフルスケールを越えることがない
ので、どのようなビデオ信号レベルに対しても、常に入
力されたビデオ信号に比例したディジタル信号に変換す
ることができる。
が、 ＡＩＤ変換器のフルスケールを越えることがない
ので、どのようなビデオ信号レベルに対しても、常に入
力されたビデオ信号に比例したディジタル信号に変換す
ることができる。
第１図は従来のアナログ・ディジタル変換器を示すブロ
ック図、第２図は本発明の一実施例を示すブロック図、
第５図は入力されるビデオ信号の波形を示す波形図であ
る。
ック図、第２図は本発明の一実施例を示すブロック図、
第５図は入力されるビデオ信号の波形を示す波形図であ
る。
符号説明
１・・・ルの変換器、
２．５．４・・・ビデオ入力機器、
＋（Ｉｔｓ・・・同期信号レベル検知回路、１０７・・
・制御信号発生回路、 ＋０８・・・減衰器、 １０２・・・共通基準
電圧源。
・制御信号発生回路、 ＋０８・・・減衰器、 １０２・・・共通基準
電圧源。
Claims (1)
- １）アナログ・ディジタル変換器において、変換のため
の基準電圧を発生する電圧源として可変基準電圧源を用
い、該電圧源から得られた第１の電圧と、入力アナログ
電圧から得られた第２の電圧とを比較する手段と、比較
結果に基いて前記可変基準電圧源における発生電圧を制
御する手段とを備え、入力アナログ電圧のレベルに応じ
て可変的に適切な基準纜圧の発生を可能にしたことを特
徴とするアナログ・ディジタル変換器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10970382A JPS592431A (ja) | 1982-06-28 | 1982-06-28 | アナログ・デイジタル変換器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10970382A JPS592431A (ja) | 1982-06-28 | 1982-06-28 | アナログ・デイジタル変換器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS592431A true JPS592431A (ja) | 1984-01-09 |
Family
ID=14517065
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10970382A Pending JPS592431A (ja) | 1982-06-28 | 1982-06-28 | アナログ・デイジタル変換器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS592431A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61112414A (ja) * | 1984-11-06 | 1986-05-30 | Nec Corp | 自動レベル制御回路 |
| JPS61142823A (ja) * | 1984-12-17 | 1986-06-30 | Tokyo Keiki Co Ltd | 信号変換方式 |
| JPH0341827A (ja) * | 1989-07-07 | 1991-02-22 | Teac Corp | アナログ・デイジタル変換器を含む回路装置 |
| JPH0587639U (ja) * | 1991-07-02 | 1993-11-26 | タイガー魔法瓶株式会社 | マイクロコンピュータの入力データ分解能可変装置 |
| US5688310A (en) * | 1992-07-06 | 1997-11-18 | Mauret; Pierre | Corrosion protection material and method, and use thereof for aluminumalloys |
| KR100601058B1 (ko) | 2004-04-01 | 2006-07-19 | 백인우 | 모래 세척 장치 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5323553A (en) * | 1976-08-18 | 1978-03-04 | Toshiba Corp | Encoder circu it |
| JPS5461453A (en) * | 1977-10-26 | 1979-05-17 | Hitachi Ltd | Analog-digital conversion circuit |
| JPS5630053U (ja) * | 1979-08-13 | 1981-03-23 | ||
| JPS56126390A (en) * | 1980-03-10 | 1981-10-03 | Sanyo Electric Co Ltd | A-d converting circuit of video signal |
-
1982
- 1982-06-28 JP JP10970382A patent/JPS592431A/ja active Pending
Patent Citations (4)
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| Publication number | Priority date | Publication date | Assignee | Title |
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| JPH0420523B2 (ja) * | 1984-11-06 | 1992-04-03 | Nippon Electric Co | |
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| KR100601058B1 (ko) | 2004-04-01 | 2006-07-19 | 백인우 | 모래 세척 장치 |
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