JPS59203963A - レベル判定回路 - Google Patents
レベル判定回路Info
- Publication number
- JPS59203963A JPS59203963A JP7914883A JP7914883A JPS59203963A JP S59203963 A JPS59203963 A JP S59203963A JP 7914883 A JP7914883 A JP 7914883A JP 7914883 A JP7914883 A JP 7914883A JP S59203963 A JPS59203963 A JP S59203963A
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- JP
- Japan
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- voltage
- circuit
- operational amplifier
- output
- terminal
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は入力信号電圧の電圧レベルを判定するヒステリ
シスを有したレベル判定回路に関するものである。
シスを有したレベル判定回路に関するものである。
第１図は゛従来のレベル、判定回路で、第１図の入力端
子１に第２図（ａ）の入力信号が入力されると、演算増
幅器５の非反転入力端子のレベル判定電圧と比較され、
演算増幅器５の出力端子すなわちレベル判定回路の出力
端子１０には正または負の飽和電圧が出力される。レベ
ル判定電圧は入力信号電圧が上がる時の判定電圧＋ｖＨ
と、入力信号電圧が下がる時の判定電圧＋ｖＬの異なる
二つの電圧を持っており、＋ＶＨ） ＋ＶＬ ） ０に
設定される。入力信号電圧が＋ＶＩ、よシ小さい状態お
よび＋ｖＬを越え＋Ｖ）（に達するまでは出力端子１０
には正の電圧が出力されるが、入力信号電圧が＋ＶＨを
越えると出力端子１０の圧力電圧は極性反転し負電圧と
なる。入力信号電圧が＋ｖＨよシ大きい状態および＋Ｖ
Ｈより下がＶ） ＋ＶＬに達するまでは出力端子１０の
電圧は負の電圧に保たれ入力信号電圧が＋ｖＬよシ下が
ると出力端子１０の電圧は再び極性反転し正の電圧とな
る。
子１に第２図（ａ）の入力信号が入力されると、演算増
幅器５の非反転入力端子のレベル判定電圧と比較され、
演算増幅器５の出力端子すなわちレベル判定回路の出力
端子１０には正または負の飽和電圧が出力される。レベ
ル判定電圧は入力信号電圧が上がる時の判定電圧＋ｖＨ
と、入力信号電圧が下がる時の判定電圧＋ｖＬの異なる
二つの電圧を持っており、＋ＶＨ） ＋ＶＬ ） ０に
設定される。入力信号電圧が＋ＶＩ、よシ小さい状態お
よび＋ｖＬを越え＋Ｖ）（に達するまでは出力端子１０
には正の電圧が出力されるが、入力信号電圧が＋ＶＨを
越えると出力端子１０の圧力電圧は極性反転し負電圧と
なる。入力信号電圧が＋ｖＨよシ大きい状態および＋Ｖ
Ｈより下がＶ） ＋ＶＬに達するまでは出力端子１０の
電圧は負の電圧に保たれ入力信号電圧が＋ｖＬよシ下が
ると出力端子１０の電圧は再び極性反転し正の電圧とな
る。
ここで、レベル判定電圧＋ｖＨおよび＋ｖＬは正の定電
圧回路７の出力電圧と、負の定電圧回路８の出力電圧と
、演算増幅器５の出力電圧と、抵抗器２゜３．４の定数
とで決定され、二つの定電圧回路により供給電源電圧＋
ＶＣＣおよび−ＶＣＣの変動に対してはレベル判定電圧
＋ｖＨおよび＋ｖＬは変動せず、゛安定なヒステリシス
を有するレベル判定回路として動作する。
圧回路７の出力電圧と、負の定電圧回路８の出力電圧と
、演算増幅器５の出力電圧と、抵抗器２゜３．４の定数
とで決定され、二つの定電圧回路により供給電源電圧＋
ＶＣＣおよび−ＶＣＣの変動に対してはレベル判定電圧
＋ｖＨおよび＋ｖＬは変動せず、゛安定なヒステリシス
を有するレベル判定回路として動作する。
従来のレベル判定回路は供給電源の電圧変動によるレベ
ル判定電圧の変動をなくすために、正電源および負電源
の両方に定電圧回路が必要であり、このために回路部品
が多くな９、部品実装が繁雑となり更に定電圧回路で余
分な電力を消費するという欠点であった。
ル判定電圧の変動をなくすために、正電源および負電源
の両方に定電圧回路が必要であり、このために回路部品
が多くな９、部品実装が繁雑となり更に定電圧回路で余
分な電力を消費するという欠点であった。
本発明は前記問題点を解消するもので、レベル判定電圧
が二つの供給電源の一方の供給電源電圧の変動には関係
しない回路構成とし、定電圧回路を一つだけの回路に簡
略化することを目的とするものである。すなわち、本発
明のレベル判定回路は演算増幅器と、正の供給電源に接
続した定電圧回路と、前記演算増幅器の非反転入力端子
および前記定電圧回路の出力端子間に接続した第一の抵
抗器と、前記演算増幅器の非反転入力端子とアース間に
接続した第二の抵抗器と、カソード端子を前記演算増幅
器の非反転入力端子に接続したダイオードと、前記演算
増幅器の出力端子および前記ダイオードのアノード端子
間に接続した第三の抵抗器とを有し、前記演算増幅器の
正の電源端子を前記定電圧回路の出力端子に接続すると
共に、該演算増幅器め負の電源端子を負の供給電源に接
続し、前記演算増幅器の反転入力端子を信号入力端子と
し、前記演算増幅器の出力端子を信号出力端子としたこ
とを特徴とするものである。
が二つの供給電源の一方の供給電源電圧の変動には関係
しない回路構成とし、定電圧回路を一つだけの回路に簡
略化することを目的とするものである。すなわち、本発
明のレベル判定回路は演算増幅器と、正の供給電源に接
続した定電圧回路と、前記演算増幅器の非反転入力端子
および前記定電圧回路の出力端子間に接続した第一の抵
抗器と、前記演算増幅器の非反転入力端子とアース間に
接続した第二の抵抗器と、カソード端子を前記演算増幅
器の非反転入力端子に接続したダイオードと、前記演算
増幅器の出力端子および前記ダイオードのアノード端子
間に接続した第三の抵抗器とを有し、前記演算増幅器の
正の電源端子を前記定電圧回路の出力端子に接続すると
共に、該演算増幅器め負の電源端子を負の供給電源に接
続し、前記演算増幅器の反転入力端子を信号入力端子と
し、前記演算増幅器の出力端子を信号出力端子としたこ
とを特徴とするものである。
以下、本発明の一実施例を図によ）説明する。
第３図は本発明のレベル判定回路の一実施例を示すもｄ
で、該レベル判定回路は演算増幅器１６と、正の供給電
源１７に接続した定電圧回路１８と、前記演算増幅器１
６の非反転入力端子および前記定電圧回路１８の出力端
子間に接続した第一の抵抗器１２と、前記演算増幅器１
６の非反転入力端子とアース電位間に接続した第二の抵
抗器１３と、カソード端子を前記演算増幅器１６の非反
転入力端子に接続したダイオード１４と、前記演算増幅
器１６の出力端子および前記ダイオード１４のアノード
端子間に接続した第三の抵抗器１５から構成され、前記
演算増幅器１６の正の電源端子を前記定電圧回路１８の
出力端子に接続すると共に該演算増幅器１６の負の電源
端子を負の供給電源１９の出力端子に接続し、前記演算
増幅器１６の反転入力端子をレベル判定回路の入力端子
１１とし、前記演算増幅器１６の出力端子をレベル判定
回路出力端子２０としたものである。
で、該レベル判定回路は演算増幅器１６と、正の供給電
源１７に接続した定電圧回路１８と、前記演算増幅器１
６の非反転入力端子および前記定電圧回路１８の出力端
子間に接続した第一の抵抗器１２と、前記演算増幅器１
６の非反転入力端子とアース電位間に接続した第二の抵
抗器１３と、カソード端子を前記演算増幅器１６の非反
転入力端子に接続したダイオード１４と、前記演算増幅
器１６の出力端子および前記ダイオード１４のアノード
端子間に接続した第三の抵抗器１５から構成され、前記
演算増幅器１６の正の電源端子を前記定電圧回路１８の
出力端子に接続すると共に該演算増幅器１６の負の電源
端子を負の供給電源１９の出力端子に接続し、前記演算
増幅器１６の反転入力端子をレベル判定回路の入力端子
１１とし、前記演算増幅器１６の出力端子をレベル判定
回路出力端子２０としたものである。
第３図に示しだ回路の各部波形は第２図に示す各部波形
と同じである。第２回の入力信号（ａ）が第３図の入力
端子１１に入力されると、演算増幅器１６の非反転入力
端子のレベル判定電圧と比較され、演算増幅器１６の出
力端子には正または負の飽和電圧が出力される。レベル
判定電圧は入力信号電圧が上がる時の判定電圧＋ｖＨと
、入力信号電圧が下がる時の判定電圧＋ＶＬの異なる二
つの電圧をもっており、＋ＶＨ＞ ＋ＶＬ ＞ Ｏであ
る。すなわち、入力信号電圧がレベル判定電圧＋ＶＬよ
り小さい状態では出力端子２０の電圧は正の電圧が出力
されてお９、入力信号電圧が犬きくな’ｆ） ＋ＶＬを
越え＋ｖＨに達するまでは出力端子２０の電圧は正の電
圧に保たれ、入力信号電圧が＋ｖＨを越えると出力端子
２０の電圧は極性反転し負の電圧となる。入力信号電圧
が＋ｖＨよシ下がり＋ｖＬに達するまでは出力端子２０
の電圧は負の電圧に保たれ、入力信号電圧が＋ｖＬよシ
下がると再び出力端子２０の出力電圧は極性反転し正の
電圧と起る。ここでレベル判定電圧が＋■Ｈとなるのは
演算増幅器１６の出力が正電圧の時であシ、定電圧回路
１８の出力電圧と、演算増幅器１６の正の出力電圧と、
ダイオード１４の順方向電圧降下と、抵抗器１２，１３
．１５の定数とで決定され、一方レベル判定電圧が＋ｖ
Ｌとなるのは演算増幅器１６の出力電圧が負電圧の時で
あり、ダイオード１４は逆バイアスされるために演算増
幅器１６の出力電圧は帰還されず定電圧回路１８の出力
電圧と、抵抗器１２．１３の定数だけで決定される。し
たがって、供給電源電圧の変動によるレベル判定電圧の
変動は正の供給電源に対しては定電圧回路で抑えられ、
負の供給電源に対しては関係しない回路構成のだめに一
つの定電圧回路を持つだけで安定なヒステリシスを有す
るレベル判定回路とすることができる。
と同じである。第２回の入力信号（ａ）が第３図の入力
端子１１に入力されると、演算増幅器１６の非反転入力
端子のレベル判定電圧と比較され、演算増幅器１６の出
力端子には正または負の飽和電圧が出力される。レベル
判定電圧は入力信号電圧が上がる時の判定電圧＋ｖＨと
、入力信号電圧が下がる時の判定電圧＋ＶＬの異なる二
つの電圧をもっており、＋ＶＨ＞ ＋ＶＬ ＞ Ｏであ
る。すなわち、入力信号電圧がレベル判定電圧＋ＶＬよ
り小さい状態では出力端子２０の電圧は正の電圧が出力
されてお９、入力信号電圧が犬きくな’ｆ） ＋ＶＬを
越え＋ｖＨに達するまでは出力端子２０の電圧は正の電
圧に保たれ、入力信号電圧が＋ｖＨを越えると出力端子
２０の電圧は極性反転し負の電圧となる。入力信号電圧
が＋ｖＨよシ下がり＋ｖＬに達するまでは出力端子２０
の電圧は負の電圧に保たれ、入力信号電圧が＋ｖＬよシ
下がると再び出力端子２０の出力電圧は極性反転し正の
電圧と起る。ここでレベル判定電圧が＋■Ｈとなるのは
演算増幅器１６の出力が正電圧の時であシ、定電圧回路
１８の出力電圧と、演算増幅器１６の正の出力電圧と、
ダイオード１４の順方向電圧降下と、抵抗器１２，１３
．１５の定数とで決定され、一方レベル判定電圧が＋ｖ
Ｌとなるのは演算増幅器１６の出力電圧が負電圧の時で
あり、ダイオード１４は逆バイアスされるために演算増
幅器１６の出力電圧は帰還されず定電圧回路１８の出力
電圧と、抵抗器１２．１３の定数だけで決定される。し
たがって、供給電源電圧の変動によるレベル判定電圧の
変動は正の供給電源に対しては定電圧回路で抑えられ、
負の供給電源に対しては関係しない回路構成のだめに一
つの定電圧回路を持つだけで安定なヒステリシスを有す
るレベル判定回路とすることができる。
以上説明したように、本発明のレベル判定回路によれば
、定電圧回路は一つで良く、回路構成が簡単にできる効
果を有するものである。
、定電圧回路は一つで良く、回路構成が簡単にできる効
果を有するものである。
第１図は従来のレベル判定回路を示す回路図、第２図（
ａ） 、 （ｂ） 、 （ｃ）は第１図および第３図の
各部の動作を示す波形図、第３図は本発明のレベル判定
回路の一実施例を示す回路図である。 １．１１・・・入力端子、２ 、３ 、４．１２，１３
．１５・・・抵抗器、５，１６・・・演算増幅器、６，
１７・・・正の供給電源端子、７ 、８．１３・・・定
電圧回路、９，１９・・・負の供給電源端子１０．２０
・・・出力端子−１４・・・ダイオード 特許出願人 日本電気株式会社
ａ） 、 （ｂ） 、 （ｃ）は第１図および第３図の
各部の動作を示す波形図、第３図は本発明のレベル判定
回路の一実施例を示す回路図である。 １．１１・・・入力端子、２ 、３ 、４．１２，１３
．１５・・・抵抗器、５，１６・・・演算増幅器、６，
１７・・・正の供給電源端子、７ 、８．１３・・・定
電圧回路、９，１９・・・負の供給電源端子１０．２０
・・・出力端子−１４・・・ダイオード 特許出願人 日本電気株式会社
Claims (1)
- （１）演算増幅器と、正の供給電源に接続した定電圧回
路と、前記演算増幅器の非反転入力端子および前記定電
圧回路の出力端子間に接続した第一の抵抗器と、前記演
算増幅器の非反転入力端子およびアース電位間に接続し
た第二の抵抗器と、カソード端子を前記演算増幅器の非
反転入力端子に接続したダイオードと、前記演算増幅器
の出力端子および前記ダイオードのアノード端子間に接
続した第三の抵抗器とを有し、前記演算増幅器の正の電
源端子を前記定電圧回路の出力端子に接続すると共に、
該演算増幅器の負の電源端子を負の供給電源に接続し、
前記演算増幅器の反転入力端子を信号入力端子とし、前
記演算増幅器の出力端子を信号出力端子としたことを特
徴とするレベル判定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7914883A JPS59203963A (ja) | 1983-05-06 | 1983-05-06 | レベル判定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7914883A JPS59203963A (ja) | 1983-05-06 | 1983-05-06 | レベル判定回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59203963A true JPS59203963A (ja) | 1984-11-19 |
Family
ID=13681869
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7914883A Pending JPS59203963A (ja) | 1983-05-06 | 1983-05-06 | レベル判定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59203963A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5366039A (en) * | 1991-06-26 | 1994-11-22 | Nippondenso Co. Ltd. | Acceleration slip control device for a motor vehicle |
-
1983
- 1983-05-06 JP JP7914883A patent/JPS59203963A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5366039A (en) * | 1991-06-26 | 1994-11-22 | Nippondenso Co. Ltd. | Acceleration slip control device for a motor vehicle |
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