JPS59171412U - 静電誘導型電界効果トランジスタのバイアス回路 - Google Patents
静電誘導型電界効果トランジスタのバイアス回路Info
- Publication number
- JPS59171412U JPS59171412U JP6675883U JP6675883U JPS59171412U JP S59171412 U JPS59171412 U JP S59171412U JP 6675883 U JP6675883 U JP 6675883U JP 6675883 U JP6675883 U JP 6675883U JP S59171412 U JPS59171412 U JP S59171412U
- Authority
- JP
- Japan
- Prior art keywords
- pair
- transistor
- output terminals
- field effect
- effect transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Junction Field-Effect Transistors (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図はSITのV−I特性を示す図、第2図は従来の
ゲートバイアス回路を有するB級増幅回路を示す回路図
、第3図は第2図の回路の動作を説明するための図、第
4図は第2図の5ITIQ、及び10゜の動作ラインと
アイドリング電流I、を示す図、第5図は本考案の一実
施例によるゲートバイアス回路を示す回路図、第6図は
第5図の回路の動作を説明するための図である。 101及び10□・・・・・・SIT、20,201及
び20□・・・・・・ゲートバイアス回路、INl及び
IN2・・・・・・一対の入力端子、0UT1及び0U
T2・・・・・・一対の出力端子、Q□・・・・・・第
1のトランジスタ、Q2・・・・・・第2のトランジス
タ、Ro・・・・・・抵抗、C2・・・・・・コンデン
サ。
ゲートバイアス回路を有するB級増幅回路を示す回路図
、第3図は第2図の回路の動作を説明するための図、第
4図は第2図の5ITIQ、及び10゜の動作ラインと
アイドリング電流I、を示す図、第5図は本考案の一実
施例によるゲートバイアス回路を示す回路図、第6図は
第5図の回路の動作を説明するための図である。 101及び10□・・・・・・SIT、20,201及
び20□・・・・・・ゲートバイアス回路、INl及び
IN2・・・・・・一対の入力端子、0UT1及び0U
T2・・・・・・一対の出力端子、Q□・・・・・・第
1のトランジスタ、Q2・・・・・・第2のトランジス
タ、Ro・・・・・・抵抗、C2・・・・・・コンデン
サ。
Claims (1)
- 静電誘導型電界効果トランジスタのゲートバイアス回路
において、前記電界効果トランジスタのゲート端子及び
別の端子に接続される一対の出力端子と、電源電圧が入
力される一対の入力端子と、該一対あ入力端子及び前記
一対の出力端子間に接続されたシリーズ・レギュレータ
型定電圧回路を有し、該定電圧回路は、前記一対の入力
端子の一方及び前記一対の出力端子の一方間にコレクタ
及びエミッタを接続された第1のトランジスタと、・前
記一対の入力端子の他方及び前記一対の出力端子の他方
間を接続する接続線と前記第1のトランジスタのベース
との間にエミッタ及びコレクタを接続された第2のトラ
ンジスタと、前記第1のトランジスタのエミッタと前記
第2のトランジスタのベースとの間に接続された抵抗と
、前記第2のトランジスタのベース及びエミッタ間に接
続されたコンデンサとを含んでおり、前記一対の入力端
子に前記電源電圧が入力されると、前記一対の出力端子
間に規定バイアス電圧より絶対値が大きい電圧が加わり
、その後、前記一対の出力端子間の電圧の絶対値が前記
抵抗と前記コンデンサとの時定数により減少して所定時
間後に前記規定バイアス値にもどるようにした静電誘導
型電界効果トランジスタのバイアス回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6675883U JPS59171412U (ja) | 1983-05-02 | 1983-05-02 | 静電誘導型電界効果トランジスタのバイアス回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6675883U JPS59171412U (ja) | 1983-05-02 | 1983-05-02 | 静電誘導型電界効果トランジスタのバイアス回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59171412U true JPS59171412U (ja) | 1984-11-16 |
JPH0332095Y2 JPH0332095Y2 (ja) | 1991-07-08 |
Family
ID=30196959
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6675883U Granted JPS59171412U (ja) | 1983-05-02 | 1983-05-02 | 静電誘導型電界効果トランジスタのバイアス回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59171412U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009194872A (ja) * | 2008-02-18 | 2009-08-27 | Systec:Kk | 同一導電型静電誘導トランジスタを用いたプッシュプルパワーアンプ回路 |
-
1983
- 1983-05-02 JP JP6675883U patent/JPS59171412U/ja active Granted
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009194872A (ja) * | 2008-02-18 | 2009-08-27 | Systec:Kk | 同一導電型静電誘導トランジスタを用いたプッシュプルパワーアンプ回路 |
Also Published As
Publication number | Publication date |
---|---|
JPH0332095Y2 (ja) | 1991-07-08 |
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