JPS59119623U - 電圧ミラ−回路 - Google Patents
電圧ミラ−回路Info
- Publication number
- JPS59119623U JPS59119623U JP1419483U JP1419483U JPS59119623U JP S59119623 U JPS59119623 U JP S59119623U JP 1419483 U JP1419483 U JP 1419483U JP 1419483 U JP1419483 U JP 1419483U JP S59119623 U JPS59119623 U JP S59119623U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- circuit
- conductivity type
- voltage
- series
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
′第1図は従来の電圧ミラー回路、第2図は本考案の一
実施例を示す同回路、第3図は本考案の他の実施例を示
す同回路である。 主な図番の説明、1・・・IC,4・・・電源端子、5
・・・入力端子、6.7・・・分圧抵抗、8・・・負荷
抵抗、9・・・出力端子、10・・・入力トランジスタ
、11・・・第1の補償トランジスタ、12・・・第2
の補償トランジスタ、13・・・第1の電流ミラートラ
ンジスタ、14・・・第2の電流ミラートランジスタ、
15・・・第3の電流ミラートランジスタ、21・・・
第1の直列回路、22・・・第2の直列回路。 第1図 第2図
実施例を示す同回路、第3図は本考案の他の実施例を示
す同回路である。 主な図番の説明、1・・・IC,4・・・電源端子、5
・・・入力端子、6.7・・・分圧抵抗、8・・・負荷
抵抗、9・・・出力端子、10・・・入力トランジスタ
、11・・・第1の補償トランジスタ、12・・・第2
の補償トランジスタ、13・・・第1の電流ミラートラ
ンジスタ、14・・・第2の電流ミラートランジスタ、
15・・・第3の電流ミラートランジスタ、21・・・
第1の直列回路、22・・・第2の直列回路。 第1図 第2図
Claims (3)
- (1)電源とアース間に第1の導電型の入力トランジス
タ、第2の導電型でダイオード接続した第1の補償トラ
ンジスタ、第1の導電型の第1の電流ミラートランジス
タを直列接続した第1の直列回路と、前記電源とアース
間に負荷抵抗、第1の導電型でダイオード接続した第2
の補償トランジスタ、第2の導電型で前記第1の補償ト
ランジスタにベースを接続した第2の電流ミラートラン
ジスタ、第1の導電型でダイオード接続した第3の電流
ミラートランジスタを直列接続した第2の直列回路と、
前記入力トランジスタのベースに接続した入力端子と、
前記第2の直列回路に接続した出力端子とより成り、前
記入力端子に設定した入力電圧と同一の電圧を前記出力
端子より導出することを特徴とした電圧ミラー回路。 - (2)前記第1の直列回路及び第2の直列回路を同一集
積回路内に設け、前記入力端子を外部端子として設けた
ことを特徴とする前記実用新案登録請求の範囲第1項に
記載の電圧ミラー回路。 - (3)前記第2の直列回路に設けた第3の電流ミラート
ランジスタのベースに共通にベースを接続した電流制御
トランジスタの出力側に前記出力端子を接続したことを
特徴とする実用新案登録請求の範囲績1項に記載の電圧
ミラー回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1419483U JPS59119623U (ja) | 1983-02-01 | 1983-02-01 | 電圧ミラ−回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1419483U JPS59119623U (ja) | 1983-02-01 | 1983-02-01 | 電圧ミラ−回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59119623U true JPS59119623U (ja) | 1984-08-13 |
JPH0113452Y2 JPH0113452Y2 (ja) | 1989-04-20 |
Family
ID=30145566
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1419483U Granted JPS59119623U (ja) | 1983-02-01 | 1983-02-01 | 電圧ミラ−回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59119623U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2015201716A (ja) * | 2014-04-07 | 2015-11-12 | 株式会社デンソー | 過電流保護回路 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5221751A (en) * | 1975-08-12 | 1977-02-18 | Toshiba Corp | Voltage follower circuit |
JPS5620316A (en) * | 1979-07-27 | 1981-02-25 | Hitachi Denshi Ltd | Buffer circuit |
-
1983
- 1983-02-01 JP JP1419483U patent/JPS59119623U/ja active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5221751A (en) * | 1975-08-12 | 1977-02-18 | Toshiba Corp | Voltage follower circuit |
JPS5620316A (en) * | 1979-07-27 | 1981-02-25 | Hitachi Denshi Ltd | Buffer circuit |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2015201716A (ja) * | 2014-04-07 | 2015-11-12 | 株式会社デンソー | 過電流保護回路 |
US9831665B2 (en) | 2014-04-07 | 2017-11-28 | Denso Corporation | Overcurrent protection circuit |
Also Published As
Publication number | Publication date |
---|---|
JPH0113452Y2 (ja) | 1989-04-20 |
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