JPS5939541U - 電源スイツチ回路 - Google Patents

電源スイツチ回路

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Publication number
JPS5939541U
JPS5939541U JP13425082U JP13425082U JPS5939541U JP S5939541 U JPS5939541 U JP S5939541U JP 13425082 U JP13425082 U JP 13425082U JP 13425082 U JP13425082 U JP 13425082U JP S5939541 U JPS5939541 U JP S5939541U
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JP
Japan
Prior art keywords
transistor
switch circuit
power switch
base
collector
Prior art date
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Pending
Application number
JP13425082U
Other languages
English (en)
Inventor
水沢 勉
Original Assignee
株式会社東芝
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Filing date
Publication date
Application filed by 株式会社東芝 filed Critical 株式会社東芝
Priority to JP13425082U priority Critical patent/JPS5939541U/ja
Publication of JPS5939541U publication Critical patent/JPS5939541U/ja
Pending legal-status Critical Current

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  • Electronic Switches (AREA)
  • Protection Of Static Devices (AREA)
  • Dc-Dc Converters (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来の電源スイツチ回路の回路図、第2図は本
考案になる電源スイツチ回路の一実施例を示す回路図、
第3図は第2図の動作を説明するための回路図である。 図中符号、1. 2. 3は端子、R1,R2,R3は
抵抗、Q□、 Q2はトランジスタである。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第1の抵抗を介したベースバイアス電圧をベースに受け
    てオンとなり、コレクタとエミッタを介して電源を負荷
    に接続する第1のトランジスタと、第1のトランジスタ
    のコレクタ、エミッタ間の電圧によりベース電流を得る
    第2のトランジスタと、第1のトランジスタのベースと
    第2のトランジスタのコレクタとの間に接続された第2
    の抵抗とを具備し、負荷短絡時に第2のトランジスタが
    オンとなるよう構成したことを特徴とする電源スイツチ
    回路。
JP13425082U 1982-09-06 1982-09-06 電源スイツチ回路 Pending JPS5939541U (ja)

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JPS5939541U true JPS5939541U (ja) 1984-03-13

Family

ID=30302558

Family Applications (1)

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JP13425082U Pending JPS5939541U (ja) 1982-09-06 1982-09-06 電源スイツチ回路

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JP (1) JPS5939541U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62146331U (ja) * 1986-03-07 1987-09-16
JPS6356829U (ja) * 1986-09-30 1988-04-15

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62146331U (ja) * 1986-03-07 1987-09-16
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