JPS59169633U - バツフア回路 - Google Patents

バツフア回路

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Publication number
JPS59169633U
JPS59169633U JP6310683U JP6310683U JPS59169633U JP S59169633 U JPS59169633 U JP S59169633U JP 6310683 U JP6310683 U JP 6310683U JP 6310683 U JP6310683 U JP 6310683U JP S59169633 U JPS59169633 U JP S59169633U
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JP
Japan
Prior art keywords
circuit
buffer circuit
transfer
output
combinational
Prior art date
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Pending
Application number
JP6310683U
Other languages
English (en)
Inventor
進藤　康史
小野木　啓之
Original Assignee
沖電気工業株式会社
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Filing date
Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のバッファ回路およびその周辺装置との接
続図、第２図は本考案のバッファ回路およびその周辺装
置との接続図、第３図は本考案の他の実施例の説明図で
ある。 ０・・・ＣＰＵ、　ｌ・・・指令線、２・・・メモリ装
置、３・・・！０装置、４・・・トラオステートバス、
５・・・応答信号線、６・・・ＯＲ回路、７・・・バッ
ファ回路、８・・・応答信号、９・・・転送出力ドライ
バ、１０・・・トライステートバス、１１・・・メモリ
装置、１２・・・１０装置、２０・・・ＣＰＵ、　２　
ｌ・・・指令線、２２・・・メモリ装置、２３・・・Ｉ
Ｏ装置、２４・・・トライステートバス、２５・・・バ
ッファ回路、２６・・・抵抗器、２７・・・ＡＮＤゲー
ト、２８・・・転送出力ドライバ、２９・・・出力イン
ピーダンス制御入力端子、３０・・・抵抗器、３１・・
・トライステートバス、３２・・・メモリ装置、３３・
・・ＩＯ装置、３４・・・ＮＯＲゲート。

Claims (2)

    【実用新案登録請求の範囲】
  1. （１）２つのバス間に接続されたバッファ回路において
    、該バッファ回路が転送入力データのみを入力する組合
    せ回路と、転送入力データを入力とし、転送出力データ
    を出力とし、出力インピータレスの制御可能な転送出力
    ドライバから構成され、上記組合せ回路で得られた信号
    にて転送出力ドライバの出力インピーダンスを決定し、
    バス上の競合を防ぐことを特徴とするバッファ回路。
  2. （２）前記組合せ回路がアンド回路あであることを特徴
    とする実用新案登録請求の範囲第１項記載のバッファ回
    路。
JP6310683U 1983-04-28 1983-04-28 バツフア回路 Pending JPS59169633U (ja)

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JP6310683U JPS59169633U (ja) 1983-04-28 1983-04-28 バツフア回路

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JP6310683U JPS59169633U (ja) 1983-04-28 1983-04-28 バツフア回路

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JPS59169633U true JPS59169633U (ja) 1984-11-13

Family

ID=30193299

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