JPS5915995A - 音声デジタル録音装置 - Google Patents
音声デジタル録音装置Info
- Publication number
- JPS5915995A JPS5915995A JP57126152A JP12615282A JPS5915995A JP S5915995 A JPS5915995 A JP S5915995A JP 57126152 A JP57126152 A JP 57126152A JP 12615282 A JP12615282 A JP 12615282A JP S5915995 A JPS5915995 A JP S5915995A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- section
- clock
- audio
- synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、音声区間を自動的に検出し、録音する音声デ
ジタル録音装置に関する。
ジタル録音装置に関する。
従来、音声デジタル録音装置は、外部からの手動作によ
シ、音声区間の始端および終端を指示し、その区間の音
声信号を無条件にデジタル化して記憶するか、あるいは
デジタル化された情報よりパワーの計算を行ない音声区
間を検出するものであった。このため、前者は音声区間
の前後の無音区間まで録音してしまうという不都合があ
り、また後者は雑音等による誤動作を防ぐためには、あ
る区間のパワーを常に計算する必要があり、特にデルタ
変調方式の場合、より高速な計算を必要とする欠点があ
る。
シ、音声区間の始端および終端を指示し、その区間の音
声信号を無条件にデジタル化して記憶するか、あるいは
デジタル化された情報よりパワーの計算を行ない音声区
間を検出するものであった。このため、前者は音声区間
の前後の無音区間まで録音してしまうという不都合があ
り、また後者は雑音等による誤動作を防ぐためには、あ
る区間のパワーを常に計算する必要があり、特にデルタ
変調方式の場合、より高速な計算を必要とする欠点があ
る。
本発明の目的は上記欠点を除去し、音声信号のみを記憶
する音声デジタル録音装置を提供することにある。
する音声デジタル録音装置を提供することにある。
本発明の音声デジタル録音装置は、クロック発生部と、
該クロック発生部からのクロックに同期して、マイクロ
フォンを通して入力される音声信号をデジタル化するた
めのデルタ変調部と、前記クロック発生部からのクロッ
クに同期して前記デルタ変調部からの信号を並列に変換
する直列並列変換部と、前記クロック発生部の信号を分
周する分周部と、該分周部からの信号によシ前記直列並
列変換部からの信号に検出部の積分回路の時定数に相当
する遅れを与える信号遅延手段と、該信号遅延手段から
の信号を記憶する記憶部と、積分回路と比較回路からな
り入力する音声信号の一定時間の積分値と規定値との比
較を行ない規定値を越えた期間のみ信号を送出−する検
出部と、該検出部からの信号を受けている期間のみ前記
分周部の出力に同期し信号遅延手段からの出力信号を記
憶部に記憶させるように制御するＣＰＵとを含んで構成
される。
該クロック発生部からのクロックに同期して、マイクロ
フォンを通して入力される音声信号をデジタル化するた
めのデルタ変調部と、前記クロック発生部からのクロッ
クに同期して前記デルタ変調部からの信号を並列に変換
する直列並列変換部と、前記クロック発生部の信号を分
周する分周部と、該分周部からの信号によシ前記直列並
列変換部からの信号に検出部の積分回路の時定数に相当
する遅れを与える信号遅延手段と、該信号遅延手段から
の信号を記憶する記憶部と、積分回路と比較回路からな
り入力する音声信号の一定時間の積分値と規定値との比
較を行ない規定値を越えた期間のみ信号を送出−する検
出部と、該検出部からの信号を受けている期間のみ前記
分周部の出力に同期し信号遅延手段からの出力信号を記
憶部に記憶させるように制御するＣＰＵとを含んで構成
される。
次に本発明の実施例について図面を用いて詳細に説明す
る。
る。
第１図は本発明の一実施例のブロック図である。
マイクロフォン１０よ少入力された音声は、増幅部２０
で増幅され、デルタ変調部３０と音声区間検出部８０に
入力される。デルタ変調部３０は入力信号をクロック発
生部５０からのクロックに同期して１ビツトのデジタル
信号に量子化し、直列並列変換部４０で並列データに変
換する。以降、並列データとは８ビツトであると仮定し
て説明する、分周部６０はクロック発生部５０の出力を
８分周し並列変換された８ビツトデータを信号遅延手段
７０を構成するフリップフロップ７１，７２゜７３．７
４に順次移行させるためのクロックを作る。フリップフ
ロップ７４からは、ある時間前にマイクロフォン１０よ
少入力された音声がデルタ変調され、クロック発生部５
０の８クロツクごとに新しいデータが出力される。
で増幅され、デルタ変調部３０と音声区間検出部８０に
入力される。デルタ変調部３０は入力信号をクロック発
生部５０からのクロックに同期して１ビツトのデジタル
信号に量子化し、直列並列変換部４０で並列データに変
換する。以降、並列データとは８ビツトであると仮定し
て説明する、分周部６０はクロック発生部５０の出力を
８分周し並列変換された８ビツトデータを信号遅延手段
７０を構成するフリップフロップ７１，７２゜７３．７
４に順次移行させるためのクロックを作る。フリップフ
ロップ７４からは、ある時間前にマイクロフォン１０よ
少入力された音声がデルタ変調され、クロック発生部５
０の８クロツクごとに新しいデータが出力される。
検出部８０は積分回路８１と比較回路８２から構成され
る。比較回路８２には例えば音声入力信号の始端検出の
ためにＱｌ ＋終端検出のためにＱ２（Ｑｌ＞Ｑ２）が
規定値として設定しである。そして、一定期間の入力信
号の積分値がＱ２を越えＱ１以下になる迄の間、検出部
８０からの検出信号をＣＰＵに送出する。ＣＰＵ９０は
検出信号を受けている間だけ、分周部６０の出力に同期
して、フリップフロップ７４の出力データを記憶部１０
０に記憶させるように制御する。
る。比較回路８２には例えば音声入力信号の始端検出の
ためにＱｌ ＋終端検出のためにＱ２（Ｑｌ＞Ｑ２）が
規定値として設定しである。そして、一定期間の入力信
号の積分値がＱ２を越えＱ１以下になる迄の間、検出部
８０からの検出信号をＣＰＵに送出する。ＣＰＵ９０は
検出信号を受けている間だけ、分周部６０の出力に同期
して、フリップフロップ７４の出力データを記憶部１０
０に記憶させるように制御する。
第２図は数字１を発声したときの音声のパワースペクト
ル図である。第２図を参照し、実施例の動作を更に説明
する。
ル図である。第２図を参照し、実施例の動作を更に説明
する。
時間Ｔ＝Ａにおいて雑音が入力されているがΔを間の入
力信号の積分値はＱｌより小さいため音声入力信号の始
端とはみなされない。Ｔ＝Ｂの時はじめてΔを間の入力
信号の積分値がＱｌを越えるため検出信号が出力される
。以後検出信号の出力は継続され、同時に終端検出動作
が開始される。
力信号の積分値はＱｌより小さいため音声入力信号の始
端とはみなされない。Ｔ＝Ｂの時はじめてΔを間の入力
信号の積分値がＱｌを越えるため検出信号が出力される
。以後検出信号の出力は継続され、同時に終端検出動作
が開始される。
Ｔ＝Ｂの時、Ｔ＝Ｂ−Δｔから８サンプル分の音声デー
タが第１図のフリップフロップ７４に出力される。
タが第１図のフリップフロップ７４に出力される。
Ｔ＝Ｃのように音声中に短かい無音区間を含む場合でも
、Δを間の入力信号の積分値はＱ２よシ大きいため始端
とはみなされない。Ｔ＝Ｄに至ってはじめてΔを間の入
力信号の積分値がＱ２よシ小さくなるため検出−６出力
は止まる。従って、第２図における実際の音声区間はＴ
−Ｂ−ΔｔからＴ＝Ｄ−Δｔの部分でありこの間の情
報のみが記憶部１００ に記憶されることになる。
、Δを間の入力信号の積分値はＱ２よシ大きいため始端
とはみなされない。Ｔ＝Ｄに至ってはじめてΔを間の入
力信号の積分値がＱ２よシ小さくなるため検出−６出力
は止まる。従って、第２図における実際の音声区間はＴ
−Ｂ−ΔｔからＴ＝Ｄ−Δｔの部分でありこの間の情
報のみが記憶部１００ に記憶されることになる。
上記実施例では信号遅延手段７０に４個のフリップフロ
ップ回路を用いた場合で説明したが、記憶部１００ を
リング状の記憶部とし、Δを間のデータを貯わえること
によってもできる。
ップ回路を用いた場合で説明したが、記憶部１００ を
リング状の記憶部とし、Δを間のデータを貯わえること
によってもできる。
以上説明したように、本発明によれば、雑音による誤動
作がなく、自動的に音声信号のみを記憶する音声デジタ
ル録音装置が得られるのでその効果は大きい。
作がなく、自動的に音声信号のみを記憶する音声デジタ
ル録音装置が得られるのでその効果は大きい。
第１図は本発明の一実施例のブロック図、第２図は数字
１を発声したときの音声のパワースペクトル図である。 １０・・・・・・マイクロフォン、２０・・・・・・増
幅部、３０・・・・・・デルタ変調部、４０・・・・・
・直列並列置。換部、５０・・・・・・クロック発生部
、６０・・・・・・分周部、７０・・・・・・信号遅延
手段、７１〜７４・・・・・・ノリツブフロップ、８０
・・・・・・検出部、８１・・・・・・積分回路、８２
・・・・・・比較回路、９０・・・・・・ＣＰＵ、１０
０・・・・・・記憶部。 ／・、？ｉヵ＼、 代理人 弁理士 内 原 晋ｌ 、−１、・１１
（８ ｔ＞ −＼←や味／
ｐ≧じ−（Ｃ１−）
１を発声したときの音声のパワースペクトル図である。 １０・・・・・・マイクロフォン、２０・・・・・・増
幅部、３０・・・・・・デルタ変調部、４０・・・・・
・直列並列置。換部、５０・・・・・・クロック発生部
、６０・・・・・・分周部、７０・・・・・・信号遅延
手段、７１〜７４・・・・・・ノリツブフロップ、８０
・・・・・・検出部、８１・・・・・・積分回路、８２
・・・・・・比較回路、９０・・・・・・ＣＰＵ、１０
０・・・・・・記憶部。 ／・、？ｉヵ＼、 代理人 弁理士 内 原 晋ｌ 、−１、・１１
（８ ｔ＞ −＼←や味／
ｐ≧じ−（Ｃ１−）
Claims (1)
- クロック発生部と、該クロック発生部からのクロックに
同期して、マイクロフォンを通して入力される音声信号
をデジタル化するだめのデルタ変調部と、前記クロック
発生部からのクロックに同期して前記デルタ変調部から
の信号を並列に変換する直列並列変換部と、前記クロッ
ク発生部の信号を分周する分周部と、該分周部からの信
号により前記直列並列変換部からの信号に検出部の積分
回路の時定数に相当する遅れを与える信号遅延手段と、
該信号遅延手段からの信号を記憶する記憶部と、積分回
路と比較回路からなり入力する音声信号の一定時間の積
分値と規定値との比較を行ない規定値を越えた期間のみ
信号を送出する検出部と、該検出部からの信号を受けて
いる期間のみ前配分周部の出力に同期し信号遅延手段か
らの出力信号を記憶部に記憶させるように制御するＣＰ
Ｕとを含むことを特徴とする音声デジタル録音装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57126152A JPS5915995A (ja) | 1982-07-20 | 1982-07-20 | 音声デジタル録音装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57126152A JPS5915995A (ja) | 1982-07-20 | 1982-07-20 | 音声デジタル録音装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5915995A true JPS5915995A (ja) | 1984-01-27 |
Family
ID=14927958
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57126152A Pending JPS5915995A (ja) | 1982-07-20 | 1982-07-20 | 音声デジタル録音装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5915995A (ja) |
-
1982
- 1982-07-20 JP JP57126152A patent/JPS5915995A/ja active Pending
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