JPS5914357A - サイリスタ変換器の制御装置 - Google Patents
サイリスタ変換器の制御装置Info
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- JPS5914357A JPS5914357A JP57122054A JP12205482A JPS5914357A JP S5914357 A JPS5914357 A JP S5914357A JP 57122054 A JP57122054 A JP 57122054A JP 12205482 A JP12205482 A JP 12205482A JP S5914357 A JPS5914357 A JP S5914357A
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- Japan
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- output
- detector
- voltage
- thyristor
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
- H02M1/088—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters for the simultaneous control of series or parallel connected semiconductor devices
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Power Conversion In General (AREA)
- Protection Of Static Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はサイリスタ変換器の制御装置に係り、特に複数
個のサイリスタを直列又は並列にして構成されるサイリ
スタアームを備えた大容量サイリスタ変換器の制御装置
に関する。
個のサイリスタを直列又は並列にして構成されるサイリ
スタアームを備えた大容量サイリスタ変換器の制御装置
に関する。
一般にサイリスタ変換器の制御装置は、変換器の各アー
ムのサイリスタに印加される電圧を検出する電圧検出器
と、その検出器の出力を一つの条件として動作するサイ
リスクの点゛孤回路を備える。
ムのサイリスタに印加される電圧を検出する電圧検出器
と、その検出器の出力を一つの条件として動作するサイ
リスクの点゛孤回路を備える。
特に大容量サイリスタ変換器では、制御装置の信頼性向
上のため、上記電圧検出器は多重化される。そしてこの
多重化出力の論理和をサイリスクの点弧回路の動作条件
の一つとする。多重化すれば、一部の電圧検出器の出力
が有ｐとなるべきところで無しとなる故障（「無」故障
）が発生しても、他の正常出力によシ多重化出力の論理
和には正常の情報が得られる。従来は以上のような制御
装置で変換器を運転していたのでおる。
上のため、上記電圧検出器は多重化される。そしてこの
多重化出力の論理和をサイリスクの点弧回路の動作条件
の一つとする。多重化すれば、一部の電圧検出器の出力
が有ｐとなるべきところで無しとなる故障（「無」故障
）が発生しても、他の正常出力によシ多重化出力の論理
和には正常の情報が得られる。従来は以上のような制御
装置で変換器を運転していたのでおる。
しかし電圧検出器の故障はｒｍｒ ＊ｍｚらない。電圧
検出器の出力が無しとなるべきところで有シとなる故障
（「有」故障）が発生することもあるのである。「有」
故障が発生すると、他の出力が正常であっても多重化出
力の論理和には誤り情報が得られることになる。この誤
シ情報でサイリスタの点弧回路が動作すると、例えばサ
イリスクアームの逆電圧期間に、本来は与えられるべき
でない点弧パルスがサイリスタに与えられることになり
、サイリスタの漏れ電流が増加し、サイリスタを劣化さ
せてしまう。そしてこのような状態が継続すれば、サイ
リスタの破壊に至るおそれも出てくる。即ち、出力に「
有」故障が生ずると、多重化し九ことがかえって信頼性
の低下をまねくことになるのである。これでは高度の信
頼性を要求される大容量サイリスタ変換器の制御装置と
しては不適格である。
検出器の出力が無しとなるべきところで有シとなる故障
（「有」故障）が発生することもあるのである。「有」
故障が発生すると、他の出力が正常であっても多重化出
力の論理和には誤り情報が得られることになる。この誤
シ情報でサイリスタの点弧回路が動作すると、例えばサ
イリスクアームの逆電圧期間に、本来は与えられるべき
でない点弧パルスがサイリスタに与えられることになり
、サイリスタの漏れ電流が増加し、サイリスタを劣化さ
せてしまう。そしてこのような状態が継続すれば、サイ
リスタの破壊に至るおそれも出てくる。即ち、出力に「
有」故障が生ずると、多重化し九ことがかえって信頼性
の低下をまねくことになるのである。これでは高度の信
頼性を要求される大容量サイリスタ変換器の制御装置と
しては不適格である。
本発明の目的は、電圧検出器の出力に「有」故障が生じ
ても、多重化出力の論理和には正常情報が得られるサイ
リスタ変換器の制イ卸装置を提供するＫある。
ても、多重化出力の論理和には正常情報が得られるサイ
リスタ変換器の制イ卸装置を提供するＫある。
本発明の要点は、各電圧検出器の出力側に検出出力しゃ
断回路を設け、「有」故障が生じたときは、このしゃ断
回路でそれを検出して、当該電圧検出器の出力をしゃ断
するところにある。ここで「しゃ断する」とは、論理回
路において高レベル信号を強制的に低レベル信号にする
ことも含む。
断回路を設け、「有」故障が生じたときは、このしゃ断
回路でそれを検出して、当該電圧検出器の出力をしゃ断
するところにある。ここで「しゃ断する」とは、論理回
路において高レベル信号を強制的に低レベル信号にする
ことも含む。
第１図は本発明の一実施例で、サイリスタ変換器の一ア
ーム分を示す。図のように、−アームはサイリスタｓｉ
； ８２．８３．８４−８Ｎを直列接続して構成される
。ｉイリスタ８１．８２には、それぞれ順電圧検出器Ｆ
ｌ、Ｆ２が接続され、サイリスタＳ３，８４には、それ
ぞれ逆電圧検出器几１．Ｒ２が接続される。すなわち本
例では、順・逆電圧検出器はそれぞれ二重化されている
のである。順電圧検出器Ｆｌ、Ｆ２は、サイリスタの分
圧抵抗２２と定電圧ダイオード２３との直列体と、定電
圧ダイオード２３に並列接続された抵抗２４と発光ダイ
オード２５との直列体、発光ダイオードからの光信号を
フォトトランジスタ２７に伝達するライトガイド２６、
フォトトランジスタ２７が受光した信号を増幅する増幅
器２８から成る。逆電圧検出器Ｒ１，Ｒ２は、定電圧ダ
イオード２３及び発光ダイオード２５の接続方向が逆で
ある他は、順電圧検出器Ｆｌ、Ｆ２と同じ構成である。
ーム分を示す。図のように、−アームはサイリスタｓｉ
； ８２．８３．８４−８Ｎを直列接続して構成される
。ｉイリスタ８１．８２には、それぞれ順電圧検出器Ｆ
ｌ、Ｆ２が接続され、サイリスタＳ３，８４には、それ
ぞれ逆電圧検出器几１．Ｒ２が接続される。すなわち本
例では、順・逆電圧検出器はそれぞれ二重化されている
のである。順電圧検出器Ｆｌ、Ｆ２は、サイリスタの分
圧抵抗２２と定電圧ダイオード２３との直列体と、定電
圧ダイオード２３に並列接続された抵抗２４と発光ダイ
オード２５との直列体、発光ダイオードからの光信号を
フォトトランジスタ２７に伝達するライトガイド２６、
フォトトランジスタ２７が受光した信号を増幅する増幅
器２８から成る。逆電圧検出器Ｒ１，Ｒ２は、定電圧ダ
イオード２３及び発光ダイオード２５の接続方向が逆で
ある他は、順電圧検出器Ｆｌ、Ｆ２と同じ構成である。
各順・逆電圧検出器Ｆｌ、Ｆ２．Ｒ１，Ｒ２は、それぞ
れ検出出力しゃ断回路Ｂｌ、Ｂ２．Ｂ３゜Ｒ４に接続さ
れる。各しゃ断回路Ｂ１〜Ｂ４は、それぞれ遅延回路６
１．信号反転回路６２、アンド回路６３から成る。しゃ
断回路Ｂｌ、Ｂ２の出力はオア回路１２に入力され、同
Ｂ３．Ｂ４の出力はオア回路１４に入力される。各オア
回路１２゜１４の出力は点弧回路８に与えられる。点弧
回路８は、フリップフロップ８１，８２．アンド回路８
３．８４、遅延回路８５から成る。点弧回路８の出力は
、増幅器１８を介してサイリスク８１〜８Ｎのゲートに
与えられる。
れ検出出力しゃ断回路Ｂｌ、Ｂ２．Ｂ３゜Ｒ４に接続さ
れる。各しゃ断回路Ｂ１〜Ｂ４は、それぞれ遅延回路６
１．信号反転回路６２、アンド回路６３から成る。しゃ
断回路Ｂｌ、Ｂ２の出力はオア回路１２に入力され、同
Ｂ３．Ｂ４の出力はオア回路１４に入力される。各オア
回路１２゜１４の出力は点弧回路８に与えられる。点弧
回路８は、フリップフロップ８１，８２．アンド回路８
３．８４、遅延回路８５から成る。点弧回路８の出力は
、増幅器１８を介してサイリスク８１〜８Ｎのゲートに
与えられる。
このような装置において、順電圧検出器Ｆｌ。
Ｆ２のうちＦｌの出力Ｋ「有」故障が生じた場合、に入
力される。遅延回路６１は、第２図に示すように、信号
ａを入力すると、その立上りでは時間１、遅れで、その
立下シでは時間ｔ２遅れで、信号すを出力する。この信
号すは、信号及転回１８６２により反転され、信号Ｃの
ような波形となる。従って信号ａ及びＣを入力するアン
ド回路６３の出力は信号ｄのようになる。このように時
刻Ｔ＋で「有」故障が生じたときには、検出器Ｆ１の出
力はしゃ断回路Ｂ１によって時刻Ｔ２でしゃ断されるこ
とになる。また時効Ｔｓの時点で「有」故障が解除され
たときには、時刻Ｔ４の時点以降、検出器Ｆ１の出力は
しゃ断されることなくオア回路１２入力端に伝達される
。よってオア回路１２の入力端には誤シ情報が長期間に
わたって与えられることがなく、二重系としてのオア回
路１２の機能は失われない。このことは、検出器Ｆ１が
正常でＦ２が「有」故障の場合も同様であシ、また逆電
圧検出器Ｒ１，几２の一方が「有」故障となった場合も
同様である。
力される。遅延回路６１は、第２図に示すように、信号
ａを入力すると、その立上りでは時間１、遅れで、その
立下シでは時間ｔ２遅れで、信号すを出力する。この信
号すは、信号及転回１８６２により反転され、信号Ｃの
ような波形となる。従って信号ａ及びＣを入力するアン
ド回路６３の出力は信号ｄのようになる。このように時
刻Ｔ＋で「有」故障が生じたときには、検出器Ｆ１の出
力はしゃ断回路Ｂ１によって時刻Ｔ２でしゃ断されるこ
とになる。また時効Ｔｓの時点で「有」故障が解除され
たときには、時刻Ｔ４の時点以降、検出器Ｆ１の出力は
しゃ断されることなくオア回路１２入力端に伝達される
。よってオア回路１２の入力端には誤シ情報が長期間に
わたって与えられることがなく、二重系としてのオア回
路１２の機能は失われない。このことは、検出器Ｆ１が
正常でＦ２が「有」故障の場合も同様であシ、また逆電
圧検出器Ｒ１，几２の一方が「有」故障となった場合も
同様である。
また検出出力しゃ断回路Ｂｌ、Ｂ２．Ｂ３．Ｂ４は、第
３図のようにフリップフロップ８８のＳ入力に遅延回路
６１の出力信号すを伝達し、第２図の信号Ｃを得ること
もできる。但し、信号Ｃの復帰はフリップフロップ８８
のＲ入力を介して行う。
３図のようにフリップフロップ８８のＳ入力に遅延回路
６１の出力信号すを伝達し、第２図の信号Ｃを得ること
もできる。但し、信号Ｃの復帰はフリップフロップ８８
のＲ入力を介して行う。
第４図は検出出力しゃ断回路Ｂｌ、Ｂ２．Ｂ３Ｂ４の他
の実施例であシマイクロプロセッサ等を使用した回路で
ある。本実施例ではマイクロプロセッサ３３よシ、第５
図の信号ｅのように周期的に７リツプフロツプ３２のリ
セットを行なう。リセット周期の間に電圧検出出力信号
ａが１回でも低レベル信号になれば、フリップ７０ツブ
３２は再びセットされる。そこでフリップ７０ツブ３２
のリセットを行なう直前に、第５図の信号ｆを入力すれ
ば、電圧検出出力信号が「有」故障になっているか、い
ないかを判断できる。そしてその結果をアンド回路６３
に出力する。
の実施例であシマイクロプロセッサ等を使用した回路で
ある。本実施例ではマイクロプロセッサ３３よシ、第５
図の信号ｅのように周期的に７リツプフロツプ３２のリ
セットを行なう。リセット周期の間に電圧検出出力信号
ａが１回でも低レベル信号になれば、フリップ７０ツブ
３２は再びセットされる。そこでフリップ７０ツブ３２
のリセットを行なう直前に、第５図の信号ｆを入力すれ
ば、電圧検出出力信号が「有」故障になっているか、い
ないかを判断できる。そしてその結果をアンド回路６３
に出力する。
これら実施例において「有」故障となったと判定する時
間、すなわち第２図の実施例におけるｔｌ、おるいは第
５図の実施例におけるリセット周期は、短かくすると誤
動作の原因となってしまうからである。例えば単相全波
整流では一周期にわたって電圧が印加されることがある
ので、それよシ短か間、ゲート制御装置は機能を失なっ
たままとなってしまｐｏ一般には２回続けて起きた場合
に対応させて２周期、すなわち５０Ｈ１回路では４Ｑｍ
ｓ程度とするのが最良である。
間、すなわち第２図の実施例におけるｔｌ、おるいは第
５図の実施例におけるリセット周期は、短かくすると誤
動作の原因となってしまうからである。例えば単相全波
整流では一周期にわたって電圧が印加されることがある
ので、それよシ短か間、ゲート制御装置は機能を失なっ
たままとなってしまｐｏ一般には２回続けて起きた場合
に対応させて２周期、すなわち５０Ｈ１回路では４Ｑｍ
ｓ程度とするのが最良である。
なお第１図で電圧検出は２重化としたが、３重化以上の
多重化させた場合でも実施できる。まだ電圧検出をライ
トガイドを使って行なったがフォトカプラ等の手段、あ
るいは絶縁増幅器等を使ってよいことはいうまでもない
。また直列接続された個々のサイリスクで電圧検出する
ようにしたが、数個のサイリスタごとに検出してもよく
、あるいはアーム全体で検出してもよい。また順・逆側
電圧を検出する場合、第１図のように必らずしも分ける
必要はなく、同一サイリスク、あるいは数個の直列サイ
リスタ順Ｓ逆両電圧を検出できるようにしてもよい。以
上の実施例はサイリスタの並列回路にも適用できる。
多重化させた場合でも実施できる。まだ電圧検出をライ
トガイドを使って行なったがフォトカプラ等の手段、あ
るいは絶縁増幅器等を使ってよいことはいうまでもない
。また直列接続された個々のサイリスクで電圧検出する
ようにしたが、数個のサイリスタごとに検出してもよく
、あるいはアーム全体で検出してもよい。また順・逆側
電圧を検出する場合、第１図のように必らずしも分ける
必要はなく、同一サイリスク、あるいは数個の直列サイ
リスタ順Ｓ逆両電圧を検出できるようにしてもよい。以
上の実施例はサイリスタの並列回路にも適用できる。
以上のように本発明によれば、「有」故障が生じたとき
には、その電圧検出器の出力をしゃ断するようにしてい
るので、残シの正常な電圧検出器の出力によりサイリス
タの点弧制御を行なうことができサイリスタ変換器の制
御装置の信頼度を極めて高くできるという顕著な゛る効
果がある。
には、その電圧検出器の出力をしゃ断するようにしてい
るので、残シの正常な電圧検出器の出力によりサイリス
タの点弧制御を行なうことができサイリスタ変換器の制
御装置の信頼度を極めて高くできるという顕著な゛る効
果がある。
第１図は本発明の一実施例でサイリスタ変換器の制御装
置のブロック図、第２図は検出出力しゃ断回路の動作説
明図、第３図及び第４図は本発明に係る検出出力しゃ断
回路の他の実施例、第５図は第４図の動作説明図である
。 ８１〜ＳＮ・・・サイリスタ、Ｆｌ、Ｆ２．Ｒ１，Ｒ２
・・・電圧検出器、Ｂｌ−Ｒ４・・・検出出力しゃ断回
路、１２．１４・・・オア回路、８・・・点弧回路、１
８・・・増第 ２ 口 第 ３ 目 す 第 ４ ｍ 第 ５ 目 佑号ｆ
置のブロック図、第２図は検出出力しゃ断回路の動作説
明図、第３図及び第４図は本発明に係る検出出力しゃ断
回路の他の実施例、第５図は第４図の動作説明図である
。 ８１〜ＳＮ・・・サイリスタ、Ｆｌ、Ｆ２．Ｒ１，Ｒ２
・・・電圧検出器、Ｂｌ−Ｒ４・・・検出出力しゃ断回
路、１２．１４・・・オア回路、８・・・点弧回路、１
８・・・増第 ２ 口 第 ３ 目 す 第 ４ ｍ 第 ５ 目 佑号ｆ
Claims (1)
- 【特許請求の範囲】 １、複数個のサイリスクを直列又は並列に接続して成る
アーム、このアームのサイリスタに印加される電圧を検
出する少なくとも二つ設けられた電、弧 Ｓ八 器の出力の論理和を上記点微回路の動作条件の一つとす
るサイリスタ変換器の制御装置において、上記電圧検出
器の出力が所定時間以上継続するときには上記出力をし
ゃ断する検出出力しゃ断回路を設けたことを特徴とする
サイリスク変換器の制御装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57122054A JPS5914357A (ja) | 1982-07-15 | 1982-07-15 | サイリスタ変換器の制御装置 |
| US06/513,315 US4527227A (en) | 1982-07-15 | 1983-07-13 | False recovery detection circuit for parallel or serial strings of thyristors |
| CA000432324A CA1206200A (en) | 1982-07-15 | 1983-07-13 | False recovery detection circuit for parallel or serial strings of thyristors |
| DE3325497A DE3325497A1 (de) | 1982-07-15 | 1983-07-14 | Thyristorstromrichtersteuerung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57122054A JPS5914357A (ja) | 1982-07-15 | 1982-07-15 | サイリスタ変換器の制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5914357A true JPS5914357A (ja) | 1984-01-25 |
Family
ID=14826468
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57122054A Pending JPS5914357A (ja) | 1982-07-15 | 1982-07-15 | サイリスタ変換器の制御装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4527227A (ja) |
| JP (1) | JPS5914357A (ja) |
| CA (1) | CA1206200A (ja) |
| DE (1) | DE3325497A1 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60255056A (ja) * | 1984-05-30 | 1985-12-16 | Hitachi Ltd | サイリスタ変換器の制御装置 |
| GB2432732A (en) * | 2005-11-24 | 2007-05-30 | Bombardier Transp Gmbh | Operating a converter using voltage measurement |
| EP2429077B1 (en) * | 2010-09-14 | 2013-04-10 | Optosys SA | Inductive proximity switch |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58195318A (ja) * | 1982-05-10 | 1983-11-14 | Mitsubishi Electric Corp | 直列サイリスタの電圧検出装置 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CA933592A (en) * | 1971-06-16 | 1973-09-11 | Canadian General Electric Company Limited | Cell surveillance monitor for a power converter |
| JPS51116663A (en) * | 1975-04-07 | 1976-10-14 | Hitachi Ltd | Gate control unit for thyrister valve |
| JPS5586373A (en) * | 1978-12-22 | 1980-06-30 | Toshiba Corp | Gate control system for thyristor converter |
| JPS55141982A (en) * | 1979-04-24 | 1980-11-06 | Toshiba Corp | Gate circuit for thyristor converter |
-
1982
- 1982-07-15 JP JP57122054A patent/JPS5914357A/ja active Pending
-
1983
- 1983-07-13 CA CA000432324A patent/CA1206200A/en not_active Expired
- 1983-07-13 US US06/513,315 patent/US4527227A/en not_active Expired - Fee Related
- 1983-07-14 DE DE3325497A patent/DE3325497A1/de active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58195318A (ja) * | 1982-05-10 | 1983-11-14 | Mitsubishi Electric Corp | 直列サイリスタの電圧検出装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| CA1206200A (en) | 1986-06-17 |
| US4527227A (en) | 1985-07-02 |
| DE3325497A1 (de) | 1984-01-19 |
| DE3325497C2 (ja) | 1990-07-05 |
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