JPS59124745A - 半導体装置 - Google Patents

半導体装置

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JPS59124745A
JPS59124745A JP57233813A JP23381382A JPS59124745A JP S59124745 A JPS59124745 A JP S59124745A JP 57233813 A JP57233813 A JP 57233813A JP 23381382 A JP23381382 A JP 23381382A JP S59124745 A JPS59124745 A JP S59124745A
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JP
Japan
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insulating substrate
transistor
radiator plate
substrate
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JP57233813A
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English (en)
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Kyoichi Ishii
恭一 石井
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Fujitsu Ltd
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Fujitsu Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の技術分野 本発明は、高い周波数帯で使用し、そして、高い出力を
得るのに好適な半導体装置に関する。
従来技術と問題点 従来、前記種類の半導体装置として第1図及び(1) 第2図に見られるものが知られている。
第1図は要部斜面図、第2図は要部切断側面図であり、
各図に於いて、1は例えば銅のように熱伝導度が良好な
材料で作製された接地導体を兼ねる放熱板、2は例えば
ベリリア(B e O)のように熱伝導度が良好な材料
で作製された絶縁基板、3はトランジスタ(半導体チッ
プ)、4.4F。
4C,4Bはメタライズ膜、5は金属細線、6はコレク
タ・リード、7はベース・リードをそれぞれ示している
図示例では、トランジスタ3はメタライズ膜4で、コレ
クタ・リード6はメタライズ膜4Cで、ベース・リード
7はメタライズ膜4Bでそれぞれ絶縁基板2に接着され
ている。そして、トランジスタ3のエミッタは金属細線
5でメタライズ膜4Eと、半導体チップ3のコレクタと
接しているメタライズ膜4は金属細線5でメタライズ膜
4Cと、トランジスタ3のベースは金属細線5でメタラ
イズ膜4Bとそれぞれ接続され、また、メタライズ膜4
Eは放熱板1と接続されている。即ち、エミ(2) ツタが接地されているものである。
さて、この従来例では、トランジスタ3の発熱は絶縁基
板2を通して放熱板1及びそれが固着されているシャー
シに放熱するようになっている。
その熱放散を効率良く行なうには、絶縁基板2としてベ
リリアのように熱伝導度が良好な材料を使用しても銅等
の金属に比較すると劣っている。
そこで、この問題を解決する手段として、絶縁基板2の
厚みを薄くすることが考えられるが、余り薄くすると機
械的強度が低下し、放熱板1との間の熱膨張係数の相違
に依って、絶縁基板2にクラックを生ずる事故が発生す
るので、若干大型になる高出力半導体装置には適さない
一般に、この種半導体装置に使用するベリリアの絶縁基
板2の厚みとして薄くできる限界は1゜5〔額〕程度で
あって、現在、その熱抵抗の低減の面では限界にきてい
る。また、絶縁基板2を薄くすると、その表面に形成す
るメタライズ膜と接地導体を兼ねる放熱板1との間の静
電容量が増大し、高周波半導体装置としての特性を劣化
させる(3) 旨の問題もある。
また、トランジスタ3の接地は、その周囲を取り囲むよ
うに形成したメタライズ膜4Eを介して行なわれる為、
メタライズ膜に依るインダクタンス成分が直列に挿入さ
れた状態となり、負帰還効果に依り高周波特性が損なわ
れる欠点も生ずる。
前記の如き問題は、第3図に示すように、整合回路を付
設した半導体装置では更に複雑となる。
第3図は他の従来例の要部斜面図であり、第1図及び第
2図に関して説明した部分と同部分は同記号で指示しで
ある。
図に於いて、8はトランジスタ3と外部回路とのインピ
ーダンス整合を採る為の内部整合回路である。尚、この
ような整合回路はトランジスタ3の入出力インピーダン
スと外部回路のインピーダンスとの整合を採るものであ
るが、図示例では、トランジスタ3の入力側、即ちベー
ス側のみに挿入しである。
整合回路8は具体的にはコンデンサであって、トランジ
スタ3に於けるベースからの金属細線5(4) をコンデンサの一ヒ部電極で中継接続することにより、
トランジスタ3のベースとベース・リード7との間に該
コンデンサ及び金属細線5に依る直列インダクタンスと
で低域波波回路を構成し、入力側のインピーダンス整合
を採っている。
このような半導体装置では、整合回路8即ちコンデンサ
の接地側ではトランジスタ3の接地と同様にメタライズ
膜がインダクタンス成分として作用し、これがコンデン
サと直列接続される為、整合回路8の特性として所望の
ものを得ることが困雌である。
発明の目的 本発明は、トランジスタ、即ち、半導体チップを実装す
る容器に改良を施すことに依り、放熱効果を高め、高周
波特性を良好にし、信頼性が高い高周波用高出力半導体
装置を提供するものである。
発明の実施例 第4図及び第5図は本発明一実施例の要部斜面図及び要
部切断側面図であり、次に、これ等の図を参照しつつ説
明する。
(5) 本実施例では、ベリリア磁器よりも一機械的強度が高い
アルミナ(Aj!20*)磁器からなる厚さ1.0〜1
.5(龍)の絶縁枠体11が銅からなる接地導体を兼ね
た放熱板12上に固着され、絶縁枠体11の上面には入
出力リード(外部導出用リード)であるベース・リード
13及びコレクタ・リード14がメタライズ膜15B及
び15Cを介して取り付けられている。
絶縁枠体11内には、熱膨張係数が銅からなる放熱板1
2のそれよりも小さい、例えばモリブデン或いはタング
ステンからなる厚さ0.4(+n〕の金属枠体16が固
着されている。
金属枠体16内では、熱伝導度が優れた絶縁体であるベ
リリア磁器からなる厚さ0.4(m)の絶縁基板17が
放熱板12に固着されている。因に、絶縁基板17の厚
さは第1図乃至第3図に示したそれの厚さの1/3以下
である。
絶縁基板17上にはメタライズ膜18が形成され、トラ
ンジスタ19が取り付けられている。トランジスタ19
のベースは金属細線20でベース(6) ・リード13に、また、コレクタは同じく金属細線20
でコレクタ・リード14に、更にまた、エミ・7タは同
じく金属細線20で金属枠体16にそれぞれ接続されて
いる。
図示されていないが、最終的には、キャップが絶縁枠体
11を利用して取り付けられ完成する。
尚、本実施例に於いては、絶縁基板17と金属枠体16
の高さが略等しくなっているが、これはボンディング作
業を容易にする為である。また、トランジスタ19が絶
縁枠体11のヒ面より低くしであるのは、絹み立て作業
中の取り扱いを容易にする為である。
ところで、本発明で重要であるのは、トランジスタ19
を固着しである絶縁基板17が薄くなっていることであ
る。
このようにすると、従来技術と問題点の項で記述したよ
うに、絶縁基板17と放熱板12との熱膨張係数の相違
に基づきクラックを発生ずる筈であるが、本発明では、
これを次の理由に依り防Iト可能としているのである。
(7) (1)絶縁基板17はトランジスタ19を搭載するだけ
であるから、その大きさは、面積にして従来のものと比
較すると20 〔%〕以下にすることができる。このよ
うに、機械的寸法の絶対値が小さければ熱膨張係数の相
違に依る内部ストレスは小さくなる。
(2)絶縁基板17の周辺に於ける放熱板12の表面に
は、銅よりも熱膨張係数が小さく、且つ、ベリリア磁器
の熱膨張係数に近い材料であるモリブデン或いはタング
ステン等からなる金属枠体16が固着しであるので、放
熱板12の熱膨張及び収縮は制限及び抑制されることに
なり、放熱板12上に固着した絶縁基板17に及ぼす内
部ストレスを実効的に小さくできる。
本発明は、前記実施例に限られず、種々の実施例を実現
できる。
例えば、第3図に示した従来例のように内部整合回路を
設けるには、コンデンサを金属枠体16上に固着すれば
良く、その場合、コンデンサの接地インダクタンスは著
しく減少し、良好なインピ(8) −ダンス整合が可能となる。また、金属枠体16を配置
することがスペース的に無理であれば、絶縁基板17の
長手方向に沿う形状のものを両側に設けても良い。
発明の効果 本発明の効果を列挙すると次の通りである。
■ トランジスタを取り付けたへりリア磁器からなる絶
縁基板が薄く形成されているので、熱抵抗もそれにつれ
て大幅に小さくなり放熱効果は著しく改善された。
■ 前記絶縁基板を薄く形成しても、該絶縁基板がトラ
ンジスタのみ搭載するものであるから小型であること、
また、該絶縁基板の近傍には放熱板の膨張及び収縮を制
限及び抑制する金属体(実施例では金属枠体)が固着さ
れていることの理由に依り、前記絶縁基板にクラックが
発生することはない。
■ 前記絶縁基板を薄く形成しても、その−1−に搭載
されるのはトランジスタのみであり、従来のように入出
力リードやメタライズ膜が設られること(9) はなく、それ等は厚さが厚い絶縁枠体−ヒに設けられて
いるから、その対接地静電容量が増加することはあり得
す、高周波特性は劣化しない。
■ トランジスタの接地は前記放熱板に固着されている
前記金属体を介し最短距離で行なわれているので直列イ
ンダクタンス成分が極めて小さくなり高周波特性が改善
される。
【図面の簡単な説明】
第1図及び第2図は従来例の要部斜面図及び要部斜面図
、第3図は他の従来例の要部斜面図、第4図及び第5図
は本発明一実施例の要部斜面図及び要部切断側面図であ
る。 図に於いて、11は絶縁枠体、12は放熱板、13はベ
ース・リード(入力リード)、14はコレクタ・リード
(出力リード)、15B及び15Cはメタライズ膜、1
6は金属枠体、17は絶縁基板、18はメタライズ膜、
19はトランジスタ、20は金属細線である。 (10)

Claims (1)

    【特許請求の範囲】
  1. 金属の放熱板、該放熱板−ヒに固着された絶縁枠体、該
    絶縁枠体内に表出されている前記放熱板上に固着され前
    記絶縁枠体の厚さより薄いそれを有する絶縁基板、該絶
    縁基板の少なくとも長手方向の両側近傍に固着され前記
    放熱板の熱膨張係数より小さいそれを有し珪つ前記絶縁
    枠体の厚さより薄いそれを有する金属体、前記絶縁基板
    上に固着された半溝体チップ、前記絶縁枠体−ヒに固着
    された外部導出用リードを備えてなることを特徴とする
    半導体装置。
JP57233813A 1982-12-30 1982-12-30 半導体装置 Pending JPS59124745A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005280701A (ja) * 2004-03-15 2005-10-13 Airbus Deutschland Gmbh 折り畳み式座席
JP2014120582A (ja) * 2012-12-14 2014-06-30 Sumitomo Electric Device Innovations Inc 半導体装置

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005280701A (ja) * 2004-03-15 2005-10-13 Airbus Deutschland Gmbh 折り畳み式座席
US8070233B2 (en) 2004-03-15 2011-12-06 Airbus Deutschland Gmbh Downwards folding seat
JP2014120582A (ja) * 2012-12-14 2014-06-30 Sumitomo Electric Device Innovations Inc 半導体装置

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